KR20040065437A - adress electrode of plasma display pannel - Google Patents

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Abstract

PURPOSE: An address electrode of a plasma display panel is provided to achieve the address electrode suitable for a high definition screen by improving in a structure having a surplus space at a terminal part of an outer panel. CONSTITUTION: A plasma display panel comprises a front plate, a rear plate, an effective surface(20) arranged in opposition with a mutual crossing shape about the front plate and the rear plate, a plurality of address electrode(40) formed with a top and a bottom direction of the effective surface, and a terminal part located at a top and a bottom part of the effective surface and having a predetermined block electrode(80a,80b) to classify the address electrode with a predetermined arrangement number. One side of the address electrode patterned at the effective surface is connected alternately with an upper side block electrode and a lower side block electrode. The upper side block electrode and the lower side block electrode at both terminal part is arranged with a mutual crossing position.

Description

플라즈마 디스플레이 패널의 어드레스 전극{adress electrode of plasma display pannel}Address electrode of plasma display panel

본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 특히 패널의 단위 픽셀당 3열로 부여되는 어드레스 전극의 제조에 효과적인 구조를 가지고 있는 플라즈마 디스플레이 패널의 어드레스 전극에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel, and more particularly, to an address electrode of a plasma display panel having a structure effective for producing address electrodes provided in three columns per unit pixel of the panel.

플라즈마 디스플레이 장치는 방전에 의한 칼라 구현을 특징으로 하는 디스플레이 장치로서, 화면의 대형화 및 화상 변화의 응답성이 뛰어나 최근에 각광받고있는 장치이다. 공지된 플라즈마 디스플레이 장치는 구동방식 별로 교류식과 직류식이 개발되어 있고, 또 방전 형태에 따라 면 방전형과 대향 방전형으로 구분되고 있으나 주로 교류 구동식의 면 방전형이 범용화되고 있는 추세이다.Plasma display device is a display device characterized by the color implementation by the discharge, the device has been in the spotlight recently because of the excellent response to the large size of the screen and the image change. In the known plasma display apparatus, AC and DC types are developed for each driving method, and surface discharge type and counter discharge type are classified according to the discharge type, but the AC drive type surface discharge type is generally used.

교류 구동식 면 방전형 플라즈마 디스플레이는 통상 2장의 글라스 기판을 대향되게 배치시킨 상태에서 주변을 밀봉하여 내부가 기밀을 유지하도록 밀봉되는 기본적 구성에 더하여, 화상 등의 표시면으로 되는 전면측 기판 상에 주사전극과 유지전극을 쌍으로 한 스트라이프상의 표시전극을 여러 쌍으로 형성 배열해 놓고 있고, 기판 상에 가깝게 배열되는 표시전극 사이로는 차광층이 배치된 구성으로 되어 있다. 상기 주사전극과 유지전극은 각각 전용의 투명전극을 통해 전원을 공급받게 되어 있고, 또 상기 투명전극은 주전원선에서 분지되어 배열되는 것이다. 여기서 통상 투명전극은 ITO, SnO2등으로 형성되고, 주전원선은 크롬과 동박의 적층체, 혹은 은박 등의 적층체로 형성된다.The AC drive type surface discharge plasma display is normally sealed on the front side substrate to be a display surface such as an image in addition to the basic configuration in which the surroundings are sealed to maintain the airtightness in a state where two glass substrates are disposed to face each other. The stripe-shaped display electrodes in which the scan electrodes and the sustain electrodes are paired are arranged in pairs, and the light shielding layer is arranged between the display electrodes arranged close to the substrate. The scan electrode and the sustain electrode are each supplied with power through dedicated transparent electrodes, and the transparent electrodes are branched from the main power line and arranged. The transparent electrode is usually formed of ITO, SnO 2, or the like, and the main power line is formed of a laminate of chromium and copper foil, or a laminate of silver foil or the like.

최근에는 투명전극 없이 주전원선에서 직접 표시전극을 전개하여 놓은 것도 있고 또 전면측 기판에는 복수열로 배치된 전극군을 덮도록 붕규산 글라스 등으로 되는 유전체층과, 이 유전체층의 상면은 산화 망간층으로 피복하여 높은 2차전자 방출계수를 갖는 보호층으로 형성되게 한 구성도 실시되고 있다.In recent years, display electrodes have been directly deployed on main power lines without transparent electrodes. On the front substrate, a dielectric layer made of borosilicate glass or the like is covered with a plurality of rows of electrode groups, and a top surface of the dielectric layer is covered with a manganese oxide layer. In addition, a configuration in which a protective layer having a high secondary electron emission coefficient is formed is also implemented.

상기 전면 기판과 대향되게 배치되는 배면 기판에도 상기 주사전극과 유지전극에 직교하는 위치로 데이터전극이 형성 배열되고 인접하는 데이터전극 사이로는 스트라이프상의 격벽이 상기 데이터전극과 평행한 방향으로 배치되됨과 아울러 이격벽의 측면에는 데이터전극을 피복하도록 형광체층이 마련된 방전 셀을 갖춘 구성으로 되어 있다. 상기 방전 셀은 특정의 가스, 예를 들면 헬륨, 네온, 알곤, 키세논 등의 가스로 봉입된다.A data electrode is formed at a position perpendicular to the scan electrode and the sustain electrode, and a stripe-shaped partition wall is disposed in a direction parallel to the data electrode between adjacent data electrodes. The side of the partition wall has a discharge cell provided with a phosphor layer to cover the data electrode. The discharge cell is enclosed with a specific gas, for example, a gas such as helium, neon, argon, xenon or the like.

상술한 구성의 플라즈마 디스플레이 장치는 서로 대향하고 사이 공간이 진공으로 유지되는 2장의 글라스 기판에 의해 그 내부에서는 주사전극과 유지전극에 대해 데이터전극이 좁은 방전공간을 끼고 직교상으로 배치됨에 따라 전극 사이로 고전압이 인가되면 방전이 발생하게 된다.The above-described plasma display apparatus has two glass substrates facing each other and the space therebetween is maintained in a vacuum so that the data electrodes are arranged orthogonally to the scan electrodes and the sustain electrodes with a narrow discharge space therebetween. When a high voltage is applied, a discharge occurs.

초기 동작에 있어서, 주사전극 또는 유지전극에 방전 개시전압을 초과하는 높은 전압을 인가하여 전체 방전셀에서 방전이 일어나거나 벽전하의 형성, 소멸이 일어난다. 다음에 화상표시 동작에서 데이터전극에 + 화상표시전압을, 그리고 주사전극에 - 주사펄스전압을 인가하면 방전공간 내에서 화상표시 방전이 일어나고 주사전극 상의 보호막층의 표면에 + 전하가 축적된다. 유지동작의 초기에 주사전극에 + 전압을 인가하고 유지전극에 - 전압을 인가하면 주사전극 상의 보호막층 표면의 + 전하에 의해 유지방전이 기동한다. 그 후 주사전극과 유지전극에 + 유지펄스전압을 번갈아 인가하는 것으로 유지동작이 지속된다. 이렇게 행해지는 유지방전의 정지는 유지전압에 + 소거펄스전압을 인가하는 것으로 행한다.In the initial operation, a high voltage exceeding the discharge start voltage is applied to the scan electrode or the sustain electrode, so that discharge occurs in all the discharge cells, or formation and dissipation of wall charges occurs. Next, in the image display operation, when + image display voltage is applied to the data electrode and-scan pulse voltage to the scan electrode, image display discharge occurs in the discharge space, and + charge is accumulated on the surface of the protective film layer on the scan electrode. When the positive voltage is applied to the scan electrode and the negative voltage is applied to the sustain electrode at the beginning of the sustain operation, the sustain discharge is started by the + charge on the surface of the protective layer on the scan electrode. After that, the sustain operation is continued by alternately applying the + sustain pulse voltage to the scan electrode and the sustain electrode. The sustain discharge is stopped by applying the + erase pulse voltage to the sustain voltage.

이와 같은 구성의 플라즈마 디스플레이 장치에서 단위 픽셀은 통상 정ㅅ각형태로 형성되어 있고, 각 픽셀은 R, G, B의 3개 셀로 구성되어 있기 때문에 이들을 독립적으로 작동되게 하는 어드레스전극은 버스 전극의 수 보다 3배가 더 많게 되어 있다.In the plasma display device having such a configuration, the unit pixels are generally formed in a square shape, and since each pixel is composed of three cells of R, G, and B, the address electrodes for operating them independently are the number of bus electrodes. Three times more.

그러므로 글라스 기판 상에서 어드레스 전극은 버스전극의 피치에 비해 1/2 이하의 극소 피치를 갖도록 배열되고 있다. 게다가 기판에는 어드레스 전극외에 2장의 글라스 기판을 대향 봉합시킬 때 필요한 얼라인 마크가 표시되어야 하고, 또 고정세 화면에서는 픽셀 수가 현저하게 증가되기 때문에 한정된 범위에서 더욱 많은 수로 배열되어야 하므로 설계 상의 기술적 어려움이 대단히 높다.Therefore, on the glass substrate, the address electrodes are arranged to have a minimum pitch of 1/2 or less compared to the pitch of the bus electrodes. In addition, the alignment mark necessary for sealing two glass substrates in addition to the address electrode must be displayed on the substrate, and the number of pixels must be arranged in a limited range because the number of pixels is significantly increased in a high-definition screen. Very high.

예로서 도 4는 종래의 어드레스 전극 패턴에 관한 일 예를 나타내고 있으며, 예시한 패널의 유효면(2) 전면에 배열되는 디스플레이부의 어드레스 전극 패턴(4)은 양 측방의 단자부(6)에 이르러 좌우 대칭되는 사선을 그리면서 더욱 좁게 모여져서 전극간 피치 A는 단자부(6)에서의 피치 B 보다 넓게 형성된다. 이와 같이 패터닝되는 이유는 단자부(6)에서 인접하는 블럭끼리의 간섭을 고려하고 실장 공정에 요구되는 얼라인 마크를 표시할 수 있는 공간을 확보하기 위한 것이므로 당연히 단자부(6)에 이르러서는 사선을 그리며 좁게 모여질 수 밖에 없고, 이 때의 좁은 간격으로 되는 사선 패턴은 육안 검사에서 혼동을 주어 검사 불량률도 높아지게 작용한다. 이러한 패턴은 싱글 배열에 적용될 수 있는 것이고, 듀얼 배열에는 불가능한 형태이며, 따라서 전극 수가 많아지는 고정세 화면에서는 설계 상의 큰 난점으로 작용하게 된다.As an example, FIG. 4 shows an example of a conventional address electrode pattern. The address electrode patterns 4 of the display unit arranged on the front of the effective surface 2 of the illustrated panel reach the terminal portions 6 on both sides. Gathering narrower while drawing a symmetrical oblique line, the inter-electrode pitch A is formed wider than the pitch B in the terminal portion 6. The reason for this patterning is to consider the interference between adjacent blocks in the terminal portion 6 and to secure a space for displaying the alignment mark required for the mounting process. It must be gathered narrowly, and the diagonal pattern at this time is confused in the visual inspection, which causes the inspection defect rate to increase. Such a pattern can be applied to a single array and is impossible for a dual array, and thus becomes a big design difficulty in a high-definition screen having a large number of electrodes.

본 발명은 상술한 종래의 문제점에 비추어 패널의 외측에 마련되는 단자부에 공간의 여유가 남겨질 수 있는 구조로 개선하여 고정세 화면에도 적합하게 이용할 수 있는 플라즈마 디스플레이 패널의 어드레스 전극을 제공함에 그 목적을 두고 있다.SUMMARY OF THE INVENTION The present invention has been made in view of the above-mentioned problems in the prior art to provide an address electrode of a plasma display panel that can be suitably used for a high-definition screen by improving the structure in which a space can be left in the terminal portion provided outside the panel. I put it.

상기의 목적을 구현하기 위하여 본 발명은 글라스 상판과 글라스 하판을 소정의 미세간격으로 대향 배치시킨 구성으로 되는 플라즈마 디스플레이 패널에 있어서, 패널의 유효면 외측방에 위치하는 양 단자부의 블록을 상호 엇갈리는 위치로 배열하여 상기 유효면에 패터닝되는 어드레스 전극의 일측방이 접속되도록 함으로써 상기 단자부의 공간에 여유가 생길 수 있게 한 구성으로 된다.In order to achieve the above object, the present invention provides a plasma display panel in which a glass upper plate and a lower glass plate are disposed to face each other at a predetermined fine interval, and the positions of the two terminal blocks alternately positioned outside the effective surface of the panel are alternately arranged. Arranged in such a manner that one side of the address electrode patterned on the effective surface is connected to allow a space in the terminal portion.

상기 어드레스 전극의 패터닝은 단자부에 이르러 좁은 간격으로 사선을 그리게 되어도 좋고, 같은 간격으로 평행하게 연장되어도 좋으며, 또 벌어지는 방향의 사선으로 연장되어도 좋다.The patterning of the address electrodes may be diagonally drawn at narrow intervals to reach the terminal portion, may be extended in parallel at the same intervals, or may be extended in diagonal lines in the opening direction.

도 1은 본 발명에 관련된 일 실시 예의 어드레스 전극 패턴을 나타내는 정면도.1 is a front view showing an address electrode pattern of an embodiment according to the present invention.

도 2는 본 발명에 관련된 다른 실시 예의 어드레스 전극 패턴을 나타내는 정면도.2 is a front view showing an address electrode pattern of another embodiment according to the present invention.

도 3은 본 발명에 관련된 또 다른 실시 예의 어드레스 전극 패턴을 나타내는 정면도.3 is a front view showing an address electrode pattern of another embodiment according to the present invention.

도 4는 종래의 어드레스 전극 패턴에 관한 일 예를 나타내는 정면도.4 is a front view illustrating an example of a conventional address electrode pattern.

이하 본 발명을 첨부 도면에 따른 바람직한 실시 예로서 상세히 설명한다.Hereinafter, the present invention will be described in detail with reference to preferred embodiments according to the accompanying drawings.

도 1은 본 발명의 일실시 예에 관련된 플라즈마 디스플레이 패널을 도시하는 정면도로서, 전면 기판과 후면 기판이 상호 교차상으로 대향 배치되어 설정되는 유효면(20)의 상 하측방향으로 전극 패턴(40)이 다수 형성되고, 이 전극 패턴(40)의어느 일측단이 상기 유효면(20)의 상 하측에 마련된 단자부(60a, 60b)로 접속 연결되는 구성을 보여 주고 있다.1 is a front view illustrating a plasma display panel according to an exemplary embodiment of the present invention, in which an electrode pattern 40 is disposed in an upward and downward direction of an effective surface 20 in which a front substrate and a rear substrate are disposed to face each other in an intersecting manner. Many of these are formed, and one of the end portions of the electrode pattern 40 is connected to the terminal portions 60a and 60b provided on the upper and lower sides of the effective surface 20.

한편, 단자부(60)에는 상기 전극 패턴(40)을 소정의 배열수로 구분시키기 위하여 각각 소정 수의 블록 전극(80a, 80b)이 마련되어 있으며 이들은 도시된 바와 같이 상호 어긋나는 위치로 등분 배열되어 있고, 상기 전극 패턴(40)은 어느 한쪽단이 상기 블록 전극(80a, 80b)의 어느 하나에 접속 연결되는 것이다.On the other hand, the terminal portion 60 is provided with a predetermined number of block electrodes 80a and 80b, respectively, in order to divide the electrode pattern 40 into a predetermined number of arrays, which are arranged in equal positions to each other as shown. One end of the electrode pattern 40 is connected to one of the block electrodes 80a and 80b.

이렇게 함으로써 상기 블록 전극(80a, 80b)은 인접하는 것끼리 상당한 거리를 둘 수 있게 되고, 또 블록 전극(80a, 80b)의 각 선 사이도 폭 넓게 설정할 수 있으며, 그 결과로 상기 전극 패턴(40)의 폭보다 블록 전극(80a, 80b)의 폭을 좁게 설정하더라도 사선의 간격이 넓어지게 되어 육안을 통한 패터닝 검사 시 착시 현상이 줄어 들어 판정 오류를 줄일 수 있다.In this way, the block electrodes 80a and 80b can be spaced apart from one another by a considerable distance, and the widths between the lines of the block electrodes 80a and 80b can also be set wide. As a result, the electrode patterns 40 Even if the width of the block electrodes 80a and 80b is set to be smaller than the width of), the interval between the diagonal lines becomes wider, and the optical illusion phenomenon is reduced during the patterning inspection through the naked eye, thereby reducing the determination error.

본 발명은 상술한 실시 예로 국한되는 것은 아니며, 상기 블록 전극(80a, 80b)은 도 2의 도시와 같이 전극 패턴(40)과 같은 폭으로 배열될 수도 있으며, 이 경우에 전극 패턴(40)과 블록 전극(80a, 80b)은 평행하게 접속된다.The present invention is not limited to the above-described embodiment, and the block electrodes 80a and 80b may be arranged in the same width as the electrode pattern 40 as shown in FIG. 2, and in this case, the electrode patterns 40 and The block electrodes 80a and 80b are connected in parallel.

또, 도 3의 도시와 같이 블록 전극(80a, 80b)의 폭을 더 넓게 설정할 수도 있다. 이 때는 전극 패턴(40)에서 블록 전극(80a, 80b)으로 연결될 때 외측으로 벌어지는 사선을 형성하게 되는 것이나, 이 때의 사선 배열폭은 상당히 넓어지므로 육안을 통한 패터닝 검사의 오류가 발생하는 일은 더욱 생기지 않게 되는 것이다.3, the widths of the block electrodes 80a and 80b can be set wider. In this case, when the electrode pattern 40 is connected to the block electrodes 80a and 80b, an oblique line that extends outward is formed. However, since the diagonal line width becomes considerably wider, an error in patterning inspection through the naked eye is more likely to occur. It will not occur.

이상 설명한 바와 같이 본 발명은 글라스 상판과 글라스 하판을 소정의 미세간격으로 대향 배치하여 상호 직교하는 방향으로 단자부가 마련되고, 그 단자부에 블록 전극이 등분 배열되어서 상기 패널의 유효면을 가로질러 형성되는 전극 패턴의 단부와 접속시켜 놓은 구성의 플라즈마 디스플레이 패널에 있어서, 상기 패널의 상 하측에 위치하는 단자부로 마련되는 블록 전극의 위치를 상하측이 상호 엇갈리도록 등분 배열하고, 상기 전극 패턴의 어느 한쪽단을 엇갈려 배치된 블록 전극으로 접속시킴에 따라 패널의 상하측 단자부로 공간적 여유가 생기게 한 것이므로 얼라인 마크를 포함하면서도 상기 블록 전극의 배열 폭을 넓게 설정할 수 있게 되는 것이며, 이에 따라 고정세 패널에서 단자부의 전극간 피치를 크게 할 수 있는 효과를 나타내어 플렉시블 프린트 서키트(FPC)의 제적 비용을 절감할 수 있을 뿐만 아니라 포토 리소그라피법에 으해 식각 형성되는 전극 패턴의 단선, 단락과 같은 패터닝 불량을 육안 검사에서 쉽게 포착할 수 있게 되는 것이므로 제품의 불량률을 대폭 낮춰 주는 효과를 가지고 있다.As described above, according to the present invention, the glass upper plate and the glass lower plate are disposed to face each other at a predetermined fine interval, and terminal portions are provided in directions perpendicular to each other, and block electrodes are equally arranged at the terminal portions to be formed across the effective surface of the panel. In a plasma display panel having a structure connected to an end portion of an electrode pattern, the positions of the block electrodes provided by the terminal portions positioned above and below the panel are equally arranged so that the top and bottom sides are alternately arranged, and either end of the electrode pattern is provided. Since spaces are provided in the upper and lower terminal portions of the panel by connecting to the alternately arranged block electrodes, the arrangement width of the block electrodes can be set to be wider while including an alignment mark. We show effect that can increase pitch between electrodes In addition to reducing the cost of elimination of printed circuit boards (FPC), it is possible to easily catch patterning defects such as disconnection and short-circuit of electrode patterns etched by the photolithography method. It has a lowering effect.

그리고 이와 같이 전극 패턴의 폭을 넓게 설정할 수 있는 것에 의해 종래에는 시도가 불가능하였던 기술, 즉 와이어를 전극소재로 한 패터닝도 가능하게 되어 플라즈마 디스플레이 패널의 제작 비용의 절감도 기대할 수 있다.In this way, the width of the electrode pattern can be set to be wide, and thus, a technique that has not been tried in the past, that is, patterning using a wire as an electrode material can also be achieved, thereby reducing the manufacturing cost of the plasma display panel.

Claims (4)

양측방으로 단자부가 마련되도록 글라스 상판과 글라스 하판을 소정의 미세간격으로 대향 배치시킨 패널의 유효면으로 어드레스 전극을 형성하고 그 단부를 상기 단자부의 블록 전극에 접속시킨 구성을 포함하는 플라즈마 디스플레이 패널에 있어서,A plasma display panel comprising a configuration in which an address electrode is formed on an effective surface of a panel in which a glass upper plate and a glass lower plate are disposed to face each other at a predetermined fine interval such that terminal portions are provided in both sides, and an end thereof is connected to a block electrode of the terminal portion. In 상기 양 단자부에서 상측 블록 전극과 하측 블록 전극이 상호 엇갈리는 위치로 배열되고, 상기 유효면에 패터닝되는 어드레스 전극의 일측단이 번갈아 상기 상측 블록 전극과 하측 블록 전극으로 접속되는 구성으로 되어 있는 플라즈마 디스플레이 패널의 어드레스 전극.The upper block electrode and the lower block electrode are arranged at mutually staggered positions in the both terminal portions, and one side end of the address electrode patterned on the effective surface is alternately connected to the upper block electrode and the lower block electrode. Address electrode. 제 1 항에 있어서, 상기 어드레스 전극의 배열 폭이 단자부의 해당 블록 전극 배열 폭 보다 넓게 설정된 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 전극.The address electrode of claim 1, wherein an array width of the address electrodes is set to be wider than a block electrode array width of the terminal portion. 제 1 항에 있어서, 상기 어드레스 전극의 배열 폭이 단자부의 해당 블록 전극 배열 폭과 같게 설정된 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 전극.2. The address electrode of a plasma display panel according to claim 1, wherein an array width of said address electrodes is set equal to a corresponding block electrode array width of a terminal portion. 제 1 항에 있어서, 상기 어드레스 전극의 배열 폭이 단자부의 해당 블록 전극 배열 폭 보다 좁게 설정된 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 전극.The address electrode of a plasma display panel according to claim 1, wherein an array width of the address electrodes is set to be smaller than a block electrode array width of the terminal portion.
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