KR20020075235A - 데이터 송신 방법 및 데이터 송신을 위한 인터페이스 - Google Patents

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Abstract

기지국의 디지털 및 무선 주파수(RF) 구성 요소들 사이의 데이터 송신을 위한 인터페이스 및 방법이 개시된다. 인터페이스 및 방법은, 타임 슬롯들(time slots)의 제 1 세트 상에 송신 또는 수신 데이터를 송신하는 단계와, 타임 슬롯들의 제 2 세트 상에 여러가지 업링크 또는 다운링크 저속 정적/제어 신호들을 송신하는 단계를 포함한다. 송신 데이터는 동위상 송신 데이터 비트들(in-phase transmit data bits)과 직교 위상 송신 비트들(quadrature phase transmit bits)을 포함하고, 수신 데이터는 다이버시티 안테나 시스템(diversity antenna system) 상에 수신된 동위상 송신 데이터 비트들 과 직교 위상 송신 비트들을 포함한다.

Description

기지국들을 위한 직렬 통신 링크{Serial communications link for a base stations}
본 발명은 일반적으로 무선 통신 시스템들(wireless communication systems)에 관한 것으로, 특히, 기지국 구성 요소들 사이의 데이터 송신에 관한 것이다.
기지국 설계에서의 유연성은 서비스 제공자들이 원하는 특징이다. 기지국 설계 유연성은 다양한 환경들을 위한 기지국 설치를 사용자화(customize)할 기회를 서비스 제공자에게 제공한다. 공지된 코드 분할 다중 액세스(code division multiple access; CDMA) 기술에 기초한 무선 통신 시스템들에서 유연성을 달성하는 한 방식은 무선 유닛들(radio units)과 같은 기지국의 무선 주파수(RF) 구성 요소들로부터 복수의 채널 요소들을 갖는 CDMA 채널 유닛들과 같은 기지국의 디지털 구성 요소들을 분리하는 것이다. RF 구성 요소들로부터 디지털 구성 요소들을 분리하는 것은, 예컨대, 폴(pole)의 상부에 탑재될 RF 구성 요소들 및 폴의 하부에 탑재될 디지털 구성 요소를 허용한다. 광학 섬유와 같은 송신 매체는 RF 및 디지털 구성 요소들 사이의 데이터 전송에 사용된다.
도 1은 본 발명에 따라 사용된 기지국을 도시하는 도면.
도 2는 섬유 광학 인터페이스의 실시예의 상세한 예시를 도시하는 도면.
도 3은 한 실시예에 따라 프레임에서의 업링크 데이터 구성 요소들의 비트 위치들을 나타내는 차트를 도시하는 도면.
도 4는 본 발명의 한 실시예에 따라 그들의 대응하는 타임 슬롯들(time slots) 또는 채널들 상에 업링크 방향으로 송신되는 프레임의 비트들을 예시하는 업링크 데이터 송신을 도시하는 도면.
도 5는 한 실시예에 따라 프레임에서의 다운링크 데이터 구성 요소들의 비트 위치들을 나타내는 차트를 도시하는 도면.
도 6은 본 발명의 한 실시예에 따라 그들의 대응하는 타임 슬롯들 또는 채널들 또는 채널들 상에 다운링크 방향으로 송신되는 프레임의 비트들을 예시하는 다운링크 데이터 송신을 도시하는 도면.
*도면의 주요부분에 대한 부호의 설명*
12; 디지털 구성 요소 인클로저 14; RF 구성 요소 인클로저
16; 섬유 광학 업링크 케이블 18; 섬유 광학 다운링크 케이블
22; 섬유 광학 인터페이스 40; CPLD
본 발명은 기지국의 디지털 및 무선 주파수(RF) 구성 요소들 사이의 데이터 전송을 위한 인터페이스 및 방법이다. 한 실시예에 있어서, 본 발명은, 타임 슬롯들의 제 1 세트 상에 송신 또는 수신 데이터를 송신하는 단계와, 타임 슬롯들의 제 2 세트 상에 여러가지 업링크 또는 다운링크 저속 정적/제어 신호들을 송신하는 단계를 포함한다. 송신 데이터는 동위상 송신 데이터 비트들(in-phase transmit data bits)과 직교 위상 송신 비트들(quadrature phase transmit bits)을 포함하고, 수신 데이터는 다이버시티 안테나 시스템(diversity antenna system) 상에 수신된 동위상 송신 데이터 비트들과 직교 위상 송신 비트들을 포함한다.
한 실시예에 있어서, 동위상 송신 데이터 비트들은 제 1 동위상 송신 데이터 비트와 제 2 동위상 송신 데이터 비트를 포함하고, 제 1 동위상 송신 데이터 비트는 제 1 타임 슬롯 상에 송신되고, 제 2 동위상 송신 데이터 비트는 제 2 타임 슬롯 상에 송신되고; 직교 위상 송신 데이터 비트들은 제 1 직교 위상 송신 데이터 비트와 제 2 직교 이상 송신 데이터 비트를 포함하고, 제 1 직교 위상 송신 데이터 비트는 타임 슬롯의 제 1 세트에서의 제 3 타임 슬롯 상에 송신되고, 제 2 직교 위상 송신 데이터 비트는 타임 슬롯들의 제 1 세트에서의 제 4 타임 슬롯 상에 송신되며; 여러가지 업링크 저속 정적/제어 신호들은, 클록/기준 신호들, 업링크 RS-485 기반 버스 데이터, 물리적 주소 정보, 인접한 CDMA 채널 유닛 유용성 정보, 업링크 직렬 포트들을 통한 입력 정보와 무선 RF 비상 스위치를 포함하고, 클록/기준 신호들, 인접한 CDMA 채널 유닛 유용성 정보, 업링크 직렬 포트들을 통한 입력 정보와 무선 RF 비상 스위치는 제 5 타임 슬롯 상에 송신을 위해 다중화되고, 업링크 RS-485 기반 버스 데이터는 제 6 및 제 7 타임 슬롯 상에 송신되며, 물리적 주소 정보는 제 8 타임 슬롯 상에 송신된다.
다른 실시예에 있어서, 동위상 수신 데이터는 제 1 동위상 수신 데이터 비트, 제 2 동위상 수신 데이터 비트, 제 3 동위상 수신 데이터 비트와 제 4 동위상 수신 데이터 비트를 포함하고, 직교 위상 수신 데이터는 제 1 직교 위상 수신 데이터 비트, 제 2 직교 위상 수신 데이터 비트, 제 3 직교 위상 수신 데이터 비트와 제 4 직교 위상 수신 데이터 비트를 포함하며, 제 1 및 제 2 동위상 및 직교 위상 수신 데이터 비트들은 제 1 안테나 상에 수신되었고, 제 3 및 제 4 동위상 및 직교 위상 수신 데이터 비트들은 제 2 안테나 상에 수신되었고, 제 1 동위상 수신 데이터 비트는 제 1 타임 슬롯 상에 송신되고, 제 2 동위상 수신 데이터 비트는 제 2 타임 슬롯 상에 송신되고, 제 3 동위상 수신 데이터 비트는 제 3 타임 슬롯 상에 송신되고, 제 4 동위상 수신 데이터 비트는 제 4 타임 슬롯 상에 송신되고, 제 1 직교 위상 수신 데이터 비트는 제 5 타임 슬롯 상에 송신되고, 제 2 직교 위상 수신 데이터 비트는 제 6 타임 슬롯 상에 송신되고, 제 3 직교 위상 수신 데이터 비트는 제 7 타임 슬롯 상에 송신되고, 제 4 직교 위상 수신 데이터 비트는 제 8 타임 슬롯 상에 송신되며; 여러가지 다운링크 저속 정적/제어 신호들은, 바이패스 정보, 다운 직렬 포트들을 통한 입력 정보와 다운링크 RS-485 기반 버스 데이터를 포함하고, 바이패스 정보 및 다운링크 직렬 포트들을 통한 입력 정보는 제 9 타임 슬롯 상에 송신을 위해 다중화되고, 다운링크 RS-485 기반 버스 데이터는 제 10 타임 슬롯 상에 송신된다.
본 발명의 특징들, 양상들 및 이점들은 다음의 상세한 설명, 첨부된 특허청구의 범위 및 첨부한 도면들을 참조하여 보다 잘 이해될 것이다.
본 발명은 코드 분할 다중 액세스(code division multiple access; CDMA) 기술들에 기초하여 기지국의 디지털 및 무선 주파수(RF) 구성 요소들 사이의 데이터 송신을 위한 인터페이스이다. 본 발명의 인터페이스는 섬유 광학 케이블들, 즉, 섬유 광학 인터페이스에 관련하여 사용된 인터페이스에 관하여 본 명세서에 기술된다. 본 명세서에 기술된 인터페이스가 다른 송신 매체들에 관련하여 사용된 인터페이스들에 또한 응용 가능하다는 것은 주목되어야 한다.
도 1은 본 발명에 따라 사용된 기지국(10)을 도시한다. 기지국(10)은, 디지털 구성 요소 인클로저(digital component enclosure; 12), RF 구성 요소 인클로저(14)와, 2개의 인클로저들을 접속하는 섬유 광학 케이블들(16, 18)을 포함한다. 디지털 구성 요소 인클로저(12)는, 섬유 광학 인터페이스와(22), CDMA 채널 유닛들과 같은 디지털 구성 요소들(24)을 갖고, RF 구성 요소 인클로저(14)는, 섬유 광학 인터페이스(26)와, 무선들 및 다이버시티 안테나 시스템(diversity antenna system)과 같은 RF 구성 요소들(28)을 가지며, 섬유 광학 인터페이스들(22, 26)은 섬유 광학 케이블들(16, 18) 상에 송신 또는 수신될 데이터를 직렬화(serialize) 및 비직렬화(deserialize)하도록 운용 가능하다. 2개의 RF 안테나들을 포함하는 다이버시티 안테나 시스템을 갖는 기지국(10) 도시됨을 주목한다. 본 발명이 비-다이버시티 안테나 시스템(non-diversity antenna system) 또는 2개 이상의 RF 안테나들을 갖는 다이버시티 안테나 시스템에 또한 응용 가능하다는 것은 이해되어야 한다. 단지 하나의 섬유 광학 케이블(또는, 무선, 트위스티드 페어(twisted pair), 등과 같은 다른 송신 매체)이 업링크 및 다운링크 송신들모두에 사용될 수 있음은 또한 이해되어야 한다.
디지털 구성 요소 인클로저(12)로부터 RF 구성 요소 인클로저(14), 즉, 업링크 및 거꾸로, 즉, 다운링크에 송신된 데이터는 송신 및 수신 데이터, 제어와, 상태 정보 및 타이밍 신호들을 포함하고, 송신 및 수신 데이터는 모바일-전화들로부터 송신 및 수신될 데이터를 포함한다. 업링크 데이터는 섬유 광학 케이블(16) 상에 송신되고, 다운링크 데이터는 섬유 광학 케이블(18) 상에 송신된다.
한 실시예에 있어서, 업링크 섬유 광학 케이블(16) 상의 송신들은 20개의 타임 슬롯들 또는 채널들로 분할된다. 업링크 섬유 광학 케이블(16)을 위한 전체 송신 데이터 속도가 393.216 MHz이면, 각각의 타임 슬롯 상에 송신된 업링크 데이터는 19.6608 MHz의 클록 속도에 있을 것이다. 유사하게는, 다운링크 섬유 광학 케이블(16) 상의 송신은 타임 슬롯 당 19.6608 MHz 클록 속도에서 20개의 타임 슬롯들로 분할된다. 본 발명은 전술한 데이터 속도들 및 채널들의 수에 관하여 본 명세서에 기술할 것이다. 본 발명이 다른 데이터 속도들 및 채널들의 수에도 똑같이 응용될 수 있음은 이해되어야 한다.
한 실시예에 있어서, 업링크 데이터는 모바일-전화들에 송신될 데이터(즉, 송신 데이터)와 여러 업링크 저속 정적/제어 신호들(uplink low rate static/control signals)을 포함한다. 송신 데이터는 본 명세서에서 LTX(또는, 국부적인 송신) 데이터로서 불린다. LTX 데이터는 LTXI 및 LTXQ 데이터를 포함한다. LTXI 데이터는 393.216 MHz의 업링크 데이터 속도에 기초하는 클록 속도인 19.6608 MHz 클록 속도에서 송신된 동위상 LTX 데이터(in-phase LTX data)의 2개의 비트들을 포함한다. LTXQ 데이터는 19.6608 MHz 클록 속도에서 송신된 직교 위상 LTX 데이터(quadrature phase LTX 데이터)의 2개의 비트들을 포함한다.
여러 업링크 저속 정적/제어 신호들은, 클록/기준 신호들, 업링크 RS-485 기반 버스 데이터, 물리적 주소 정보, 인접한 CDMA 채널 유닛 유용성 정보, 업링크 직렬 포트들을 통한 입력 정보와, 무선 RF 비상 스위치를 포함한다. 클록/기준 신호들은 짝수의 초 신호(even second signal)와 시스템 클록 신호를 포함한다. 본 명세서에서 even_sec 신호로서 또한 불리는 짝수의 초 신호는 또한, 2초마다 송신된 네거티브 고잉 펄스(negative going pulse)이다. 또한, 본 명세서에서 SCLK23±19.6608 MHz 신호가 393.216 MHz(또는, 타임 슬롯 당 19.6608 MHz)의 업링크 데이터 속도로부터 RF 구성 요소 인클로저(14)에서 유도된다.
본 명세서에서 ARCNET_TXEN으로서 또한 불리는 업링크 RS-485 기반 버스 데이터는 아크넷(ArcNet)에 의해 다음에 오는 전기 표준들에 따른 제어 버스 정보를 나타낸다. 한 실시예에 있어서, ARCNET_TXEN은 다중 직렬 비트들로부터 제어 버스 비트들과 ArcNet 정보의 송신을 할 수 있게 하는 인에이블 비트를 포함한다. 물리적인 주소 정보는 LTX 데이터를 가리키는 특정한 RF 구성 요소 인클로저를 나타내기 위한 4개의 비트들을 포함한다.
CAVAIL_N 정보로서 또한 불리는 인접한 CDMA 채널 유닛 유용성 정보는 디지털 구성 요소 인클로저(12)에서의 최종 CDMA 채널 유닛(CDMA 채널 유닛들의 직렬로)이 이용 가능하고 운용 중인지를 RF 구성 요소 인클로저(14)에 나타낸다. CBRSER 및 CRCSER로서 또한 불리는 업링크 직렬 포트들을 통한 입력 정보는 각각무선 및/또는 무선 제어기 직렬 포트들을 통해 디지털 구성 요소 인클로저(12)에 첨부된 테스트 장비에 의해 제공된 제어 정보를 포함한다. CBR_SW로서 또한 불리는 무선 RF 비상 스위치는 그 자신 또는 그 구성 요소들의 하나 또는 그 이상을 온(on) 또는 오프(off)로 바꾸도록 RF 구성 요소 인클로저(12)에 나타낸다.
한 실시예에 있어서, 다운링크 데이터는 모바일-전화들로부터 수신된 데이터(즉, 수신 데이터)와 여러 다운링크 저속 정적/제어 신호들을 포함한다. 본 명세서에서 RX 데이터로서 또한 불리는 수신 데이터는 RXI 및 RXQ 데이터를 포함한다. RXI 데이터는 섬유 광학 케이블(18) 상의 393.216 MHz 다운링크 데이터 속도에 기초하는 19.6608 클록 속도에서 동위상 RX 데이터의 4개의 비트들을 포함하고, 2개의 동위상 RX 데이터 비트들은 한 RF 안테나 상에 수신되며, 다른 2개의 동위상 데이터 비트들은 다른 RF 안테나(2개의 안테나 다이버시티 시스템을 위한) 상에 수신된다. RXQ 데이터는 19.6608 클록 속도에서 직교 위상 RX 데이터의 4개의 비트들을 포함하고, 2개의 직교 위상 RX 데이터 비트들은 한 RF 안테나 상에 수신되며, 다른 2개의 직교 위상 RX 데이터 비트들은 다른 RF 안테나 상에 수신된다. 한 RF 안테나 상에 수신된 RXI 및 RXQ 데이터의 2개의 비트들 및 다른 안테나 상에 수신된 RXI 및 RXQ 데이터의 2개의 비트들은 모바일-전화에 의해 송신된 동일한 2개의 RXI 및 RXQ 비트들의 다중 경로 버전들이다.
여러 다운링크 저속 정적/제어 신호들은, 바이패스 정보(bypass information), 다운링크 직렬 포트들을 통한 입력 정보와, 다운링크 RS-485 기반 버스 데이터를 포함한다. CLBYP_N 정보로서 또한 불리는 바이패스 정보는 최종CDMA 채널 유닛이 비-운용 중일 때와 같은 적절한 상황에서 최종 CDMA 채널 유닛을 바이패스하는, CAVAIL_N 정보에 대한 응답이다. CBRSER 및 CRCSER로서 또한 불리는, 다운링크 직렬 포트들을 통한 입력 정보는 각각 무선 및/또는 무선 제어기 직렬 포트들을 통한 RF 구성 요소 인클로저(14)에 첨부된 테스트 장비에 의해 제공된 제어 정보를 포함한다. 본 명세서에서 ARCNET_RX로서 또한 불리는 다운링크 RS-485 기반 버스 데이터는 아크넷에 의해 다음에 오는 전기 표준들에 따라 제어 버스 정보를 나타낸다. ARCNET_RX는 데이터의 다중 직렬 비트들로부터 한 비트의 제어 버스 정보를 포함한다.
양방향들에 있어서, 업링크 및 다운링크 스트림들은 섬유 광학 인터페이스들(22, 26)을 사용하여 섬유 광학 케이블들(16, 18) 상에 송신된다. 도 2는 섬유 광학 인터페이스(22)의 실시예의 상세한 예시를 도시한다. 간결하게 하기 위해, 섬유 광학 인터페이스(26)는 섬유 광학 인터페이스(22)와 동일한 것으로 가정하며, 따라서, 본 명세서에서 별도로 설명하지 않을 것이다. 섬유 광학 인터페이스(22, 26)가 서로 동일하지 않을 수 있다는 것은 이해되어야 한다.
섬유 광학 인터페이스(22)는, 복합 프로그램 가능한 논리 장치(complex programmable logic device; CPLD; 40), 직렬화기(serializer; 42), 비직렬화기(deserializer; 44)와, 트랜시버(transceiver; 46)를 포함한다. CPLD(40)는 16개의 병렬 데이터 버스들의 세트를 통해 직렬화기(42)에, 그리고, 16개의 병렬 데이터 버스들 또는 다른 접속들을 통해 비직렬화기(44)에 접속된다. 직렬화기(42) 및 비직렬화기(44)는 개별적인 데이터 버스들 또는 접속들을 통해 트랜시버(46)에 각각 접속된다. 트랜시버(46)는 광학 송신기(47)와 광학 수신기(48)를 포함하고, 광학 송신기(47)는 직렬화기(42)에 접속되고, 광학 수신기(48)는 비직렬화기(44)에 접속된다.
CPLD(40)는 디지털 구성 요소들(24)(디지털 귀로(digital backhaul)로서 또한 불리는)로부터 업링크 데이터를 수신하고, 적절한 곳에서, 업링크 데이터의 일정한 구성 요소들을 다중화한다. 예컨대, 클록/기준 신호들 및 무선 RF 비상 스위치는 단일 타임 슬롯 상의 송신을 위해 다중화된다. 수신된 업링크 데이터 및 업링크 데이터의 다중화된 구성 요소들은 CPLD(40)에 의해, 직렬화기(42)에 CPLD를 접속하는 16개의 병렬 데이터 버스들 상의 패리티 비트(parity bit) 및 다중 동기화 펄스(multiplex synchronization pulse)에 따라 직렬화기(42)에 제공되고, 다중 동기화 펄스 및 패리티 비트는 섬유 광학 인터페이스들(22, 26) 모두를 각각 동기화하기 위한 CPLD(40) 및 에러 제어에 의해 각각 발생된다. 패리티 비트들은 데이터의 제 1의 15 비트들(코딩 비트들이 아닌)에 기초한다. 다운링크 방향에서, CPLD(40)는 섬유 광학 인터페이스들(22, 26) 모두를 동기화하기 위해 역다중 동기화 펄스(demultiplex synchronization pulse)를 발생한다.
업링크 데이터 구성 요소가 송신되는 16개의 병렬 데이터 버스 중 특정한 하나는 업링크 데이터 구성 요소가 송신 될 채널 또는 타임 슬롯에 의존한다. 한 실시예에 있어서, 데이터 베이스들의 각각과 타임 슬롯들 사이의 1대1 관계가 존재한다. 예컨대, LTXI 데이터의 제 1 비트가 제 1 타임 슬롯(즉, 타임 슬롯 0) 상에 송신되면, 그 비트는 직렬화기(42)에 CPLD(40)를 접속하는 제 1 데이터 버스 상에 직렬화기(42)에 송신된다. 마찬가지로, LTXI 데이터의 제 2 비트가 제 2 타임 슬롯(즉, 타임 슬롯 1) 상에 송신되면, 그 비트는 직렬화기(42)에 CPLD(40)를 접속하는 제 2 데이터 버스 상에 직렬화기(42)에 송신된다.
16개의 병렬 데이터 버스들로부터, 직렬화기(42)는 19.6608 MHz의 클록 속도(또는 프레임 속도)에서 트랜시버(46)에 4개의 코딩 비트들에 따라 이어서 순차적으로 송신되는 16개의 비트 방식의 입력들(sixteen bitwise inputs)을 수신하고, 코딩 비트들은 업링크 데이터 스트림을 디코딩하는 방식을 광학 섬유 인터페이스(26)에서 비직렬화기에 나타내기 위한 직렬화기(42)에 의해 발생된다. 따라서, 20개의 비트들은 직렬화기(42)로부터 트랜시버(46)로 프레임 당(또는 20개의 타임 슬롯들) 순차적으로 송신될 수 있다. 직렬화기(42)에 의해 송신된 비트들은 "직렬 업링크 데이터 스트림"으로서 본 명세서에서 또한 불려진다. 트랜시버(46)에서, 광학 송신기(47)는 광학 섬유 케이블(16) 상의 직렬 업링크 데이터 스트림을 RF 구성 요소 인클로저(14)에서의 광학 수신기에 송신한다.
광학 섬유 인터페이스(22)에서, 직렬 다운링크 데이터 스트림은 RF 구성 요소 인클로저(14)로부터 광학 수신기(48)에 의해 수신된다. 직렬 다운링크 데이터 스트림은 비직렬화기(44)에 송신되고, 직렬 다운링크 데이터 스트림은 직렬 다운링크 데이터 스트림에 포함된 코딩 비트들을 사용하여 비직렬화된다. 비직렬화된 직렬 다운링크 데이터 스트림(직렬 다운링크 데이터 스트림에 있는 4개의 코딩 비트들 없이)은 비트들이 도착한 타임 슬롯에 따라 CPLD(40)에 비직렬화기(44)를 접속하는 16개의 병렬 데이터 버스들 상에 순차적으로 비트 방식으로 송신된다. 마찬가지로, CPLD(40)에서, 수신된 비트들은 그것들이 도착한 데이터 버스들에 기초한 적절한 디지털 구성 요소들에 루팅(route)된다.
도 3은 한 실시예에 따른 프레임에서 업링크 데이터 구성 요소들의 비트 위치들을 나타내는 차트(30)를 도시한다. 특히, LTXO1AI0으로서 또한 불리는 LTXI 데이터의 제 1 비트는 19.6608 MHz 클록 속도에서 프레임의 비트 0으로서 송신되고, LTXO1AI1로서 또한 불리는 LTXI 데이터의 제 2 비트는 19.6608 MHz 클록 속도에서 프레임의 비트 1로서 송신되고, LTXO1AQ0으로서 또한 불리는 LTXQ 데이터의 제 1 비트는 19.6608 MHz 클록 속도에서 프레임의 비트 2로서 송신되며, LTXO1AQ1로서 또한 불리는 LTXQ 데이터의 제 2 비트는 19.6608 MHz 클록 속도에서 프레임의 비트 3으로서 송신된다. 비트 4 내지 9는 미래의 사용을 위해 예약되고, 어떤 비트들도 이들 비트 위치들에서 송신되지 않는다. 업링크 RS-485 기반 버스 데이터의 2 비트들 또는 ARCNET_TXEN은 1.25 Mbps에서 프레임의 비트들(10 및 11)로서 송신된다. 프레임의 비트 12는 클록/기준 신호들, 업링크 직렬 포트들을 통한 입력 정보, 무선 RF 비상 스위치 및 여러 데이터 속도들에서 인접한 CDMA 채널 유닛 유용성 정보의 송신을 위해 다중화된 채널에 대응한다. 프레임의 비트 13은 물리적 주소의 송신을 위해 다중화된 채널에 대응하고, 다중 동기화 펄스 비트는 2.4576 Mbps에서 프레임의 비트 14로서 송신되고, 패리티 비트는 프레임의 비트 15로서 송신되며, 4개의 코딩 비트들은 프레임의 비트들 16 내지 19로서 송신된다. 도 4는 본 발명의 한 실시예에 따라 그 대응하는 타임 슬롯들 또는 채널들 상의 업링크 방향으로 송신되는 프레임의 비트들을 예시하는 업링크 데이터 송신(50)을 도시한다.
도 5는 한 실시예에 따라 프레임에서의 다운링크 데이터 구성 요소들의 비트 위치들을 나타내는 차트(52)를 도시한다. 특히, RXI 데이터의 4개의 비트들(RXIA0, RXIA1, RXIA2 및 RXIA3으로서 또한 불리는)은 19.6608 MHz 클록 속도에서 프레임에서의 비트들 0 내지 3으로서 송신되고, RXQ 데이터의 4개의 비트들(RXQA0, RXQA1, RXQA2 및 RXQA3으로서 본 명세서에서 또한 불리는)은 19.6608 MHz 클록 속도에서 프레임에서의 비트들 4 내지 7로서 송신되고, 다운링크 RS-485 기반 버스 데이터의 한 비트 또는 ARCNET_RX는 1.25 Mbps에서 프레임의 비트 11로서 송신되고, 프레임의 비트 12는 여러 데이터 속도들에서 다운링크 직렬 포트들을 통해 입력 정보 및 바이패스 정보의 송신을 위한 다중화된 채널에 대응하고, 역다중화 동기화 펄스 비트는 2.4576 Mbps에서 프레임의 비트 14로서 송신되고, 패리티 비트는 프레임의 비트 15로서 송신되고, 4개의 코딩 비트들은 프레임의 비트들 16 내지 19로서 송신되며, 비트들 9 내지 10 및 13은 미래의 사용을 위해 예약되고, 어떤 비트들도 이들 비트 위치들에서 송신되지 않는다. RXIA0, RXIA1, RXIA2 및 RXIA3 비트들이 다이버시티 안테나들의 어느 하나 상에 수신된 제 1 또는 제 2 동위상 RX 데이터 비트들일 수 있음을 주목한다. 유사하게, RXQA0, RXQA1, RXQA2 및 RXQA3 비트들은 다이버시티 안테나들의 어느 하나 상에 수신된 제 1 또는 제 2 직교 위상 RX 데이터일 수 있다. 도 6은 본 발명의 한 실시예에 따라 그 대응하는 타임 슬롯들 또는 채널들 상에 다운링크 방향으로 송신되는 프레임의 비트들을 예시하는 다운링크 데이터 송신(60)을 도시한다.
상술된 실시예들이 단지 본 발명의 예시이며, 그 여러가지 변형들이 본 발명의 범위로부터 벗어나지 않고 당업자에 의해 고안될 수 있음은 이해되어야 한다. 예컨대, 단일 디지털 구성 요소 인클로저에 접속된 다중 RF 구성 요소 인클로저들이 존재할 수 있으며, 또는 직렬화기(42) 및/또는 비직렬화에 CPLD(40)를 접속하는 병렬 데이터 버스들의 수는 서로 다를 수 있다. 그러므로, 그러한 변형들이 다음의 특허청구범위 내에 포함된다.
본 발명에 의하면, 다양한 환경들을 위한 기지국 설치를 사용자화(customize)할 기회를 서비스 제공자에게 제공하는 기지국 설계 유연성을 갖는다.

Claims (10)

  1. 데이터 송신 방법에 있어서,
    타임 슬롯들의 제 1 세트 상에 송신 데이터를 송신하는 단계로서, 상기 송신 데이터는 동위상 송신 데이터 비트들(in-phase transmit data bits)과 직교 위상 송신 비트들(quadrature phase transmit bits)을 포함하는, 상기 송신 단계와;
    타임 슬롯들의 제 2 세트 상에 여러가지 업링크 저속 정적/제어 신호들(uplink low rate static/control signals)을 송신하는 단계를 포함하는 데이터 송신 방법.
  2. 제 1 항에 있어서,
    상기 동위상 송신 데이터 비트들은 제 1 동위상 송신 데이터 비트와 제 2 동위상 송신 데이터 비트를 포함하고, 상기 제 1 동위상 송신 데이터 비트는 상기 타임 슬롯들의 제 1 세트에서 제 1 타임 슬롯 상에 송신되고, 상기 제 2 동위상 송신 데이터 비트는 상기 타임 슬롯들의 제 1 세트에서 제 2 타임 슬롯 상에 송신되는, 데이터 송신 방법.
  3. 제 1 항에 있어서,
    타임 슬롯들의 제 3 세트 상의 수신 데이터와, 타임 슬롯들의 제 4 세트 상의 여러가지 다운링크 저속 정적/제어 신호들을 포함하는 다운링크 직렬 데이터 스트림을 수신하는 부가적인 단계를 더 포함하는, 데이터 송신 방법.
  4. 데이터 송신 방법에 있어서,
    타임 슬롯들의 제 1 세트 상에 수신 데이터를 송신하는 단계로서, 상기 수신 데이터는 동위상 송신 데이터 비트들과 직교 위상 송신 비트들을 포함하는, 상기 송신 단계와;
    타임 슬롯들의 제 2 세트 상에 여러가지 다운링크 저속 정적/제어 신호들을 송신하는 단계를 포함하는 데이터 송신 방법.
  5. 제 4 항에 있어서,
    상기 수신 데이터는 제 1 안테나 상에 수신된 동위상 수신 데이터 비트들 중 2개의 비트들, 제 2 안테나 상에 수신된 동위상 수신 데이터 비트들 중 2개의 비트들, 상기 제 1 안테나 상에 수신된 직교 위상 수신 데이터 비트들 중 2개의 비트들과, 상기 제 2 안테나 상에 수신된 직교 위상 수신 데이터 비트들 중 2개의 비트들을 포함하는, 데이터 송신 방법.
  6. 데이터 송신을 위한 인터페이스에 있어서,
    병렬 송신 매체들의 제 1 세트;
    복수의 디지털 구성 요소들에 접속되고, 상기 병렬 송신 매체들의 제 1 세트의 한 단부에 접속된 복합 프로그램 가능한 논리 장치(complex programmable logicdevice)로서, 상기 복수의 디지털 구성 요소들로부터 송신 데이터 및 여러가지 업링크 저속 정적/제어 데이터를 수용하고, 상기 송신 데이터 또는 여러가지 업링크 저속 정적/제어 데이터를 다중화하며, 상기 병렬 송신 매체들의 제 1 세트 상에 상기 송신 데이터 및 여러가지 업링크 저속 정적/제어 데이터를 송신하도록 동작할 수 있는, 상기 복합 프로그램 가능한 논리 장치;
    제 1 직렬 송신 매체;
    상기 병렬 송신 매체들의 제 1 세트의 다른 단부 및 상기 제 1 직렬 송신 매체의 한 단부에 접속된 직렬화기(serializer)로서, 상기 복합 프로그램 가능한 논리 장치에 의해 송신된 송신 데이터 및 여러가지 업링크 저속 정적/제어 신호들을 수용하고, 상기 제 1 직렬 송신 매체 상에 상기 송신 데이터 및 여러가지 업링크 저속 정적/제어 신호들을 직렬로 순차적으로 송신하도록 동작할 수 있는 상기 직렬화기와;
    상기 제 1 직렬 송신 매체의 다른 단부에 접속된 송신기로서, 상기 직렬화기에 의해 송신된 상기 송신 데이터 및 여러가지 업링크 저속 정적/제어 신호들을 수용하고, 다른 송신 매체 상에 상기 송신 데이터 및 여러가지 업링크 저속 정적/제어 신호들을 송신하도록 동작할 수 있는 상기 송신기를 포함하는 데이터 송신을 위한 인터페이스.
  7. 제 6 항에 있어서,
    상기 송신 데이터는, 제 1 동위상 송신 데이터 비트, 제 2 동위상 송신 데이터 비트, 제 1 직교 위상 송신 데이터 비트와, 제 2 직교 위상 송신 데이터 비트를 포함하고, 상기 복합 프로그램 가능한 논리 장치는, 상기 병렬 송신 매체들의 제 1 세트에서의 제 1 송신 매체 상에 상기 제 1 동위상 송신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 2 송신 매체 상에 상기 제 2 동위상 송신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 3 송신 매체 상에 상기 제 1 직교 위상 송신 데이터 비트를, 및 상기 병렬 송신 매체들의 제 1 세트에서의 제 4 송신 매체 상에 상기 제 2 직교 위상 송신 데이터 비트를 송신하도록 동작할 수 있는, 데이터 송신을 위한 인터페이스.
  8. 제 7 항에 있어서,
    상기 여러가지 업링크 저속 정적/제어 신호들은, 클록/기준 신호들, 업링크 RS-485 기반 버스 데이터, 물리적 주소 정보, 인접한 CDMA 채널 유닛 유용성 정보, 업링크 직렬 포트들을 통한 입력 정보와 무선 RF 비상 스위치를 포함하고, 상기 복합 프로그램 가능한 논리 장치는, 업링크 다중화된 데이터 스트림을 생성하기 위해, 상기 클록/기준 신호들, 인접한 CDMA 채널 유닛 유용성 정보, 업링크 직렬 포트들을 통한 입력 정보와 무선 RF 비상 스위치를 다중화하도록 운용 가능하고, 상기 복합 프로그램 가능한 논리 장치는 상기 병렬 송신 매체들의 제 1 세트에서의 제 5 송신 매체 상에 상기 업링크 다중화된 데이터 스트림을, 상기 병렬 송신 매체들의 제 1 세트에서의 제 6 및 제 7 송신 매체 상에 상기 업링크 RS-485 기반 버스 데이터를, 및 상기 병렬 송신 매체들의 제 1 세트에서의 제 8 송신 매체 상에 상기물리적 주소 정보를 송신하도록 동작할 수 있는, 데이터 송신을 위한 인터페이스.
  9. 데이터 송신을 위한 인터페이스에 있어서,
    병렬 송신 매체들의 제 1 세트;
    복수의 RF 구성 요소들에 접속되고, 상기 병렬 송신 매체들의 제 1 세트의 한 단부에 접속된 복합 프로그램 가능한 논리 장치로서, 상기 복수의 RF 구성 요소들로부터 수신 데이터 및 여러가지 다운링크 저속 정적/제어 데이터를 수용하고, 상기 송신 데이터 또는 여러가지 다운링크 저속 정적/제어 데이터를 다중화하며, 상기 병렬 송신 매체들의 제 1 세트 상에 상기 수신 데이터 및 여러가지 다운링크 저속 정적/제어 데이터를 송신하도록 동작할 수 있는 상기 복합 프로그램 가능한 논리 장치;
    제 1 직렬 송신 매체;
    상기 병렬 송신 매체들의 제 1 세트의 다른 단부 및 상기 제 1 직렬 송신 매체의 한 단부에 접속된 직렬화기로서, 상기 복합 프로그램 가능한 논리 장치에 의해 송신된 상기 수신 데이터 및 여러가지 다운링크 저속 정적/제어 신호들을 수용하고, 상기 제 1 직렬 송신 매체 상에 상기 수신 데이터 및 여러가지 다운링크 저속 정적/제어 신호들을 직렬로 순차적으로 송신하도록 동작할 수 있는 상기 직렬화기와;
    상기 제 1 직렬 송신 매체의 다른 단부에 접속된 송신기로서, 상기 직렬화기에 의해 송신된 상기 수신 데이터 및 여러가지 다운링크 저속 정적/제어 신호들을수용하고, 다른 송신 매체 상에 상기 수신 데이터 및 여러가지 다운링크 저속 정적/제어 신호들을 송신하도록 동작할 수 있는 상기 송신기를 포함하는 데이터 송신을 위한 인터페이스.
  10. 제 9 항에 있어서,
    상기 수신 데이터는, 제 1 동위상 수신 데이터 비트, 제 2 동위상 수신 데이터 비트, 제 3 동위상 수신 데이터 비트, 제 4 동위상 수신 데이터 비트, 제 1 직교 위상 수신 데이터 비트, 제 2 직교 위상 수신 데이터 비트, 제 3 직교 위상 수신 데이터 비트와 제 4 직교 위상 수신 데이터 비트를 포함하고, 상기 제 1 및 제 2 동위상 및 직교 위상 수신 데이터 비트들은 제 1 안테나 상에 수신되고, 상기 제 3 및 제 4 동위상 및 직교 위상 수신 데이터 비트들은 제 2 안테나 상에 수신되고, 상기 복합 프로그램 가능한 논리 장치는 상기 병렬 송신 매체들의 제 1 세트에서의 제 1 송신 매체 상에 상기 제 1 동위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 2 송신 매체 상에 상기 제 2 동위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 3 송신 매체 상에 상기 제 3 동위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 4 송신 매체 상에 상기 제 4 동위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 5 송신 매체 상에 상기 제 1 직교 위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 6 송신 매체 상에 상기 제 2 직교 위상 수신 데이터 비트를, 상기 병렬 송신 매체들의 제 1 세트에서의 제 7 송신 매체 상에 상기 제 3직교 위상 수신 데이터 비트를, 및 상기 병렬 송신 매체들의 제 1 세트에서의 제 8 송신 매체 상에 상기 제 4 직교 위상 수신 데이터 비트를 송신하도록 동작할 수 있는, 데이터 송신을 위한 인터페이스.
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