KR102586409B1 - Coating by ALD to suppress metal whiskers - Google Patents

Coating by ALD to suppress metal whiskers Download PDF

Info

Publication number
KR102586409B1
KR102586409B1 KR1020187032442A KR20187032442A KR102586409B1 KR 102586409 B1 KR102586409 B1 KR 102586409B1 KR 1020187032442 A KR1020187032442 A KR 1020187032442A KR 20187032442 A KR20187032442 A KR 20187032442A KR 102586409 B1 KR102586409 B1 KR 102586409B1
Authority
KR
South Korea
Prior art keywords
layer
ald
deposition
substrate
stack
Prior art date
Application number
KR1020187032442A
Other languages
Korean (ko)
Other versions
KR20180133476A (en
Inventor
마르코 푸다스
Original Assignee
피코순 오와이
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 피코순 오와이 filed Critical 피코순 오와이
Publication of KR20180133476A publication Critical patent/KR20180133476A/en
Application granted granted Critical
Publication of KR102586409B1 publication Critical patent/KR102586409B1/en

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/3244Gas supply means
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/455Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
    • C23C16/45523Pulsed gas flow or change of composition over time
    • C23C16/45525Atomic layer deposition [ALD]
    • C23C16/45527Atomic layer deposition [ALD] characterized by the ALD cycle, e.g. different flows or temperatures during half-reactions, unusual pulsing sequence, use of precursor mixtures or auxiliary reactants or activations
    • C23C16/45529Atomic layer deposition [ALD] characterized by the ALD cycle, e.g. different flows or temperatures during half-reactions, unusual pulsing sequence, use of precursor mixtures or auxiliary reactants or activations specially adapted for making a layer stack of alternating different compositions or gradient compositions
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/02Pretreatment of the material to be coated
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/02Pretreatment of the material to be coated
    • C23C16/0209Pretreatment of the material to be coated by heating
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/02Pretreatment of the material to be coated
    • C23C16/0227Pretreatment of the material to be coated by cleaning or etching
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/455Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
    • C23C16/45523Pulsed gas flow or change of composition over time
    • C23C16/45525Atomic layer deposition [ALD]
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/455Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
    • C23C16/45523Pulsed gas flow or change of composition over time
    • C23C16/45525Atomic layer deposition [ALD]
    • C23C16/45544Atomic layer deposition [ALD] characterized by the apparatus
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/455Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
    • C23C16/45523Pulsed gas flow or change of composition over time
    • C23C16/45525Atomic layer deposition [ALD]
    • C23C16/45555Atomic layer deposition [ALD] applied in non-semiconductor technology
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/52Controlling or regulating the coating process
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C28/00Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D
    • C23C28/04Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D only coatings of inorganic non-metallic material
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C28/00Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D
    • C23C28/04Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D only coatings of inorganic non-metallic material
    • C23C28/042Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D only coatings of inorganic non-metallic material including a refractory ceramic layer, e.g. refractory metal oxides, ZrO2, rare earth oxides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/32458Vessel
    • H01J37/32522Temperature
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/22Secondary treatment of printed circuits
    • H05K3/28Applying non-metallic protective coatings
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/0313Organic insulating material
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/01Dielectrics
    • H05K2201/0137Materials
    • H05K2201/0162Silicon containing polymer, e.g. silicone
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/01Dielectrics
    • H05K2201/0137Materials
    • H05K2201/0179Thin film deposited insulating layer, e.g. inorganic layer for printed capacitor
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/07Electric details
    • H05K2201/0753Insulation
    • H05K2201/0769Anti metal-migration, e.g. avoiding tin whisker growth
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/08Treatments involving gases
    • H05K2203/086Using an inert gas
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/08Treatments involving gases
    • H05K2203/087Using a reactive gas

Abstract

ALD(atomic layer deposition)에 의해 기재의 표면 상에 스택을 증착시키는 단계를 포함하는 증착 방법이 제공된다. 또한, 이 증착 방법을 수행하기 위한 ALD 반응기 및 이 증착 방법을 사용하여 얻어진 생성물이 제공된다.A deposition method is provided that includes depositing a stack on the surface of a substrate by atomic layer deposition (ALD). Also provided are an ALD reactor for carrying out this deposition method and products obtained using this deposition method.

Description

금속 휘스커를 억제하기 위한 ALD에 의한 코팅Coating by ALD to suppress metal whiskers

본 발명은 전반적으로 재료가 기재 표면 상에 증착되는 원자층 증착 기술에 관한 것이다.The present invention generally relates to atomic layer deposition techniques in which materials are deposited on the surface of a substrate.

이 섹션은, 여기에 기술된 임의의 기술이 종래 기술을 대표한다는 인정 없이, 유용한 배경 정보를 예시한다.This section illustrates useful background information, without acknowledging that any of the techniques described herein represent prior art.

원자층 증착(Atomic Layer Deposition: ALD)은, 반응 공간 내의 적어도 하나의 기재에 대한 적어도 2개의 반응성 전구체 종의 순차적인 도입에 기초한 특수 화학 증착 방법이다. 플라즈마 강화 ALD(Plasma enhanced ALD: PEALD)는, 기재 표면에 대한 추가 반응성(additional reactivity)이 플라즈마 생성 종의 형태로 전달되는 ALD 방법이다. 또한, 관련된 공정은 일종의 역전된 ALD인 원자층 식각(Atomic Layer Etching; ALE)이며, 여기서는, 특정 화학 작용의 도움으로, 하나의, 가능하게는 특정의, 원자 또는 분자 층의 공형 제거(conformal removal)가 이루어진다. 또한, ALD의 하위 클래스는 분자층 증착(Molecular Layer Deposition: MLD)인데, 이는 한 번에 층당 하나보다 많은 원자를 증착시키는 것을 지칭하며, 이는 많은 경우에 유기 재료를 포함한다. 그러한 재료는 "Beilstein J. Nanotechnol. 2014, 5, 1104-1136"(Organic and inorganic-organic thin film structures by molecular layer deposition: A review, Pia Sundberg and Maarit Karppinen)에서 논의된다.Atomic Layer Deposition (ALD) is a specialized chemical vapor deposition method based on the sequential introduction of at least two reactive precursor species to at least one substrate in a reaction space. Plasma enhanced ALD (PEALD) is an ALD method in which additional reactivity to the substrate surface is delivered in the form of plasma-generated species. Additionally, a related process is Atomic Layer Etching (ALE), a type of inverted ALD, in which the conformal removal of one, possibly specific, atomic or molecular layer is achieved with the help of specific chemistries. ) is accomplished. Additionally, a subclass of ALD is Molecular Layer Deposition (MLD), which refers to depositing more than one atom per layer at a time, which in many cases includes organic materials. Such materials are discussed in “Beilstein J. Nanotechnol. 2014, 5, 1104-1136” (Organic and inorganic-organic thin film structures by molecular layer deposition: A review, Pia Sundberg and Maarit Karppinen).

ALD 공정에서, 기재는 보통 세정되지 않는데, 이는, 이들이 다른 청정 공정으로부터 또는 깨끗한 기재 박스(clean substrate box)로부터 청정실의 ALD 툴(ALD tool)로 이송되기 때문이다. 공기(air) 또는 주위(ambient)로부터 흡수된 분자 층은 통상적으로, 통상적으로 사용되는 실리콘 웨이퍼 기재를 불활성 가스 흐름 중에서 최대 300 ℃까지의 온도로 가열함으로써 완화된다. 대조적으로, 통상적인 리플로우(reflow) 또는 수동 솔더링 단계는 융제(flux)의 일부 흔적을 남기며, 이는 ALD 증착에 유해하다. 또한, 예를 들어 PCB는 실리콘 웨이퍼가 허용하는 것과 같은 그러한 높은 온도를 허용하지 않으며, 다른 세정을 필요로 한다.In ALD processes, substrates are usually not cleaned because they are transferred from other clean processes or from clean substrate boxes to the ALD tool in a clean room. The molecular layer absorbed from the air or ambient is usually relieved by heating the commonly used silicon wafer substrate to a temperature of up to 300° C. in a flow of inert gas. In contrast, conventional reflow or manual soldering steps leave some traces of flux, which is detrimental to ALD deposition. Additionally, PCBs, for example, do not tolerate such high temperatures as silicon wafers do and require different cleaning.

금속 휘스커 형성은, 특히 금속 및 금속 합금(예를 들어, Sn 및 Sn 합금, Cd 및 Cd 합금, 및 Zn 및 Zn 합금)을 사용할 때 마주치게 되는 문제점이다. 금속 휘스커는 표면에 금속 스파이크(metal spike) 또는 기타 들쭉날쭉함(irregularities)을 포함하는데, 이는, 회로 단락, 부식, 유도 부식(induced corrosion), 원치 않는 입자 축적의 증가(증가된 표면적의 결과로서)를 야기하고, RF 라인 및 부품(RF-lines and components)의 RF 성능을 변화시킨다. 한편, 부식은 통상적으로, 휘스커 발생 경향의 중요한 요인으로서 언급되어 왔다. 금속 휘스커 형성은, 예를 들어, 인쇄 회로 기판(PCB)의 솔더링 공정에서 전자 부품 또는 보드의 전기 도금(솔더 페이스트의 리플로우(reflow)라고도 알려져 있음)시에 시작될 수 있는데, 이는, 심지어 수년이 지난 후에도, PCB의 보관 또는 사용 조건에 관계없이, 문제를 발생시킬 수 있다. Metal whisker formation is a problem encountered especially when using metals and metal alloys (e.g., Sn and Sn alloys, Cd and Cd alloys, and Zn and Zn alloys). Metal whiskers include metal spikes or other irregularities on the surface that can short-circuit, corrode, induce corrosion, or increase unwanted particle accumulation (as a result of increased surface area). and changes the RF performance of RF-lines and components. Meanwhile, corrosion has generally been mentioned as an important factor in the tendency for whiskers to occur. Metal whisker formation can begin, for example, in the soldering process of printed circuit boards (PCBs), upon electroplating of electronic components or boards (also known as reflow of solder paste), even after several years. Even later, regardless of the conditions in which the PCB was stored or used, problems can occur.

금속 휘스커 형성 문제는 전자 회로의 경우에서도 치명적이지만, 예를 들어 전자 제품에 사용되는 예를 들어 부품 및 전자 제품 케이스(이것은 종종 전기 도금된 금속으로 만들어진다)와도 관련이 있다. The problem of metal whisker formation is also critical in the case of electronic circuits, but is also relevant for, for example, components used in electronics and electronics cases (which are often made of electroplated metal).

특히 주석 휘스커 형성은 종래에 그 합금에 Pb를 첨가함으로써 상당히 감소된 바 있다. 그러나, Pb의 독성으로 인해, 주석 휘스커 형성을 완화하거나 궁극적으로는 방지할 수 있고 또한 가능하게는 부식 방지를 향상시킬 수 있는 새로운 방법이 필요하다. 특히, PCB 및 전자 부품에서의 필라멘트 형태 주석 휘스커의 형성은 문제점들을 야기할 수 있으며, 따라서, 이것의 형성을 방지할 필요가 있다.In particular, tin whisker formation has previously been significantly reduced by adding Pb to the alloy. However, due to the toxicity of Pb, new methods are needed to mitigate or ultimately prevent tin whisker formation and possibly also improve corrosion protection. In particular, the formation of filament-like tin whiskers in PCBs and electronic components can cause problems, and therefore there is a need to prevent their formation.

문헌에서, 주석 휘스커의 형성에 영향을 미치는 다양한 요인들이 제시된 바 있다. 그러한 요인들은 다음을 포함한다: 표면 장력; 온도; 습도; 전위; 정전하; 및 구조적 결함, 옥사이드 층, 결정립계, 이온성 오염, 국부적 응력 및 응력 구배로 인한 불완전한 금속 표면. 이들의 세부사항들 중 일부는 최근 공개된 "Journal of Applied Physics 119, 085301 (2016), Surface parameters determining a metal propensity for whiskers, Diana Shvydka and V. G. Karpov"에 논의되어 있다. In the literature, various factors affecting the formation of tin whiskers have been suggested. Such factors include: surface tension; temperature; humidity; electric potential; electrostatic charge; and imperfect metal surfaces due to structural defects, oxide layers, grain boundaries, ionic contamination, local stresses and stress gradients. Some of these details are discussed in the recently published Journal of Applied Physics 119, 085301 (2016), Surface parameters determining a metal propensity for whiskers, Diana Shvydka and V. G. Karpov.

본 발명의 제1 측면에 따라, 금속 휘스커(whisker) 형성, 일렉트로마이그레이션(electromigration) 및 부식을 감소시키는 증착 방법이 제공되며, 이때, 이 증착 방법은, According to a first aspect of the present invention, a deposition method is provided that reduces metal whisker formation, electromigration, and corrosion, the deposition method comprising:

기재를 제공하는 단계;providing a substrate;

상기 기재를 세정에 의해 전처리하는 단계; Pretreating the substrate by washing;

상기 기재를 예열 및/또는 배출(evacuating)에 의해 전처리하는 단계; 및pretreating the substrate by preheating and/or evacuating; and

적어도 제1 층(100)을 원자층 증착(atomic layer deposition: ALD)에 의해 증착시키는 단계를 포함하는 스택 증착 단계;를 포함한다. and a stack deposition step including depositing at least the first layer 100 by atomic layer deposition (ALD).

본 발명의 제2 측면에 따라, 금속 휘스커 형성, 일렉트로마이그레이션(electromigration) 및/또는 부식으로부터 기재를 보호하기 위한 제1 측면의 방법의 용도가 제공된다.According to a second aspect of the invention, there is provided the use of the method of the first aspect for protecting a substrate from metal whisker formation, electromigration and/or corrosion.

본 발명의 제3 측면에 따라, ALD 반응기 시스템(700)으로서, 상기 ALD 반응기 시스템이 제1 측면의 방법을 수행하는 것을 야기하도록 구성된 제어 수단(702)을 포함하는 ALD 반응기 시스템(700)이 제공된다.According to a third aspect of the invention, there is provided an ALD reactor system (700) comprising control means (702) configured to cause the ALD reactor system to perform the method of the first aspect. do.

일 측면에 따라, 제1 측면의 방법을 사용하여 증착된 기재를 포함하는 장치가 제공된다. According to one aspect, a device is provided comprising a substrate deposited using the method of the first aspect.

본 발명의 다양한 비구속적인 예시적 측면 및 구현예들이 앞에서 설명되었다. 상기 구현예들은 단지, 본 발명의 구현에 이용될 수 있는 선택된 측면들 또는 단계들을 설명하기 위해 사용된다. 일부 구현예는 본 발명의 특정 예시적 측면들만을 참조하여 제시될 수 있다. 대응하는 구현예들은 다른 예시적 측면들에도 적용될 수 있다는 것이 이해되어야 한다. 구현예들의 임의의 적절한 조합이 형성될 수 있다.Various non-binding example aspects and implementations of the invention have been described above. The above implementation examples are merely used to describe selected aspects or steps that may be used in implementing the invention. Some implementations may be presented with reference only to specific illustrative aspects of the invention. It should be understood that corresponding implementations may apply to other example aspects as well. Any suitable combination of embodiments may be formed.

이하에서는, 본 발명을, 단지 예시적으로, 첨부 도면을 참조하여 설명한다.
도 1은 예시적 구현예에 따른 방법의 흐름도를 도시한다.
도 2는 본 방법을 사용하여 증착된 기재 상에 증착된 스택의 구현들의 개략도를 보여준다.
도 3은 예시적 구현예에 따른 ALD 반응기 시스템을 보여준다.
도 4a 및 도 4b는, 코팅되지 않은 대조군 샘플(도 4b)과 비교하여, 제1 측면의 방법을 사용하여 코팅된 SnAg 샘플(도 4a) 기재 상에서의 감소된 필라멘트 휘스커 형성을 보여주는 SEM 이미지이다. 도 4b의 코팅되지 않은 기재는 수십 ㎛의 길이를 갖는 필라멘트 휘스커를 보여준다. 도 4a의 눈금 막대는 10 ㎛이고, 도 4b의 눈금 막대는 20 ㎛이다.
Hereinafter, the present invention will be described by way of example only with reference to the accompanying drawings.
1 shows a flow diagram of a method according to an example implementation.
Figure 2 shows a schematic diagram of implementations of a stack deposited on a substrate deposited using the present method.
Figure 3 shows an ALD reactor system according to an example embodiment.
Figures 4A and 4B are SEM images showing reduced filament whisker formation on a SnAg sample coated using the method of the first aspect (Figure 4A) compared to an uncoated control sample (Figure 4B). The uncoated substrate in Figure 4b shows filamentous whiskers with a length of several tens of μm. The scale bar in FIG. 4A is 10 μm, and the scale bar in FIG. 4B is 20 μm.

일 구현예에 있어서, 상기 스택 증착 단계는 적어도 하나의 환원성 화학물질(reductive chemical)로 출발하는 제1 펄스(first pulse)를 포함한다.In one implementation, the stack deposition step includes a first pulse starting with at least one reductive chemical.

일 구현예에 있어서, 상기 스택 증착 단계는 적어도 하나의 산화성 화학물질(oxidizing chemical)로 출발하는 제1 펄스를 포함한다.In one implementation, the stack deposition step includes a first pulse starting with at least one oxidizing chemical.

일 구현예에 있어서, 상기 스택 증착 단계는 상기 환원성 화학물질 또는 화학물질들의 다수의 펄스들 및 이들 사이의 후속 불활성 가스 펄스로 이루어진 제1 펄스를 포함한다. In one implementation, the stack deposition step includes a first pulse consisting of multiple pulses of the reducing chemical or chemicals with subsequent inert gas pulses therebetween.

일 구현예에 있어서, 상기 금속은 Zn, Zn 합금, Sn, Sn 합금, Cd 또는 Cd 합금, 또는 Ag 또는 Ag 합금을 포함한다. In one embodiment, the metal includes Zn, Zn alloy, Sn, Sn alloy, Cd or Cd alloy, or Ag or Ag alloy.

일 구현예에 있어서, 기재는 인쇄 회로 기판(PCB)를 포함하거나, 또는 PCB이다. 기재는 통상적으로 부품들을 갖는 조립된 PCB 또는 PCB 어셈블리로서 알려져 있을 수 있지만, 본 명세서에서는 PCB로 지칭된다. 그러나, 주목되어야 하는 바와 같이, 이 공정은 반제품(semi-finished product)(예를 들어, 솔더 페이스트가 있는 PCB 보드 또는 PCB, 또는 리플로우(reflow)된 솔더가 있는 PCB, 전자장치 어셈블리 또는 부분 어셈블리)에 적용 가능하다. 다른 구현예에서, 기재는 구성부품, 구성부품 하우징, 금속 패키지, 또는 금속 하우징이다. 또한, 수리 또는 재가공 역시 본 명세서에 기술된 ALD 코팅에 의해 수행될 수 있다. 일 구현예에 있어서, 앞에서 설명된 그리고 이후에 설명되는 증착 공정은 전자제품의 제조 단계를 형성한다.In one embodiment, the substrate includes or is a printed circuit board (PCB). The substrate may be commonly known as an assembled PCB or PCB assembly with components, but is referred to herein as a PCB. However, as should be noted, this process is suitable for semi-finished products (e.g. PCB boards or PCBs with solder paste, or PCBs with reflowed solder, electronics assemblies or sub-assemblies). ) is applicable to In other embodiments, the substrate is a component, component housing, metal package, or metal housing. Additionally, repair or refurbishment can also be performed by the ALD coating described herein. In one embodiment, the deposition processes described above and described hereinafter form a manufacturing step for an electronic product.

또한, PCB 또는 전자장치 어셈블리(electronics assembly)의 전자장치(electronics)의 일부로서 사용될 수 있는 구성부품은, 금속화 코팅(metallization coating) 또는 금속 패키지(metal package)를 가질 수 있으며, 이것들은 금속 휘스커를 형성할 수 있다. 그러한 코팅 방법은, 통상적으로 알려진 "침지 주석(immersion tin)" 등을 포함한다. 본 방법은 그러한 기재에도 적용된다.Additionally, components that may be used as part of the electronics of a PCB or electronics assembly may have a metallization coating or metal package, which may include metal whiskers. can be formed. Such coating methods include commonly known “immersion tin” and the like. The method also applies to such substrates.

본 방법은, 일 구현예에서, PCB를 포함하는 전자 부품 및 전자 회로와 같은 기재를 보호하기 위해 사용된다. 본 방법 및 그 용도는 품질 및 환경에 대한 저항성이 특히 중요한 응용 분야(예를 들어, 우주항공, 의료, 산업, 자동차 및 군사 분야에서 사용되도록 의도된 전자장치(electronics))에서 특히 유용하다. The method, in one embodiment, is used to protect substrates such as electronic components and electronic circuits, including PCBs. The method and its use are particularly useful in applications where quality and environmental resistance are particularly important (e.g., electronics intended for use in aerospace, medical, industrial, automotive and military fields).

일 구현예에 있어서, 제1 층(100)은 적어도 하나의 ALD 층의 층을 포함한다. 제1 층은 선택적으로(optionally), 기재(10)에 접착하도록 적용된다. 일 구현예에서, 접착(adherence)이 가장 최적이다.In one implementation, first layer 100 includes a layer of at least one ALD layer. The first layer is optionally applied to adhere to the substrate 10. In one embodiment, adherence is most optimal.

일 구현예에 있어서, 스택은 원자층 증착(ALD)에 의해 제2 층(200)을 증착하는 단계를 더 포함한다.In one implementation, the stack further includes depositing the second layer 200 by atomic layer deposition (ALD).

일 구현예에 있어서, 제2 층(200)은 수많은 하위층(sublayer)을 포함한다. 일 구현예에 있어서, 적어도 하나의 하위층은 탄성 층이다.In one implementation, second layer 200 includes numerous sublayers. In one embodiment, at least one lower layer is an elastic layer.

일 구현예에 있어서, 제2 층(200)은 적어도 하나의 탄성 층으로 이루어진다.In one implementation, second layer 200 consists of at least one elastic layer.

일 구현예에 있어서, 제2 층(200)은 적어도 하나의 유기 층 또는 실리콘 폴리머(silicone polymer) 함유 층으로 이루어진다. In one implementation, the second layer 200 is comprised of at least one organic layer or a layer containing silicone polymer.

일 예로서, 층(200)은 n×(I + II)이고, 여기서, n ≥ 1이고, I는 적어도 두 가지 화학물질(예를 들어, TMA + H2O)로 이루어지며, II는, 그 중 적어도 하나가 층 I의 화학물질과 다른 화학물질들의 임의의 다른 조합이다. 또한, 임의의 다른 조합(예를 들어, n*(I + II + III) 또는 n*(I + II) + m*(III + IV) 또는 x{n*(I + II) + m*(III + IV)}, 여기서, m≥1)이 사용될 수 있다. I, II, III 및 IV의 각각은 두 가지 화학물질로 이루어지되, 이때, 이들 중 적어도 하나는 서로 비교하여 상이하고, 선택적으로(optionally)는 I 및 II에서 사용되는 것들과 비교하여 상이하다.As an example, layer 200 is n×(I + II), where n ≥ 1, I consists of at least two chemicals (e.g., TMA + H 2 O), and II is: At least one of them is any other combination of chemicals from layer I and other chemicals. Additionally, any other combination (e.g. n*(I + II + III) or n*(I + II) + m*(III + IV) or x{n*(I + II) + m*( III + IV)}, where m≥1) can be used. Each of I, II, III and IV consists of two chemicals, wherein at least one of them is different compared to each other and optionally different compared to those used in I and II.

일 구현예에 있어서, 스택은 원자층 증착(ALD)에 의해 제3 층(300)을 증착하는 단계를 더 포함한다. In one implementation, the stack further includes depositing a third layer 300 by atomic layer deposition (ALD).

일 구현예에 있어서, 제3 층(300)은 최상층이다.In one implementation, third layer 300 is the top layer.

일 구현예에 있어서, 세정에 의해 기재를 전처리하는 단계는 세척(washing)에 의한 세정(cleaning)을 포함한다.In one embodiment, pretreating the substrate by washing includes cleaning by washing.

일 구현예에 있어서, 세정에 의해 기재를 전처리하는 단계는 용매에 의한 세정을 포함한다.In one embodiment, pretreating the substrate by cleaning includes cleaning with a solvent.

일 구현예에 있어서, 세정에 의해 기재를 전처리하는 단계는 송풍(blowing)에 의한 세정 또는 가스 또는 가스들과 같은 비액체 유체에 의한 세정에 의한 세정을 포함한다.In one embodiment, pretreating the substrate by cleaning includes cleaning by blowing or cleaning by a non-liquid fluid such as a gas or gases.

일 구현예에 있어서, 예열에 의해 기재를 전처리하는 단계는 반응 온도보다 높은 온도를 갖는 가열된 가스의 펄스로 예열하는 단계를 포함한다.In one embodiment, pretreating the substrate by preheating includes preheating with a pulse of heated gas having a temperature greater than the reaction temperature.

일 구현예에 있어서, 하위층 I, II 및 III 중 임의의 하나는 독립적으로 전기 절연 재료를 포함한다.In one embodiment, any one of sublayers I, II and III independently comprises an electrically insulating material.

일 구현예에서, 층 II는 유기층이다.In one embodiment, layer II is an organic layer.

일 구현예에서, 층 II는 유기 또는 실리콘 폴리머 함유 층이다.In one embodiment, layer II is an organic or silicone polymer containing layer.

일 구현예에서, 층 III은 유기 또는 실리콘 폴리머 함유 층이다.In one embodiment, layer III is an organic or silicone polymer containing layer.

일 구현예에 있어서, 층 I, II, III 및 IV 중 적어도 하나는 주위(ambient)와 반응성인 반응성 화학물질을 포함한다.In one embodiment, at least one of layers I, II, III and IV comprises a reactive chemical that is reactive with the ambient.

일 구현예에서, 층 I, II 및 III 중 적어도 하나는 경질 층(hard layer)이다.In one embodiment, at least one of layers I, II and III is a hard layer.

특정 구현예에서, 층 I, II 및 III 중 어느 하나; 층 IV 및 층 IV는 ALD 층, 전기 절연 층, 옥사이드, 카바이드, 금속 카바이드, 금속, 플루오라이드 및 나이트라이드(이들 층은 분자층 증착(MLD)으로 증착된 분자층을 포함)로부터 독립적으로 선택된다.In certain embodiments, any of layers I, II, and III; Layer IV and Layer IV are independently selected from ALD layers, electrically insulating layers, oxides, carbides, metal carbides, metals, fluorides and nitrides (these layers include molecular layers deposited by molecular layer deposition (MLD)). .

일 구현예에서, 층 II는 MLD로 증착된(그에 따라, 한 번에 다수의 원자들이 효과적으로 증착된) 층(예를 들어, 유기층(예를 들어, 알루콘(Alucone) 또는 티타니콘(Titanicone)), 또는 다양한 상이한 원자들(예를 들어, C, N, Si 및/또는 O)을 포함하는 층)이다. 추가의 구현예에서, 이 층은 폴리머 사슬 또는 가교 결합을 형성하여, 통상적으로 알려져 있는 기계적 강도 또는 화성(formation)을 가능하게 한다. 그러한 가교 폴리머 구조의 공지된 예는 지방족 폴리우레아, DEZ 및 TiCl4를 갖는 헥사-2,4-디인-1,6-디올, 및 실리콘 폴리머 -(SiR2-O))n-이다. 일 구현예에서 중합의 효과는, ALD 반응기에서, 진공 클러스터에서 또는 어셈블리 외부에서, UV-중합을 통한 조합된 효과를 포함한다.In one embodiment, layer II is a MLD deposited layer (thereby effectively depositing multiple atoms at a time) (e.g., an organic layer (e.g., Alucone or Titanicone) ), or a layer containing various different atoms (e.g., C, N, Si and/or O). In a further embodiment, this layer forms polymer chains or cross-links, enabling commonly known mechanical strength or formation. Known examples of such cross-linked polymer structures are aliphatic polyureas, hexa-2,4-diyne-1,6-diol with DEZ and TiCl 4 , and silicone polymers -(SiR 2 -O))n-. In one embodiment the effect of polymerization includes the combined effect via UV-polymerization, in an ALD reactor, in a vacuum cluster or outside the assembly.

일 구현예에서, 층 II는 유기 또는 실리콘 폴리머 사슬-함유 층이다. 층 Ⅱ는 바람직하게는, 크래킹에 저항성이며, 증착된 층들의 변형을 가능하게 한다. 일 구현예에서, 층 II는 가교 결합된 층이다. 또 다른 구현예에서, 층 II는 단일층이거나, 또는 다수의 분자층을 포함한다. 따라서, 층 II의 다수의 층들은, 전체 스택과 같은 탄성 거동을 갖는 더 두꺼운 적층체를 제공하도록 증착될 수 있다. 그러한 층은 균열(예를 들어, 힐록(Hillock), 또는 제1 층 또는 스택에서의 유사한 작은 화성(formation)에 의해 야기됨)에 대한 저항성을 제공하여, 내부식성을 유지하는데 특히 유리하다.In one embodiment, layer II is an organic or silicone polymer chain-containing layer. Layer II is preferably resistant to cracking and allows deformation of the deposited layers. In one embodiment, layer II is a cross-linked layer. In another embodiment, layer II is a single layer or comprises multiple molecular layers. Accordingly, multiple layers of Layer II can be deposited to provide a thicker laminate with elastic behavior similar to the overall stack. Such layers are particularly advantageous for maintaining corrosion resistance by providing resistance to cracking (eg, caused by Hillock, or similar small formations in the first layer or stack).

일 구현예에 있어서, 스택의 두께는 1 내지 2000 nm, 바람직하게는 50 내지 500 nm, 가장 바람직하게는 100 내지 200 nm이다.In one embodiment, the thickness of the stack is 1 to 2000 nm, preferably 50 to 500 nm, most preferably 100 to 200 nm.

일 구현예에 있어서, 본 방법은 포어-라인 배출 흐름(fore-line exhaust flow)을 변경, 정지 또는 제한하는 단계를 더 포함한다. 일 구현예에 있어서, 변경, 정지 또는 제한은 화학물질 펄스와 동기화된다.In one embodiment, the method further includes altering, stopping or limiting fore-line exhaust flow. In one implementation, changes, stops or limits are synchronized with chemical pulses.

일 구현예에 있어서, 본 방법은 추가의 코팅 방법에 의해 스택의 상단에 추가 코팅을 제공하는 단계를 더 포함한다.In one embodiment, the method further includes providing an additional coating on top of the stack by an additional coating method.

일 구현예에서, 추가 코팅은 래커(lacquer)와 같은 폴리머 또는 실리콘 폴리머를 포함한다.In one embodiment, the additional coating includes a polymer such as lacquer or a silicone polymer.

일 구현예에 있어서, 추가 코팅은, 예를 들어, 기재에 래커(lacquer) 등을 제공하는(또는, 예를 들어, 딥-코팅(dip-coating)하는) 단계를 포함한다.In one embodiment, the additional coating comprises, for example, providing (or, for example, dip-coating) a lacquer, etc. to the substrate.

일 구현예에서, 추가 코팅은, 통상적인 수단(예를 들어, 분무, 브러싱 또는 딥-코팅)에 의해 도포된 통상적인 유기 또는 실리콘 폴리머 코팅을 제공하는 것을 포함한다.In one embodiment, the additional coating includes providing a conventional organic or silicone polymer coating applied by conventional means (eg, spraying, brushing or dip-coating).

또 다른 구현예에서, 층 II에 부가하여 또는 층 II 대신에, 스택 내에 탄소 나노튜브, 탄소 나노튜브 그물, 또는 그래핀 네트워크를 포함하는 층이 제공된다. 일 구현예에 있어서, 그러한 층은, 일 구현예에서는 모든 면에서, 전기 절연 재료(예를 들어, Al2O3)의 층으로 덮힌다. 또 다른 구현예에서, 탄소 나노튜브 또는 탄소 나노튜브 그물은 전기적으로 절연되도록 구성된다.In another embodiment, in addition to or instead of layer II, a layer comprising carbon nanotubes, a carbon nanotube network, or a graphene network is provided in the stack. In one embodiment, such layer is covered, in one embodiment on all sides, with a layer of electrically insulating material (eg Al 2 O 3 ). In another embodiment, the carbon nanotubes or carbon nanotube nets are configured to be electrically insulating.

일 구현예에 있어서, 본 방법은, 제2 층(200) 대신에 또는 이에 추가하여, 탄소 나노튜브, 탄소 나노튜브 그물, 또는 그래핀 네트워크를 포함하는 적어도 하나의 하위층을 포함하는 층을 추가적으로 증착하는 단계를 포함한다.In one embodiment, the method further deposits, instead of or in addition to the second layer 200, a layer comprising at least one sublayer comprising carbon nanotubes, a carbon nanotube network, or a graphene network. It includes steps to:

일 구현예에 있어서, 탄소 나노튜브, 탄소 나노튜브 그물, 또는 그래핀 네트워크를 포함하는 하위층은 전기 절연 재료로 코팅된다.In one embodiment, the sublayer comprising carbon nanotubes, carbon nanotube networks, or graphene networks is coated with an electrically insulating material.

일 구현예에서, 층(300)은, 웨이퍼 또는 습기에 의한 가수분해와 같은 가수분해를 방지하는 최상층이다. 일 구현예에서, 층(300)은 배리어 층이다. 다른 구현예에서, 층(300)은 Nb2O5를 포함한다. 또 다른 구현예에서, 층(300)은 가수분해에 저항성인 추가 재료(예를 들어, TiO2 등, 또는 유기층, 예를 들어, 플루오로폴리머를 포함하는 MLD 층)를 포함한다. 일 구현예에 있어서, 최상층의 두께는 1 원자층 내지 20 ㎚, 또는 1 내지 20 ㎚의 범위이다. In one implementation, layer 300 is a top layer that prevents hydrolysis, such as hydrolysis by the wafer or moisture. In one implementation, layer 300 is a barrier layer. In another implementation, layer 300 includes Nb 2 O 5 . In another embodiment, layer 300 includes an additional material that is resistant to hydrolysis (eg, TiO 2 , etc., or an MLD layer comprising an organic layer, eg, a fluoropolymer). In one embodiment, the thickness of the top layer ranges from 1 atomic layer to 20 nm, or from 1 to 20 nm.

일 구현예에서, 층(300)은, ALD 공정 이후에 도포된 코팅에 화학적으로 접착하도록 구성된 최상층이다.In one implementation, layer 300 is a top layer configured to chemically adhere to a coating applied after an ALD process.

일 구현예에 있어서, 스택은, 층 I, II 및/또는 III 대신에 또는 그에 추가하여, 경질 층(hard layer)을 포함한다. 일 구현예에 있어서, 경질 층은 금속 산화물 층을 포함한다. 추가의 구현예에서, 경질 층은, 단일 또는 반복되는 스택에서, Al2O3, TiO2, Ta2O5, ZrO2, SiO2 , Nb2O5, WO3, HfO2, 또는 이들의 조합으로부터 선택된다. 바람직하게는, 경질 층은, Al2O3/TiO2 반복 스택(repeating stack), 즉 적층체(laminate)와 같은 반복 스택이다.In one embodiment, the stack includes a hard layer instead of or in addition to layers I, II and/or III. In one embodiment, the hard layer includes a metal oxide layer. In further embodiments, the hard layer, single or in repeated stacks, is Al 2 O 3 , TiO 2 , Ta 2 O 5 , ZrO 2 , SiO 2 , Nb 2 O 5 , WO 3 , HfO 2 , or these. are selected from combinations. Preferably, the hard layer is an Al 2 O 3 /TiO 2 repeating stack, ie a repeating stack, such as a laminate.

일 구현예에 있어서, 증착된 층(100 또는 200)의 층 I, II, III 중 적어도 하나는 의도적으로 구조체 내에 과량의 비율로 남겨진 반응성 화학물질을 포함한다. 대안적으로, 산화물 재료는 산소 비율을 감소시키기 위해 환원될 수 있다. 반응성 화학물질은 적어도 부분적으로 자기 치유 층(self-healing layer)을 제공한다. 반응성 화학물질은, 일 구현예에서, 주위 중의 공기 또는 수분과 반응하는 화학물질로부터 선택된다. 일 구현예에서, 반응성 화학물질은 예를 들어 TMA, 또는 환원된 Mg 또는 Ti를 포함한다.In one embodiment, at least one of layers I, II, and III of deposited layer 100 or 200 includes a reactive chemical that is intentionally left in excess proportion within the structure. Alternatively, the oxide material can be reduced to reduce the oxygen content. The reactive chemical provides at least a partially self-healing layer. The reactive chemicals, in one embodiment, are selected from chemicals that react with ambient air or moisture. In one embodiment, the reactive chemical includes, for example, TMA, or reduced Mg or Ti.

일 구현예에 있어서, 층들 중 적어도 하나는 주위(ambient)와 반응성인 적어도 하나의 반응성 화학물질을 포함한다.In one embodiment, at least one of the layers includes at least one reactive chemical that is reactive with the ambient.

일 구현예에서, 층 I, II 및 III 중 적어도 하나는 경질 층이다.In one embodiment, at least one of layers I, II and III is a hard layer.

일 구현예에 있어서, 기재는 Sn을 포함한다. Sn 함유 기재 상에 증착시키는 것은, 주석 휘스커 형성이 적어도 부분적으로 방지될 수 있기 때문에, 특히 유리하다. 또한, 일 구현예에 있어서, 기재는 Ag를 포함하는데, 이것은 하이브리드 전자장치에서 전형적으로 사용되며, 또한 이것은 쉽게 발생하는 일렉트로마이그레이션을 방지하는 것과 함께 주석 휘스커 보호의 이익을 얻는다. In one embodiment, the substrate includes Sn. Deposition on Sn-containing substrates is particularly advantageous because tin whisker formation can be at least partially prevented. Additionally, in one embodiment, the substrate comprises Ag, which is typically used in hybrid electronics, and which also benefits from tin whisker protection along with preventing electromigration that easily occurs.

일 구현예에 있어서, 본 방법은 고종횡비(high aspect ratio: HAR)로서의 ALD 코팅, 예를 들어 상이한 재료의 층들 사이의 또는 PCB 상의 구성부품들 아래의 결함들 또는 공동(cavity)을 채우기 위한 기공 코팅(pore coating)을 수행하는 단계를 포함한다. 이는 폴리머 패키지의 경우에 또는 PCB의 상이한 재료들 사이의 계면(예를 들어, 금속과, PCB 구성에 사용되는 다른 재료 사이의 계면)을 증착하는 경우에 바람직하다. 일 구현예에 있어서, 고종횡비의 증착은 최대 증착 온도보다 낮은 온도에서 수행된다. 이는, 열팽창으로 인해 고온에서 폐쇄되는 기공을 코팅하는데 바람직하다.In one embodiment, the method is a high aspect ratio (HAR) ALD coating, e.g., pores to fill defects or cavities between layers of different materials or beneath components on a PCB. It includes performing coating (pore coating). This is desirable in the case of polymer packages or when depositing interfaces between different materials of a PCB (eg, interfaces between metals and other materials used in PCB construction). In one implementation, high aspect ratio deposition is performed at a temperature below the maximum deposition temperature. This is desirable for coating pores that close at high temperatures due to thermal expansion.

일 구현예에 있어서, 포어-라인 흐름(fore-line flow)은 공지된 공정들로 변경되거나, 또는 정지 흐름 또는 제한된 흐름(피코플로우(PicoFlow)로 알려짐)이, 공동에서의 현저히 증가된 종횡비 코팅을 얻도록 하는, 그리고 코팅의 증가된 균일성을 얻도록 하는 코팅을 가능하게 하기 위해 사용된다.In one embodiment, the fore-line flow is modified by known processes, or stopped flow or restricted flow (known as PicoFlow) is used to achieve significantly increased aspect ratio coating in the cavity. It is used to enable a coating to obtain and to obtain increased uniformity of the coating.

일 구현예에서, 특정 폴리머(이것은 반응성 화학물질들 또는 그들의 금속 또는 리간드를 흡수할 수 있음)를 함유하는 기재 상에 증착시키는 경우, 저온 공정이, 전체 공정에 걸쳐 또는 공정 시작시에, 사용될 수 있으며, 예를 들어, 50 ℃ 이하의 온도가 고온(그에 따라, 더 빠른) 증착을 위한 확산 장벽을 증착하는데 사용된다.In one embodiment, when depositing on substrates containing certain polymers (which may absorb reactive chemicals or their metals or ligands), low temperature processes may be used throughout the entire process or at the start of the process. For example, temperatures below 50° C. are used to deposit diffusion barriers for higher temperature (and therefore faster) deposition.

일 구현예에 있어서, 증착된 스택의 전체 두께는, 기재에 기계적, 화학적 및 전기적 절연 특성을 제공하기에 충분한 두께이다. 일 구현예에 있어서, 스택의 높이는 1 내지 2000 nm, 바람직하게는 50 내지 500 nm, 가장 바람직하게는 100 내지 200 nm이다. 일 구현예에 있어서, 본 공정은 기재의 예열 및 세정을 포함하고, 후속적으로, ALD와 공형적으로(conformally) 적어도 하나의 원자 또는 분자 층의 증착을 포함한다.In one embodiment, the total thickness of the deposited stack is sufficient to provide mechanical, chemical and electrical insulating properties to the substrate. In one embodiment, the height of the stack is 1 to 2000 nm, preferably 50 to 500 nm, most preferably 100 to 200 nm. In one embodiment, the process includes preheating and cleaning of the substrate, followed by deposition of at least one atomic or molecular layer conformally with ALD.

일 구현예에 있어서, 증착의 공정 온도는 기재가 견딜 수 있는 최대 온도에 해당하도록 선택된다. 일 구현예에 있어서, 공정 온도는 상기 최대 온도가 아니라, 그러한 최대 온도보다 낮은 온도이다. 우주항공분야 적용을 위한 PCB의 경우, 공정 온도는 125 ℃일 수 있다. 또 다른 구현예에서, 공정 온도는 선택된 압력에서 물의 끓는점보다 높으며, 그에 따라, 표면에서의 흡수(absorption) 및 응축(condensation)을 방지할 수 있다. In one embodiment, the process temperature of deposition is selected to correspond to the maximum temperature that the substrate can withstand. In one embodiment, the process temperature is not the maximum temperature, but a temperature below that maximum temperature. For PCBs for aerospace applications, the process temperature can be 125 °C. In another embodiment, the process temperature is above the boiling point of water at the selected pressure, thereby preventing absorption and condensation at the surface.

일 구현예에서, 기재는 PCB이고, 본 방법은, 리플로우(reflow)라고도 알려진, 솔더 용융 온도보다 높은 온도에서의 솔더링 단계를 포함한다. 이것은 솔더에 기포가 없는 구조를 제공하는데 유리하며, 또는 진공 상태에서 PCB를 제조하는 경우에 유리하다.In one embodiment, the substrate is a PCB and the method includes a soldering step at a temperature above the solder melt temperature, also known as reflow. This is advantageous in providing a bubble-free structure in the solder, or when manufacturing PCBs in a vacuum.

일 구현예에 있어서, 공정 온도는 솔더링 온도보다 낮지만, ALD 공정의 도움으로, 솔더링 입자 또는 구(sphere)가 함께 부착되는 방식으로 솔더링 효과가 발생한다. 이는 기재에 대한 그리고 구성부품에 대한 접착(adherence)에 추가적으로 적용할 수 있다. 또한, ALD 공정이 솔더를 통한 최종 부착을 일으키기에 불충분할 수 있지만, 솔더링 단계가, ALD 공정 후에, ALD 툴의 내부 또는 외부에서, 수행된다. In one embodiment, the processing temperature is lower than the soldering temperature, but with the help of the ALD process, the soldering effect occurs in such a way that the soldering particles or spheres adhere together. This can additionally apply to adherence to substrates and to components. Additionally, a soldering step is performed after the ALD process, either inside or outside of the ALD tool, although the ALD process may be insufficient to produce final attachment via solder.

일 구현예에 있어서, 기재는 증착되기 전에 부분적으로 마스킹되어, 증착된 스택에 개구부를 제공한다.In one implementation, the substrate is partially masked prior to deposition to provide openings in the deposited stack.

일 구현예에 있어서, 목적하는 두께의 스택이 기재 상에 직접 증착될 수 있다. 스택 층들은 동일한 ALD 반응기에서 또는 추가 ALD 반응기(들)에서 증착된다.In one implementation, a stack of the desired thickness can be deposited directly on the substrate. Stack layers are deposited in the same ALD reactor or in additional ALD reactor(s).

스택의 증착들은 제품의 제조 단계들을 형성할 수 있거나, 또는 생산 라인의 일부가 되도록 통합될 수 있다.Depositions of the stack can form manufacturing steps for a product, or can be integrated to become part of a production line.

도 1은 본 발명의 일 구현예에 따른 방법의 흐름도를 보여준다. 단계 1에서, 증착용으로 의도된 기재가 제공된다. 기재는 앞에서 설명된 그리고 뒤에서 설명될 바와 같은 기재를 포함한다. 단계 2에서, 기재는 ALD 반응기에 기재를 삽입 또는 적재하기 전에 또는 기재가 ALD 반응기에 삽입된 후에 전처리(예를 들어, 세척, 세정 또는 예열)된다. 1 shows a flow chart of a method according to one embodiment of the present invention. In Step 1, a substrate intended for deposition is provided. The description includes those described above and as will be described later. In Step 2, the substrate is pretreated (e.g., washed, cleaned, or preheated) prior to inserting or loading the substrate into the ALD reactor or after the substrate is inserted into the ALD reactor.

PEALD와 ALD 공정은 둘 다, PEALD 화학물질의 플라즈마를 사용하여 또는 ALD 공정에 적용 가능한 기체상태의 화학물질 또는 다수의 화학물질들을 사용하여, 코팅 전에 표면을 세정하는데 사용될 수 있다. Both PEALD and ALD processes can be used to clean the surface prior to coating, using a plasma of PEALD chemicals or using a gaseous chemical or multiple chemicals applicable to the ALD process.

일 구현예에 있어서, 샘플의 전처리는, 샘플을 ALD 반응기에 삽입하기 전에, 이를 세정하기 위한 다양한 단계들(예를 들어, 용매로 세척하는 것 또는 송풍(blowing))을 포함한다. 일 구현예에 있어서, 세정에 사용되는 유체는 세정의 목적(예를 들어, 이온 오염 및/또는 먼지와 같은 느슨한 입자를 제거하는 것)에 따라 선택된다.In one embodiment, pretreatment of the sample includes various steps to clean the sample (e.g., washing with a solvent or blowing) prior to inserting the sample into the ALD reactor. In one embodiment, the fluid used for cleaning is selected depending on the purpose of the cleaning (eg, removing ionic contamination and/or loose particles such as dust).

ALD 반응기에서의 세정과 더불어, 추가의 표면 세정 방법은 센(hard) 루이스 산 또는 센(hard) 루이스 염기에 의한 세정을 포함한다. 일 구현예에 있어서, 세정은, 예를 들어, NH3, HMDS, H2, O2, O3 및/또는 TMA를 사용하는 세정을 포함한다. 추가 구현예에서, 세정은 PEALD의 도움으로 행해지며, 이때, PEALD의 플라즈마는 더욱더 효과적인 세정을 가능하게 한다.In addition to cleaning in the ALD reactor, additional surface cleaning methods include cleaning with hard Lewis acids or hard Lewis bases. In one embodiment, cleaning includes cleaning using, for example, NH 3 , HMDS, H 2 , O 2 , O 3 and/or TMA. In a further embodiment, cleaning is carried out with the aid of PEALD, where the plasma of PEALD allows for even more effective cleaning.

일 구현예에 있어서, 세정은 가열된 H2 또는 O2 또는 O3를 사용하는 것을 포함한다.In one embodiment, cleaning includes using heated H 2 or O 2 or O 3 .

또한, 일 구현예에 있어서, 환원성 세정은 H2를 사용하여, 또는 기체 상태에서(특히, ALD 공정에서) 유사한 효과(2-메틸-1,4-비스(트리메틸실릴)-2,5-사이클로헥사디엔 또는 1,4-비스(트리메틸실릴)-1,4-디하이드로피라진에 대해 보고된 바와 같은 효과)를 갖는 화학물질을 사용하여 수행된다.Additionally, in one embodiment, reductive cleaning is performed using H 2 or in the gas phase (particularly in ALD processes) with a similar effect (2-methyl-1,4-bis(trimethylsilyl)-2,5-cyclo This is done using chemicals with the same effect as reported for hexadiene or 1,4-bis(trimethylsilyl)-1,4-dihydropyrazine.

따라서, 일 구현예에 있어서, 세정은, 표면을 안정화시키고 이 안정화에 이어 환원성 가스 펄스를 제공하는 공정에 의해 달성되며, 이때, 상기 펄스는 예를 들어 H2, H2 함유 플라즈마, SO3, 또는 Al(CH3)3을 포함할 수 있다. 이는 본 명세서에서 시작 펄스라고 지칭되는데, 이 시작 펄스는 안정화 후에 반응 챔버 내로 방출되는 반응성 재료의 실질적인 첫 번째 펄스이다. 또한, 그 효과를 강화하기 위해, 환원성 화학물질 펄스들은 간격을 두고 서로 이어지도록(적어도 0.01 초의 지연 후에 한 번씩 이어지도록) 하는 것이 바람직하다. 더욱 바람직하게는, 환원성 화학물질 펄스들은 적어도 5 회, 이들 사이에 5 초의 지연이 포함되도록, 반복되며, 그 후에, ALD 조건에서 재료를 증가시키기 위해, 생성된 표면 상에서 화학 반응이 부가된다. Accordingly, in one embodiment, cleaning is achieved by a process of stabilizing the surface and providing a reducing gas pulse following the stabilization, wherein the pulse includes, for example, H 2 , a H 2 -containing plasma, SO 3 , Or it may include Al(CH 3 ) 3 . This is referred to herein as the starting pulse, which is effectively the first pulse of reactive material released into the reaction chamber after stabilization. Additionally, to enhance the effect, it is preferred that the reducing chemical pulses follow each other at intervals (once after a delay of at least 0.01 seconds). More preferably, the reducing chemical pulses are repeated at least five times, with a delay of 5 seconds between them, after which a chemical reaction is added on the resulting surface to increase the material in ALD conditions.

일 구현예에 있어서, 세정은 ALE 펄스들을 포함한다. 일 구현예에 있어서, 원자층 식각(Atomic Layer Etching: ALE)은 세정의 대안으로서 또는 세정에 추가하여 사용되며, 그에 따라, 표면으로부터 또는 바람직하게는 특정 분자 조성을 갖는 결정 경계(crystal boundary)로부터 불순물을 식각할 수 있다. ALE 공정에서, 표면에서는, 역전된 ALD로서 적어도 두 단계의 사이클들에서, 가능하게는 선택적으로(selectively) 그리고 가능하게는 선호되는 화학물질들 만이 제거된다.In one implementation, cleaning includes ALE pulses. In one embodiment, Atomic Layer Etching (ALE) is used as an alternative to or in addition to cleaning, thereby removing impurities from the surface or, preferably, from crystal boundaries with a specific molecular composition. can be etched. In the ALE process, only preferred chemicals are removed from the surface, possibly selectively and possibly in at least two stages of cycles as reversed ALD.

샘플이 ALD 반응기에 삽입된 후, 일 구현예에 있어서, 추가의 전처리 단계(예를 들어, "인시투(in-situ)" 세정 단계)가 수행된다. 일 구현예에 있어서, 전처리는 저온(예를 들어, 125 ℃)에서의 저온 연소(예를 들어, O2, O3 또는 H2에 의한)에 의한 표면 세정을 포함하거나, 또는 반응기 공간의 온도보다 높은 온도의 가스를 사용한 표면 세정을 포함한다. 일 구현예에 있어서, 전처리는 불활성 가스 또는 화학물질 가스를 사용하는 다양한 압력 및 온도에서의 헹굼(rinse)을 포함한다. 일 구현예에 있어서, 표면은 가열된 가스 펄스에 노출(예를 들어, "연소", 산화 또는 환원)되거나, 또는 화학 반응이 상단부 표면 상에서 유도된다.After the sample is inserted into the ALD reactor, in one embodiment, additional pretreatment steps (e.g., an “in-situ” cleaning step) are performed. In one embodiment, the pretreatment includes cleaning the surface by low temperature combustion (e.g. with O 2 , O 3 or H 2 ) at low temperature (e.g. 125° C.), or by reducing the temperature of the reactor space. Includes surface cleaning using higher temperature gases. In one embodiment, pretreatment includes rinsing at various pressures and temperatures using inert or chemical gases. In one embodiment, the surface is exposed to a pulse of heated gas (eg, “combusted,” oxidized or reduced), or a chemical reaction is induced on the top surface.

가열된 가스는 표면 재료에(즉, 표면 재료의 마이크로- 또는 나노미터 두께 범위의 최상층에) 열처리를 제공하기 위해 사용되는데, 그러한 표면 재료는, 그렇지 않으면, 상승된 온도에 대한 장시간 노출을 견딜 수 없을 것이다. 또한, 가열된 가스 펄스를 사용함으로써 열처리를 표면에만 제공할 수 있으며, 이는 열에 민감한 기재를 사용할 때 바람직하다. 부가적으로, 솔더의 외층은, 일 구현예에 있어서, 구성부품을 손상시키거나 분리시키지 않고 이러한 방식으로 재용융된다. 이로 인해, 강철 제조 단계와 유사한 방식으로 합금 결정에 영향을 줄 수 있는 어닐링 효과가 발생한다. 일 구현예에 있어서, 전체 기재의 온도 증가는 금속의 실제 용융 온도보다 낮다.Heated gases are used to provide a heat treatment to a surface material (i.e., to the top layer in the micro- or nanometer thickness range of the surface material) such that such surface material could not otherwise withstand prolonged exposure to elevated temperatures. There won't be. Additionally, by using heated gas pulses, heat treatment can be applied only to the surface, which is desirable when using heat-sensitive substrates. Additionally, the outer layer of solder, in one embodiment, is remelted in this manner without damaging or separating the components. This results in an annealing effect that can affect the alloy crystals in a similar way to the steel manufacturing steps. In one embodiment, the temperature increase of the entire substrate is below the actual melting temperature of the metal.

일 구현예에 있어서, 열 펄스는, 사용된 가스, 반응 챔버 온도, 사용된 가스 유량 및 다른 가스 유량에 따라, 0.01 내지 100 초와 같은 특정 시간 동안 열 펄스를 제공함으로써 수행된다. 또 다른 구현예에서, 열 펄스 가스의 온도는, 가스를 고온, 예를 들어 1,000 ℃까지 가열하도록 구성된 가열된 가스 유입에 의해 상승된다. 펄스 질량 흐름은, 일 구현예에 있어서, 그 시간에 반응기로 유입되는 다른 가스 흐름 또는 흐름들에 비해, 더 작거나(예를 들어, 0.1 내지 50 sccm), 동등하거나(예를 들어, 20 내지 500 sccm), 또는 상당히 더 클 것이다(예를 들어, 200 내지 20,000 sccm). 조합되어 또는 개별적으로, 그러한 상이한 온도의 가스 흐름들은, 일 구현예에 있어서, 코팅된 재료들을 균등하게 냉각시키는데 사용되며, 그에 따라, 개별적으로 또는 조합되어, 코팅된 재료들의 표면 야금학적 개질을 가능하게 한다. 이는 통상적으로 강철 가공 분야에서 알려져 있지만, 그것은 벌크의 경우이고, 그에 따라, 사용되는 금속에 의존적이다. 이는 유사한 어닐링 효과를 가져오는데, 이 어닐링 효과는 강철 제조 단계에서와 같은 방식으로 합금 결정에 영향을 미칠 수 있다.In one embodiment, the heat pulse is performed by providing the heat pulse for a specific time, such as 0.01 to 100 seconds, depending on the gas used, reaction chamber temperature, gas flow rate used, and other gas flow rates. In another embodiment, the temperature of the heat pulse gas is raised by a heated gas introduction configured to heat the gas to a high temperature, for example 1,000°C. The pulsed mass flow, in one embodiment, is smaller (e.g., 0.1 to 50 sccm), or equivalent (e.g., 20 to 20 sccm) compared to the other gas flow or flows entering the reactor at that time. 500 sccm), or significantly larger (e.g., 200 to 20,000 sccm). Such different temperature gas flows, in combination or individually, are, in one embodiment, used to uniformly cool the coated materials, thereby allowing, individually or in combination, surface metallurgical modification of the coated materials. Let it be done. This is commonly known in the field of steel processing, but it is a bulk case and therefore dependent on the metal used. This results in a similar annealing effect, which can affect the alloy crystals in the same way as in the steel manufacturing stage.

또한, 일 구현예에 있어서, 반응기는 코팅된 기재들의 온도를 측정하도록 배열된 하나 이상의 광학 또는 접촉 센서(들)을 갖도록 구현된다.Additionally, in one embodiment, the reactor is implemented with one or more optical or contact sensor(s) arranged to measure the temperature of the coated substrates.

또 다른 구현예에서, 전처리는 ALD 반응기에서 배출(evacuating)에 의해 수행된다. 다른 구현예에서, 배출 단계(evacuating step)는, 표면의 어닐링을 유발하기 위해, 질소와 같은 불활성 가스 분위기에서의 가열을 수반한다.In another embodiment, pretreatment is performed by evacuating the ALD reactor. In another embodiment, the evacuating step involves heating in an inert gas atmosphere, such as nitrogen, to cause annealing of the surface.

일 구현예에 있어서, 증착 단계에서, 앞에서 및 뒤에서 언급된 바와 같이, 스택은 ALD에 의해 기재 상에 증착된다.In one embodiment, in the deposition step, the stack is deposited on the substrate by ALD, as mentioned above and below.

또한, 용도에 따라, 일 구현예에서, 도포된 ALD 층은 추가의 코팅 방법에 의해 추가적으로 코팅되며, 예를 들어 래커에 의해, 예를 들어 향상된 기계적 내구성을 위해, 코팅될 수 있다. 또한, ALD 층은 딥-코팅 공정(이 공정은, 본 발명이 아니라면, 예를 들어 사용된 용매로 인해 PCB 구조에 해를 끼칠 수 있음)에 의한 추가 코팅을 가능하게 하며, 그에 따라, ALD 층은 그러한 새로운 공정의 적용을 가능하게 한다. 추가 코팅이 적용되지 않아도 되므로, 다른 코팅들 대비 ALD 단독의 이점은, ALD 층이 통상적으로 ~100 nm 두께를 공형적으로(conformally) 갖기 때문에, 코팅된 물체의 질량 또는 치수가 크게 증가하지 않는다는 것이다.Furthermore, depending on the application, in one embodiment, the applied ALD layer can be additionally coated by a further coating method, for example with a lacquer, for example for improved mechanical durability. In addition, the ALD layer allows for further coating by a dip-coating process (which, if not according to the invention, could harm the PCB structure, for example due to the solvents used), thereby allowing the ALD layer makes the application of such new processes possible. The advantage of ALD alone over other coatings is that since no additional coatings need to be applied, the mass or dimensions of the coated object do not increase significantly, since the ALD layer is typically ~100 nm thick conformally. .

도 2는 본 방법을 사용하여 증착된 기재 상에 증착된 스택의 구현예들의 개략도이다. 기재(10)에는 적층된 층들(100, 200 및 300)이 증착된다. 층(100)은 기재에 대한 계면에 있으며, 여기서는, Al2O3와 같은 하나의 증착된 재료를 지칭하고 있다. 층(200)은 단일층 또는 하위층들(예를 들어, I, II, II, III 및 IV, 또는 이들의 조합)로 이루어지며, 이들 중 적어도 하나는 탄성이거나, 또는 탄소, 유기 재료 또는 실리콘 폴리머의 가교된 사슬들을 함유한다. 일 구현예에서, 층(200)은 적어도 하나의 하위층 I, II, III 및 IV의 임의의 수의 조합 또는 반복으로 이루어진다.Figure 2 is a schematic diagram of embodiments of a stack deposited on a substrate deposited using the present method. Stacked layers 100, 200, and 300 are deposited on the substrate 10. Layer 100 is at the interface to the substrate, and herein refers to a single deposited material, such as Al 2 O 3 . Layer 200 consists of a single layer or sublayers (e.g., I, II, II, III, and IV, or combinations thereof), at least one of which is elastic, or is a carbon, organic material, or silicone polymer. It contains cross-linked chains. In one implementation, layer 200 consists of any number of combinations or repetitions of at least one sublayer I, II, III, and IV.

300은 가수분해와 같은 표면 화학 반응으로부터 보호하는 기능을 갖는 표면층이다. 대안적으로 또는 부가적으로, 그것은, ALD 공정 후에 첨가되는 유기물(래커와 같은)의 가능한 층과 화학적으로 접착하도록 적응된 화학물질을 함유할 수 있다.300 is a surface layer that has the function of protecting against surface chemical reactions such as hydrolysis. Alternatively or additionally, it may contain chemicals adapted to chemically adhere to possible layers of organic matter (such as lacquer) added after the ALD process.

도 2는 본 방법을 사용하여 증착된 기재 상에 증착된 스택의 구현예들의 개략도를 보여준다. 기재(10)에는 적층된 층들(100, 200 및 300)이 증착된다. 제1 층의 다양한 구현예들을 왼쪽에 나타냈다. 층(200-I)은 층(200)의 일 구현예이며, 단층의 층(I)만이 표면 상에 증착되는 구현예를 예시한다. 층(200-I-II)은 층(200)의 일 구현예로서, 여기서는, 층(200)이 층들(I 및 II)(이들은 하위층들(210 및 220)에 각각 대응하며, 앞에서 정의된 바와 같음)에 의해 형성되는 구현예를 도시한다. 층(200-I-II-III)은 층(200)의 일 구현예로서, 층(200)이 층들(I, II 및 III)(이들은 하위층들(210, 220, 및 230)에 각각 대응하며, 앞에서 정의된 바와 같음)에 의해 형성되는 구현예를 예시한다. 일 구현예에 있어서, 구조 200-I-II 및 200-I-II-III에서, 이러한 층상 구조는 적어도 2회 반복된다(도 2에서 미도시).Figure 2 shows a schematic diagram of embodiments of a stack deposited on a substrate deposited using the present method. Stacked layers 100, 200, and 300 are deposited on the substrate 10. Various implementations of the first layer are shown on the left. Layer 200-I is one implementation of layer 200 and illustrates an implementation in which only a single layer of layer I is deposited on the surface. Layer 200-I-II is one implementation of layer 200, where layer 200 is divided into layers I and II, which correspond to sublayers 210 and 220, respectively, as defined above. shows an implementation example formed by (same as). Layer 200-I-II-III is one implementation of layer 200, wherein layer 200 corresponds to layers I, II, and III, which correspond to lower layers 210, 220, and 230, respectively. , as defined above) illustrates an implementation example formed by: In one embodiment, in structures 200-I-II and 200-I-II-III, this layered structure is repeated at least twice (not shown in Figure 2).

기재가 PCB이고, 본 방법이 PCB 또는 그것을 사용하는 장치의 제조 공정 중에 사용되는 경우, 층상 구조 스택이 상기 기재 상에 형성된다. 스택은 보호 기능을 제공하고, PCB에서 주석 휘스커 형성을 방지함으로써, 사용 중에 부식 및 손상에 대한 저항력과 품질을 향상시킬 수 있다.When the substrate is a PCB and the method is used during the manufacturing process of the PCB or a device using the same, a layered structure stack is formed on the substrate. The stack provides protection and prevents tin whisker formation on the PCB, improving its quality and resistance to corrosion and damage during use.

층들(100 내지 300)은 ALD 반응기에서 통상적인 방식으로 증착된다. 층들(100, 200 및 300)은 기재의 상단에 ALD에 의해 증착된다.Layers 100-300 are deposited in a conventional manner in an ALD reactor. Layers 100, 200 and 300 are deposited by ALD on top of the substrate.

세정을 제외한 최소 스택의 예는 다음과 같다:An example of a minimal stack excluding cleaning is:

x(TMA + H2O), 여기서, x는, 사용되는 온도에서, 요구되는 층 두께를 생성하는 데 필요한 사이클 수이다(예를 들어, 125 ℃에서 x = 1000). 이것은 층(I)을 나타낸다. x (TMA + H 2 O), where x is the number of cycles required to produce the required layer thickness, at the temperature used (eg x = 1000 at 125°C). This represents layer (I).

스택의 다른 예는 다음과 같다:Other examples of stacks include:

z{x(TMA+H2O) + y(TMA+에틸글리콜)}, 여기서, a, y 및 z의 비율은 요구되는 기계적 특성을 개질하기 위해 조정될 수 있으며, 여기서 x, y 및 z는 동일하거나 상이하고 및/또는 1보다 크다. 이것은 층들(I 및 II)을 나타낸다. 선택적으로(optionally), 층(II)은 단지 층(I) 이외의 임의 것이다. z { _ _ is different and/or greater than 1. This represents layers (I and II). Optionally, layer (II) is anything other than just layer (I).

스택의 또 다른 예는 다음과 같다: Another example of a stack is:

z{x(TMA+H2O) + y(TMA+에틸글리콜)} + n(Nb(OEt)5 + H2O), 여기서, Nb 함유층은 가수분해되기 매우 어려운 층을 생성한다. 이것은 층들(II(a), II(b) 및 III)을 나타내며, 여기서, II(a)의 첫번째 출현은 사실상 층(I)이다. z { _ _ _ _ _ It represents layers II(a), II(b) and III, where the first occurrence of II(a) is in fact layer I.

명확히 하자면, 층(200)은 임의의 수의 하위층들(II)로 이루어질 수 있다(예들 들어, y(TMA+에틸글리콜) 또는 적층된 x(TMA+H2O) + y(TMA+에틸글리콜).For clarity, layer 200 may consist of any number of sublayers (II) (e.g., y (TMA+ethylglycol) or stacked x (TMA+H 2 O) + y (TMA+ethylglycol).

스택의 또 다른 예는, TMA + H2O로부터 생성된 Al2O3 층이 산화물(예를 들어, TiO2 내지 Al2O3 + TiO2의 변형의 조합)로 대체된 스택이다. TiCl4가 TiO2의 전구체로 고려되는 경우에는, 다음과 같은 구조가 생성될 수 있거나:Another example of a stack is a stack in which the Al 2 O 3 layer resulting from TMA + H 2 O is replaced by an oxide (eg, a combination of variations from TiO 2 to Al 2 O 3 + TiO 2 ). If TiCl 4 is considered as a precursor for TiO 2 , the following structures can be produced or:

(TMA + H2O) -> (TMA + H2O) + (TiCl4 + H2O)(TMA + H 2 O) -> (TMA + H 2 O) + (TiCl 4 + H2O)

또는, 다음과 같은 방식의 임의의 조합의 구조가 생성될 수 있다:Alternatively, any combination of structures may be created in the following manner:

z{x(TMA+H2O) + n(TiCl4+H2O) + y(TMA+에틸글리콜) + } + m(TMA+H2O) z { x (TMA+H 2 O) + n (TiCl 4 +H 2 O) + y (TMA+ethyl glycol) + } + m (TMA+H 2 O)

여기서, m 및 n은 동일하거나 상이하고 및/또는 1보다 크다.where m and n are the same or different and/or greater than 1.

또 다른 예는 TMA + 에틸글리콜(통상적으로 AB로 알려져 있음)이며, 이는 TMA + 에틸글리콜 + H2O(ABC)로 대체될 수 있으며, 여기서 첨가된 물은 미반응 TMA와 반응하도록 의도된 것이다. 층(II)은 AB 또는 ABC를 함유할 수 있다.Another example is TMA + ethyl glycol (commonly known as AB), which can be replaced by TMA + ethyl glycol + H 2 O (ABC), where the added water is intended to react with the unreacted TMA. . Layer (II) may contain AB or ABC.

도 4a 및 도 4b에 도시된 바와 같이, 본 발명의 제1 측면의 일 구현예에 따라, 적층된 Al2O3 및 알루콘으로 만들어진 ALD 코팅은, 대기 조건 저장(ambient storage)에서 6개월 후에도 필라멘트 형태의 주석 휘스커 성장을 방지할 수 있다. 샘플들은 구리 위에 ~2μm SnCu를 전기도금함으로써 제조되었으며, 이 샘플들은 가속된 속도에서 자발적으로 주석 휘스커를 생성하도록 의도되었다. ALD 코팅의 두께는 ~500 nm이었다: Al2O3 + 19*(Al2O3 + 알루콘) + Al2O3. ALD 코팅은 초기 금속 코팅의 4일 후에 이루어졌으며, 이때 왼쪽에 표시된 구조물이 이미 보였다. 이 구조는 100, 200 및 300의 스택을 의미하며, 여기서 100과 300은 동일한 재료이다.4A and 4B, according to one embodiment of the first aspect of the invention, an ALD coating made of laminated Al 2 O 3 and alucon remains even after 6 months in ambient storage. It can prevent the growth of filament-shaped tin whiskers. The samples were fabricated by electroplating ~2μm SnCu on copper, and these samples were intended to spontaneously generate tin whiskers at accelerated rates. The thickness of the ALD coating was ~500 nm: Al 2 O 3 + 19*(Al 2 O 3 + alucon) + Al 2 O 3 . The ALD coating took place 4 days after the initial metal coating, by which time the structures shown on the left were already visible. This structure implies stacks of 100, 200 and 300, where 100 and 300 are the same material.

또 다른 구현예에서, PCB상의 ALD(MLD 및 ALE 포함) 성장은 몇몇 위치에서 차단되는데, 이러한 차단은 의도된 합금 표면에만(예를 들어, 솔더 상에는 증착되되, 유전체 재료 상에는 증착되지 않도록) 증착하기 위한 특정 화학 및 공정을 사용함으로써 이루어질 수 있다. 이러한 표적화된 증착은 원하지 않은 장소(예를 들어, 유전체)에서의 성장을 차단함으로써 가능해질 수 있는데, 이러한 차단은, 통상적으로 ALD 성장 억제제로 알려져 있는 화학물질의 도움으로 이루어질 수 있으며, 이때, ALD 성장 억제제는 특정 실란의 자기 조립 단일층(self-assembly monolayer)과 같은 재료를 포함한다. 반응기 내부 또는 외부에서, 이러한 억제 코팅의 화학적 성질은, 예를 들어, 그것이 솔더를 코팅하지 않도록 맞춤될 수 있다. 그러한 특정 코팅은, 예를 들어, 가능하게는 전도성인 층의 박막에 의한 솔더 표면 코팅을 가능하게 하는데, 이는, 일부 경우에 있어서, 솔더의 표면 장력을 변화시키는데 바람직할 수 있다. 따라서, 명백하게도, 표면 장력이 전기적 표면 절연을 손상시키지 않고 변화될 수 있다면, 본 명세서에 제시된 패터닝은 마스크(mask) 또는 마킹(marking)과 함께 적용될 필요가 없다.In another embodiment, ALD (including MLD and ALE) growth on a PCB is blocked at several locations by depositing only the intended alloy surface (e.g., depositing on the solder but not on the dielectric material). This can be achieved by using specific chemistries and processes. Such targeted deposition can be made possible by blocking growth in undesirable locations (e.g., the dielectric), which can be achieved with the help of chemicals commonly known as ALD growth inhibitors. Growth inhibitors include materials such as self-assembly monolayers of certain silanes. Inside or outside the reactor, the chemistry of this inhibitory coating can be tailored, for example, so that it does not coat the solder. Such specific coatings enable, for example, coating of the solder surface with a thin film of a possibly conductive layer, which in some cases may be desirable to change the surface tension of the solder. Therefore, clearly, if the surface tension can be varied without damaging the electrical surface insulation, the patterning presented herein need not be applied with a mask or marking.

도 3은 ALD 반응기 시스템(700), 즉 예시적 구현예에 따른 반응기 및 그의 제어 시스템을 도시한다. 일 구현예에 있어서, ALD 반응기는 반응 챔버를 포함하며, 거기에서, 기재(예를 들어, PCB, 반제품 조립체 또는 구성부품 보드 조립체)는 적절한 방식으로 적재될 수 있으며, 예를 들어, 반응기는, 생산 라인이 ALD 반응기를 통해 이동할 수 있도록, 생산 라인에 통합될 수 있다. 전구체 공급원 또는 공급원들은, 일 구현예에서, 공급물 투입부(in-feed part)를 통해 반응기의 반응 챔버와 유체연통하도록 제공된다. 반응 챔버로부터의 반응 잔류물은 진공 펌프를 통해 배출 라인, 즉 포어-라인(fore-line) 내로 펌핑될 수 있다. ALD 반응기는, 본 명세서에 기술된 방법 단계들 사이의 세정을 모니터링하기 위한 수단에 유체 연결될 수 있다.3 shows an ALD reactor system 700, a reactor and its control system according to an example implementation. In one embodiment, an ALD reactor comprises a reaction chamber, in which a substrate (e.g., a PCB, semi-finished assembly, or component board assembly) can be loaded in a suitable manner, for example, the reactor: It can be integrated into a production line, allowing the production line to move through the ALD reactor. The precursor source or sources, in one embodiment, is provided in fluid communication with the reaction chamber of the reactor via an in-feed part. The reaction residue from the reaction chamber can be pumped into the discharge line, ie fore-line, via a vacuum pump. The ALD reactor may be fluidly connected to means for monitoring cleaning between method steps described herein.

일 구현예에 있어서, 시스템은 충분한 탈기, 및/또는 건조, 및/또는 기재에 대한 반응성 화학물질의 투여를 표시하도록 구성된 측정 수단(708)을 포함한다. 일 구현예에서, 그러한 수단은 예를 들어 질량 분광계 및/또는 광학 수단을 포함하며, 이때, 이들은, 반응기 내부로부터, 포어-라인으로부터, 또는 펌프 이후에, 반응기로부터 유출되는 가스들의 화학적 성분(chemical content) 또는 특성(signature)) 또는 압력을 측정하도록 구성된다. 이 시스템은 통상적으로 잔류 가스 분석기(Residual Gas Analyzer, RGA)로 알려져 있다. 일 구현예에 있어서, RGA(708)는 제어 수단(702) 또는 HMI(706) 또는 별도의 사용자 인터페이스와 통신하도록 구성됨으로써, 반응기로부터 나온 가스들의(또는, 포어-라인(710) 가스들의) 화학적 또는 원소 성분 또는 특징(fingerprint) 및 이들의 농도를 나타낼 수 있다. 고품질 ALD 반응의 경우, 예를 들어, 모든 반응성 가스를, 예를 들어 1000 분의 1부 미만으로, 더욱 바람직하게는 1 PPM 미만의 양으로 감소되도록, 씻어내는(flushed out) 것이 중요하다. 일 구현예에서, RGA(708)는 반응 챔버로부터의 모든 유출 가스를 샘플링하는데 사용된다. 추가 구현예에서, RGA는, 우주항공 응용 분야에서 요구되는 기재(들)의 대기(ambient) 조건, 가열 조건 또는 화학적 노출 조건에서, 유출 가스의 양 및 품질을 정량화하는데 사용된다. In one embodiment, the system includes measurement means 708 configured to indicate sufficient degassing, and/or drying, and/or administration of reactive chemicals to the substrate. In one embodiment, such means include, for example, mass spectrometers and/or optical means, which determine the chemical composition of the gases leaving the reactor, either from within the reactor, from the fore-line, or after the pump. It is configured to measure content or signature or pressure. This system is commonly known as a Residual Gas Analyzer (RGA). In one implementation, RGA 708 is configured to communicate with control means 702 or HMI 706 or a separate user interface to determine the chemical properties of gases from the reactor (or of fore-line 710 gases). Alternatively, it may indicate elemental components or fingerprints and their concentrations. For high quality ALD reactions, it is important, for example, to flush out all reactive gases, for example reduced to less than one part per thousand, more preferably less than 1 PPM. In one implementation, RGA 708 is used to sample all effluent gases from the reaction chamber. In a further embodiment, RGA is used to quantify the quantity and quality of effluent gases under ambient conditions, heating conditions, or chemical exposure conditions of the substrate(s) required in aerospace applications.

일 구현예에 있어서, 포어-라인(710)은 바람직하지 않은 입자 발생을 실질적으로 방지하거나 적어도 현저히 감소시키기 위한 가열 수단을 포함한다. 가열 수단은 일 구현예에 있어서 포어-라인(710)의 진공 감소 밸브의 상류에 배치된다.In one embodiment, the fore-line 710 includes heating means to substantially prevent or at least significantly reduce the generation of undesirable particles. The heating means is arranged upstream of the vacuum reducing valve in the fore-line 710 in one embodiment.

일 구현예에 있어서, ALD 반응기 시스템(700)은, 적어도 500 ℃의 온도까지, 다른 가스 입구들과는 별도로 가열되도록 구성된 적어도 하나의 추가 가스 입구를 포함한다.In one implementation, ALD reactor system 700 includes at least one additional gas inlet configured to be heated separately from the other gas inlets, to a temperature of at least 500° C.

일 구현예에 있어서, 적어도 하나의 추가 가스 입구는 세라믹 재료, 금속, 또는 세라믹 재료로 코팅된 금속으로 제조된다.In one embodiment, the at least one additional gas inlet is made of ceramic material, metal, or metal coated with ceramic material.

일 구현예에 있어서, 적어도 하나의 추가 가스 입구는 반응기의 중간 공간(intermediate space)에서 가열되도록 구성된다.In one embodiment, at least one additional gas inlet is configured for heating in the intermediate space of the reactor.

일 구현예에 있어서, ALD 반응기 시스템(700)은 H2, O2 및/또는 O3를 펄싱(pulsing)할 수 있도록 구성된 가스 입구들을 포함한다.In one implementation, ALD reactor system 700 includes gas inlets configured to pulse H 2 , O 2 and/or O 3 .

일 구현예에 있어서, ALD 반응기 시스템(700)은 반응 챔버 온도보다 높은 열을 견디도록 구성된 가스 입구들을 포함한다.In one implementation, ALD reactor system 700 includes gas inlets configured to withstand heat above the reaction chamber temperature.

일 구현예에 있어서, ALD 반응기 시스템(700)은 반응기 공간과 비교하여 적어도 100 ℃의 온도차를 갖는 가스 펄스를 가능하게 하도록 구성된 가스 입구들을 포함한다.In one implementation, ALD reactor system 700 includes gas inlets configured to enable gas pulses with a temperature difference of at least 100 degrees Celsius compared to the reactor space.

중간 공간(intermediate space)은 ALD 반응기의 내부 부분으로서, 주위 압력보다 낮은 압력으로 평가되고 및/또는 불활성 가스로 채워지고, 또한 반응성 화학물질과 접촉하지 않도록 추가적으로 배열되는 ALD 반응기의 내부 부분을 지칭한다. Intermediate space refers to the internal part of the ALD reactor that is rated at a pressure lower than ambient pressure and/or is filled with an inert gas and is further arranged to avoid contact with reactive chemicals. .

증착 프로세스 및 반응기 시스템은, 일 구현예에 있어서, 제어 시스템에 의해 제어된다. 일 구현예에 있어서, ALD 반응기는 컴퓨터 제어 시스템(computer-controlled system)이다. 시스템의 메모리에 저장된 컴퓨터 프로그램은 명령어들을 포함하며, 이 명령어들이 시스템의 적어도 하나의 프로세서에 의해 실행되면, ALD 반응기는 지시된 대로 작동하게 된다. 명령어는 컴퓨터 판독 가능 프로그램 코드의 형태일 수 있다. 일 구현예에 따른 기본 시스템 구성에서, 공정 파라미터는 소프트웨어의 도움으로 프로그래밍되고, 명령어들은 인간 기계 인터페이스(HMI) 터미널(706)로 실행되며, 이더넷 버스(ethernet bus)(704)를 통해 제어 수단(702)에 다운로드된다. 일 구현예에 있어서, 제어 수단(702)은 범용 프로그래밍가능한 논리 제어(programmable logic control: PLC) 유닛을 포함한다. 제어 수단(702)은 메모리에 저장된 프로그램 코드를 포함하는 제어 소프트웨어를 실행하기 위한 적어도 하나의 마이크로프로세서, 동적 및 정적 메모리, I/O 모듈, A/D 및 D/A 컨버터 및 전원 릴레이를 포함한다. 제어 수단(702)은 ALD 반응기의 공급물 투입 라인 밸브의 공압 제어기에 전력을 보내며, 공급물 투입 라인 질량 흐름 제어기, 및 전구체 공급원 또는 공급원들과 양방향으로 통신하며, 뿐만 아니라, ALD 반응기의 작동에 대한 기타 제어를 수행한다. 제어 수단(702)은, 일 구현예에 있어서, ALD 반응기 또는 그 가스 라인으로부터의 프로브, 센서 또는 측정 수단의 판독치를 측정한 후, HMI 터미널(706)까지 중계한다. 점선(716)은 ALD 반응기 부품들과 제어 수단(702) 사이의 인터페이스 라인을 나타낸다. HMI 터미널(706) 및 제어 수단(702)은 하나의 모듈로서 결합될 수 있다.The deposition process and reactor system, in one implementation, are controlled by a control system. In one embodiment, the ALD reactor is a computer-controlled system. A computer program stored in the memory of the system includes instructions that, when executed by at least one processor of the system, cause the ALD reactor to operate as directed. The instructions may be in the form of computer-readable program code. In a basic system configuration according to one implementation, process parameters are programmed with the help of software, instructions are executed to a human machine interface (HMI) terminal 706, and control means ( 702). In one implementation, the control means 702 comprises a general purpose programmable logic control (PLC) unit. Control means 702 includes at least one microprocessor for executing control software including program code stored in memory, dynamic and static memory, I/O modules, A/D and D/A converters and power relays. . Control means 702 directs power to a pneumatic controller of the feed input line valve of the ALD reactor and is in bi-directional communication with the feed input line mass flow controller and the precursor source or sources, as well as for operation of the ALD reactor. Perform other controls. Control means 702, in one embodiment, measures readings of probes, sensors or measurement means from the ALD reactor or its gas lines and then relays them to HMI terminal 706. Dashed line 716 represents the interface line between ALD reactor components and control means 702. HMI terminal 706 and control means 702 may be combined as one module.

본 발명자들이 확립한 바에 따르면, ALD에 의한 적어도 하나의 층의 증착과 전처리를 조합하는 앞에서 설명된 방법은 금속 휘스커의, 특히 필라멘트 유형의 금속 휘스커의, 형성을 실질적으로 방지하거나 적어도 현저히 감소시킨다.The inventors have established that the above-described method of combining pretreatment with the deposition of at least one layer by ALD substantially prevents or at least significantly reduces the formation of metal whiskers, especially metal whiskers of the filament type.

특허 청구 범위의 범위 및 해석을 제한하지 않고, 본 명세서에 개시된 예시적 구현예들 중 하나 이상의 특정 기술적 효과가 다음에 열거된다: 일 기술적 효과는 주석 휘스커의 형성을 방지하는 것이다. 다른 기술적 효과는 물 또는 황과 같은 부식성 화학물질에 대한 저항성을 제공하는 것이다. 또 다른 기술적 효과는 수분에 의해 선택적으로(optionally) 야기되는 일렉트로마이그레이션(electromigration)의 방지이다. 또 다른 기술적 효과는 경질(hard) ALD 층과 같은 ALD 층의 기계적 강도를 증가시키는 것이다. 또 다른 기술적 효과는 주석 휘스커 형성이 가능한 전도성 재료의 보호이다. 또 다른 기술적 효과는 가스 부식으로부터의 보호이다. 또 다른 기술적 효과는 저비용 제조 공정을 제공하는 것이다. 또 다른 기술적인 효과는 적층된 스택이, 예를 들어 레이저에 의해, 연결 또는 접촉과 같은 재가공을 위해, 개방될 수 있다는 것이다. Without limiting the scope and interpretation of the patent claims, specific technical effects of one or more of the exemplary embodiments disclosed herein are listed as follows: One technical effect is to prevent the formation of tin whiskers. Another technical benefit is to provide resistance to corrosive chemicals such as water or sulfur. Another technical effect is the prevention of electromigration, which is optionally caused by moisture. Another technical effect is to increase the mechanical strength of ALD layers, such as hard ALD layers. Another technical effect is the protection of conductive materials from which tin whisker formation is possible. Another technical effect is protection against gas corrosion. Another technological effect is to provide a low-cost manufacturing process. Another technical effect is that the laminated stack can be opened for reprocessing, such as connection or contact, for example by laser.

본 명세서에 제공된 방법과 도구는, 주석 휘스커 완화와 동시에, 부식성 가스, 수분, 액체(사용된 코팅에 따라 다름, 예를 들어, 물)에 대한 부식 장벽의 형성을 가능하게 한다. 또한, 본 방법은 덴드라이트 형성(dendrite formation)의 형태로 알려진 일렉트로마이그레이션(electromigration)에 대한 보호를 가능하게 한다.The methods and tools provided herein enable the formation of a corrosion barrier against corrosive gases, moisture, liquids (depending on the coating used, e.g. water), while simultaneously mitigating tin whiskers. Additionally, the method allows protection against electromigration, known as dendrite formation.

또한, 제공된 본 방법은, 대부분 금속 표면의 액체, 응축물 또는 습한 공기와 관련된 PCB 표면의 부식을 방지한다.Additionally, the provided method prevents corrosion of the PCB surface, most often associated with liquids, condensates or humid air on metal surfaces.

또한, 주석 휘스커 문제를 완화하기 위해 PCB에서 ALD를 사용하는 주된 이점은, 예를 들어 기계적으로 또는 레이저로 코팅을 제거함으로써, 수리 공정에서 ALD 층을 재가공할 수 있다는 것이다. 또한, ADL 아래의 솔더와 잠재적인 추가 구성부품(예를 들어, 솔더 페이스트) 사이의 ALD 층이 단단한 절연 재료를 효과적으로 떼어 낼 수 있기 때문에, ALD 코팅을 사용하여 솔더링된 부품 위에 구성부품을 부착하는 것이 가능하다.Additionally, the main advantage of using ALD in PCBs to alleviate the tin whisker problem is that the ALD layer can be reprocessed in the repair process, for example by removing the coating mechanically or with a laser. Additionally, because the ALD layer between the solder beneath the ADL and potential additional components (e.g., solder paste) can effectively strip away hard insulating materials, ALD coatings can be used to attach components over soldered parts. It is possible.

본 발명의 또 다른 이점은, 예를 들어 구성부품 다리(leg)가 코팅되지 않은 경우에, 예를 들어 주위 환경을 통한, 주석 휘스커, 부식, 전기적 파괴(electrical breakthrough)로부터, 또는 일렉트로마이그레이션으로부터, 본 명세서에서 PCB로 지칭되는, 가능하게는 구성부품을 갖는, 타겟 구성부품 또는 보드를 보호하는 것이 가능하게 된다는 것이다. Another advantage of the invention is that, for example, if the component legs are not coated, they are protected from tin whiskers, corrosion, electrical breakthrough, or electromigration, for example through the surrounding environment. It becomes possible to protect the target component or board, possibly with components, referred to herein as PCB.

또한, BGA(Ball Grid Array) 구성부품 언더코팅이 ALD로 가능하게 되는데, 이는, 매우 높은 종횡비 때문에, 다른 보호 방법에 의해서는 불가능한 것이었다. Additionally, undercoating of Ball Grid Array (BGA) components is possible with ALD, which is not possible with other protection methods due to the very high aspect ratio.

앞에 기술된 설명은, 본 발명의 특정 구현예 및 실시예의 비제한적인 예로서, 본 발명을 수행하기 위해 본 발명자들이 현재 고려한 최선의 모드에 대한 자세하고 유익한 설명을 제공하였다. 그러나, 당해 기술분야의 통상의 기술자에게 명백한 바와 같이, 본 발명은 앞에서 제시된 구현예들의 세부 사항에 제한되지 않으며, 본 발명의 특징으로부터 벗어나지 않으면서 균등한 수단을 사용하는 다른 구현예들에서 실행될 수 있다. The foregoing description, by way of non-limiting examples of specific implementations and examples of the invention, has provided a detailed and informative description of the best mode currently contemplated by the inventors for carrying out the invention. However, as will be apparent to those skilled in the art, the present invention is not limited to the details of the embodiments presented above, and may be practiced in other embodiments using equivalent means without departing from the characteristics of the invention. there is.

또한, 본 발명의 앞에서 기술된 구현예의 특징들 중 일부는 다른 특징들의 상응하는 사용 없이 이점을 얻기 위해 사용될 수 있다. 이와 같이, 앞에서 기술된 설명은 단지 본 발명의 원리를 설명하기 위한 것으로 간주되어야 하고, 본 발명의 원리를 제한하는 것으로 간주되어서는 안된다. 따라서, 본 발명의 범위는 첨부된 특허 청구 범위에 의해서만 제한된다.Additionally, some of the features of the previously described implementations of the invention may be used to gain advantage without corresponding use of other features. As such, the foregoing description should be regarded as merely illustrative of the principles of the invention and should not be considered as limiting the principles of the invention. Accordingly, the scope of the present invention is limited only by the appended claims.

Claims (34)

금속 휘스커(whisker) 형성, 일렉트로마이그레이션(electromigration) 및 부식을 감소시키기 위해, 반응기 시스템에서 수행되는 증착 방법으로서,
기재를 제공하는 단계;
상기 기재를 세정에 의해 전처리하는 단계;
상기 기재를 예열 또는 배출(evacuating)에 의해 전처리하는 단계; 및
적어도 제1 층(100)을 원자층 증착(atomic layer deposition: ALD)에 의해 증착시키는 단계를 포함하는 스택 증착 단계;를 포함하고,
상기 스택 증착 단계는 적어도 하나의 환원성 화학물질(reductive chemical)을 구비한 제1 펄스(first pulse)를 포함하고,
상기 스택 증착 단계 동안, 반응성 가스는 반응 챔버에서 배출 포어-라인으로 펌핑되어, 1000 분의 1부 미만의 양에 도달하고,
배출 포어-라인의 반응성 가스는 잔류 가스 분석기에 의해 분석되고,
상기 잔류 가스 분석기는 반응기 시스템의 작동을 제어하는 제어 수단에 연결되고,
상기 스택 증착 단계는, 원자층 증착(ALD)에 의해, 상이한 하위층(sublayer)들로 이루어진 제2 층(200)을 증착시키는 단계를 더 포함하고, 상기 제2 층(200)은 적어도 하나의 유기 하위층 또는 실리콘 폴리머 함유 하위층으로 이루어지는, 증착 방법.
1. A deposition method performed in a reactor system to reduce metal whisker formation, electromigration and corrosion, comprising:
providing a substrate;
Pretreating the substrate by washing;
pretreating the substrate by preheating or evacuating; and
A stack deposition step comprising depositing at least the first layer 100 by atomic layer deposition (ALD),
The stack deposition step includes a first pulse with at least one reductive chemical,
During the stack deposition step, reactive gas is pumped from the reaction chamber to the exhaust fore-line, reaching an amount of less than one part per thousand,
The reactive gas in the discharge fore-line is analyzed by a residual gas analyzer,
the residual gas analyzer is connected to control means for controlling the operation of the reactor system,
The stack deposition step further includes depositing a second layer 200 composed of different sublayers by atomic layer deposition (ALD), wherein the second layer 200 includes at least one organic A deposition method comprising a sublayer or a silicon polymer containing sublayer.
청구항 1에 있어서,
제1 펄스는 환원성 화학물질(reductive chemical) 또는 화학물질들의 다수의 펄스들 및 이들 사이의 후속 불활성 가스 펄스로 이루어는, 증착 방법.
In claim 1,
A method of deposition, wherein the first pulse consists of a reductive chemical or multiple pulses of chemicals with subsequent inert gas pulses therebetween.
청구항 1에 있어서,
상기 금속은 Zn, Sn, Cd 또는 Ag를 포함하는, 증착 방법.
In claim 1,
The deposition method of claim 1, wherein the metal includes Zn, Sn, Cd or Ag.
청구항 1에 있어서,
필라멘트 유형 금속 휘스커 형성이 감소되거나 또는 방지되는, 증착 방법.
In claim 1,
A deposition method in which filament type metal whisker formation is reduced or prevented.
청구항 1에 있어서,
상기 기재는 인쇄 회로 기판(Printed Circuit Board: PCB); 구성부품(component); 구성부품 하우징; 또는 금속 하우징;을 포함하는, 증착 방법.
In claim 1,
The substrate may include a printed circuit board (PCB); component; Component housing; or a metal housing; a deposition method comprising:
청구항 1에 있어서,
상기 제2 층(200)은 적어도 하나의 탄성 하위층으로 이루어진, 증착 방법.
In claim 1,
The method of claim 1 , wherein the second layer (200) consists of at least one elastic sublayer.
청구항 1에 있어서,
상기 제2 층(200)은 전기 절연 재료의 적어도 하나의 하위층을 포함하는, 증착 방법.
In claim 1,
The second layer (200) includes at least one sublayer of electrically insulating material.
청구항 1에 있어서,
상기 스택은 경질 층(hard layer)인 적어도 하나의 하위층을 포함하는, 증착 방법.
In claim 1,
The method of claim 1 , wherein the stack includes at least one sublayer that is a hard layer.
청구항 1에 있어서,
상기 스택 증착 단계는 원자층 증착(ALD)에 의해 제3 층(300)을 증착시키는 단계를 더 포함하는, 증착 방법.
In claim 1,
The deposition method further includes depositing the third layer 300 by atomic layer deposition (ALD).
청구항 1에 있어서,
상기 기재를 예열에 의해 전처리하는 단계는, 반응 온도 이상의 온도를 갖는 가열된 가스의 펄스로 예열하는 단계를 포함하는, 증착 방법.
In claim 1,
The method of claim 1 , wherein pretreating the substrate by preheating includes preheating the substrate with a pulse of heated gas having a temperature above the reaction temperature.
청구항 1에 있어서,
적어도 하나의 층은 주위(ambient)와 반응성인 적어도 하나의 반응성 화학물질을 포함하는, 증착 방법.
In claim 1,
A method of deposition, wherein at least one layer includes at least one reactive chemical that is reactive with the ambient.
청구항 1에 있어서,
상기 스택의 두께는 1 내지 2000 nm인, 증착 방법.
In claim 1,
The deposition method of claim 1, wherein the stack has a thickness of 1 to 2000 nm.
청구항 1에 있어서,
상기 배출 포어-라인 흐름을 변경, 정지 또는 제한하는 단계를 더 포함하는, 증착 방법.
In claim 1,
A method of deposition, further comprising altering, stopping or limiting said exhaust fore-line flow.
청구항 1에 있어서,
추가적인 코팅 방법에 의해 상기 스택의 상단 위에 추가 코팅을 제공하는 단계를 더 포함하는, 증착 방법.
In claim 1,
The deposition method further comprising providing an additional coating on top of the stack by an additional coating method.
청구항 14에 있어서,
상기 추가 코팅은 래커(lacquer)와 같은 폴리머 또는 실리콘 폴리머를 포함하는, 증착 방법.
In claim 14,
The method of claim 1 , wherein the additional coating comprises a lacquer-like polymer or a silicone polymer.
청구항 1에 있어서,
상기 세정은 ALE 펄스를 포함하는, 증착 방법.
In claim 1,
The method of claim 1 , wherein the cleaning comprises an ALE pulse.
청구항 1에 있어서,
상기 세정은 가열된 H2 또는 O2 또는 O3를 사용하는 것을 포함하는, 증착 방법.
In claim 1,
The method of claim 1 , wherein the cleaning comprises using heated H 2 or O 2 or O 3 .
청구항 1 내지 청구항 17 중 어느 한 항에 있어서,
상기 증착 방법은 금속 휘스커 형성, 일렉트로마이그레이션(electromigration) 및/또는 부식으로부터 기재를 보호하기 사용되는, 증착 방법.
The method of any one of claims 1 to 17,
The deposition method is used to protect the substrate from metal whisker formation, electromigration and/or corrosion.
ALD 반응기 시스템(700)으로서, 상기 ALD 반응기 시스템이 청구항 1 내지 청구항 17 중 어느 한 항의 증착 방법을 수행하는 것을 야기하도록 구성된 제어 수단(702)을 포함하고, 상기 ALD 반응기 시스템은:
포어-라인, 진공 펌프 및 잔류 가스 분석기와 유체 연결되는 반응기 챔버;
기재를 세정에 의해 전처리하도록 구성된 제1 전처리 수단;
상기 기재를 예열에 의해 전처리하도록 구성된 제2 전처리 수단;
적어도 제1 층(100)을 원자층 증착(ALD)에 의해 기재 상에 증착시키는 것을 포함하는 스택 증착 수단; 및
가열된 가스의 흐름을 변화시키기 위한 수단을 구비하는 가열된 가스 배출 포어-라인(heated gas exhaust fore-line)을 포함하고,
상기 잔류 가스 분석기는 제어 수단과 통신하도록 구성되고,
상기 스택 증착 수단은, 원자층 증착(ALD)에 의해, 상이한 하위층(sublayer)들로 이루어진 제2 층(200)을 증착시키고, 상기 제2 층(200)은 적어도 하나의 유기 하위층 또는 실리콘 폴리머 함유 하위층으로 이루어지는 ALD 반응기 시스템(700).
An ALD reactor system (700) comprising control means (702) configured to cause the ALD reactor system to perform the deposition method of any one of claims 1-17, wherein the ALD reactor system:
a reactor chamber in fluid communication with a fore-line, vacuum pump and residual gas analyzer;
first pre-treatment means configured to pre-treat the substrate by washing;
a second pre-treatment means configured to pre-treat the substrate by preheating;
stack deposition means comprising depositing at least a first layer (100) on the substrate by atomic layer deposition (ALD); and
a heated gas exhaust fore-line having means for changing the flow of heated gas;
wherein the residual gas analyzer is configured to communicate with control means,
The stack deposition means deposits, by atomic layer deposition (ALD), a second layer 200 consisting of different sublayers, the second layer 200 containing at least one organic sublayer or a silicon polymer. ALD reactor system 700 consisting of a sub-layer.
청구항 19에 있어서,
적어도 500 ℃의 온도까지 다른 가스 입구들과 별도로 가열되도록 구성된 적어도 하나의 추가 가스 입구를 더 포함하는 ALD 반응기 시스템(700).
In claim 19,
ALD reactor system 700 further comprising at least one additional gas inlet configured to be heated separately from the other gas inlets to a temperature of at least 500° C.
청구항 19에 있어서,
H2, O2 또는 O3의 펄스화(pulsing)를 가능하게 하도록 구성된 가스 입구를 포함하는 ALD 반응기 시스템(700).
In claim 19,
An ALD reactor system (700) comprising a gas inlet configured to enable pulsing of H 2 , O 2 or O 3 .
청구항 19에 있어서,
반응 챔버 온도보다 높은 열을 견디도록 구성된 가스 입구를 포함하는 ALD 반응기 시스템(700).
In claim 19,
An ALD reactor system 700 including a gas inlet configured to withstand heat above the reaction chamber temperature.
청구항 19에 있어서,
반응기 챔버의 공간과 비교하여 적어도 100 ℃의 온도차를 갖는 가스 펄스를 가능하게 하도록 구성된 가스 입구를 포함하는 ALD 반응기 시스템(700).
In claim 19,
An ALD reactor system (700) comprising a gas inlet configured to enable gas pulses with a temperature difference of at least 100° C. compared to the space of the reactor chamber.
청구항 20에 있어서,
상기 적어도 하나의 추가 가스 입구는 세라믹 재료 또는 금속, 또는 세라믹 재료로 코팅된 금속으로 제조된, ALD 반응기 시스템(700).
In claim 20,
ALD reactor system (700), wherein the at least one additional gas inlet is made of ceramic material or metal, or metal coated with ceramic material.
청구항 20에 있어서,
상기 적어도 하나의 추가 가스 입구는 상기 반응기의 중간 공간(intermediate space)에서 가열되도록 구성된, ALD 반응기 시스템(700).
In claim 20,
An ALD reactor system (700), wherein the at least one additional gas inlet is configured to heat an intermediate space of the reactor.
삭제delete 삭제delete 삭제delete 삭제delete 삭제delete 삭제delete 삭제delete 삭제delete 삭제delete
KR1020187032442A 2016-04-12 2016-04-12 Coating by ALD to suppress metal whiskers KR102586409B1 (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
PCT/FI2016/050237 WO2017178690A1 (en) 2016-04-12 2016-04-12 Coating by ald for suppressing metallic whiskers

Publications (2)

Publication Number Publication Date
KR20180133476A KR20180133476A (en) 2018-12-14
KR102586409B1 true KR102586409B1 (en) 2023-10-11

Family

ID=60042786

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1020187032442A KR102586409B1 (en) 2016-04-12 2016-04-12 Coating by ALD to suppress metal whiskers

Country Status (9)

Country Link
US (2) US20190127853A1 (en)
EP (1) EP3443139A4 (en)
JP (1) JP6839206B2 (en)
KR (1) KR102586409B1 (en)
CN (1) CN109072430A (en)
MY (1) MY189436A (en)
SG (1) SG11201808461PA (en)
TW (2) TW202336257A (en)
WO (1) WO2017178690A1 (en)

Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR3086673B1 (en) * 2018-10-01 2021-06-04 Commissariat Energie Atomique MULTI-LAYER STACKING FOR CVD GROWTH OF CARBON NANOTUBES
US20200260592A1 (en) * 2019-02-07 2020-08-13 Hamilton Sundstrand Corporation Method for repairing coated printed circuit boards
FI130166B (en) 2019-03-08 2023-03-23 Picosun Oy Solder mask
CN112239858A (en) 2019-07-17 2021-01-19 皮考逊公司 Method for producing corrosion-resistant coated articles, corrosion-resistant coated articles and use thereof
CN111132466A (en) * 2019-12-27 2020-05-08 苏州晶台光电有限公司 Method for preventing metal ion migration on surface of PCB
KR20220116804A (en) * 2021-02-15 2022-08-23 신웅철 A printed circuit board and the manufacturing method thereof
US20220359332A1 (en) * 2021-05-09 2022-11-10 Spts Technologies Limited Temporary passivation layer on a substrate
FI20216125A1 (en) * 2021-10-29 2023-04-30 Picosun Oy Multifunctional coating, method of manufacturing thereof, related coated items and uses

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003209103A (en) * 2002-01-17 2003-07-25 Tokyo Electron Ltd Treatment apparatus and method therefor
WO2010051341A1 (en) * 2008-10-31 2010-05-06 Sundew Technologies, Llc Coatings for suppressing metallic whiskers
KR101507913B1 (en) * 2014-08-26 2015-04-07 민치훈 Manufacturing method of printed circuit board

Family Cites Families (26)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FI57975C (en) * 1979-02-28 1980-11-10 Lohja Ab Oy OVER ANCHORING VIDEO UPDATE FOR AVAILABILITY
US4389973A (en) * 1980-03-18 1983-06-28 Oy Lohja Ab Apparatus for performing growth of compound thin films
US6174377B1 (en) * 1997-03-03 2001-01-16 Genus, Inc. Processing chamber for atomic layer deposition processes
US5879459A (en) * 1997-08-29 1999-03-09 Genus, Inc. Vertically-stacked process reactor and cluster tool system for atomic layer deposition
KR100252213B1 (en) * 1997-04-22 2000-05-01 윤종용 Apparatus for manufacturing semiconductor device and method of manufacturing semiconductor device using the same
US6638856B1 (en) * 1998-09-11 2003-10-28 Cypress Semiconductor Corporation Method of depositing metal onto a substrate
US6551929B1 (en) * 2000-06-28 2003-04-22 Applied Materials, Inc. Bifurcated deposition process for depositing refractory metal layers employing atomic layer deposition and chemical vapor deposition techniques
AU2003220088A1 (en) * 2002-03-08 2003-09-22 Sundew Technologies, Llc Ald method and apparatus
US7153362B2 (en) * 2002-04-30 2006-12-26 Samsung Electronics Co., Ltd. System and method for real time deposition process control based on resulting product detection
US7851360B2 (en) * 2007-02-14 2010-12-14 Intel Corporation Organometallic precursors for seed/barrier processes and methods thereof
US20080241354A1 (en) * 2007-03-28 2008-10-02 Tokyo Electron Limited Apparatus and methods for curing a layer by monitoring gas species evolved during baking
US9136545B2 (en) * 2008-02-27 2015-09-15 GM Global Technology Operations LLC Low cost fuel cell bipolar plate and process of making the same
US20100120245A1 (en) * 2008-11-07 2010-05-13 Agus Sofian Tjandra Plasma and thermal anneal treatment to improve oxidation resistance of metal-containing films
US20100227476A1 (en) * 2009-03-04 2010-09-09 Peck John D Atomic layer deposition processes
US7968452B2 (en) * 2009-06-30 2011-06-28 Intermolecular, Inc. Titanium-based high-K dielectric films
JP2011063850A (en) * 2009-09-17 2011-03-31 Tokyo Electron Ltd Film-forming apparatus, film-forming method and storage medium
US20110139748A1 (en) * 2009-12-15 2011-06-16 University Of Houston Atomic layer etching with pulsed plasmas
US9373500B2 (en) * 2014-02-21 2016-06-21 Lam Research Corporation Plasma assisted atomic layer deposition titanium oxide for conformal encapsulation and gapfill applications
JP5885830B2 (en) * 2011-04-07 2016-03-16 ピコサン オーワイPicosun Oy Deposition reactor with plasma source
DE102012200211A1 (en) * 2012-01-09 2013-07-11 Carl Zeiss Nts Gmbh Device and method for surface treatment of a substrate
US10217045B2 (en) * 2012-07-16 2019-02-26 Cornell University Computation devices and artificial neurons based on nanoelectromechanical systems
FR3003693B1 (en) * 2013-03-21 2017-01-20 Commissariat Energie Atomique ENCAPSULATION METHOD AND ASSOCIATED DEVICE
US20150093889A1 (en) * 2013-10-02 2015-04-02 Intermolecular Methods for removing a native oxide layer from germanium susbtrates in the fabrication of integrated circuits
KR20150081202A (en) * 2014-01-03 2015-07-13 삼성전자주식회사 Stacking structure having material layer on graphene layer and method of forming material layer on graphene layer
US10490475B2 (en) * 2015-06-03 2019-11-26 Asm Ip Holding B.V. Methods for semiconductor passivation by nitridation after oxide removal
US9899210B2 (en) * 2015-10-20 2018-02-20 Taiwan Semiconductor Manufacturing Co., Ltd. Chemical vapor deposition apparatus and method for manufacturing semiconductor device using the same

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003209103A (en) * 2002-01-17 2003-07-25 Tokyo Electron Ltd Treatment apparatus and method therefor
WO2010051341A1 (en) * 2008-10-31 2010-05-06 Sundew Technologies, Llc Coatings for suppressing metallic whiskers
KR101507913B1 (en) * 2014-08-26 2015-04-07 민치훈 Manufacturing method of printed circuit board

Also Published As

Publication number Publication date
MY189436A (en) 2022-02-11
TW202336257A (en) 2023-09-16
US20190127853A1 (en) 2019-05-02
TW201807238A (en) 2018-03-01
EP3443139A1 (en) 2019-02-20
KR20180133476A (en) 2018-12-14
CN109072430A (en) 2018-12-21
JP6839206B2 (en) 2021-03-03
JP2019514211A (en) 2019-05-30
EP3443139A4 (en) 2019-05-08
TWI799377B (en) 2023-04-21
WO2017178690A1 (en) 2017-10-19
US20210310124A1 (en) 2021-10-07
SG11201808461PA (en) 2018-10-30

Similar Documents

Publication Publication Date Title
KR102586409B1 (en) Coating by ALD to suppress metal whiskers
KR102520620B1 (en) Selective deposition on metal or metallic surfaces relative to dielectric surfaces
KR20190021325A (en) Method for providing a temporary protective layer on a graphen sheet
JP6810149B2 (en) Polymer coatings and methods of depositing polymer coatings
WO2009061666A1 (en) Atomic layer deposition process
TW201413031A (en) Methods of improving tungsten contact resistance in small critical dimension features
US9209134B2 (en) Method to increase interconnect reliability
JP2009060072A (en) Thin film metal conductive line and method for manufacturing the same
US10304730B2 (en) Semiconductor device having a Pd-containing adhesion layer
US20210071308A1 (en) Selective surface finishing for corrosion inhibition via chemical vapor deposition
DE102011116233A1 (en) Reduction of the formation of oxides on solders
JP2022530804A (en) Protection of seed layer during metal electrodeposition in semiconductor device manufacturing
Lee et al. Area‐Selective Atomic Layer Deposition Using Vapor Dosing of Short‐Chain Alkanethiol Inhibitors on Metal/Dielectric Surfaces
JP2016197622A (en) Chip resistor and method for manufacturing the same
JP2022191403A (en) Protection of substrate
Kutilainen et al. Atomic layer deposition (ALD) to mitigate tin whisker growth and corrosion issues on printed circuit board assemblies
Borra et al. Sn whisker growth mitigation by using NiO sublayers
WO2019030953A1 (en) Corrosion-resistant electronic substrate and coating composition used for same
CN111132466A (en) Method for preventing metal ion migration on surface of PCB
US20210366768A1 (en) Improving substrate wettability for plating operations
Pappas et al. Plasma Surface Engineering: An Enabling Technology Designed to Clean and Protect Printed Circuit Boards
KR102019834B1 (en) Methods of treating metal surface and structure surface treated by using the same
KR102227909B1 (en) Batch type substrate processing apparatus and method for operating the same
TWI789848B (en) Method for forming ruthenium thin film
JP2017118068A (en) Wiring board and manufacturing method of the same

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E90F Notification of reason for final refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant