KR102089701B1 - Dielectric ceramic composition and multilayer ceramic capacitor comprising the same - Google Patents

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Abstract

본 발명은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하며, (1-z)BaTiO3 - zBi0 .5+ aNa0 .5+ aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, 상기 a는 -0.025≤a≤0.025)을 포함하고, Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때, 단위면적에 대한 상기 제2 결정립의 면적비율이 5.0 ~ 50%인 유전체 자기 조성물에 관한 것이다.The invention includes a second main component represented by the first principal component and Bi 0 .5+ a Na 0 .5+ a TiO 3 represented by BaTiO 3, (1-z) BaTiO 3 - zBi 0 .5+ a Na 0 .5+ a TiO base powder (where z is the 0.05≤z≤0.5, wherein a is -0.025≤a≤0.025) represented by 3 and comprises a, Bi content of 1.0 at When less than% and Na content less than 5.0 at%, the first grain, Bi content 1.0 ~ 70 at%, Na content 5.0 ~ 70 at% of the grain, the second grain, the second grain to the unit area It relates to a dielectric ceramic composition having an area ratio of 5.0 to 50%.

Description

유전체 자기 조성물 및 이를 포함하는 적층 세라믹 커패시터{DIELECTRIC CERAMIC COMPOSITION AND MULTILAYER CERAMIC CAPACITOR COMPRISING THE SAME}Dielectric ceramic composition and multilayer ceramic capacitor including the same TECHNICAL FIELD

본 발명은 X9R 온도 특성 및 신뢰성이 보증되는 유전체 자기 조성물 및 이를 포함하는 적층 세라믹 커패시터에 관한 것이다.The present invention relates to a dielectric ceramic composition having guaranteed X9R temperature characteristics and reliability and a multilayer ceramic capacitor comprising the same.

일반적으로 커패시터, 인덕터, 압전 소자, 바리스터, 또는 서미스터 등의 세라믹 재료를 사용하는 전자부품은 세라믹 재료로 이루어진 세라믹 바디, 바디 내부에 형성된 내부전극 및 상기 내부전극과 접속되도록 세라믹 바디 표면에 설치된 외부전극을 구비한다.In general, electronic components using ceramic materials such as capacitors, inductors, piezoelectric elements, varistors, or thermistors include ceramic bodies made of ceramic materials, internal electrodes formed inside the body, and external electrodes installed on the surface of the ceramic body to be connected to the internal electrodes. It is provided.

세라믹 전자부품 중 적층 세라믹 커패시터는 적층된 복수의 유전체층, 일 유전체층을 사이에 두고 대향 배치되는 내부전극, 상기 내부전극에 전기적으로 접속된 외부전극을 포함한다.Among ceramic electronic components, a multilayer ceramic capacitor includes a plurality of stacked dielectric layers, internal electrodes disposed to face each other with a dielectric layer interposed therebetween, and external electrodes electrically connected to the internal electrodes.

적층 세라믹 커패시터는 소형이면서 고용량이 보장되고, 실장이 용이하다는 장점으로 인하여 컴퓨터, PDA, 휴대폰 등의 이동 통신장치의 부품으로서 널리 사용되고 있다.The multilayer ceramic capacitor is widely used as a component of a mobile communication device such as a computer, a PDA, and a mobile phone due to its small size, high volume, and easy mounting.

적층 세라믹 커패시터는 통상적으로 내부 전극용 페이스트와 유전체층용 페이스트를 시트법이나 인쇄법 등에 의해 적층하고 동시 소성하여 제조된다.Multilayer ceramic capacitors are usually produced by laminating internal electrode paste and dielectric layer paste by a sheet method or a printing method, and simultaneously firing.

최근 자동차에 전자제어 장치의 비율이 증가하고 하이브리드(Hybrid) 자동차 및 전기자동차의 개발로 인해 150도 이상의 고온에서 사용 가능한 적층 세라믹 커패시터의 요구가 점점 증가하고 있다. Recently, the proportion of electronic control devices in automobiles is increasing, and the demand for multilayer ceramic capacitors usable at high temperatures of 150 degrees or more is increasing due to the development of hybrid vehicles and electric vehicles.

현재 환원분위기에서 소성이 가능하면서 200도 보증 제품에 적용 가능한 유전체 재료로 C0G계열의 유전체가 있으나 유전율이 30 정도로 매우 낮아 고용량 제품을 제작하기 어려운 문제가 있다.Currently, there is a C0G-based dielectric as a dielectric material that can be fired in a reducing atmosphere and applicable to a 200-degree warranty product, but there is a problem that it is difficult to manufacture a high-capacity product because the dielectric constant is very low, about 30.

BaTiO3의 경우 유전율이 1000 이상으로 높으나 큐리온도 125도 이상에서 유전율이 급격하게 떨어지는 특징이 있어 150도 이상영역인 200도까지 특성 보증은 불가능하다. In the case of BaTiO 3 , the dielectric constant is higher than 1000, but it has a feature that the dielectric constant drops rapidly at a Curie temperature of 125 degrees or higher, so it is impossible to guarantee characteristics up to 200 degrees, which is an area of 150 degrees or higher.

따라서 큐리 온도가 높으면서 비교적 높은 유전율을 유지하여여 X9R 온도 특성을 만족하며 신뢰성을 보증하는 재료가 필요한 실정이다.Therefore, a material having a high Curie temperature and maintaining a relatively high dielectric constant to satisfy the X9R temperature characteristic and to guarantee reliability is required.

한국 공개특허공보 제10-2012-0129918호Korean Patent Publication No. 10-2012-0129918

본 발명의 목적은 X9R 온도 특성 및 신뢰성이 보증되는 유전체 자기 조성물 및 이를 포함하는 적층 세라믹 커패시터를 제공하는 것이다.It is an object of the present invention to provide a dielectric ceramic composition with guaranteed X9R temperature characteristics and reliability and a multilayer ceramic capacitor comprising the same.

본 발명의 일 실시 형태에 따른 유전체 자기 조성물은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하며, (1-z)BaTiO3 - zBi0 .5+ aNa0 .5+ aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, 상기 a는 -0.025≤a≤0.025)을 포함하고, Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때, 단위면적에 대한 상기 제2 결정립의 면적비율이 5.0 ~ 50%이다.The dielectric ceramic composition according to an embodiment of the present invention includes the second principal component represented by the first principal component and Bi 0 .5+ a Na 0 .5+ a TiO 3 represented by BaTiO 3, (1-z) BaTiO 3 - zBi 0 .5+ a Na 0 .5+ a TiO base powder (where z is the 0.05≤z≤0.5, wherein a is -0.025≤a≤0.025) represented by 3 and comprises a, Bi content of 1.0 at When less than% and Na content less than 5.0 at%, the first grain, Bi content 1.0 ~ 70 at%, Na content 5.0 ~ 70 at% of the grain, the second grain, the second grain to the unit area The area ratio of is 5.0 to 50%.

본 발명의 다른 실시 형태에 따른 적층 세라믹 커패시터는 유전체층과 제1 및 제2 내부전극이 교대로 적층된 세라믹 바디; 및 상기 세라믹 바디의 양 단부에 형성되며, 상기 제1 및 제2 내부전극과 전기적으로 연결되는 제1 및 제2 외부전극;을 포함하고, 상기 유전체 층은 Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때, 단위면적에 대한 상기 제2 결정립의 면적비율이 5.0 ~ 50%이다.A multilayer ceramic capacitor according to another embodiment of the present invention includes a ceramic body in which a dielectric layer and first and second internal electrodes are alternately stacked; And first and second external electrodes formed on both ends of the ceramic body and electrically connected to the first and second internal electrodes, wherein the dielectric layer has a Bi content of less than 1.0 at% and a Na content of 5.0. When the grain size less than at% is referred to as a first grain size, and when a grain size having a Bi content of 1.0 to 70 at% and a Na content of 5.0 to 70 at% is referred to as a second grain size, the area ratio of the second grain size to the unit area is 5.0 to 50%.

본 발명의 일 실시 형태에 따르면, X9R 온도 특성을 만족하고 유전율이 높은 유전체 자기 조성물, 유전체 층 및 이를 포함하는 적층 세라믹 커패시터를 구현할 수 있다.According to one embodiment of the present invention, a dielectric ceramic composition satisfying X9R temperature characteristics and having a high dielectric constant, a dielectric layer, and a multilayer ceramic capacitor including the same can be implemented.

또한, 본 발명의 일시 형태에 따르는 1050 ℃ 이하에서 소성이 가능한 소결조제를 적용함으로써 Bi의 휘발을 억제하여 본 발명의 적층 세라믹 커패시터의 목표 특성을 구현할 수 있다.In addition, by applying a sintering aid capable of firing at 1050 ° C. or less according to the temporary form of the present invention, the volatilization of Bi can be suppressed to achieve the target characteristics of the multilayer ceramic capacitor of the present invention.

도 1 및 2는 제1 결정립과 제2 결정립으로 이루어진 미세 구조 및 각 결정립 내에서 STEM/EDS 분석으로 Bi 및 Na의 함량을 분석하는 위치 P1, P2, P3, P4에 대한 모식도 및 미세구조이다.
도 3은 제1 결정립의 P1 내지 P4의 Bi 및 Na 함량을 측정한 그래프이며, 도 4는 제2 결정립의 P1 내지 P4의 Bi 및 Na 함량을 측정한 그래프이다.
도 5는 본 발명의 일 실시 형태에 따른 적층 세라믹 커패시터를 나타내는 개략적인 사시도이다.
도 6는 도 5의 VI-VI`를 따라 취한 적층 세라믹 커패시터를 나타내는 개략적인 단면도이다.
1 and 2 are schematic diagrams and microstructures for positions P1, P2, P3, and P4 that analyze the content of Bi and Na by STEM / EDS analysis in a microstructure composed of first and second crystal grains and within each grain.
3 is a graph measuring the Bi and Na contents of P1 to P4 of the first crystal grain, and FIG. 4 is a graph measuring the Bi and Na contents of P1 to P4 of the second crystal grain.
5 is a schematic perspective view showing a multilayer ceramic capacitor according to an embodiment of the present invention.
6 is a schematic cross-sectional view showing a multilayer ceramic capacitor taken along VI-VI` of FIG. 5.

이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시형태들을 설명한다.Hereinafter, preferred embodiments of the present invention will be described with reference to the accompanying drawings.

그러나, 본 발명의 실시형태는 여러 가지 다른 형태로 변형될 수 있으며, 본 발명의 범위가 이하 설명하는 실시 형태로 한정되는 것은 아니다. 또한, 본 발명의 실시형태는 당해 기술 분야에서 평균적인 지식을 가진 자에게 본 발명을 더욱 완전하게 설명하기 위해서 제공되는 것이다. 따라서, 도면에서의 요소들의 형상 및 크기 등은 명확한 설명을 위해 과장될 수 있으며, 도면상의 동일한 부호로 표시되는 요소는 동일한 요소이다.However, embodiments of the present invention may be modified in various other forms, and the scope of the present invention is not limited to the embodiments described below. In addition, embodiments of the present invention are provided to more fully describe the present invention to those skilled in the art. Accordingly, the shape and size of elements in the drawings may be exaggerated for clarity, and elements indicated by the same reference numerals in the drawings are the same elements.

본 발명은 유전체 자기 조성물에 관한 것으로, 유전체 자기 조성물을 포함하는 전자부품은 커패시터, 인덕터, 압전체 소자, 바리스터, 또는 서미스터 등이 있으며, 이하에서는 유전체 자기 조성물 및 전자부품의 일례로서 적층 세라믹 커패시터에 관하여 설명한다.The present invention relates to a dielectric ceramic composition, and electronic components including the dielectric ceramic composition include capacitors, inductors, piezoelectric elements, varistors, or thermistors. Hereinafter, multilayer ceramic capacitors are examples of dielectric ceramic compositions and electronic components. Explain.

본 발명의 일 실시 형태에 따른 유전체 자기 조성물은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하는 (1-z)BaTiO3 - zBi0.5+aNa0.5+aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, a는 -0.025≤a≤0.025)를 만족한다.In accordance with one embodiment of the invention the dielectric ceramic composition has a first main component and Bi 0 .5+ a Na 0 .5+ a TiO (1-z) BaTiO and a second principal component represented by the three represented by BaTiO 3 3 -The base material powder represented by zBi 0.5 + a Na 0.5 + a TiO 3 (however, z satisfies 0.05≤z≤0.5 and a is -0.025≤a≤0.025).

본 발명의 일 실시형태에 따른 유전체 자기 조성물은 EIA(Electronic Industries Association) 규격에서 명시한 X9R(-55℃~200℃) 특성을 만족할 수 있다.The dielectric ceramic composition according to an embodiment of the present invention may satisfy X9R (-55 ° C to 200 ° C) characteristics specified in the EIA (Electronic Industries Association) standard.

더 상세하게, 본 발명의 일 실시형태에 따르면 구리(Cu)을 내부전극으로 사용하고, 상기 구리(Cu)이 산화되지 않는 환원 분위기에서 소성이 가능한 유전체 자기 조성물을 제공한다.More specifically, according to an embodiment of the present invention, copper (Cu) is used as an internal electrode, and a dielectric ceramic composition capable of firing in a reducing atmosphere in which the copper (Cu) is not oxidized is provided.

또한, 이를 이용한 적층 세라믹 커패시터를 제공하여 상기 온도 특성을 만족함과 동시에 우수한 신뢰성을 구현할 수 있다.In addition, by providing a multilayer ceramic capacitor using the same, it is possible to realize the excellent reliability while satisfying the temperature characteristics.

특히, 본 발명에서는 유전율이 높은 BaTiO3와 큐리온도가 높은 (Bi0.5+aNa0.5+a)TiO3를 이용하고 1050도 이하에서 소성이 가능한 유전체 자기 조성물이용하여 Bi의 휘발을 최대한 억제하고 하나의 소결체 내에서 이들 조성을 각각 가지는 두 종류의 결정립으로 구성된 복합체 형태의 시료를 제작하고 이들 두 결정립의 면적 비율을 제어함으로써 본 발명의 목표 특성을 구현할 수 있었다.Particularly, in the present invention, BaTiO 3 having a high dielectric constant and (Bi 0.5 + a Na 0.5 + a ) TiO 3 having a high Curie temperature are used, and a dielectric ceramic composition capable of firing at 1050 degrees or less is used to suppress Bi volatility as much as possible. The target characteristics of the present invention could be realized by preparing a sample in the form of a composite composed of two types of crystal grains each having these compositions in a sintered body of and controlling the area ratio of these two grains.

이하, 본 발명의 일 실시형태에 따른 유전체 자기 조성물의 각 성분을 보다 구체적으로 설명하도록 한다.Hereinafter, each component of the dielectric ceramic composition according to an embodiment of the present invention will be described in more detail.

a) 모재 분말a) base powder

본 발명의 일 실시 형태에 따른 유전체 자기 조성물은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하는 (1-z)BaTiO3 - zBi0.5+aNa0.5+aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, a는 -0.025≤a≤0.025)를 만족한다.In accordance with one embodiment of the invention the dielectric ceramic composition has a first main component and Bi 0 .5+ a Na 0 .5+ a TiO (1-z) BaTiO and a second principal component represented by the three represented by BaTiO 3 3 -The base material powder represented by zBi 0.5 + a Na 0.5 + a TiO 3 (however, z satisfies 0.05≤z≤0.5 and a is -0.025≤a≤0.025).

상기 식에서 z는 0.05≤z≤0.5를 만족할 수 있다.In the above equation, z may satisfy 0.05≤z≤0.5.

또한, a는 -0.025≤a≤0.025를 만족할 수 있다.In addition, a may satisfy -0.025≤a≤0.025.

상기 제1 주성분은 BaTiO3로 표시될 수 있으며, 상기 BaTiO3는 일반적인 유전체 모재에 사용되는 재료로서, 큐리 온도가 대략 125도 정도인 강유전체 재료일 수 있다.The first main component may be represented by BaTiO 3 , and the BaTiO 3 may be a ferroelectric material having a Curie temperature of about 125 degrees as a material used in a general dielectric base material.

상기 제1 주성분은 BaTiO3로 표시되는 성분뿐만 아니라 Ca, Zr 등이 일부 고용되어 수정된 (Ba1 - xCax)(Ti1 - yCay)O3 (BCTZ), Ba(Ti1-yZry)O3 (BTZ) 등의 형태도 가능하다.The first main component is (Ba 1 - x Ca x ) (Ti 1 - y Ca y ) O 3 (BCTZ), Ba (Ti 1- ) modified by partially dissolving Ca, Zr, etc. as well as the component represented by BaTiO 3 y Zr y ) O 3 (BTZ) or the like is also possible.

또한, 상기 제2 주성분은 Bi0 .5+ aNa0 .5+ aTiO3로 표시될 수 있다.In addition, the second principal component can be expressed as Bi 0 .5+ a Na 0 .5+ a TiO 3.

상기 a는 -0.025≤a≤0.025를 만족할 수 있으며, 바람직하게 상기 제2 주성분은 Bi0.5Na0.5O3로 표시될 수 있다.The a may satisfy -0.025≤a≤0.025, and preferably, the second main component may be represented by Bi 0.5 Na 0.5 O 3 .

즉, 본 발명의 일 실시형태에 따른 유전체 자기 조성물의 모재 분말은 큐리 온도가 낮은 BaTiO3 강유전체 재료와 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 재료를 일정 비율로 혼합한 형태일 수 있다.That is, the dielectric base material powder of a ceramic composition in accordance with one embodiment of the invention is a mixture of materials represented by the Curie temperature low BaTiO 3 ferroelectric material and a Bi 0 .5+ a Na 0 .5+ a TiO 3 as a percentage It can be in the form.

상기와 같이 일정 비율로 제1 주성분과 제2 주성분 재료를 혼합하여 모재 분말을 제작함으로써 본 발명의 일 실시 형태에 따른 유전체 자기 조성물을 이용한 유전체층과 적층 세라믹 커패시터는 유전율이 높고, 1050 ℃ 이하에서 소성이 가능하며, 특히 X9R 온도 특성을 만족할 수 있다.The dielectric layer and the multilayer ceramic capacitor using the dielectric ceramic composition according to one embodiment of the present invention have a high dielectric constant and are fired at 1050 ° C. or lower by mixing the first main component and the second main component material at a constant ratio as described above to produce a base material powder. This is possible, and in particular, can satisfy the X9R temperature characteristics.

본 발명의 일 실시형태에 따른 유전체 자기 조성물 상온 유전율이 1000 이상, 상온 비저항이 1.0 × 1011 Ohm-cm 이상, 고온 200 TCC(200 ℃) ±22% 미만 및 고온(200℃) 내전압 50 V/㎛ 이상의 모든 특성의 동시 구현이 가능하다.Dielectric porcelain composition according to an embodiment of the present invention has a dielectric constant at room temperature of 1000 or more, a resistivity at room temperature of 1.0 × 10 11 Ohm-cm or more, a high temperature of 200 TCC (200 ° C) less than ± 22% and a high temperature (200 ° C) withstand voltage of 50 V / Simultaneous realization of all properties above µm is possible.

또한, 상기 유전체 자기 조성물의 모재 분말은 상술한 큐리 온도가 서로 다른 재료를 혼합한 형태 외에도 고용된 형태일 수도 있다. 상기 모재 분말이 서로 고용된 형태일 경우에는 상기 모재 분말은 하나 이상의 상을 가지는 형태일 수 있다. 예를 들어, Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때, 상기 모재 분말은 제1 및 제2 결정립을 가지는 형태 일 수 있다.In addition, the base powder of the dielectric ceramic composition may be in the form of a solid solution in addition to a mixture of materials having different Curie temperatures. When the base powder is in the form of solid solution, the base powder may have a form having one or more phases. For example, a crystal grain having a Bi content of less than 1.0 at% and a Na content of less than 5.0 at% is referred to as a first grain, and a crystal grain having a Bi content of 1.0 to 70 at% and a Na content of 5.0 to 70 at% is referred to as a second grain, The base powder may have a shape having first and second crystal grains.

도 1 및 2는 제1 결정립과 제2 결정립으로 이루어진 미세 구조 및 각 결정립 내에서 STEM/EDS 분석으로 Bi 및 Na의 함량을 분석하는 위치 P1, P2, P3, P4에 대한 모식도 및 미세구조이며, 도 3은 제1 결정립의 P1 내지 P4의 Bi 및 Na 함량을 측정한 그래프이며, 도 4는 제2 결정립의 P1 내지 P4의 Bi 및 Na 함량을 측정한 그래프이다.1 and 2 are schematic diagrams and microstructures for positions P1, P2, P3, and P4 that analyze the content of Bi and Na by STEM / EDS analysis within each crystal grain and the microstructure composed of the first grain and the second grain, 3 is a graph measuring the Bi and Na contents of P1 to P4 of the first crystal grain, and FIG. 4 is a graph measuring the Bi and Na contents of P1 to P4 of the second crystal grain.

도 1 및 2에서 보는 바와 같이, 본 발명의 일 실시 형태에 따른 유전체 조성물을 이용한 적층 세라믹 전자 부품의 유전체 층의 미세구조는 제1 결정립(10) 및 제2 결정립(20)을 포함한다. 1 and 2, the microstructure of the dielectric layer of the multilayer ceramic electronic component using the dielectric composition according to one embodiment of the present invention includes first crystal grains 10 and second crystal grains 20.

제1 결정립(10)은 도 1 및 2에 나타난 결정립 중 하나에서 P1 내지 P4의 위치에 Bi 및 Na의 함량을 측정하여, Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 의미한다. 즉, 도 3에서 보는 바와 같이, P1 내지 P4의 Bi 함량 및 Na 함량을 측정하여, 4 곳의 평균을 내어 Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제1 결정립으로 정의할 수 있다.The first crystal grain 10 means a grain having a Bi content of less than 1.0 at% and a Na content of less than 5.0 at% by measuring the content of Bi and Na at positions P1 to P4 in one of the grains shown in FIGS. 1 and 2. That is, as shown in Figure 3, by measuring the Bi content and Na content of P1 to P4, the average of the four places Bi content of 1.0 at%, Na content of less than 5.0 at% can be defined as the first grain have.

제2 결정립(20)은 도 1 및 2에 나타난 결정립 중 하나에서 P1 내지 P4의 위치에 Bi 및 Na의 함량을 측정하여, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 의미한다. 즉, 도 4에서 보는 바와 같이, P1 내지 P4의 Bi 함량 및 Na 함량을 측정하여, 4 곳의 평균을 내어 Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제1 결정립으로 정의할 수 있다.The second crystal grains 20 measure the content of Bi and Na at the positions of P1 to P4 in one of the grains shown in FIGS. 1 and 2, thereby obtaining grains having a Bi content of 1.0 to 70 at% and a Na content of 5.0 to 70 at%. it means. That is, as shown in Figure 4, by measuring the Bi content and Na content of P1 to P4, the average of the four places Bi content of 1.0 ~ 70 at%, Na content of 5.0 ~ 70 at% grains as the first grain Can be defined.

본 발명의 일 실시형태에 따른 유전체 자기 조성물은 단위면적에 대한 제2 결정립의 면적비율이 5.0 ~ 50%인 경우에 상술한 모든 특성의 동시 구현이 가능하다. 즉, 단위면적에 대한 제2 결정립의 면적비율이 5.0 ~ 50%를 벗어나는 경우, 본 발명의 모든 목표 특성을 구현할 수 없다.In the dielectric ceramic composition according to an embodiment of the present invention, when the area ratio of the second crystal grain to the unit area is 5.0 to 50%, it is possible to simultaneously implement all of the above-described characteristics. That is, when the area ratio of the second crystal grain to the unit area is out of 5.0 to 50%, all the target characteristics of the present invention cannot be realized.

상기 모재 분말은 특별히 제한되는 것은 아니나, 분말의 평균 입경은 300 nm 이하일 수 있다.The base powder is not particularly limited, but the average particle diameter of the powder may be 300 nm or less.

b) 제1 부성분b) first subcomponent

본 발명의 일 실시 형태에 따르면, 상기 유전체 자기 조성물은 제1 부성분으로서 Li를 포함하는 산화물 탄산염을 더 포함할 수 있으며, 바람직하게 Li2CO3를 더 포함할 수 있다. 제1 부성분은 모재 분말 100 mol에 대해 0.2 mol 내지 5.0 mol 포함될 수 있다.According to one embodiment of the present invention, the dielectric ceramic composition may further include an oxide carbonate containing Li as a first subcomponent, and may further include Li 2 CO 3 . The first subcomponent may be included from 0.2 mol to 5.0 mol with respect to 100 mol of the base powder.

제1 부성분은 유전체 자기 조성물이 적용된 적층 세라믹 커패시터의 상온 비저항 및 고온 내전압 특성을 향상시키는 역할을 한다.The first subcomponent serves to improve room temperature resistivity and high temperature withstand voltage characteristics of the multilayer ceramic capacitor to which the dielectric ceramic composition is applied.

제1 부성분이 모재 분말 100 mol에 대해 0.2 mol 미만이면 소결 밀도가 낮아 상온 비저항 및 고온 내전압이 매우 낮은 문제가 발생하며, 제1 부성분이 모재 분말 100 mol에 대해 5.0 mol를 초과하면 고온 내전압이 50 V/㎛ 미만으로 낮아지는 문제가 발생할 수 있다.If the first sub-component is less than 0.2 mol with respect to 100 mol of the base material powder, the sintering density is low, resulting in a very low temperature resistivity and high-temperature withstand voltage. A problem that lowers to less than V / µm may occur.

따라서, 본 발명의 일 실시형태에 따른 유전체 자기 조성물은 제1 부성분의 함량이 모재 분말 100 mol에 대해 0.2 ~ 5.0 mol인 경우에 상술한 모든 특성의 동시 구현이 가능하다.Therefore, in the dielectric ceramic composition according to an embodiment of the present invention, when the content of the first subcomponent is 0.2 to 5.0 mol with respect to 100 mol of the base material powder, it is possible to simultaneously implement all the above-described properties.

c) 제2 부성분c) second subcomponent

본 발명의 일 실시형태에 따르면, 상기 유전체 자기 조성물은 제2 부성분으로서, Mn, V, Cr, Fe, Ni, Co, Cu 및 Zn 중 적어도 하나 이상을 포함하는 산화물 혹은 탄산염을 더 포함할 수 있으며, 바람직하게 MnO2 또는 V2O5를 더 포함할 수 있다. According to one embodiment of the present invention, the dielectric ceramic composition may further include an oxide or carbonate containing at least one of Mn, V, Cr, Fe, Ni, Co, Cu, and Zn as the second subcomponent, , Preferably it may further include MnO 2 or V 2 O 5 .

상기 제2 부성분으로서, Mn, V, Cr, Fe, Ni, Co, Cu 및 Zn 중 적어도 하나 이상을 포함하는 산화물 혹은 탄산염은 상기 모재 분말 100 mol에 대하여, 0.2 mol 내지 3.0 mol의 함량으로 포함될 수 있다.As the second sub-component, oxide or carbonate containing at least one of Mn, V, Cr, Fe, Ni, Co, Cu and Zn may be included in an amount of 0.2 mol to 3.0 mol with respect to 100 mol of the base powder have.

또는, 2 종류 이상의 제2 부성분을 포함하는 경우, at%를 기준으로 제2 부성분의 전체 함량이 0.2 내지 3.0 at% 를 만족하도록 포함될 수 있다.Alternatively, when two or more types of the second subcomponent are included, the total content of the second subcomponent based on at% may be included to satisfy 0.2 to 3.0 at%.

상기 제2 부성분은 유전체 자기 조성물이 적용된 적층 세라믹 커패시터의 상온 비저항 및 고온 내전압 특성을 향상시키는 역할을 한다.The second sub-component serves to improve the room temperature resistivity and high temperature withstand voltage characteristics of the multilayer ceramic capacitor to which the dielectric ceramic composition is applied.

상기 제2 부성분의 전체 함량이 0.2 at% 미만이면 상온 비저항 및 고온 내전압 특성이 저하될 수 있다. If the total content of the second subcomponent is less than 0.2 at%, the room temperature specific resistance and high temperature withstand voltage characteristics may be deteriorated.

상기 제2 부성분의 함량이 전체 3.0 at%를 초과하는 경우에도 상온 비저항 및 고온 내전압 특성이 저하될 수 있다. Even when the content of the second subcomponent exceeds 3.0 at%, the resistivity at room temperature and the high temperature withstand voltage may be deteriorated.

특히, 본 발명의 일 실시형태에 따른 유전체 자기 조성물은 모재 분말 100 at%에 대하여, 0.2 내지 3.0 at%의 함량을 갖는 제2 부성분을 더 포함할 수 있으며, 이로 인하여 저온 소성이 가능하며 높은 고온 내전압 특성을 얻을 수 있으며, 상술한 모든 특성의 동시 구현이 가능하다.In particular, the dielectric ceramic composition according to an embodiment of the present invention may further include a second subcomponent having a content of 0.2 to 3.0 at% with respect to 100 at% of the base powder, thereby enabling low-temperature firing and high high temperature. Withstand voltage characteristics can be obtained, and simultaneous implementation of all of the above characteristics is possible.

d) 제3 부성분d) third subcomponent

본 발명의 일 실시형태에 따르면, 상기 유전체 자기 조성물은 Ba 및 Ca 중 하나 이상 원소의, 산화물 및 탄산염으로 이루어진 군에서 선택되는 하나 이상을 포함하는 제3 부성분을 포함할 수 있며, 바람직하게 BaCO3를 더 포함할 수 있다..According to one embodiment of the present invention, the dielectric ceramic composition may include a third subcomponent comprising at least one selected from the group consisting of oxides and carbonates of at least one element of Ba and Ca, preferably BaCO 3 It may further include ..

상기 제3 부성분은 상기 모재 분말 100 mol에 대하여, 0.2 내지 10.0 mol의 함량으로 포함될 수 있다. The third subcomponent may be included in an amount of 0.2 to 10.0 mol with respect to 100 mol of the base powder.

제3 부성분이 모재 분말 100 mol에 대해 0.2 mol 미만이면 고온 내전압이 매우 낮은 문제가 발생하며, 제1 부성분이 모재 분말 100 mol에 대해 10.0 mol를 초과하면 소결 밀도가 낮아 고온 내전압이 낮아지는 문제가 발생할 수 있다.If the third sub-component is less than 0.2 mol with respect to 100 mol of the base material powder, a high temperature withstand voltage problem is very low. Can occur.

따라서, 본 발명의 일 실시형태에 따른 유전체 자기 조성물은 제3 부성분의 함량이 모재 분말 100 mol에 대해 0.2 ~ 10.0 mol인 경우에 상술한 모든 특성의 동시 구현이 가능하다.Therefore, in the dielectric ceramic composition according to an embodiment of the present invention, when the content of the third subcomponent is 0.2 to 10.0 mol with respect to 100 mol of the base material powder, it is possible to simultaneously implement all the above-described properties.

e) 제4 부성분e) fourth accessory ingredient

본 발명의 일 실시형태에 따르면, 상기 유전체 자기 조성물은 Si 원소의 산화물, Si 원소의 탄산염 및 Si 원소를 포함하는 글라스로 이루어진 군에서 선택되는 하나 이상을 포함하는 제4 부성분을 포함할 수 있으며, 바람직하게 SiO2를 더 포함할 수 있다.According to one embodiment of the present invention, the dielectric ceramic composition may include a fourth sub-component including one or more selected from the group consisting of oxides of Si elements, carbonates of Si elements, and glasses containing Si elements, Preferably, SiO 2 may be further included.

상기 제4 부성분은 상기 모재 분말 100 mol에 대하여, 0.2 내지 5.0 mol로 포함될 수 있다. The fourth subcomponent may be included in 0.2 to 5.0 mol with respect to 100 mol of the base powder.

상기 제4 부성분의 함량이 상기 모재 분말 100 mol에 대하여, 0.5 mol 미만인 경우에는 소결 밀도가 낮아 상온 비저항 및 고온 내전압이 저하될 수 있으며, 5.0 mol를 초과하여 포함되는 경우에도 2차 상 생성 등의 문제로 고온 내전압이 낮아질 수 있다. When the content of the fourth subcomponent is less than 0.5 mol with respect to 100 mol of the base powder, the sintering density is low, and the specific temperature resistance and the high temperature withstand voltage may be lowered. As a problem, the high temperature withstand voltage may be lowered.

도 5은 본 발명의 일 실시형태에 따른 적층 세라믹 커패시터(100)를 나타내는 개략적인 사시도이고, 도 6는 도 5의 VI-VI`를 따라 취한 적층 세라믹 커패시터(100)를 나타내는 개략적인 단면도이다.5 is a schematic perspective view showing a multilayer ceramic capacitor 100 according to an embodiment of the present invention, and FIG. 6 is a schematic cross-sectional view showing a multilayer ceramic capacitor 100 taken along VI-VI ′ in FIG. 5.

도 5 및 도 6를 참조하면, 본 발명의 다른 실시예에 따른 적층 세라믹 커패시터(100)는 유전체층(111)과 제1 및 제2 내부 전극(121, 122)이 교대로 적층된 세라믹 바디(110)를 가진다. 세라믹 바디(110)의 양 단부에는 세라믹 바디(110)의 내부에 교대로 배치된 제1 및 제2 내부 전극(121, 122)과 각각 도통하는 제1 및 제2 외부 전극(131, 132)이 형성되어 있다.5 and 6, the multilayer ceramic capacitor 100 according to another embodiment of the present invention includes a ceramic body 110 in which the dielectric layers 111 and the first and second internal electrodes 121 and 122 are alternately stacked. ). At both ends of the ceramic body 110, first and second external electrodes 131 and 132 that are in communication with the first and second internal electrodes 121 and 122, which are alternately disposed inside the ceramic body 110, are respectively provided. Is formed.

세라믹 바디(110)의 형상에 특별히 제한은 없지만, 일반적으로 육면체 형상일 수 있다. 또한, 그 치수도 특별히 제한은 없고, 용도에 따라 적절한 치수로 할 수 있고, 예를 들면 (0.6∼5.6mm)×(0.3∼5.0mm)×(0.3∼1.9mm)일 수 있다.Although the shape of the ceramic body 110 is not particularly limited, it may be generally a hexahedral shape. Further, the dimensions are not particularly limited, and can be appropriately sized depending on the application, and may be, for example, (0.6 to 5.6 mm) x (0.3 to 5.0 mm) x (0.3 to 1.9 mm).

유전체층(111)의 두께는 커패시터의 용량 설계에 맞추어 임의로 변경할 수 있는데, 본 발명의 일 실시예에서 소성 후 유전체층의 두께는 1층당 바람직하게는 0.1㎛ 이상일 수 있다. The thickness of the dielectric layer 111 may be arbitrarily changed according to the capacitor's capacity design. In one embodiment of the present invention, the thickness of the dielectric layer after firing may be preferably 0.1 μm or more per layer.

너무 얇은 두께의 유전체층은 한층 내에 존재하는 결정립 수가 작아 신뢰성에 나쁜 영향을 미치기 때문에 유전체층의 두께는 0.1 ㎛ 이상일 수 있다.The thickness of the dielectric layer may be 0.1 µm or more because a dielectric layer having a thickness that is too thin has a small number of crystal grains present in one layer, which adversely affects reliability.

제1 및 제2 내부 전극(121, 122)은 각 단면이 세라믹 바디(110)의 대향하는 양 단부의 표면에 교대로 노출되도록 적층되어 있다. The first and second internal electrodes 121 and 122 are stacked such that each cross section is alternately exposed on the surfaces of opposite ends of the ceramic body 110.

상기 제1 및 제2 외부 전극(131, 132)은 세라믹 바디(110)의 양 단부에 형성되고, 교대로 배치된 제1 및 제2 내부 전극(121, 122)의 노출 단면에 전기적으로 연결되어 커패시터 회로를 구성한다.The first and second external electrodes 131 and 132 are formed at both ends of the ceramic body 110 and are electrically connected to exposed cross sections of the alternately disposed first and second internal electrodes 121 and 122. Construct a capacitor circuit.

제1 및 제2 내부 전극(121, 122)에 함유되는 도전성 재료는 특별히 한정되지 않지만, 본 발명의 일 실시형태에 따른 유전체층은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하는 (1-z)BaTiO3 - zBi0.5+aNa0.5+aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, a는 -0.025≤a≤0.025)을 포함하는 유전체 자기 조성물을 이용하기 때문에, 제1 및 제2 내부 전극(121, 122)은 구리(Cu)을 이용할 수 있다.First and second conductive material included in the internal electrodes 121 and 122 is not particularly limited, the dielectric layer according to an embodiment of the present invention has a first main component represented by BaTiO 3 and Bi 0 .5+ a Na 0 .5+ a TiO (1-z) and a second principal component represented by BaTiO 3 3 -Since the base material powder represented by zBi 0.5 + a Na 0.5 + a TiO 3 (where z is 0.05≤z≤0.5 and a is -0.025≤a≤0.025) is used, the first magnetic material composition is used. And the second internal electrodes 121 and 122 may use copper (Cu).

제1 및 제2 내부 전극(121, 122)의 두께는 용도 등에 따라 적절히 결정할 수 있으며 특별히 제한되는 것은 아니나, 예를 들면 0.1 내지 5㎛ 또는 0.1∼2.5㎛일 수 있다.The thicknesses of the first and second internal electrodes 121 and 122 may be appropriately determined according to the use and the like, and are not particularly limited, but may be, for example, 0.1 to 5 μm or 0.1 to 2.5 μm.

상기 제1 및 제2 외부 전극(131, 132)에 함유되는 도전성 재료는 특별히 한정되지 않지만, 니켈(Ni), 구리(Cu), 또는 이들 합금을 이용할 수 있다. The conductive materials contained in the first and second external electrodes 131 and 132 are not particularly limited, but nickel (Ni), copper (Cu), or alloys thereof may be used.

상기 제1 및 제2 외부 전극(131, 132)의 두께는 용도 등에 따라 적절히 결정할 수 있으며 특별히 제한되는 것은 아니나, 예를 들면 10 내지 50㎛ 일 수 있다.The thickness of the first and second external electrodes 131 and 132 may be appropriately determined according to the use and the like, and is not particularly limited, but may be, for example, 10 to 50 μm.

상기 세라믹 바디(110)를 구성하는 유전체층(111)은 본 발명의 일 실시형태에 따른 유전체 자기 조성물을 포함할 수 있다.  The dielectric layer 111 constituting the ceramic body 110 may include a dielectric magnetic composition according to an embodiment of the present invention.

상기 유전체 자기 조성물은 BaTiO3로 표시되는 제1 주성분 및 Bi0.5+aNa0.5+aTiO3로 표시되는 제2 주성분을 포함하는 (1-z)BaTiO3 - zBi0.5+aNa0.5+aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, a는 -0.025≤a≤0.025)을 포함한다.The dielectric ceramic composition includes (1-z) BaTiO 3 -zBi 0.5 + a Na 0.5 + a TiO comprising a first main component represented by BaTiO 3 and a second main component represented by Bi 0.5 + a Na 0.5 + a TiO 3 Base material powder represented by 3 (however, z is 0.05≤z≤0.5, a includes -0.025≤a≤0.025).

이하, 실시예 및 비교예를 통하여 본 발명을 더욱 상세히 설명하지만, 이는 발명의 구체적인 이해를 돕기 위한 것으로 본 발명의 범위가 실시예에 의해 한정되는 것은 아니다.Hereinafter, the present invention will be described in more detail through Examples and Comparative Examples, but this is for the purpose of helping the specific understanding of the present invention and the scope of the present invention is not limited by the Examples.

하기의 표 1, 표 3 및 표 5에 명시된 조성으로 에탄올과 톨루엔을 용매로 하여 분산제와 함께 혼합한 후, 바인더를 혼합하여 세라믹 시트를 제작하였다.After mixing with a dispersant using ethanol and toluene as solvents in the compositions specified in Tables 1, 3, and 5 below, a binder was mixed to prepare a ceramic sheet.

성형된 세라믹 시트에 구리(Cu) 전극을 인쇄하여 21층을 적층하여 액티브 시트를 제작하고, 액티브 시트의 상부 및 하부에 위치하는 커버는 커버용 시트(10 ~ 13㎛)를 25층으로 적층 및 압착하여 압착 바(bar)를 제작하였다.An active sheet is produced by laminating 21 layers by printing copper (Cu) electrodes on a molded ceramic sheet, and the cover sheets located at the top and bottom of the active sheet are laminated with 25 layers of cover sheets (10 to 13 µm). Pressed to produce a press bar.

그 후, 압착 바(bar)를 절단기를 이용하여 3.2 mm × 1.6 mm 크기의 칩으로 절단하였다.Thereafter, the compressed bar was cut into chips having a size of 3.2 mm × 1.6 mm using a cutter.

절단한 칩을 탈 바인더를 위해 가소한 후 환원분위기(N2 분위기) 하에서 1050℃ 에서 소성을 진행하고, 소성된 칩에 Cu 페이스트로 외부 전극을 형성하였다.After the cut chip was calcined for debinding, calcination was performed at 1050 ° C. under a reducing atmosphere (N 2 atmosphere), and an external electrode was formed on the calcined chip with Cu paste.

주성분 모재로서는 평균 입자크기가 300 nm인 BaTiO3 및 (Bi0 . 5Na0 . 5)TiO3 분말을 사용하였다.As the base material the main component was used as BaTiO 3 and (Bi 0. 5 Na 0. 5) TiO 3 powder with an average particle size of 300 nm.

주성분과 부성분이 포함된 원료 분말을 지르코니아 볼을 혼합/분산 메디아로 사용하고 에탄올/톨루엔과 분산제 및 바인더를 혼합 후, 20 시간 동안 볼밀링 하였다. The raw material powder containing the main component and the subcomponent was used as a mixing / dispersing media of zirconia balls, mixed with ethanol / toluene, a dispersing agent and a binder, and then ball milled for 20 hours.

제조된 슬러리는 닥터 블레이드 방식의 코터를 이용하여 3.5 ㎛와 10~13 ㎛ 의 두께로 성형 시트를 제조하였다. The prepared slurry was formed into a molding sheet with a thickness of 3.5 µm and 10 to 13 µm using a doctor blade type coater.

상기 약 10㎛의 두께를 갖는 시트에 구리(Cu) 내부전극을 인쇄하였다.  A copper (Cu) internal electrode was printed on the sheet having a thickness of about 10 μm.

상하 커버층으로는 10 내지 13㎛의 두께를 갖는 성형 시트로 25층으로 적층하였고, 약 2.0㎛의 두께를 갖는 내부전극이 인쇄된 시트를 21층 적층하여 액티브 층을 제작하여 바를 제조하여, 적층 세라믹 커패시터를 완성하였다. The upper and lower cover layers were laminated in 25 layers with a molded sheet having a thickness of 10 to 13 µm, and 21 sheets of the internal electrode printed sheets having a thickness of about 2.0 µm were laminated to produce an active layer to produce a bar, and then laminated. The ceramic capacitor was completed.

상기와 같이 완성된 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC) 시편에 대해 상온 정전용량 및 유전손실은 LCR meter 이용하여 1 kHz, AC 0.2V/μm 조건에서 용량을 측정하였다.For the finished prototype multilayer ceramic capacitor (Proto-type MLCC) specimen, the room temperature capacitance and dielectric loss were measured at 1 kHz and AC 0.2V / μm using an LCR meter.

정전용량과 MLCC 칩의 유전체 두께, 내부전극 면적, 적층수로부터 MLCC 칩 유전체의 유전율을 계산하였다.The dielectric constant of the MLCC chip dielectric was calculated from the capacitance, the dielectric thickness of the MLCC chip, the internal electrode area, and the number of stacks.

상온 절연저항은 10 개씩 샘플을 취하여 DC 10V/μm 을 인가한 상태에서 60 초 경과 후 측정하였다.The insulation resistance at room temperature was measured after taking 60 samples and applying DC 10V / μm after 60 seconds.

온도에 따른 정전용량의 변화는 -55 ℃ 에서 125 ℃ 의 온도 범위에서 측정되었다.The change in capacitance with temperature was measured in a temperature range of -55 ° C to 125 ° C.

고온 IR 승압 실험은 150℃에서 전압 단계를 5V/μm씩 증가시키면서 저항 열화거동을 측정하였는데, 각 단계의 시간은 10분이며 5초 간격으로 저항값을 측정하였다.In the high-temperature IR boosting experiment, resistance deterioration behavior was measured while increasing the voltage step by 5V / μm at 150 ° C. The time of each step was 10 minutes and the resistance value was measured at 5 second intervals.

고온 IR 승압 실험으로부터 고온 내전압을 도출하였는데, 150℃에서 유전체 단위 두께당 전압 스텝(voltage step) dc 5V/μm를 10분간 인가하고 이 전압 스텝을 계속 증가시키면서 측정할 때, IR이 105Ω이상을 견디는 전압을 의미한다.High-temperature withstand voltage was derived from the high-temperature IR boosting experiment, and when applying the voltage step dc 5V / μm per dielectric unit thickness at 150 ℃ for 10 minutes and measuring while continuously increasing this voltage step, the IR was 10 5 Ω or more. It means the voltage that withstands.

RC값은 AC 0.2V/μm, 1kHz 에서 측정한 상온 용량값과 DC 10V/μm 에서 측정한 절연 저항값의 곱이다.The RC value is the product of the room temperature capacitance measured at AC 0.2V / μm and 1 kHz and the insulation resistance measured at DC 10V / μm.

표 2, 4, 6은 표 1, 3, 5에 명시된 조성에 해당하는 Cu 내부 전극이 적용된 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Tables 2, 4, and 6 show the properties of a prototype multilayer ceramic capacitor (Proto-type MLCC) to which Cu internal electrodes corresponding to the compositions specified in Tables 1, 3, and 5 were applied.

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Figure 112015102057533-pat00002
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표 1은 모재 (1-z)BaTiO3 + z(Bi0.5Na0.5)TiO3 100 mol 대비 제1 부성분 Li2CO3: 1.8 mol, 제2 부성분인 MnO2: 0.5 mol, V2O5: 0 mol , 제3 부성분 BaCO3: 1.0 mol, 제4 부성분 SiO2: 1.0 mol, 제2 주성분  (Bi0 . 5Na0 . 5)TiO3 함량 z 값에 따른 실시예 조성들을 나타내고, 표 2는 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Table 1 shows the first sub-component Li 2 CO 3 : 1.8 mol, the second sub-component MnO 2 : 0.5 mol, V 2 O 5 as compared to the base material (1-z) BaTiO 3 + z (Bi 0.5 Na 0.5 ) TiO 3 100 mol: 0 mol, third subcomponent BaCO 3: 1.0 mol, fourth subcomponent SiO 2: 1.0 mol, the second principal component (.. Bi 0 5 Na 0 5) TiO 3 depict an embodiment the composition according to the content of z values, and Table 2 The properties of the prototype multilayer ceramic capacitor (Proto-type MLCC) corresponding to these compositions are shown.

표 2를 참조하면, z가 0.05 미만인 경우(실시예 1, 2)에는 고온 TCC(200 ℃)가 ± 22%를 벗어나는 문제가 있으며, z가 0.5을 초과하는 경우(실시예 8)에는 상온 비저항이 1.0 × 1011 Ohm-cm 미만으로 낮아지고, 고온 내전압이 50 V/㎛ 미만으로 낮아지는 문제가 있다. 따라서, z가 0.05 이상, 0.5 이하를 만족하는 경우에 본 발명의 일 실시형태에 따른 유전체 자기 조성물 상온 유전율이 1000 이상, 상온 비저항이 1.0 × 1011 Ohm-cm 이상, 고온 200 TCC(200 ℃) ±22% 미만 및 고온(200℃) 내전압 50 V/㎛ 이상의 모든 특성의 동시 구현이 가능하다. 이러한 경우에 단위면적에 대한 제2 결정립의 면적 비율은 5 내지 50 % 범위에 속함을 알 수 있다.Referring to Table 2, when z is less than 0.05 (Examples 1 and 2), there is a problem that the high temperature TCC (200 ° C) deviates from ± 22%, and when z is greater than 0.5 (Example 8), room temperature specific resistance There is a problem that this is lowered to less than 1.0 × 10 11 Ohm-cm, and the high temperature withstand voltage is lowered to less than 50 V / µm. Therefore, when z satisfies 0.05 or more and 0.5 or less, the dielectric ceramic composition according to an embodiment of the present invention has a dielectric constant of 1000 or more, a specific resistivity of room temperature of 1.0 × 10 11 Ohm-cm or more, and a high temperature of 200 TCC (200 ° C). Simultaneous realization of all characteristics of less than ± 22% and high temperature (200 ℃) withstand voltage of 50 V / µm or more. In this case, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

이와 달리, 실시예 9는 단일 주성분 (Ba0 . 9Bi0 . 1Na0 . 1)TiO3 고용체로 이루어진 경우의 특성을 나타내는데, 주성분의 각 원자의 함량은 실시예 4 또는 5와 유사하지만, 단위면적에 대한 제2 결정립의 면적 비율이 100%에 해당되며, 이와 같은 경우에는 본 발명의 목표 특성이 구현되지 않는 것을 알 수 있다. 따라서, 본 발명의 목표 특성을 구현하기 위하여 단위면적에 대한 제2 결정립의 면적 비율은 5 내지 50%를 만족하여야 한다.Alternatively, the embodiment 9 is to represent a characteristic in a case made of a single main component (Ba 0. 9 Bi 0. 1 Na 0. 1) TiO 3 solid solution, the content of each atom of the main component is similar to the embodiment 4 or 5, but The area ratio of the second crystal grain to the unit area corresponds to 100%, and in such a case, it can be seen that the target characteristic of the present invention is not implemented. Therefore, in order to realize the target characteristic of the present invention, the area ratio of the second crystal grain to the unit area should satisfy 5 to 50%.

Figure 112015102057533-pat00003
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Figure 112015102057533-pat00004
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표 3의 실시예 10 내지 18은 모재 0.8BaTiO3 + 0.2(Bi0.5Na0.5)TiO3 100 mol 대비 제2 부성분 MnO2: 0.5 mol, V2O5: 0 mol, 제3 부성분 BaCO3: 1.0 mol, 제4 부성분 SiO2: 1.0 mol일 때, 제1 부성분 Li2CO3의 함량에 따른 실험예 조성들을 나타내고, 표 4의 실시예 10 내지 18은 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Examples 10 to 18 in Table 3 is the base material 0.8BaTiO 3 + 0.2 (Bi 0.5 Na 0.5 ) TiO 3 Compared to 100 mol of the second subcomponent MnO 2 : 0.5 mol, V 2 O 5 : 0 mol, the third subcomponent BaCO 3 : 1.0 mol, the fourth sub-component SiO2: When 1.0 mol, shows the experimental example compositions according to the content of the first sub-component Li 2 CO 3 , Examples 10 to 18 of Table 4 are prototype multilayer ceramic capacitors (Proto -type MLCC).

Li2CO3의 함량이 0.2 mol 미만인 경우 (실시예 10, 11) 소결 밀도가 낮아 상온 비저항 및 고온 내전압이 매우 낮은 문제가 발생하며, Li2CO3의 함량이 5.0 mol을 초과하는 경우(실시예 18)에도 고온 내전압이 50 V/㎛ 미만으로 낮아지는 문제가 발생함을 알 수 있다. When the content of Li 2 CO 3 is less than 0.2 mol (Examples 10 and 11), the problem of very low specific temperature resistance and high temperature withstand voltage occurs due to low sintering density, and when the content of Li 2 CO 3 exceeds 5.0 mol (implementation) Even in Example 18), it can be seen that a problem occurs in that the high temperature withstand voltage becomes lower than 50 V / µm.

Li2CO3 함량이 0.2 ~ 5.0 mol 범위에 속하는 경우(실시예 12~17)에 본 발명의 목표인 상온유전율 1000 이상, 상온비저항 1E11 Ohm-cm 이상, 고온 200도 TCC(200 ℃) ±22% 미만, 그리고 고온 200도 내전압 50V/㎛ 이상의 모든 특성 동시 구현이 가능하다. 이때에도 단위면적에 대한 제2 결정립의 면적비율은 5 ~ 50% 범위에 속함을 확인할 수 있다.When the Li 2 CO 3 content is in the range of 0.2 to 5.0 mol (Examples 12 to 17), the target temperature of the present invention is room temperature dielectric constant of 1000 or more, room temperature resistivity of 1E11 Ohm-cm or more, and high temperature of 200 ° C TCC (200 ° C) ± 22 It is possible to simultaneously implement all characteristics of less than% and high temperature 200 degrees withstand voltage of 50V / µm or more. At this time, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

표 3의 실시예 19 내지 25는 모재 0.8BaTiO3 + 0.2(Bi0.5Na0.5)TiO3 100 mol 대비 제1 부성분 Li2CO3: 1.8 mol, 제2 부성분 V2O5: 0 mol, 제3 부성분 BaCO3: 1.0 mol, 제4 부성분 SiO2: 1.0 mol일 때, 제2 부성분 MnO2의 함량에 따른 실험예 조성들을 나타내고, 표 4의 실시예 19 내지 25는 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Examples 19 to 25 of Table 3 is the base material 0.8BaTiO 3 + 0.2 (Bi 0.5 Na 0.5 ) TiO 3 100 mol compared to the first sub-component Li 2 CO 3 : 1.8 mol, the second sub-component V 2 O 5 : 0 mol, the third When the subcomponent BaCO 3 : 1.0 mol and the fourth subcomponent SiO 2 : 1.0 mol, the experimental example compositions according to the content of the second subcomponent MnO 2 are shown, and Examples 19 to 25 of Table 4 stack prototypes corresponding to these compositions. It shows the characteristics of a ceramic capacitor (Proto-type MLCC).

MnO2의 함량이 0.2 mol 미만인 경우(실시예 19)에는 상온 비저항 및 고온 내전압이 매우 낮은 문제가 발생하며, MnO2의 함량이 3.0 mol을 초과하는 경우(실시예 25)에도 역시 상온 비저항 및 고온 내전압이 낮아지는 문제를 확인할 수 있다.When the content of MnO 2 is less than 0.2 mol (Example 19), the problem of very low temperature resistance and high temperature withstand voltage occurs, and even when the content of MnO 2 exceeds 3.0 mol (Example 25), the room temperature specific resistance and high temperature It can be confirmed that the withstand voltage is lowered.

MnO2 함량이 0.2 내지 3.0 mol 범위에 속할 때(실시예 20~24), 본 발명의 목표인 상온유전율 1000 이상, 상온비저항 1.0 × 1011 Ohm-cm 이상, 고온 200도 TCC(200 ℃) ±22% 미만, 그리고 고온 200도 내전압 50V/㎛ 이상의 모든 특성 동시 구현이 가능하다. 이때에도 단위면적에 대한 제2 결정립의 면적비율은 5 ~ 50% 범위에 속함을 확인할 수 있다.When the MnO 2 content is in the range of 0.2 to 3.0 mol (Examples 20 to 24), the target dielectric constant of the present invention is 1000 or more, room temperature resistivity 1.0 × 10 11 Ohm-cm or more, and high temperature 200 degrees TCC (200 ° C) ± It is possible to simultaneously implement all characteristics of less than 22% and high temperature 200 degrees withstand voltage of 50V / µm or more. At this time, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

표 3의 실시예 26 내지 30는 모재 0.8BaTiO3 + 0.2(Bi0.5Na0.5)TiO3 100 mol 대비 제1 부성분 Li2CO3: 1.8 mol, 제3 부성분 BaCO3: 1.0 mol, 제4 부성분 SiO2: 1.0 mol일 때, 제2 부성분 MnO2 및 V2O5를 함께 첨가한 경우의 실험예 조성들을 나타내고, 표 4의 실시예 26 내지 30은 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Examples 26 to 30 of Table 3 is the base material 0.8BaTiO 3 + 0.2 (Bi 0.5 Na 0.5 ) TiO 3 100 mol compared to the first sub-component Li 2 CO 3 : 1.8 mol, the third sub-component BaCO 3 : 1.0 mol, the fourth sub-component SiO 2 : When 1.0 mol, the second sub-components MnO 2 and V 2 O 5 together shows experimental example compositions, and Examples 26 to 30 of Table 4 are prototype multilayer ceramic capacitors corresponding to these compositions (Proto- type MLCC).

Mn 단독으로 첨가(실시예 20~24)하거나, Mn 및 V을 함께 첨가한 경우(실시예 26-30) at%를 기준으로 제2 부성분 전체 함량이 동일하면 거의 동일한 특성이 구현되는 것을 확인할 수 있으며 제2 부성분 전체 함량이 at% 기준으로 0.2 ~ 3.0 at% 범위에 속할 때(실시예 20~24 또는 실시예 26~30), 본 발명의 목표인 상온유전율 1000 이상, 상온비저항 1.0 × 1011 Ohm-cm 이상, 고온 200도 TCC(200 ℃) ±22% 미만, 그리고 고온 200도 내전압 50V/㎛ 이상의 모든 특성 동시 구현이 가능하다. 이때에도 단위면적에 대한 제2 결정립의 면적비율은 5 ~ 50% 범위에 속함을 확인할 수 있다.When Mn alone is added (Examples 20 to 24) or Mn and V are added together (Examples 26-30), it can be confirmed that almost the same characteristics are realized when the total content of the second subcomponent is the same based on at%. And when the total content of the second sub-component is in the range of 0.2 to 3.0 at% based on at% (Examples 20 to 24 or Examples 26 to 30), the target temperature of the present invention is room temperature dielectric constant of 1000 or more and room temperature resistivity of 1.0 × 10 11 More than Ohm-cm, high temperature 200 degrees TCC (200 ℃) less than ± 22%, and high temperature 200 degrees withstand voltage 50V / µm or more can be simultaneously implemented. At this time, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

Figure 112015102057533-pat00005
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Figure 112015102057533-pat00006
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표 5의 실시예 31 내지 39는 모재 0.8BaTiO3 + 0.2(Bi0.5Na0.5)TiO3 100 mol 대비 제1 부성분 Li2CO3: 1.8 mol, 제2 부성분 MnO2: 0.5 mol, V2O5: 0 mol, 제4 부성분 SiO2: 1.0 mol일 때, 제3 부성분 BaCO3 의 함량에 따른 실험예 조성들을 나타내고, 표 6의 31 내지 39는 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Examples 31 to 39 in Table 5 are the first subcomponent Li 2 CO 3 : 1.8 mol, the second subcomponent MnO 2 : 0.5 mol, V 2 O 5 compared to the base material of 0.8BaTiO 3 + 0.2 (Bi 0.5 Na 0.5 ) TiO 3 100 mol : 0 mol, 4th sub-component SiO 2 : When 1.0 mol, shows the experimental example compositions according to the content of the third sub-component BaCO 3 , and 31 to 39 in Table 6 are prototype multilayer ceramic capacitors (Proto- type MLCC).

제3 부성분 BaCO3의 함량이 0.2 mol 미만인 경우(실시예 31)에는 고온 내전압이 낮은 문제가 발생하며, BaCO3의 함량이 10.0 mol을 초과하는 경우(실시예 39)에도 소결 밀도가 낮아 역시 고온 내전압이 낮아지는 문제를 확인할 수 있다. BaCO3의 함량이 0.2 ~ 10.0 mol 범위에 속할 때(실시예 32~38), 본 발명의 목표인 상온유전율 1000 이상, 상온비저항 1.0 × 1011 Ohm-cm 이상, 고온 200도 TCC(200 ℃) ±22% 미만, 그리고 고온 200도 내전압 50V/㎛ 이상의 모든 특성 동시 구현이 가능하다. 이때에도 단위면적에 대한 제2 결정립의 면적비율은 5 ~ 50% 범위에 속함을 확인할 수 있다.When the content of the third subcomponent BaCO 3 is less than 0.2 mol (Example 31), a problem of low high temperature withstand voltage occurs, and even when the content of BaCO 3 exceeds 10.0 mol (Example 39), the sintering density is low and still high temperature. It can be confirmed that the withstand voltage is lowered. When the content of BaCO 3 is in the range of 0.2 to 10.0 mol (Examples 32 to 38), the target dielectric constant of the present invention is 1000 or more, the room temperature resistivity is 1.0 × 10 11 Ohm-cm or more, and the high temperature is 200 degrees TCC (200 ℃) Simultaneous implementation of all characteristics of less than ± 22% and high temperature 200 degrees withstand voltage of 50V / µm or more. At this time, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

표 5의 실시예 40 내지 46은 모재 0.8BaTiO3 + 0.2(Bi0.5Na0.5)TiO3 100 mol 대비 제1 부성분 Li2CO3: 1.8 mol, 제2 부성분 MnO2: 0.5 mol, V2O5: 0 mol, 제3 부성분 BaCO3: 1.0 mol일 때, 제4 부성분 SiO2의 함량에 따른 실험예 조성들을 나타내고, 표 6의 40 내지 46은 이들 조성에 해당하는 프로토 타입 적층 세라믹 커패시터(Proto-type MLCC)의 특성을 나타낸다.Examples 40 to 46 of Table 5 are the base material 0.8BaTiO 3 + 0.2 (Bi 0.5 Na 0.5 ) TiO 3 100 mol compared to the first subcomponent Li 2 CO 3 : 1.8 mol, the second subcomponent MnO 2 : 0.5 mol, V 2 O 5 : 0 mol, the third subcomponent BaCO 3 : When 1.0 mol, shows the experimental example compositions according to the content of the fourth subcomponent SiO 2 , and 40 to 46 in Table 6 are prototype multilayer ceramic capacitors corresponding to these compositions (Proto- type MLCC).

제4 부성분 SiO2의 함량이 0.2 mol 미만인 경우(실시예 40, 41)에는 소결 밀도가 낮아 상온 비저항 및 고온 내전압이 낮은 문제가 발생하며, SiO2의 함량이 5.0 mol을 초과하는 경우(실시예 46)에도 이차상 등의 생성으로 인해 역시 고온 내전압이 낮아지는 문제를 확인할 수 있다. SiO2 함량이 0.2 ~ 5.0 mol 범위에 속할 때(실시예 42~45), 본 발명의 목표인 상온유전율 1000 이상, 상온비저항 1.0 × 1011 Ohm-cm 이상, 고온 200도 TCC(200 ℃) ±22% 미만, 그리고 고온 200도 내전압 50V/㎛ 이상의 모든 특성 동시 구현이 가능하다. 이때에도 단위면적에 대한 제2 결정립의 면적비율은 5 ~ 50% 범위에 속함을 확인할 수 있다.In the case where the content of the fourth subcomponent SiO 2 is less than 0.2 mol (Examples 40 and 41), the problem of low sintering density and low temperature resistivity and high temperature withstand voltage occurs, and when the content of SiO 2 exceeds 5.0 mol (Example 46) Also, due to the generation of secondary phases, it can be confirmed that the high temperature withstand voltage is also lowered. When the SiO 2 content is in the range of 0.2 to 5.0 mol (Examples 42 to 45), the target dielectric constant of the present invention is 1000 or more, room temperature resistivity 1.0 × 10 11 Ohm-cm or more, and high temperature 200 degrees TCC (200 ℃) ± It is possible to simultaneously implement all characteristics of less than 22% and high temperature 200 degrees withstand voltage of 50V / µm or more. At this time, it can be seen that the area ratio of the second crystal grain to the unit area falls within a range of 5 to 50%.

본 발명은 상술한 실시형태 및 첨부된 도면에 의해 한정되는 것이 아니며, 첨부된 청구범위에 의해 한정된다. 따라서, 청구범위에 기재된 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 다양한 형태의 치환, 변형 및 변경이 가능하다는 것은 당 기술분야의 통상의 지식을 가진 자에게는 자명할 것이며, 이 또한 첨부된 청구범위에 기재된 기술적 사상에 속한다 할 것이다.The present invention is not limited by the above-described embodiments and the accompanying drawings, but is limited by the appended claims. Therefore, it will be apparent to those skilled in the art that various forms of substitution, modification, and modification are possible without departing from the technical spirit of the present invention as set forth in the claims. It will be said to belong to the technical idea described in.

100: 적층 세라믹 커패시터 110: 세라믹 바디
111: 유전체층 121, 122: 제1 및 제2 내부전극
131, 132: 제1 및 제2 외부전극
100: multilayer ceramic capacitor 110: ceramic body
111: dielectric layers 121, 122: first and second internal electrodes
131, 132: first and second external electrodes

Claims (12)

BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하며, (1-z)BaTiO3 - zBi0 .5+ aNa0 .5+ aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, 상기 a는 -0.025≤a≤0.025)을 포함하고,
Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때,
단위면적에 대한 상기 제2 결정립의 면적비율이 5.0 ~ 50%인 유전체 자기 조성물.
The first main component and a Na .5+ Bi 0 0 .5+ a TiO and a second principal component represented by 3, (1-z) represented by BaTiO 3 BaTiO 3 - zBi 0 .5+ a Na 0 .5+ base material powder represented by a TiO 3 (provided that said z is 0.05≤z≤0.5, wherein a is -0.025≤a≤0.025) includes,
When the grains having a Bi content of less than 1.0 at% and the Na content of less than 5.0 at% are called first crystal grains, and the grains having a Bi content of 1.0 to 70 at% and Na content of 5.0 to 70 at% are referred to as second crystal grains,
A dielectric ceramic composition having an area ratio of the second crystal grains to a unit area of 5.0 to 50%.
제1항에 있어서,
제1 부성분으로서 Li2CO3를 모재 분말 100 mol에 대해 0.2 ~ 5.0 mol을 포함하는 유전체 자기 조성물.
According to claim 1,
A dielectric ceramic composition comprising 0.2 to 5.0 mol of Li 2 CO 3 as a first subcomponent with respect to 100 mol of a base powder.
제1항에 있어서,
제2 부성분으로서 MnO2 또는 V2O5를 모재 분말 100 mol에 대해 0.2 ~ 3.0 mol을 포함하는 유전체 자기 조성물.
According to claim 1,
MnO 2 as second subcomponent Or V 2 O 5 The dielectric ceramic composition containing 0.2 to 3.0 mol with respect to 100 mol of the base powder.
제1항에 있어서,
제3 부성분으로서 BaCO3를 모재 분말 100 mol에 대해 0.2 ~ 10.0 mol을 포함하는 유전체 자기 조성물.
According to claim 1,
Dielectric ceramic composition containing 0.2 to 10.0 mol based on 100 mol of BaCO 3 as a third sub-component.
제1항에 있어서,
제4 부성분으로서 SiO2를 모재 분말 100 mol에 대해 0.2 ~ 5.0 mol을 포함하는 유전체 자기 조성물.
According to claim 1,
A dielectric ceramic composition containing 0.2 to 5.0 mol of SiO 2 as a fourth subcomponent relative to 100 mol of the base powder.
유전체층과 제1 및 제2 내부전극이 교대로 적층된 세라믹 바디; 및
상기 세라믹 바디의 양 단부에 형성되며, 상기 제1 및 제2 내부전극과 전기적으로 연결되는 제1 및 제2 외부전극;을 포함하고,
상기 유전체 층은 Bi 함량 1.0 at% 미만, Na 함량 5.0 at% 미만인 결정립을 제 1 결정립이라 하고, Bi 함량 1.0 ~ 70 at%, Na 함량 5.0 ~ 70 at%인 결정립을 제 2 결정립이라 할 때, 단위면적에 대한 상기 제2 결정립의 면적비율이 5.0 ~ 50%인 적층 세라믹 커패시터.
A ceramic body in which dielectric layers and first and second internal electrodes are alternately stacked; And
Includes; first and second external electrodes formed on both ends of the ceramic body and electrically connected to the first and second internal electrodes.
When the dielectric layer has a Bi content of less than 1.0 at% and a Na content of less than 5.0 at%, the first grain is referred to as a Bi content of 1.0 to 70 at% and a Na content of 5.0 to 70 at% is a second grain. A multilayer ceramic capacitor having an area ratio of the second crystal grain to a unit area of 5.0 to 50%.
제6항에 있어서,
상기 유전체 층은 BaTiO3로 표시되는 제1 주성분 및 Bi0 .5+ aNa0 .5+ aTiO3로 표시되는 제2 주성분을 포함하며, (1-z)BaTiO3 - zBi0 .5+ aNa0 .5+ aTiO3로 표시되는 모재 분말(단, 상기 z는 0.05≤z≤0.5, 상기 a는 -0.025≤a≤0.025)을 포함하는 유전체 자기 조성물을 이용하여 형성되는 적층 세라믹 커패시터.
The method of claim 6,
It said dielectric layer comprises a second principal component represented by the first principal component and Bi 0 .5+ a Na 0 .5+ a TiO 3 represented by BaTiO 3, (1-z) BaTiO 3 - zBi 0 .5+ a Na 0 .5+ base material powder represented by a TiO 3 using the dielectric ceramic composition containing (where z is the 0.05≤z≤0.5, wherein a is -0.025≤a≤0.025) Multilayer ceramic capacitor formed by.
제7항에 있어서,
상기 유전체 자기 조성물은 제1 부성분으로서 Li2CO3를 모재 분말 100 mol에 대해 0.2 ~ 5.0 mol을 포함하는 적층 세라믹 커패시터.
The method of claim 7,
The dielectric ceramic composition is a multilayer ceramic capacitor containing 0.2 to 5.0 mol of Li 2 CO 3 as a first subcomponent with respect to 100 mol of a base powder.
제7항에 있어서,
상기 유전체 자기 조성물은 제2 부성분으로서 MnO2 또는 V2O5를 모재 분말 100 mol에 대해 0.2 ~ 3.0 mol을 포함하는 적층 세라믹 커패시터.
The method of claim 7,
The dielectric ceramic composition has MnO as a second subcomponent2 Or V2O5Multilayer ceramic capacitor containing 0.2 to 3.0 mol with respect to 100 mol of the base powder.
제7항에 있어서,
상기 유전체 자기 조성물은 제3 부성분으로서 BaCO3를 모재 분말 100 mol에 대해 0.2 ~ 10.0 mol을 포함하는 적층 세라믹 커패시터.
The method of claim 7,
The dielectric ceramic composition is a multilayer ceramic capacitor containing BaCO 3 as a third subcomponent from 0.2 to 10.0 mol with respect to 100 mol of the base powder.
제7항에 있어서,
상기 유전체 자기 조성물은 제4 부성분으로서 SiO2를 모재 분말 100 mol에 대해 0.2 ~ 5.0 mol을 포함하는 적층 세라믹 커패시터.
The method of claim 7,
The dielectric ceramic composition is a multilayer ceramic capacitor containing 0.2 to 5.0 mol of SiO 2 as a fourth subcomponent with respect to 100 mol of the base powder.
제6항에 있어서,
상기 제1 및 제2 내부 전극은 구리(Cu)를 포함하는 적층 세라믹 커패시터.
The method of claim 6,
The first and second internal electrodes include copper (Cu).
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