KR101890484B1 - 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템 - Google Patents

위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템 Download PDF

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Abstract

본 발명은 위상제어 기술에 관한 것으로서, 더 상세하게는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템에 대한 것이다.
본 발명에 따르면, DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어함으로써 기존 방식들에 비해 정밀한 위상제어가 가능하다.

Description

위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템{Precise control Method and System for phase sampling digital radio frequency memory}
본 발명은 위상제어 기술에 관한 것으로서, 더 상세하게는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템에 대한 것이다.
현대의 레이더는 위상정보를 사용하는 동기 방식(coherent)으로 발전하고 있다. 이러한 동기 방식 레이더에 대한 전자공격(electronic attack)을 효율적으로 수행하기 위해서는 대상 레이더 신호의 위상정보를 저장하고 제어할 수 있는 재밍 자원이 필요하다.
이를 위해 가장 널리 사용되고 있는 재밍 자원은 디지털 고주파 기억장치(DRFM: Digital Radio Frequency Memory)이다. DRFM은 레이더로부터 방사된 신호를 디지털화하여 저장한 후 신호처리 과정을 거쳐 출력할 수 있는 재밍 자원이다.
이러한 DRFM은 레이더 신호의 위상정보를 그대로 저장할 수 있기 때문에 동기 방식 레이더에 대해 효과적인 재밍을 할 수 있다. DRFM은 진폭 샘플링 방식과 위상 샘플링 방식으로 구분되며, 이중 입력 신호 세기에 대한 민감도 및/또는 신호처리 복잡도가 비교적 낮은 위상 샘플링 방식이 널리 사용된다.
이러한 위상 샘플링 방식은 수신 신호를 동상(in-phase) 신호(이하 I 신호)와 직교(quadrature) 신호(이하 Q신호)로 분리한 후 그로부터 신호의 위상을 계산하고 디지털화하여 메모리에 저장 및 신호 처리하는 방식이다.
이러한 위상 샘플링 방식의 DRFM에 대한 구성 블록도를 보여주는 도면이 도 1이다. 도 1을 참조하면, 위상 샘플링 방식의 DRFM은 I, Q 신호로부터 순시 위상
Figure 112016117584300-pat00001
을 계산한다. 이때, 삼각함수의 주기성으로 인해 순시 위상의 범위는 0°~ 360° (0∼2π radian)이다. ADC(Analogue-to-Digital Convertor)를 통해 디지털화된 순시 위상 값은 설정된 양자화 비트수인
Figure 112016117584300-pat00002
비트로 표현된다.
예를 들어 신호 주파수(
Figure 112016117584300-pat00003
) 10MHz인 사인파 신호가 샘플링 주파수(
Figure 112016117584300-pat00004
) 1GHz이고 양자화 비트수(
Figure 112016117584300-pat00005
) 3비트인 DRFM으로 수신되었을 때, 순시 위상값은 도 2와 같은 형태로 DRFM의 메모리에 저장된다.
위와 같이 DRFM은 순시 위상값을 저장하므로 저장된 순시 위상값에 위상변화량을 가산하여 출력함으로써 원하는 위상의 재밍 신호를 만들어 낼 수 있다. 이때 변화시킬 수 있는 위상의 최소값, 즉 위상제어 해상도는
Figure 112016117584300-pat00006
이다.
이렇듯 기존 DRFM의 위상제어 해상도는 양자화 비트수에 의해서 제한되며, 일반적으로 재밍 시스템에서는 신호 저장 공간에 대한 제약이 크기 때문에 재밍 시스템에 사용되는 DRFM의 경우 양자화 비트수는 3~4비트로 사용되고 있다. 따라서, 크로스 아이, 정밀 잡음 재밍 등 최근 재밍 시스템은 정교한 위상제어가 요구되므로 더욱 정밀한 위상제어 기법이 필요하다.
1. 한국등록특허번호 제10-0991439호(2010.10.27)(발명의 명칭: 주파수 변조 방법과 그 장치, 및 상기 방법을 구현하는 프로그램이 기록된 기록매체)
1. 홍상근외, "위상 샘플링 방식 DRFM 적용 대역폭 제어 잡음 재밍 기법 개발"한국전자파학회논문지 제22권 제8호 통권171호 (2011년 8월) pp.776-783
본 발명은 위 배경기술에 따른 문제점을 해소하기 위해 제안된 것으로서, DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 위상 제어 방법을 제공하는데 그 목적이 있다.
본 발명은 위에서 제시된 과제를 달성하기 위해, DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 위상 제어 방법을 제공한다.
상기 위상 제어 방법은 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법으로서,
(a) 신호 변환부가 레이더로부터 수신되는 레이더 신호를 처리하여 I/Q(In-phase/Quadrature) 신호를 생성하는 단계;
(b) DRFM(Digital Radio Frequency Memory)이 위상 샘플링 방식을 통해 상기 I/Q 신호로부터 미리 정해진 샘플링 간격으로 샘플들의 순시 위상값들을 계산하는 단계;
(c) 상기 DRFM이 상기 순시 위상값들을 순차적으로 저장하는 단계;
(d) 상기 DRFM이 상기 샘플들간의 위상차를 계산하는 단계;
(e) 상기 DRFM이 미리 설정되는 목표 위상 제어량에 근접한 저장 메모리 주소를 선택하는 단계; 및
(f) 출력부가 선택된 저장 메모리 주소에 해당하는 샘플로부터 레이더 신호로 변환하여 출력하는 단계;를 포함하는 것을 특징으로 할 수 있다.
또한, 상기 위상차는 상기 샘플링 간격에 비례하는 것을 특징으로 할 수 있다.
또한, 상기 위상차는 신호 주파수와 샘플링 주파수를 이용하여 인접한 샘플사이의 차이를 통해 산출되는 값인 것을 특징으로 할 수 있다.
또한, 상기 위상차는 수학식
Figure 112016117584300-pat00007
(여기서,
Figure 112016117584300-pat00008
는 위상차이고,
Figure 112016117584300-pat00009
는 신호 주파수이고,
Figure 112016117584300-pat00010
는 샘플링 주파수를 나타낸다)로 정의되며,
Figure 112016117584300-pat00011
일 경우
Figure 112016117584300-pat00012
(여기서, k는 양자화 비트수이고,
Figure 112016117584300-pat00013
= 2π/2k이다)인 것을 특징으로 할 수 있다.
또한, 상기 위상차는 위상제어 해상도인 것을 특징으로 할 수 있다.
또한, 상기 선택된 저장 메모리 주소는 저장된 순시 위상값의 시작 주소로부터 자연수만큼 떨어진 저장 메모리 주소인 것을 특징으로 할 수 있다.
또한, 상기 자연수(w)는 수학식
Figure 112016117584300-pat00014
(여기서, w는 자연수이고,
Figure 112016117584300-pat00015
는 목표 위상 변화량이며,
Figure 112016117584300-pat00016
는 주소 제어로 인한 위상 변화량을 나타낸다)으로 정의되는 것을 특징으로 할 수 있다.
다른 한편으로, 본 발명의 다른 일실시예는, 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 시스템으로, 레이더; 상기 레이더로부터 수신되는 레이더 신호를 처리하여 I/Q(In-phase/Quadrature) 신호를 생성하는 신호 변환부; 위상 샘플링 방식을 통해 상기 I/Q 신호로부터 미리 정해진 샘플링 간격으로 샘플들의 순시 위상값들을 계산하고, 상기 순시 위상값들을 순차적으로 저장하고, 상기 샘플들간의 위상차를 계산하며, 미리 설정되는 목표 위상 제어량에 근접한 저장 메모리 주소를 선택하는 DRFM(Digital Radio Frequency Memory); 및 선택된 저장 메모리 주소에 해당하는 샘플로부터 레이더 신호로 변환하여 출력하는 출력부; 를 포함하는 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 시스템을 제공할 수 있다.
본 발명에 따르면, DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어함으로써 기존 방식들에 비해 정밀한 위상제어가 가능하다.
또한, 본 발명의 다른 효과로서는 크로스 아이, 정밀 잡음 재밍 등 최근 재밍 시스템에서 정교한 위상 제어가 가능하다는 점을 들 수 있다.
도 1은 일반적인 위상 샘플링 방식의 DRFM에 대한 구성 블록도이다.
도 2는 도 1에 도시된 DRFM(Digital Radio Frequency Memory)의 메모리에 저장되는 순시 위상값의 예시이다.
도 3은 본 발명의 일실시예에 따른 DRFM(Digital Radio Frequency Memory)리에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 위상 제어 시스템의 블록 구성도이다.
도 4는 도 3에 도시된 DRFM의 상세한 구성 블록도이다.
도 5는 본 발명의 일실시예에 따른 DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 과정을 보여주는 흐름도이다.
도 6은 본 발명의 일실시예에 따른 위상 제어 출력 신호의 비교를 보여주는 그래프이다.
본 발명은 다양한 변경을 가할 수 있고 여러 가지 실시예를 가질 수 있는바, 특정 실시예들을 도면에 예시하고 상세한 설명에 구체적으로 설명하고자 한다. 그러나 이는 본 발명을 특정한 실시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다.
각 도면을 설명하면서 유사한 참조부호를 유사한 구성요소에 대해 사용한다.
제 1, 제 2등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다.
예를 들어, 본 발명의 권리 범위를 벗어나지 않으면서 제 1 구성요소는 제 2 구성요소로 명명될 수 있고, 유사하게 제 2 구성요소도 제 1 구성요소로 명명될 수 있다. "및/또는" 이라는 용어는 복수의 관련된 기재된 항목들의 조합 또는 복수의 관련된 기재된 항목들 중의 어느 항목을 포함한다.
다르게 정의되지 않는 한, 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 모든 용어들은 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미가 있다.
일반적으로 사용되는 사전에 정의되어 있는 것과 같은 용어들은 관련 기술의 문맥상 가지는 의미와 일치하는 의미를 가지는 것으로 해석되어야 하며, 본 출원에서 명백하게 정의하지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않아야 한다.
이하 첨부된 도면을 참조하여 본 발명의 일실시예에 따른 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법 및 시스템을 상세하게 설명하기로 한다.
도 3은 본 발명의 일실시예에 따른 DRFM(Digital Radio Frequency Memory)리에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 위상 제어 시스템(300)의 블록 구성도이다. 도 3을 참조하면, 위상 제어 시스템(300)은 레이더 신호를 생성하는 레이더(310), 레이더 신호에 대하여 레이더 신호 처리를 수행하여 I/Q(In-phase/Quadrature) 신호를 생성하는 신호 변환부(320), I/Q(In-phase/Quadrature) 신호로부터 일정한 샘플링 간격으로 레이더 신호의 순시 위상값을 계산하고 메모리에 순차적으로 저장하여 목표 위상 제어량에 가장 근접하한 주소를 선택하고 그 선택된 주소에 해당하는 출력 신호를 생성하는 DRFM(330), 출력 신호를 출력하는 출력부(340) 등을 포함하여 구성될 수 있다.
레이더(310)는 레이더 송신기에서 대기중으로 방사된 고주파, 고출력의 펄스파가 표적에 후방 산란되어 다시 레이더 안테나로 들어와 수신기에 감지된 전파 신호인 레이더 신호를 생성한다.
신호 변환부(320)는 레이더 신호에 대하여 동상(in-phase) 신호(이하 I 신호) 및 직교(quadrature) 신호(이하 Q신호)로 분리하여 I/Q(In-phase/Quadrature) 신호를 생성한다.
DRFM(330)은 위상 샘플링 방식을 통해 I/Q(In-phase/Quadrature)로부터 신호의 위상을 계산하고 디지털화하여 메모리에 저장 및/또는 신호 처리한다. 부연하면, DRFM(330)은 일정한 샘플링 간격으로 신호의 순시 위상값을 메모리에 순차적으로 저장한다. 또한, 저장 샘플간의 위상차를 계산하고, 목표 위상 제어량에 가장 인접하게 주소를 선택하여 신호를 출력한다.
도 4는 도 3에 도시된 DRFM(330)의 상세한 구성 블록도이다. 도 4를 참조하면, DRFM(330)에는 메모리(410)가 구성되어 있으며, 이 메모리(410)에 일정한 샘플링 간격으로 순시 위상값(410)들(
Figure 112016117584300-pat00017
)이 저장 메모리 주소(420)에 따라 순차적으로 저장된다. 신호의 시간 변화량은 위상 변화량에 비례하기 때문에 인접하여 저장된 순시 위상값은 샘플링 간격에 비례하는 위상 차이를 가지게 된다.
물론, DRFM(330)에는 순시 위상값들을 디지털화된 순시 위상값으로 변환하는 ADC(Analog-to-Digital Convertor)(미도시), 메모리(410)에 순차적으로 저장되는 순시 위상값들에 따른 위상차를 이용하여 목표 위상 제어량에 근접한 저장 메모리 주소를 선택하여 해당 샘플 신호를 생성하고 신호 처리 모듈(미도시), 해당 샘플 신호를 아날로그화된 신호로 변환하는 DAC(Digital-to-Analog)(미도시) 등이 구성된다.
메모리(410)는 DRFM(330) 내에 구비되는 메모리일 수 있고, 별도의 메모리가 될 수 있다. 따라서 플래시 메모리 디스크(SSD: Solid State Disk), 하드 디스크 드라이브, 플래시 메모리, EEPROM(Electrically erasable programmable read-only memory), SRAM(Static RAM), FRAM (Ferro-electric RAM), PRAM (Phase-change RAM), MRAM(Magnetic RAM) 등과 같은 비휘발성 메모리 및/또는 DRAM(Dynamic Random Access Memory), SDRAM(Synchronous Dynamic Random Access Memory), DDR-SDRAM(Double Date Rate-SDRAM) 등과 같은 휘발성 메모리의 조합으로 구성될 수 있다.
도 5는 본 발명의 일실시예에 따른 DRFM(Digital Radio Frequency Memory)에 저장된 신호의 주소값을 선택하여 출력 신호의 위상을 제어하는 과정을 보여주는 흐름도이다. 도 5를 참조하면, 신호 변환부(320)가 레이더(도 3의 310)로부터 수신되는 레이더 신호를 처리하여 I/Q(In-phase/Quadrature) 신호를 생성한다(단계 S510).
이후, DRFM(Digital Radio Frequency Memory)(도 3의 330)이 위상 샘플링 방식을 통해 상기 I/Q 신호로부터 미리 정해진 샘플링 간격으로 샘플들의 순시 위상값들을 계산하고, DRFM(330)이 상기 순시 위상값들을 순차적으로 저장한다(단계 S530).
이후, 상기 DRFM(330)이 상기 샘플들간의 위상차를 계산한다(단계 S540). 부연하면, DRFM(330)은 일정한 샘플링 간격으로 신호의 순시 위상값(
Figure 112016117584300-pat00018
)을 메모리(410)에 순차적으로 저장한다. 신호의 시간 변화량은 위상 변화량에 비례하기 때문에 인접하여 저장된 순시 위상값은 샘플링 간격에 비례하는 위상차를 갖는다.
예를 들어 신호 주파수(
Figure 112016117584300-pat00019
)가 1Hz인 사인파 신호는 1초에 1회 진동한다고 가정하자. 즉, 1초동안 0°(0 rad)에서 360°(2π rad)의 위상변화가 발생하는 것을 의미한다. 이때 샘플링 주파수(
Figure 112016117584300-pat00020
)가 4Hz라면 1초 길이의 신호를 4번 균등하게 분할하여 그 값을 저장하므로, 메모리에는 0°(0 rad), 90°(π/2 rad), 180°(π rad), 270°(3π/2 rad)라는 순시 위상값이 저장된다.
이때, 샘플간 시간 간격은 0.25초이고 샘플간 위상차는 π/2 rad이므로 시간 변화량 0.25초마다 위상 변화량 π/2 rad인 비례관계이다. 즉, 신호 주파수(
Figure 112016117584300-pat00021
)와 샘플링 주파수(
Figure 112016117584300-pat00022
)를 이용하여 인접하게 저장된 샘플 사이의 위상차는 다음 수학식을 통해 계산된다.
Figure 112016117584300-pat00023
여기서,
Figure 112016117584300-pat00024
는 샘플간 위상차이고,
Figure 112016117584300-pat00025
는 신호 주파수(즉, 레이더 신호의 주파수)이고,
Figure 112016117584300-pat00026
는 샘플링 주파수를 나타낸다. 또한, 샘플간 위상차
Figure 112016117584300-pat00027
는 본 발명의 일실시예에 따른 위상제어 해상도가 된다. 본 발명의 일실시예에서는
Figure 112016117584300-pat00028
일 경우
Figure 112016117584300-pat00029
이므로 순시 위상값을 가산하는 기존 방법보다 정밀한 위상제어가 가능하다. 여기서, k는 양자화 비트수이고,
Figure 112016117584300-pat00030
= 2π/2k 이다.
이후, DRFM(330)이 미리 설정되는 목표 위상 제어량에 근접한 저장 메모리 주소를 선택한다(단계 S550). 부연하면, 저장된 순시 위상값의 시작 주소로부터 자연수(w)만큼 떨어진 저장 메모리 주소를 선택한다. w는 출력 신호가 목표 위상제어량(
Figure 112016117584300-pat00031
)에 근접하도록 아래 수학식을 기준으로 선택된다.
Figure 112016117584300-pat00032
여기서, w는 자연수이고,
Figure 112016117584300-pat00033
는 목표 위상 변화량이며,
Figure 112016117584300-pat00034
는 주소 제어로 인한 위상 변화량을 나타낸다. 따라서, 수학식 2는 목표 위상변화량(
Figure 112016117584300-pat00035
)과 주소 제어로 인한 위상변화량(
Figure 112016117584300-pat00036
)의 차이가 최소가 되는 자연수 w를 선택하는 것을 의미한다. 이와 같은 방식으로 위상 샘플링 방식 DRFM에서 정밀 위상제어가 가능하다.
이후, DRFM(330)이 선택된 저장 메모리 주소에 해당하는 샘플로부터 레이더 신호로 변환하여 출력한다(단계 S560).
도 6은 본 발명의 일실시예에 따른 위상 제어 출력 신호의 비교를 보여주는 그래프이다. 도 6을 참조하면, DRFM(330)으로 입력되는 신호 주파수(
Figure 112016117584300-pat00037
)가 약100MHz이고, DRFM의 샘플링 주파수(
Figure 112016117584300-pat00038
)는 약 4GHz, 양자화 비트수(k)는 3비트를 가정하였다. 목표 위상 제어량을 약 30°로 신호를 출력하고자 할 경우 기존 순시 위상값 가산을 이용한 방식과 본 발명의 일실시예에 따른 방식의 위상제어 결과이다.
도 6을 참조하면, 기존 방식인 순시 위상값 가산을 이용하여 위상제어를 할 경우(점선 곡선) 약 30°에 가까운 신호로 약 45°인 신호 생성이 가능하여 목표 위상(실선 곡선)인 30°와 약 15°의 오차가 발생한다.
반면 본 발명의 일실시예에 따른 위상제어를 적용할 경우(일점 쇄선 곡선), 약 27°인 신호 생성이 가능하여 약 3°오차의 신호를 출력할 수 있다.
상세한 설명에 기재된 …부", "모듈" 등의 용어는 적어도 하나의 기능이나 동작을 처리하는 단위를 의미하며, 이는 하드웨어나 소프트웨어 또는 하드웨어 및 소프트웨어의 결합으로 구현될 수 있다. 하드웨어 구현에 있어, 상술한 기능을 수행하기 위해 디자인된 ASIC(application specific integrated circuit), DSP(digital signal processing), PLD(programmable logic device), FPGA(field programmable gate array), 프로세서, 제어기, 마이크로프로세서, 다른 전자 유닛 또는 이들의 조합으로 구현될 수 있다. 소프트웨어 구현에 있어, 상술한 기능을 수행하는 모듈로 구현될 수 있다. 소프트웨어는 메모리 유닛에 저장될 수 있고, 프로세서에 의해 실행된다. 메모리 유닛이나 프로세서는 당업자에게 잘 알려진 다양한 수단을 채용할 수 있다.
300: 위상 제어 시스템
310: 레이더
320: 신호 변환부
330: DRFM(Digital Radio Frequency Memory)
340: 출력부

Claims (8)

  1. 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법에 있어서,
    (a) 신호 변환부가 레이더로부터 수신되는 레이더 신호를 처리하여 I/Q(In-phase/Quadrature) 신호를 생성하는 단계;
    (b) DRFM(Digital Radio Frequency Memory)이 위상 샘플링 방식을 통해 상기 I/Q 신호로부터 미리 정해진 샘플링 간격으로 샘플들의 순시 위상값들을 계산하는 단계;
    (c) 상기 DRFM이 상기 순시 위상값들을 순차적으로 저장하는 단계;
    (d) 상기 DRFM이 상기 샘플들간의 위상차를 계산하는 단계;
    (e) 상기 DRFM이 미리 설정되는 목표 위상 제어량에 근접한 저장 메모리 주소를 선택하는 단계; 및
    (f) 출력부가 선택된 저장 메모리 주소에 해당하는 샘플로부터 레이더 신호로 변환하여 출력하는 단계;를 포함하며,
    상기 위상차는 신호 주파수와 샘플링 주파수를 이용하여 인접한 샘플사이의 차이를 통해 산출되는 값인 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  2. 제 1 항에 있어서,
    상기 위상차는 상기 샘플링 간격에 비례하는 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  3. 삭제
  4. 제 1 항에 있어서,
    상기 위상차는 수학식
    Figure 112018031454471-pat00039
    (여기서,
    Figure 112018031454471-pat00040
    는 위상차이고,
    Figure 112018031454471-pat00041
    는 신호 주파수이고,
    Figure 112018031454471-pat00042
    는 샘플링 주파수를 나타낸다)로 정의되며,
    Figure 112018031454471-pat00043
    일 경우
    Figure 112018031454471-pat00044
    (여기서, k는 양자화 비트수이고,
    Figure 112018031454471-pat00045
    = 2π/2k이다)인 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  5. 제 1 항에 있어서,
    상기 위상차는 위상제어 해상도인 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  6. 제 1 항에 있어서,
    상기 선택된 저장 메모리 주소는 저장된 순시 위상값의 시작 주소로부터 자연수만큼 떨어진 저장 메모리 주소인 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  7. 제 6 항에 있어서,
    상기 자연수(w)는 수학식
    Figure 112016117584300-pat00046
    (여기서, w는 자연수이고,
    Figure 112016117584300-pat00047
    는 목표 위상 변화량이며,
    Figure 112016117584300-pat00048
    는 주소 제어로 인한 위상 변화량을 나타낸다)으로 정의되는 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 방법.
  8. 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 시스템에 있어서,
    레이더;
    상기 레이더로부터 수신되는 레이더 신호를 처리하여 I/Q(In-phase/Quadrature) 신호를 생성하는 신호 변환부;
    위상 샘플링 방식을 통해 상기 I/Q 신호로부터 미리 정해진 샘플링 간격으로 샘플들의 순시 위상값들을 계산하고, 상기 순시 위상값들을 순차적으로 저장하고, 상기 샘플들간의 위상차를 계산하며, 미리 설정되는 목표 위상 제어량에 근접한 저장 메모리 주소를 선택하는 DRFM(Digital Radio Frequency Memory); 및
    선택된 저장 메모리 주소에 해당하는 샘플로부터 레이더 신호로 변환하여 출력하는 출력부; 를 포함하며,
    상기 위상차는 신호 주파수와 샘플링 주파수를 이용하여 인접한 샘플사이의 차이를 통해 산출되는 값인 것을 특징으로 하는 위상 샘플링 디지털 고주파 기억장치를 위한 위상제어 시스템.
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