KR101643432B1 - 원격통신 네트워크에서 ｐｄｃｃｈ 검출 에러들을 제거하기 위한 시스템 및 방법 - Google Patents

원격통신 네트워크에서 ｐｄｃｃｈ 검출 에러들을 제거하기 위한 시스템 및 방법 Download PDF

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Abstract

검출 에러를 제거하기 위해, LTE(Long Term Evolution) 원격통신 시스템에서의 PDCCH(Physical Downlink Control Channel) 채널의 분명한(unambiguous) 인코딩을 위한 시스템, 방법 및 노드가 개시된다. 이 방법은, 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 원형 버퍼의 크기를 수정하는 단계를 포함한다. 원형 버퍼는 복수의 비트를 갖는 PDCCH 페이로드로부터 인터리빙된 비트들을 수집한다. PDCCH 페이로드는 컨볼루션 코드로 인코딩된다. 그 다음, PDCCH 페이로드의 비트들이 인터리빙된다. 인터리빙된 비트들은 수정된 원형 버퍼 내로 수집된다. 그 다음, 송신을 위해 수정된 원형 버퍼로부터 비트들이 선택된다.

Description

원격통신 네트워크에서 ＰＤＣＣＨ 검출 에러들을 제거하기 위한 시스템 및 방법{SYSTEM AND METHOD FOR REMOVING PDCCH DETECTION ERRORS IN A TELECOMMUNICATIONS NETWORK}
본 출원은 2008년 8월 21일에 출원된 미국 특허 가출원 제61/090753호의 이익을 주장하며, 그 개시내용은 여기에 참조로 포함된다.
본 발명은 통신 네트워크에 관한 것이다. 더 구체적으로, 본 발명은 LTE(Long Term Evolution) 원격통신 시스템에서 PDCCH(Physical Downlink Control Channel) 검출 에러를 제거하기 위한 시스템 및 방법에 관한 것이지만, 이에 제한되는 것은 아니다.
도 1은 코어 네트워크(102)라고 칭해지는 3세대(3G) 네트워크(102), 및 UTRAN(UMTS Terrestrial Radio Access Network)(104)을 포함하는 UMTS(Universal Mobile Telecommunications Systems) 네트워크(100)의 간략화된 블록도를 도시한 것이다. UTRAN은 복수의 무선 네트워크 제어기(RNC)(106)를 포함한다. 또한, 다양한 역할을 수행하는 복수의 RNC가 존재한다. 각각의 RNC는 기지국들의 집합에 접속된다. 기지국은 종종 Node-B라고 칭해진다. 각각의 Node-B(108)는 주어진 지리적 셀 내의 하나 이상의 사용자 장비(UE)(110)와의 통신을 담당한다. 서빙 RNC는 Node-B와 코어 네트워크 간에서 데이터를 시그널링하며 사용자를 라우팅하는 것을 담당한다.
LTE 시스템에서, PDCCH는 수개의 UE 간에서 공유되는 무선 자원들을 통해 송신된다. UE는 UE-특정(UE-specific) 검색 공간에 대해 4개의 집단(aggregation) 레벨, 구체적으로 1, 2, 4 및 8을 모니터링하며, 공통 검색 공간에 대해 2개의 집단 레벨, 구체적으로 4 및 8을 모니터링해야 하는 것으로서 특정된다.
3GPP(Third Generation Partnership Project) TS(Technical Specification) 36.213(버전 8)의 섹션 9.1은 물리적 다운링크 제어 채널 할당을 결정하기 위한 UE 절차를 설명하고 있다. 구체적으로, 섹션 9.1.1(PDCCH 할당 절차)은 수학식 1에 의해 주어지는 CCE들(Control Channel Elements)의 연속 집합(contiguous set)에 의해 정의되는 집단 레벨
Figure 112011019893196-pct00001
에서의 검색 공간
Figure 112011019893196-pct00002
을 논의하며,
Figure 112011019893196-pct00003
여기에서,
Figure 112011019893196-pct00004
는 서브프레임 k의 제어 영역 내의 CCE의 총 수이고,
Figure 112011019893196-pct00005
은 검색 공간의 시작을 정의하고,
Figure 112011019893196-pct00006
이며,
Figure 112011019893196-pct00007
은 주어진 검색 공간 내에서 모니터링할 PDCCH의 개수이다. 각각의 CCE는 36개의 QPSK(Quadrature Phase Shift Keying) 변조 심볼을 포함한다.
Figure 112011019893196-pct00008
의 값은 표 1에 의해 특정되며, 3GPP TS 36.213 내에 아래에 나타난 것과 같이 개시되어 있다.
Figure 112011019893196-pct00009
이러한 정의를 이용하면, 상이한 집단 레벨들에 대한 검색 공간은 시스템 대역폭에 무관하게 서로 중첩될 수 있다. 구체적으로, UE-특정 검색 공간 및 공통 검색 공간이 중첩될 수 있다. 또한, 상이한 집단 레벨들에 대한 검색 공간이 중첩될 수 있다. 예를 들어, 아래의 표 2는 그러한 중첩의 예를 나타낸다. 표 2는 각각 L = {1, 2, 4, 8}에 대하여
Figure 112011019893196-pct00010
인 예를 나타낸다.
Figure 112011019893196-pct00011
PDCCH 송신은 레이트 1/3 테일-바이팅 컨볼루션 코드(rate 1/3 Tail-biting Convolutional code)에 대하여 원형 버퍼 기반의 레이트 매칭(circular buffer based rate matching)을 이용한다. 상이한 집단 레벨들 간에서의 검색 공간 중첩 및 코딩된 비트들의 반복으로 인해, 복수의 집단 레벨이 CRC(Cycle Redundancy Check) 검사를 통과할 수 있다.
또한, 원형 버퍼 기반의 레이트 매칭으로 인해, 주어진 집단 크기(2, 4 또는 8)에 대하여, 코딩된 비트들은 제1 CCE 이후에 그 자신을 반복하기 시작한다. 도 2a 및 도 2b는 기존 원격통신 시스템에서의 CCE 반복 예를 도시한 간략한 블록도이다. 도 2a 및 도 2b는 특정 페이로드 크기(즉, 48비트)에 대한 예들을 도시하고 있다. 도 2a는 2회의 반복으로 집단 크기 4를 갖는 복수의 CCE(200)를 갖는 페이로드를 도시하고 있다. 각각의 반복은 원형 버퍼 내의 동일한 위치에서 시작한다. 도 2b는 집단 크기 8을 갖는 복수의 CCE(202)를 갖는 페이로드를 도시하고 있다. 집단 크기 8에서는 4회의 반복이 존재하는데, 각각의 반복은 원형 버퍼 내의 동일한 위치에서 시작한다.
일반적으로, 혼동스러운 레벨들(confusing levels)을 갖기 위한 필요 조건은 아래와 같이 나타내어지는데:
Figure 112011019893196-pct00012
여기에서, N은 모호한(ambiguous) 페이로드 크기이고, m 및 k는 둘 다 정수이다. UE는 0.75보다 높은 코드 레이트로 PDCCH를 디코딩하도록 요구되지 않으므로, N은 54 ×(8-m)보다 커서는 안 된다. 예를 들어, N=48이고, m=2k일 때, k는 1, 2, 또는 4의 값을 취할 수 있다. 그러한 예에서, {1, 2, 4, 8}의 임의의 조합은 혼동스러운 (2 또는 그 이상의) 집단 레벨을 생성할 수 있다. LTE PDCCH 페이로드는 정보 비트들 및 대응하는 16-비트 CRC를 포함하므로, 페이로드 크기는 20비트보다 작지 않다. LTE 시스템에 적용가능한 모든 문제있는 크기들을 모두 나열한 목록은 다음과 같다.
Figure 112011019893196-pct00013
상이한 집단 크기들 간에서의 검색 공간 중첩 및 코딩된 비트 반복으로 인해, 복수의 집단 크기가 CRC 검사를 통과할 수 있다. PDCCH의 제1 CCE는 동적 스케줄링(dynamic scheduling)을 위해 업링크 ACK/NACK(Acknowledgement/Negative Acknowledgement) 자원에 링크되므로, UE는 Node-B가 알지 못하는 다른 자원에서 그것의 ACK/NACK를 발송할 수 있다(즉, 복수의 ACK/NACK 자원이 가능하다). 이와 같이, 상이한 집단 레벨들로부터의 둘 이상의 PDCCH 디코딩 후보가 상이한 최저 CCE 인덱스를 가질 때, 대응하는 PDCCH 승인(grants)의 제1 CCE로부터 맵핑되는 업링크(UL) ACK/NACK 자원 위치에 혼동이 존재할 수 있다. 잠재적으로 잘못된 UL ACK/NACK 자원 위치는 불필요한 UL 간섭을 발생시킬 뿐만 아니라, 특히 높은 지오메트리(high geometry)의 UE에 대하여, 다운링크 스루풋에도 영향을 준다.
이러한 문제를 해결하기 위한 많은 해법들이 있어 왔다. 한 해법에서, 집단 크기를 나타내기 위해, 각각의 PDCCH 포맷에 2 비트가 추가된다. 이러한 간단한 해법은 UE가 집단 크기의 올바름을 검증하는 것을 허용한다. 그러나, 이 해법은 PDCCH에 대한 오버헤드를 증가시키고, 이러한 중요한 시스템 신호들의 커버리지를 감소시킨다.
다른 기존 해법에서는, 상이한 집단 크기들에 대하여, 상이한 CRC 마스크 또는 스크램블링 코드들이 적용된다. 이것은 명백히 UE 디코딩 복잡성을 증가시킨다. 또한, CRC에 대한 추가의 스크램블링 동작들(예를 들어, 다양한 UE 식별, 송신 안테나 선택 마스크, 및 집단 레벨 특정 마스크들에 대한 제안)은 더 높은 CRC 오검출 확률로 이어진다. 따라서, 이 해법은 검출 신뢰도와 연관된 문제를 해결하지 못한다.
다른 기존 해법에서는, eNodeB(evolved Node B)가 모든 가능한 위치들에서 UE의 ACK/NACK를 디코딩하려고 시도한다. eNodeB는 UE가 모호한 PDCCH 페이로드 크기들에 대해 PDCCH 송신을 위한 올바른 집단 레벨을 선택하는지에 관한 지식을 갖지 않는다. eNodeB는 모든 가능한 집단 레벨들에서 주어진 UE에 대하여 UL ACK/NACK를 검출하려고 선택할 수 있다. 그러나, 그것은 추가의 구현 복잡성을 만들어낼 뿐만 아니라, 더 중요하게는, 올바른 검출을 보장할 수 없다. 첫번째로, eNodeB는 어떠한 UL ACK/NACK 충돌도 가능하지 않음을 확실하게 해야 한다. 상이한 UE들은 중첩되는 검색 공간을 가져서는 안 되므로, 이것은 심각한 스케줄링 제약을 부과한다. 이것은 불가능하지는 않더라도, 시스템 부하로 인해 실제로 만족시키기가 매우 어렵다. 또한, eNodeB는 채널 상태들, HARQ(Hybrid Automatic Repeat Request) 종단(termination) 타깃, 및 불완전한 전력 제어로 인해, 특정 집단 레벨들에 대한 특정 ACK/NACK 통계를 추정할 수 없다. 마지막으로, 복수의 가설(hypotheses)은 필연적으로, UL ACK/NACK 검출 성능에 부정적인 영향을 준다. 따라서, 위에서 언급된 문제들을 해결하기 위해 eNodeB를 이용하는 것은 실용적이지 않다.
PDCCH 송신을 위한 실제의 집단 레벨을 결정하기 위해, UE는 다양한 접근방식들을 이용할 수 있다. UE는 변조된 심볼들을 이용하여, CCE들의 모든 가능한 혼동스러운 조합들에 대한 에너지를 결정할 수 있다. 그러나, 이러한 접근방식은 다른 셀들로부터의 간섭으로 인해 신뢰도가 매우 낮다. 다른 접근방식에서, PDCCH는 재-인코딩될 수 있다. UE는 비트들을 디코딩하여 PDCCH를 재-인코딩하고 CCE들의 모든 가능한 혼동스러운 조합들의 SNR(Signal-to-Noise Ratio)을 결정할 수 있다. 이러한 접근방식은 신뢰도가 더 높지만, 매우 복잡하다. 대안적으로, UE는 코딩된 비트들의 반복의 정수 배 및 CCE들의 정수 배를 포함하는 각각의 세그먼트에 대해 CRC 체크를 수행할 수 있다. 각각의 세그먼트가 동일한 CRC 검사 결과를 갖는다는 보장은 없다. 따라서, 복잡한 판정 로직이 고안되어야 한다. 또한, 이러한 접근방식은 필연적으로, 블라인드(blind) PDCCH 디코드들의 수를 상당히 증가시킨다. 따라서, 매우 복잡한 구현이 채용되지 않으면, 해법이 쉽게 구현되지 않는다. 대안적으로, 위의 복잡한 구현들을 우회하기 위해, 집단 레벨들이 선택될 수 있다. 예를 들어, 포지티브 CRC 검사를 갖는 모든 집단 레벨 중에서, 최고 또는 최저 집단 레벨이 선택될 수 있다. 어느 경우에서든, 구현들은 (올바르지 않은 집단 레벨을 선택하는 것의) 무시할 수 없는 잘못된 경고 확률에 종속된다.
다른 기존 해법에서, "문제가 있는" 페이로드 크기를 갖는 PDCCH에 제로 패딩(zero padding)이 적용될 수 있다. 문제가 있는 페이로드 크기가 너무 많기 때문에, 이 해법은 복잡한 수신기 블라인드 디코딩 로직을 필요로 한다.
본 발명은 임의의 집단 레벨 혼동을 피하기 위해, 원형 버퍼의 크기를 수정한다. 본 발명은 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써, PDCCH의 이러한 분명한 인코딩(unambiguous encoding)을 달성한다. 구체적으로, 제외되는 비트는 페이로드 내의 마지막 코딩된 비트, 하나보다 많은 코딩된 비트, 또는 임의의 코딩된 비트일 수 있다.
일 양태에서, 본 발명은 분명한 인코딩에 의해, LTE(Long Term Evolution) 원격통신 시스템에서의 PDCCH(Physical Downlink Control Channel) 검출 에러를 제거하는 방법에 관한 것이다. 이 방법은, 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 원형 버퍼의 크기를 수정하는 단계를 포함한다. 원형 버퍼는 복수의 비트를 갖는 PDCCH 페이로드로부터 인터리빙된 비트들을 수집한다. PDCCH 페이로드는 컨볼루션 코드로 인코딩된다. 그 다음, PDCCH 페이로드의 비트들이 인터리빙된다. 인터리빙된 비트들은 수정된 원형 버퍼 내로 수집된다. 그 다음, 송신을 위해 수정된 원형 버퍼로부터 비트들이 선택된다.
다른 양태에서, 본 발명은 분명한 인코딩으로 LTE 원격통신 시스템에서의 PDCCH 검출 에러를 제거하는 시스템에 관한 것이다. 이 시스템은 복수의 비트를 갖는 PDCCH 페이로드를 송신하기 위한 송신기, 및 PDCCH 페이로드로부터 인터리빙된 비트들을 수집하기 위한 원형 버퍼를 포함한다. 원형 버퍼의 크기는, 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 수정된다. PDCCH 페이로드는 컨볼루션 코드로 인코딩된다. PDCCH 페이로드의 복수의 비트가 인터리빙되고, 수정된 원형 버퍼 내로 수집된다. 그 다음, 수정된 원형 버퍼로부터 선택된 비트들이 송신된다.
또 다른 양태에서, 본 발명은 분명한 인코딩으로 페이로드를 송신함으로써 LTE 원격통신 시스템에서의 PDCCH 검출 에러를 제거하는 노드에 관한 것이다. 이 노드는 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 원형 버퍼의 크기를 수정한다. 원형 버퍼는 복수의 비트를 갖는 PDCCH 페이로드로부터 인터리빙된 비트들을 수집한다. 이 노드는 PDCCH 페이로드를 컨볼루션 코드로 인코딩하고, PDCCH 페이로드의 복수의 비트를 인터리빙한다. 이 노드는 인터리빙된 비트들을 수정된 원형 버퍼 내로 수집한다. 그 다음, 이 노드는 송신을 위해 수정된 원형 버퍼로부터 비트들을 선택한다.
이하의 섹션에서는, 도면들에 도시된 예시적인 실시예들을 참조하여 본 발명이 설명될 것이다.
도 1(종래 기술)은 UMTS 네트워크의 간략화된 블록도를 도시한 것이다.
도 2a(종래 기술)는 집단 크기 4를 갖는 복수의 CCE를 갖는 페이로드를 도시한 것이다.
도 2b(종래 기술)는 집단 크기 8을 갖는 복수의 CCE를 갖는 페이로드를 도시한 것이다.
도 3은 컨볼루션 코딩된 전송 채널들 및 제어 정보에 대한 레이트 매칭을 도시한 간략화된 블록도이다.
도 4는 LTE 원격통신 시스템 내에서 PDCCH 검출 에러를 제거하는 단계들을 도시한 흐름도이다.
이하의 상세한 설명에서는, 본 발명의 완벽한 이해를 제공하기 위해 다수의 구체적인 세부사항이 제공된다. 그러나, 본 기술분야의 지식을 가진 자들은, 본 발명이 그러한 구체적인 세부사항 없이도 실시될 수 있음을 이해할 것이다. 다른 경우들에서, 본 발명을 모호하게 하지 않도록, 잘 알려진 방법, 절차, 컴포넌트 및 회로는 상세하게 설명되지 않는다.
본 발명은 LTE(Long Term Evolution) 원격 통신 시스템에서 PDCCH(Physical Downlink Control Channel) 검출 에러를 제거하는 시스템 및 방법이다. 본 발명은 어떠한 집단 레벨 혼동도 일어나지 않을 수 있도록 원형 버퍼의 크기를 수정한다. 본 발명은 원형 버퍼로부터 하나의 코딩된 비트를 제외시킴으로써 PDCCH의 이러한 분명한 인코딩을 달성한다. 본 발명의 바람직한 실시예에서, 제외되는 비트는 마지막 코딩된 비트일 수 있다. 원형 버퍼 길이를 3×N으로부터 (3×N-1)로 감소시킴으로써, PDCCH 검출 혼동을 유발할 수 있는 페이로드 크기 N≥20이 존재하지 않을 것이다. LTE PDCCH 페이로드는 정보 비트들 및 대응하는 16-비트 CRC를 포함하므로, 페이로드 크기는 20비트보다 작지 않다. 대안적으로, 제외되는 비트의 수는 1보다 클 수 있다. 또한, 제외되는 비트는 페이로드의 마지막 위치와는 다른 위치들에 위치될 수 있다.
도 3은 3GPP TS 36.212에서 논의된 것과 같은 컨볼루션 코딩된 전송 채널 및 제어 정보에 대한 레이트 매칭을 도시하는 간략화된 블록도이다. 도시된 바와 같이, 복수의 서브블록 인터리버(250, 252 및 254)는 비트 컬렉션(260)으로 출력을 제공한다. 그 다음, 페이로드는 비트 선택 및 프루닝(pruning)(262)에서 처리된다. 구체적으로, PDCCH 페이로드는 우선 레이트 1/3 테일-바이팅 컨볼루션 코드에 의해 인코딩된다. 따라서, 테일-바이팅 컨볼루션 인코더의 입력에서 N 비트의 페이로드 크기를 이용하면, 인코더의 출력에서 3×N 비트가 존재한다. 그 다음, 도 3에 도시된 바와 같이, 이러한 비트들은 3개의 서브블록 인터리버에 의해 인터리빙된다. 인터리빙된 비트들은 원형 버퍼 내로 수집되고, 이것은 다음에 송신을 위해 선택될 수 있다.
도 3에 도시되어 있는 바와 같이, 컨볼루션 코딩된 전송 채널들 및 제어 정보에 대한 레이트 매칭은 3개의 비트 스트림
Figure 112011019893196-pct00014
,
Figure 112011019893196-pct00015
을 인터리빙하는 것, 및 그에 후속하는 비트들의 수집 및 원형 버퍼의 생성으로 구성된다. 비트 스트림
Figure 112011019893196-pct00016
은
Figure 112011019893196-pct00017
으로서 정의되는 출력 시퀀스를 갖는 서브블록 인터리버(250)에 따라 인터리빙된다. 비트 스트림
Figure 112011019893196-pct00018
은
Figure 112011019893196-pct00019
으로서 정의되는 출력 시퀀스를 갖는 서브블록 인터리버(252)에 따라 인터리빙된다. 비트 스트림
Figure 112011019893196-pct00020
은
Figure 112011019893196-pct00021
으로서 정의되는 출력 시퀀스를 갖는 서브블록 인터리버(254)에 따라 인터리빙된다. 블록 인터리버에 입력되는 비트들은
Figure 112011019893196-pct00022
에 의해 표시되며, 여기서 D는 비트들의 수이다.
3GPP TS 36.212에 설명된 컨볼루션 인코딩 및 레이트 매칭 알고리즘은 일반적으로 광범위한 사용자 데이터 또는 시스템 제어 정보에 적용될 수 있음에 주목해야 한다. 검출 신뢰도 문제는 PDCCH의 특정 구조로부터만 발생하므로, 본 발명의 바람직한 실시예에서는 PDCCH 페이로드의 경우에서만 최소한의 변경이 이루어진다. 본 발명의 제1 실시예에서, 3GPP TS 36.212의 섹션 5.1.4.2.2의 동작들(비트 수집, 선택 및 송신)은 다음과 같이 수정된다. 길이
Figure 112011019893196-pct00023
의 원형 버퍼는 다음과 같이 생성된다:
Figure 112011019893196-pct00024
.
페이로드가 PDCCH에 대한 것인 경우, 원형 버퍼의 길이는 1만큼 감소된다:
Figure 112011019893196-pct00025
.
레이트 매칭 출력 시퀀스 길이를 E로 표기하면, 레이트 매칭 출력 비트 시퀀스는
Figure 112011019893196-pct00026
이고,
Figure 112011019893196-pct00027
이다.
Figure 112011019893196-pct00028
본 발명의 제2 실시예에서, 제1 실시예에 대하여 위에 논의된 동작들은 더 수정될 수 있다. 구체적으로, 원형 버퍼 길이는 다음과 같이 결정된다:
PDCCH 페이로드에 대해서는
Figure 112011019893196-pct00029
, 그리고
그 외에 대해서는
Figure 112011019893196-pct00030
.
원형 버퍼는 다음과 같이 생성된다:
PDCCH 페이로드에 대해서는,
Figure 112011019893196-pct00031
그 외에 대해서는,
Figure 112011019893196-pct00032
.
레이트 매칭 출력 시퀀스 길이를 E로 표기하면, 레이트 매칭 출력 비트 시퀀스는
Figure 112011019893196-pct00033
이고,
Figure 112011019893196-pct00034
이다.
Figure 112011019893196-pct00035
본 발명의 제3 실시예에서, 모든 LTE 컨볼루션 코딩된 신호에 대하여 원형 버퍼의 크기가 수정된다. 구체적으로, 3GPP TS 36.212의 섹션 5.1.4.2.2의 동작들(비트 수집, 선택 및 송신)은 다음과 같이 수정된다. 길이
Figure 112011019893196-pct00036
의 원형 버퍼는 다음과 같이 생성된다:
Figure 112011019893196-pct00037
.
레이트 매칭 출력 시퀀스 길이를 E로 표기하면, 레이트 매칭 출력 비트 시퀀스는
Figure 112011019893196-pct00038
이고,
Figure 112011019893196-pct00039
이다.
Figure 112011019893196-pct00040
도 4는 본 발명의 교시에 따라 LTE 원격통신 시스템에서 PDCCH 검출 에러를 제거하는 단계들을 도시한 흐름도이다. 이하에서는, 도 1 내지 도 4를 참조하여, 본 발명의 단계들이 설명될 것이다. 이 방법은 어떠한 집단 레벨 혼동도 일어나지 않을 수 있도록 원형 버퍼의 크기가 수정되는 단계(300)에서 시작된다. 이것은 원형 버퍼로부터 하나의 코딩된 비트를 제외시킴으로써 달성될 수 있다. 제외되는 비트는 페이로드의 마지막 코딩된 비트, 하나보다 많은 제외되는 비트, 또는 다른 코딩된 비트일 수 있다. 일 실시예에서는, 위에서 논의된 바와 같이, PDCCH 페이로드만의 원형 버퍼가 수정된다. 다른 실시예에서, 원형 버퍼 길이는 다음과 같이 결정된다:
PDCCH 페이로드에 대해서는
Figure 112011019893196-pct00041
, 그리고
그 외에 대해서는
Figure 112011019893196-pct00042
.
다른 실시예에서는, 모든 LTE 컨볼루션 코딩된 신호에 대한 원형 버퍼의 크기가 수정된다.
다음으로, 단계(302)에서, PDCCH 페이로드는 레이트 1/3 테일-바이팅 컨볼루션 코드에 의해 인코딩된다. 그 다음, 단계(304)에서, 비트들은 서브블록 인터리버(250, 252 및 254)에 의해 인터리빙된다. 다음으로, 단계(306)에서, 비트들은 비트 컬렉션(260)에서, 수정된 원형 버퍼 내로 수집된다. 단계(308)에서, 송신을 위해, 참조번호(262)에서 비트들이 선택되고 프루닝된다.
본 발명은 기존 시스템들에 비하여 몇가지 구별되는 이점을 제공한다. 본 발명은 PDCCH 검출 신뢰도 문제에 대한 보편적인 해법을 제공한다. 또한, 본 발명은 원격통신 시스템에 복잡성을 과도하게 추가하지 않고서, PDCCH 검출 에러를 검출하고 제거하는 비교적 간단한 방법 및 시스템을 제공한다.
본 기술분야의 지식을 가진 자들이 인식할 바와 같이, 본원에 설명된 혁신적인 개념들은 광범위한 애플리케이션들에 대하여 수정 및 변경될 수 있다. 따라서, 특허 청구 대상의 범위는 위에 논의된 특정의 예시적인 교시 중 임의의 것으로 한정되지 않고, 그 대신에 이하의 청구항들에 의해 정의된다.

Claims (25)

  1. LTE(Long Term Evolution) 원격통신 시스템에서의 PDCCH(Physical Downlink Control Channel)의 분명한(unambiguous) 인코딩 방법으로서,
    PDCCH 페이로드들에만 연관된 원형 버퍼(circular buffer)로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 상기 원형 버퍼의 크기를 수정하는 단계 - 상기 원형 버퍼는 복수의 비트를 갖는 PDCCH 페이로드로부터 인터리빙된 비트들을 수집함 -;
    상기 PDCCH 페이로드를 채널 코드로 인코딩하는 단계;
    상기 PDCCH 페이로드의 상기 복수의 비트를 인터리빙하는 단계;
    인터리빙된 비트들을 수정된 상기 원형 버퍼 내로 수집하는 단계; 및
    송신을 위해 상기 수정된 원형 버퍼로부터 비트들을 선택하는 단계
    를 포함하는 방법.
  2. 제1항에 있어서,
    상기 원형 버퍼의 크기를 수정하는 단계는 상기 원형 버퍼의 마지막 코딩된 비트를 제외시키는 단계를 포함하는 방법.
  3. 제1항에 있어서,
    상기 원형 버퍼의 크기를 수정하는 단계는 상기 원형 버퍼로부터 복수의 코딩된 비트를 제외시키는 단계를 포함하는 방법.
  4. 제1항에 있어서,
    상기 원형 버퍼의 크기를 수정하는 단계는 상기 원형 버퍼의 임의의 위치로부터 코딩된 비트를 제외시키는 단계를 포함하는 방법.
  5. 삭제
  6. 제1항에 있어서,
    상기 원형 버퍼의 크기를 수정하는 단계는,
    PDCCH 페이로드에 대해서는
    Figure 112011019893196-pct00043
    로, 그리고
    그 외에 대해서는
    Figure 112011019893196-pct00044
    으로
    원형 버퍼 길이를 수정하는 단계를 포함하는 방법.
  7. 제1항에 있어서,
    모든 LTE 컨볼루션 코딩된 신호들에 대해 상기 원형 버퍼의 크기가 수정되는 방법.
  8. 제1항에 있어서,
    상기 채널 코드는 레이트 1/3 테일-바이팅 컨볼루션 코드(rate 1/3 tail-biting convolutional code)인 방법.
  9. LTE(Long Term Evolution) 원격통신 시스템에서 분명하게 인코딩된 PDCCH(Physical Downlink Control Channel) 채널을 송신하기 위한 시스템으로서,
    복수의 비트를 갖는 PDCCH 페이로드를 송신하기 위한 송신기;
    상기 PDCCH 페이로드로부터 인터리빙된 비트들을 수집하기 위한 원형 버퍼;
    PDCCH 페이로드들에만 연관된 상기 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 상기 원형 버퍼의 크기를 수정하기 위한 수단;
    상기 PDCCH 페이로드를 채널 코드로 인코딩하기 위한 수단;
    상기 PDCCH 페이로드의 상기 복수의 비트를 인터리빙하기 위한 수단;
    인터리빙된 비트들을 수정된 상기 원형 버퍼 내로 수집하기 위한 수단; 및
    송신을 위해 상기 수정된 원형 버퍼로부터 비트들을 선택하기 위한 수단
    을 포함하는 시스템.
  10. 제9항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼의 마지막 코딩된 비트를 제외시키기 위한 수단을 포함하는 시스템.
  11. 제9항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼로부터 복수의 코딩된 비트를 제외시키기 위한 수단을 포함하는 시스템.
  12. 제9항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼의 임의의 위치로부터 코딩된 비트를 제외시키기 위한 수단을 포함하는 시스템.
  13. 삭제
  14. 제9항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은,
    PDCCH 페이로드에 대해서는
    Figure 112011019893196-pct00045
    로, 그리고
    그 외에 대해서는
    Figure 112011019893196-pct00046
    으로
    원형 버퍼 길이를 수정하기 위한 수단을 포함하는 시스템.
  15. 제9항에 있어서,
    모든 LTE 컨볼루션 코딩된 신호들에 대해 상기 원형 버퍼의 크기가 수정되는 시스템.
  16. 제9항에 있어서,
    상기 PDCCH 페이로드의 상기 복수의 비트를 인터리빙하기 위한 수단은 복수의 서브블록 인터리버인 시스템.
  17. 제9항에 있어서,
    상기 채널 코드는 레이트 1/3 테일-바이팅 컨볼루션 코드인 시스템.
  18. LTE(Long Term Evolution) 원격통신 시스템에서 분명하게 인코딩된 PDCCH(Physical Downlink Control Channel) 채널을 송신하기 위한 노드로서,
    PDCCH 페이로드들에만 연관된 원형 버퍼로부터 적어도 하나의 코딩된 비트를 제외시킴으로써 상기 원형 버퍼의 크기를 수정하기 위한 수단 - 상기 원형 버퍼는 복수의 비트를 갖는 PDCCH 페이로드로부터 인터리빙된 비트들을 수집함 -;
    상기 PDCCH 페이로드를 채널 코드로 인코딩하기 위한 수단;
    상기 PDCCH 페이로드의 상기 복수의 비트를 인터리빙하기 위한 수단;
    인터리빙된 비트들을 수정된 상기 원형 버퍼 내로 수집하기 위한 수단; 및
    송신을 위해 상기 수정된 원형 버퍼로부터 비트들을 선택하기 위한 수단
    을 포함하는 노드.
  19. 제18항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼의 마지막 코딩된 비트를 제외시키기 위한 수단을 포함하는 노드.
  20. 제18항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼로부터 복수의 코딩된 비트를 제외시키기 위한 수단을 포함하는 노드.
  21. 제18항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은 상기 원형 버퍼의 임의의 위치로부터 코딩된 비트를 제외시키기 위한 수단을 포함하는 노드.
  22. 삭제
  23. 제18항에 있어서,
    상기 원형 버퍼의 크기를 수정하기 위한 수단은,
    PDCCH 페이로드에 대해서는
    Figure 112011019893196-pct00047
    로, 그리고
    그 외에 대해서는
    Figure 112011019893196-pct00048
    으로
    원형 버퍼 길이를 수정하기 위한 수단을 포함하는 노드.
  24. 제18항에 있어서,
    모든 LTE 컨볼루션 코딩된 신호들에 대해 상기 원형 버퍼의 크기가 수정되는 노드.
  25. 제18항에 있어서,
    상기 채널 코드는 레이트 1/3 테일-바이팅 컨볼루션 코드인 노드.
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