KR101231522B1 - The printed circuit board and the method for manufacturing the same - Google Patents

The printed circuit board and the method for manufacturing the same Download PDF

Info

Publication number
KR101231522B1
KR101231522B1 KR1020100134547A KR20100134547A KR101231522B1 KR 101231522 B1 KR101231522 B1 KR 101231522B1 KR 1020100134547 A KR1020100134547 A KR 1020100134547A KR 20100134547 A KR20100134547 A KR 20100134547A KR 101231522 B1 KR101231522 B1 KR 101231522B1
Authority
KR
South Korea
Prior art keywords
solder resist
bump
pad
mask
opening
Prior art date
Application number
KR1020100134547A
Other languages
Korean (ko)
Other versions
KR20120072685A (en
Inventor
류성욱
심성보
신승열
Original Assignee
엘지이노텍 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 엘지이노텍 주식회사 filed Critical 엘지이노텍 주식회사
Priority to KR1020100134547A priority Critical patent/KR101231522B1/en
Priority to EP11852118.6A priority patent/EP2645829B1/en
Priority to CN201180068501.8A priority patent/CN103404244B/en
Priority to US13/997,596 priority patent/US9706652B2/en
Priority to PCT/KR2011/010057 priority patent/WO2012087072A2/en
Priority to TW100148569A priority patent/TWI442854B/en
Publication of KR20120072685A publication Critical patent/KR20120072685A/en
Application granted granted Critical
Publication of KR101231522B1 publication Critical patent/KR101231522B1/en

Links

Images

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3457Solder materials or compositions; Methods of application thereof
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/18Printed circuits structurally associated with non-printed electric components
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3452Solder masks

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Electric Connection Of Electric Components To Printed Circuits (AREA)

Abstract

본 발명의 실시 예에 따른 인쇄회로기판은 절연층과, 상기 절연층 위에 형성되어 있는 적어도 하나의 회로 패턴 또는 패드와, 상기 절연층 위에 형성되어 상기 패드의 상면을 노출하는 개구부를 갖는 솔더 레지스트와, 상기 패드 위에 도금으로 형성되며, 상기 솔더 레지스트의 표면 위로 돌출되어 있는 범프를 포함하며, 상기 범프는 상기 패드의 상면 면적보다 좁은 하면 면적을 갖는다.A printed circuit board according to an embodiment of the present invention includes a solder resist having an insulating layer, at least one circuit pattern or pad formed on the insulating layer, and an opening formed on the insulating layer to expose the top surface of the pad; And a bump formed on the pad by plating and protruding above the surface of the solder resist, wherein the bump has a lower surface area that is narrower than an upper surface area of the pad.

Description

인쇄회로기판 및 그의 제조 방법{The printed circuit board and the method for manufacturing the same}[0001] The present invention relates to a printed circuit board and a method of manufacturing the same,

본 발명은 인쇄회로기판 및 그의 제조 방법에 관한 것이다.The present invention relates to a printed circuit board and a method of manufacturing the same.

인쇄회로기판(PCB; Printed Circuit Board)은 전기 절연성 기판에 구리와 같은 전도성 재료로 회로 패턴을 인쇄하여 형성한 것으로, 전자부품을 탑재하기 직전의 기판(Board)을 말한다. 즉, 여러 종류의 전자 소자를 평판 위에 밀집 탑재하기 위해, 각 부품의 장착 위치를 확정하고, 부품을 연결하는 회로 패턴을 평판 표면에 인쇄하여 고정한 회로 기판을 의미한다.A printed circuit board (PCB) is formed by printing a circuit pattern on a electrically insulating substrate with a conductive material such as copper, and refers to a board immediately before mounting an electronic component. That is, it means the circuit board which fixed the mounting position of each component, and printed and fixed the circuit pattern which connects components on the flat surface in order to mount various types of electronic elements on a flat plate.

또한, 최근 들어 전자산업의 발달에 따라 전자 부품의 고기능화, 소형화, 가격 경쟁력 및 단납기의 요구가 급증하고 있다. 이러한 추세에 대응하고자 인쇄회로기판업체에서는 세미 에디티브 방식(SAP: Semi Additive Process)을 적용하여 인쇄회로기판의 박형화 및 고밀도화 추세에 대응하고 있다.In addition, with the development of the electronics industry, the demand for high functionalization, miniaturization, price competitiveness, and short delivery time of electronic components is increasing rapidly. In order to cope with this trend, printed circuit board manufacturers are applying semi-additive process (SAP) to cope with the trend of thinner and denser printed circuit boards.

도 1a 내지 도 1e는 일반적인 인쇄회로기판에서의 범프(bump) 제조 과정을 나타내는 단면도이다.1A to 1E are cross-sectional views illustrating a bump manufacturing process in a general printed circuit board.

우선적으로, 도 1a와 같이 절연성 기판(절연 플레이트)(1) 위에 제 1 금속층(2)을 형성한다. 또한, 상기 제 1 금속층(2)은 구리, 니켈 또는 이들의 합금으로 형성될 수 있다. 상기 제 1 금속층(2)이 형성되면, 상기 제 1 금속층(2) 위에 제 1 마스크 패턴(3)을 형성한다. 그럼 다음, 상기 형성된 제 1 마스크 패턴(3)을 중심으로 상기 제 1 금속층(2)을 씨드층으로 전해 도금하여 패드(4)를 형성된다. 상기 패드(4)가 형성되면, 박리 및 에칭 공정을 거쳐 불필요한 부분인 상기 제 1 금속층(2) 및 제 1 마스크 패턴(3)을 제거한다. First, as shown in FIG. 1A, the first metal layer 2 is formed on the insulating substrate (insulating plate) 1. In addition, the first metal layer 2 may be formed of copper, nickel, or an alloy thereof. When the first metal layer 2 is formed, a first mask pattern 3 is formed on the first metal layer 2. Then, the pad 4 is formed by electroplating the first metal layer 2 with the seed layer around the formed first mask pattern 3. When the pad 4 is formed, the first metal layer 2 and the first mask pattern 3, which are unnecessary parts, are removed through a peeling and etching process.

그런 다음, 도 1b에 도시된 바와 같이 상기 패드(4)가 형성된 절연성 기판(1) 위에 상기 형성된 패드(4)를 노출하는 솔더 레지스트(5)를 형성한다.Next, as shown in FIG. 1B, the solder resist 5 exposing the formed pad 4 is formed on the insulating substrate 1 on which the pad 4 is formed.

그런 다음, 도 1c에 도시된 바와 같이 상기 도포된 솔더 레지스트(5) 위에 제 2 금속층(6)을 형성하고, 상기 형성된 제 2 금속층(6) 위에 제 2 마스크 패턴(7)을 형성한다. 이때, 상기 솔더 레지스트(5)와 제 2 금속층(6) 간의 밀착력을 확보하기 위해, 상기 솔더 레지스트(5)의 표면 처리를 수행한다. Then, as shown in FIG. 1C, a second metal layer 6 is formed on the applied solder resist 5, and a second mask pattern 7 is formed on the formed second metal layer 6. At this time, in order to secure the adhesion between the solder resist 5 and the second metal layer 6, the surface treatment of the solder resist 5 is performed.

그런 다음, 도 1d에 도시된 바와 같이, 상기 패드(4) 위에 범프(8)를 형성하고, 박리 및 에칭 공정을 거쳐 도 1e와 같이, 불필요한 부분인 상기 제 2 금속층(6) 및 제 2 마스크 패턴(7)을 제거한다.Then, as shown in FIG. 1D, the bumps 8 are formed on the pads 4, and after the peeling and etching process, as shown in FIG. 1E, the second metal layer 6 and the second mask, which are unnecessary parts, are formed. Remove the pattern (7).

그러나, 상기와 같은 종래 기술에 따르면, 상기와 같은 범프(8) 형성 시 솔더 레지스트(5)의 표면 처리 및 제 2 금속층 형성 등과 같은 추가 공정이 필요하고, 이에 따른 추가 비용이 발생하는 문제가 있다.However, according to the prior art as described above, when the bump 8 is formed as described above, an additional process such as surface treatment of the solder resist 5 and the formation of the second metal layer is required, which causes additional cost. .

본 발명에 따른 실시 예에서는 새로운 구조의 인쇄회로기판 및 그의 제조 방법을 제공한다.An embodiment according to the present invention provides a printed circuit board having a new structure and a method of manufacturing the same.

또한, 본 발명에 따른 실시 예에서는 SMD(Solder Mask Defined) 및 NSMD(Non Solder Mask Defined) 디자인의 인쇄회로기판에 있어서, 파인 피치(Fine Pitch) 범프를 구현시킬 수 있는 인쇄회로기판 및 그의 제조 방법을 제공한다.In addition, in the embodiment according to the present invention, in a printed circuit board of SMD (Solder Mask Defined) and NSMD (Non Solder Mask Defined) design, a printed circuit board capable of realizing a fine pitch (Pitch) bump and a manufacturing method thereof To provide.

본 발명에서 이루고자 하는 기술적 과제들은 이상에서 언급한 기술적 과제들로 제한되지 않으며, 언급되지 않은 또 다른 기술적 과제들은 아래의 기재로부터 제안되는 실시 예가 속하는 기술분야에서 통상의 지식을 가진 자에게 명확하게 이해될 수 있을 것이다.  Technical problems to be achieved in the present invention are not limited to the technical problems mentioned above, and other technical problems not mentioned above are clearly understood by those skilled in the art to which the embodiments proposed from the following description belong. Could be.

본 발명의 실시 예에 따른 인쇄회로기판은 절연층과, 상기 절연층 위에 형성되어 있는 적어도 하나의 회로 패턴 또는 패드와, 상기 절연층 위에 형성되어 상기 패드의 상면을 노출하는 개구부를 갖는 솔더 레지스트와, 상기 패드 위에 도금으로 형성되며, 상기 솔더 레지스트의 표면 위로 돌출되어 있는 범프를 포함하며, 상기 범프는 상기 패드의 상면 면적보다 좁은 하면 면적을 갖는다.A printed circuit board according to an embodiment of the present invention includes a solder resist having an insulating layer, at least one circuit pattern or pad formed on the insulating layer, and an opening formed on the insulating layer to expose the top surface of the pad; And a bump formed on the pad by plating and protruding above the surface of the solder resist, wherein the bump has a lower surface area that is narrower than an upper surface area of the pad.

또한, 본 발명의 실시 예에 따른 인쇄회로기판의 제조 방법은 절연 기판 위에 패드를 형성하는 단계와, 상기 절연 기판 위에 상기 패드를 노출하는 개구부를 갖는 솔더 레지스트를 도포하는 단계와, 상기 솔더 레지스트 위에 상기 개구부를 개방하는 윈도우를 갖는 마스크를 형성하는 단계와, 상기 솔더 레지스트의 개구부 및 상기 마스크의 윈도우를 매립하는 범프를 형성하는 단계를 포함하여 이루어진다.In addition, the method of manufacturing a printed circuit board according to an embodiment of the present invention comprises the steps of forming a pad on an insulating substrate, applying a solder resist having an opening exposing the pad on the insulating substrate, and on the solder resist Forming a mask having a window opening the opening, and forming a bump filling the opening of the solder resist and the window of the mask.

본 발명에 따른 실시 예에 의하면, 범프 형성시 솔더 레지스트의 표면 처리 공정을 생략함으로써, 최소의 공정으로 신뢰성이 높고 안정적인 인쇄회로기판을 제공할 수 있다.According to the embodiment of the present invention, by eliminating the surface treatment process of the solder resist during bump formation, it is possible to provide a highly reliable and stable printed circuit board with a minimum process.

도 1a 내지 도 1e는 종래 기술의 인쇄회로기판을 제조하기 위한 방법을 나타내는 단면도이다.
도 2는 본 발명의 제 1 실시 예에 따른 인쇄회로기판의 단면도이다.
도 3 내지 도 10은 본 발명의 제 1 실시 예에 따른 인쇄회로기판의 제조 방법을 공정 순서대로 도시하는 단면도이다.
도 11은 본 발명의 제 2 실시 예에 따른 인쇄회로기판의 단면도이다.
도 12 내지 도 15는 본 발명의 제 2 실시 예에 따른 인쇄회로기판의 제조 방법을 공정 순서대로 도시하는 단면도이다.
도 16 내지 도 20은 본 발명의 제 3 실시 예에 따른 인쇄회로기판의 제조 방법을 공정 순서대로 도시하는 단면도이다.
1A to 1E are cross-sectional views illustrating a method for manufacturing a printed circuit board of the prior art.
2 is a cross-sectional view of a printed circuit board according to a first embodiment of the present invention.
3 to 10 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to a first embodiment of the present invention in the order of process.
11 is a cross-sectional view of a printed circuit board according to a second exemplary embodiment of the present invention.
12 to 15 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to a second embodiment of the present invention in the order of processes.
16 to 20 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to a third embodiment of the present invention in order of process.

아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예에 한정되지 않는다. Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art can easily carry out the present invention. As those skilled in the art would realize, the described embodiments may be modified in various different ways, all without departing from the spirit or scope of the present invention.

명세서 전체에서, 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다. Throughout the specification, when a part is said to "include" a certain component, it means that it can further include other components, without excluding other components unless specifically stated otherwise.

그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하고, 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.In order to clearly illustrate the present invention in the drawings, thicknesses are enlarged in order to clearly illustrate various layers and regions, and parts not related to the description are omitted, and like parts are denoted by similar reference numerals throughout the specification .

층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐만 아니라 그 중간에 또 다른 부분이 있는 경우도 포함한다. 반대로 어떤 부분이 다른 부분 "바로 위에" 있다고 할 때에는 중간에 다른 부분이 없는 것을 뜻한다.When a portion of a layer, film, region, plate, etc. is said to be "on top" of another part, this includes not only when the other part is "right over" but also when there is another part in the middle. Conversely, when a part is "directly over" another part, it means that there is no other part in the middle.

이하에서는, 도 2 내지 도 10을 참조하여 본 발명의 제 1 실시 예에 따른 인쇄회로기판을 설명한다.Hereinafter, a printed circuit board according to a first embodiment of the present invention will be described with reference to FIGS. 2 to 10.

도 2는 본 발명의 제 1 실시 예에 따른 인쇄회로기판의 단면도이다.2 is a cross-sectional view of a printed circuit board according to a first embodiment of the present invention.

도 2를 참조하면, 본 발명의 제 1 실시 예에 따른 인쇄회로기판은 절연 플레이트(110), 상기 절연 플레이트(110) 위에 형성되는 회로 패턴(도시하지 않음)과 연결되어 있는 패드(125), 상기 패드(125) 위에 형성되는 범프(160), 상기 범프(160)의 도금 씨드층(150) 및 상기 회로 패턴을 덮는 솔더 레지스트(130)를 포함한다.Referring to FIG. 2, the printed circuit board according to the first embodiment of the present invention may include an insulating plate 110, a pad 125 connected to a circuit pattern (not shown) formed on the insulating plate 110, A bump 160 formed on the pad 125, a plating seed layer 150 of the bump 160, and a solder resist 130 covering the circuit pattern are included.

상기 절연 플레이트(110)는 열경화성 또는 열가소성 고분자 기판, 세라믹 기판, 유-무기 복합 소재 기판, 또는 글라스 섬유 함침 기판일 수 있으며, 고분자 수지를 포함하는 경우, 에폭시계 절연 수지를 포함할 수 있으며, 이와 달리 폴리 이미드계 수지를 포함할 수도 있다.The insulation plate 110 may be a thermosetting or thermoplastic polymer substrate, a ceramic substrate, an organic-inorganic composite material substrate, or a glass fiber impregnated substrate. When the insulation plate 110 includes a polymer resin, the insulation plate 110 may include an epoxy-based insulation resin. It may alternatively include polyimide resin.

상기 절연 플레이트(110) 위에는 복수의 회로 패턴과 연결되어 있는 복수의 패드(125)가 형성되어 있다. 상기 패드(125)는 인쇄회로기판 위에 실장되는 소자를 장착하기 위한 용도로 형성되며, 솔더(도시하지 않음)가 부착되는 패드(13)를 의미한다.A plurality of pads 125 connected to a plurality of circuit patterns are formed on the insulating plate 110. The pad 125 is formed to mount a device mounted on a printed circuit board, and refers to a pad 13 to which solder (not shown) is attached.

상기 패드(125)는 전도성 물질로 형성되며, 절연 플레이트(110) 상에 형성되는 동박층을 패터닝하여 회로 패턴을 형성하는 경우, 구리를 포함하는 합금으로 형성될 수 있다.The pad 125 may be formed of a conductive material, and may be formed of an alloy including copper when the circuit pattern is formed by patterning a copper foil layer formed on the insulating plate 110.

이때, 상기 패드(125)는 솔더 레지스트(130)의 측면에 형성된 도금층(150)을 씨드층으로 전기동도금하여 형성될 수 있다. 상기 도금층(150)은 화학동도금으로 상기 솔더 레지스트(130)의 측면과, 마스크(140)의 상면 및 측면에 형성될 수 있다.In this case, the pad 125 may be formed by electroplating the plating layer 150 formed on the side surface of the solder resist 130 as a seed layer. The plating layer 150 may be formed on the side surface of the solder resist 130 and the top and side surfaces of the mask 140 by chemical copper plating.

상기 패드(125) 위에는 상기 패드(125)의 상면을 덮는 복수의 범프(160)가 형성되어 있다. 이때, 상기 범프(160)는 전기동도금으로 상기 패드(125)의 상면의 면적보다 좁은 면적을 갖도록 형성될 수 있다.A plurality of bumps 160 covering the top surface of the pad 125 are formed on the pad 125. In this case, the bump 160 may be formed to have an area smaller than that of the upper surface of the pad 125 by electroplating.

또한, 상기 범프(160)는 도금에 의해 형성되기 때문에, 상기 범프(160)의 상면 및 상기 상면과 대향하는 하면의 면적은 동일하다. 상기 범프(160)는 상면과 하면의 면적이 동일한 원 기둥 형상이나 사각 기둥 형상 등으로 형성될 수 있다.In addition, since the bumps 160 are formed by plating, the areas of the upper surface of the bumps 160 and the lower surface of the bumps 160 that are opposite to each other are the same. The bumps 160 may have a circular columnar shape or a square columnar shape having the same upper and lower surfaces.

이때, 상기 솔더 레지스트(130)는 상기 패드(125)를 노출하는 개구부(135)를 갖으며, 상기 범프(160)는 상기 개구부(135)를 매립하며 형성된다. 이에 따라, 상기 범프(160)는 상기 개구부(135)의 면적과 동일한 면적을 갖는다.In this case, the solder resist 130 has an opening 135 exposing the pad 125, and the bump 160 is formed while filling the opening 135. Accordingly, the bump 160 has the same area as that of the opening 135.

실질적으로, 상기 범프(160)의 일부는 상기 도금층(150)으로 이루어져 있으며, 이에 따라 상기 범프(160)는 상기 도금층(150)을 포함하여 구성되어 진다.Substantially, a part of the bump 160 is composed of the plating layer 150, and thus the bump 160 includes the plating layer 150.

상기 범프(160)는 상기 패드(125)와 동일한 재질인 구리를 포함하는 합금으로 형성될 수 있다.The bumps 160 may be formed of an alloy including copper having the same material as the pads 125.

또한, 상기 범프(160)는 주석을 포함하는 합금으로 형성된 솔더 범프일 수도 있다.In addition, the bump 160 may be a solder bump formed of an alloy including tin.

다시 말해서, 상기 패드(125) 위에는 구리를 포함하는 합금을 도금한 범프(160)가 형성되어 있을 수도 있고, 주석을 포함하는 합금을 도금한 범프(160)가 형성되어 있을 수도 있다.In other words, a bump 160 plated with an alloy containing copper may be formed on the pad 125, or a bump 160 plated with an alloy containing tin may be formed.

상기 절연 플레이트(110) 위에는 회로 패턴을 덮으며 솔더 레지스트(130)가 형성되어 있다.The solder resist 130 is formed on the insulating plate 110 to cover the circuit pattern.

상기 솔더 레지스트(130)는 절연 플레이트(110)의 표면을 보호하기 위한 것으로, 절연 플레이트(110)의 전면에 형성되며, 노출되어야 하는 패드(125)의 상면을 개방하는 개구부(135)를 가진다.The solder resist 130 is to protect the surface of the insulating plate 110, is formed on the front surface of the insulating plate 110, and has an opening 135 that opens an upper surface of the pad 125 to be exposed.

상기 범프(160)는 상기 솔더 레지스트(130)가 갖는 개구부(135)를 매립하여 형성되며, 상기 솔더 레지스트(130)의 상면으로부터 돌출되도록 형성된다.The bump 160 is formed by filling the opening 135 of the solder resist 130 and protrudes from an upper surface of the solder resist 130.

이때, 상기 도금층(150)은 상기 솔더 레지스트(130)의 측면에 형성되며, 상기 솔더 레지스트(130)의 상면으로부터 돌출되어 상기 범프(160)의 측면으로까지 연장되어 형성된다.In this case, the plating layer 150 is formed on the side surface of the solder resist 130 and protrudes from the upper surface of the solder resist 130 to extend to the side surface of the bump 160.

이는 상기 도금층(150)이 상기 솔더 레지스트(130)의 상면 및 측면에 형성되지 않고, 상기 솔더 레지스트(130)의 측면에만 형성되기 때문이다.This is because the plating layer 150 is not formed on the top and side surfaces of the solder resist 130 but is formed only on the side surfaces of the solder resist 130.

즉, 종래 기술에 따르면, 디스미어 공정을 실시하여 상기 솔더 레지스트의 표면에 조도를 부여한 후, 무전해 화학동 도금을 실시하여, 상기 솔더 레지스트의 표면과 상기 화학동 간의 접착력을 높여주었다. 그러나, 이는 상기 디스미어 공정이 추가적으로 실시되어야 하며, 상기 솔더 레지스트의 표면이 상기 디스미어 공정으로 인해 거칠어져 인쇄회로기판의 품질을 낮추는 요인으로 작용하는 문제점이 있다.That is, according to the prior art, after the desmear process was performed to give roughness to the surface of the solder resist, electroless copper plating was performed to increase adhesion between the surface of the solder resist and the chemical copper. However, this is a problem that the desmear process must be additionally performed, and the surface of the solder resist is roughened by the desmear process, which acts as a factor of lowering the quality of the printed circuit board.

그러나, 본 발명에 따른 실시 예에서는 상기 솔더 레지스트의 표면에 실시했던 디스미어 공정을 생략하고, 상기 화학동을 상기 솔더 레지스트의 측면과, 마스크의 상면 및 측면에 형성되도록 하여, 상기 솔더 레지스트에 발생하던 품질 문제를 해결한 인쇄회로기판을 제공할 수 있다. 즉, 본 발명에 따른 실시 예에 의하면, 상기 범프 형성시 발생하던 공정을 최소화하여 제조 원가를 줄일 수 있으며, 상기 솔더 레지스트의 표면을 효과적으로 보호할 수 있다.However, in the embodiment according to the present invention, the desmear process performed on the surface of the solder resist is omitted, and the chemical copper is formed on the side surface of the solder resist, the top surface and the side surface of the mask, so that the solder resist is generated. It can provide a printed circuit board that solves the quality problem. That is, according to the embodiment of the present invention, it is possible to reduce the manufacturing cost by minimizing the process generated during the bump formation, it is possible to effectively protect the surface of the solder resist.

도 3 내지 도 10을 참조하여, 도 2의 인쇄회로기판을 제조하는 방법을 설명한다.A method of manufacturing the printed circuit board of FIG. 2 will be described with reference to FIGS. 3 to 10.

도 3 내지 도 10은 본 발명의 제 1 실시 예에 따른 인쇄회로기판의 제조 방법을 나타낸 단면도이다.3 to 10 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to the first embodiment of the present invention.

먼저, 도 3과 같이 절연 플레이트(110)를 준비한다.First, the insulating plate 110 is prepared as shown in FIG. 3.

도 3의 절연 플레이트(110)에는 복수의 회로 패턴이 형성되어 있으며, 절연 플레이트(110)의 하부에도 회로 패턴이 형성될 수 있다.A plurality of circuit patterns are formed on the insulating plate 110 of FIG. 3, and a circuit pattern may also be formed under the insulating plate 110.

즉, 상기 절연 플레이트(110)가 복수의 적층 구조 중 한 절연층을 의미하는 경우, 상기 절연 플레이트(110)의 상부 또는 하부에 복수의 회로 패턴(도시하지 않음)이 연속적으로 형성될 수 있으며, 그렇지 않은 경우, 상기 절연 플레이트(110)의 상부 및 하부 모두에 복수의 회로 패턴이 연속적으로 형성될 수 있다. That is, when the insulating plate 110 means one insulating layer among a plurality of stacked structures, a plurality of circuit patterns (not shown) may be continuously formed on the upper or lower portion of the insulating plate 110. Otherwise, a plurality of circuit patterns may be continuously formed on both the upper and lower portions of the insulating plate 110.

상기 절연 플레이트(110)는 열경화성 또는 열가소성 고분자 기판, 세라믹 기판, 유-무기 복합 소재 기판, 또는 글라스 섬유 함침 기판일 수 있으며, 고분자 수지를 포함하는 경우, 에폭시계 절연 수지를 포함할 수 있으며, 이와 달리 폴리 이미드계 수지를 포함할 수도 있다.The insulation plate 110 may be a thermosetting or thermoplastic polymer substrate, a ceramic substrate, an organic-inorganic composite material substrate, or a glass fiber impregnated substrate. When the insulation plate 110 includes a polymer resin, the insulation plate 110 may include an epoxy-based insulation resin. It may alternatively include polyimide resin.

이후, 상기 절연 플레이트(110) 위에 도전층(120)을 적층한다.Thereafter, the conductive layer 120 is stacked on the insulating plate 110.

상기 도전층(120)은 상기 절연 플레이트(110) 위에 구리를 포함하는 금속을 비전해 도금하여 형성될 수 있다.The conductive layer 120 may be formed by electroless plating a metal including copper on the insulating plate 110.

또한, 상기 도전층(120)은 상기 절연 플레이트(110)에 비전해 도금을 하여 형성하는 것과는 달리, CCL(Copper Clad Laminate)을 사용할 수 있다.In addition, the conductive layer 120 may use CCL (Copper Clad Laminate), unlike the non-electrolytic plating formed on the insulating plate 110.

상기 도전층(120)을 비전해 도금하여 형성하는 경우, 상기 절연 플레이트(110)의 상면에 조도를 부여하여 도금이 원활히 수행되도록 할 수 있다.When the electroconductive layer 120 is formed by electroless plating, the plating may be smoothly performed by applying roughness to the upper surface of the insulating plate 110.

상기 절연 플레이트(110)와 도전층(120)의 적층 구조에서 상기 도전층(120)을 식각하여 도 4의 패드(125) 및 회로 패턴(도시 하지 않음)을 형성한다.The conductive layer 120 is etched in the stacked structure of the insulating plate 110 and the conductive layer 120 to form a pad 125 and a circuit pattern (not shown) of FIG. 4.

이때, 상기 절연 플레이트(110)에 형성된 도전층(120)은 상기 절연 플레이트(110)의 상면 및 하면에 각각 형성되어 있을 수 있으며, 이에 따라 상기 회로 패턴(도시하지 않음) 및 패드(125)는 상기 절연 플레이트(110)의 하면에도 형성될 수 있다.In this case, the conductive layer 120 formed on the insulating plate 110 may be formed on the upper and lower surfaces of the insulating plate 110, and accordingly, the circuit pattern (not shown) and the pad 125 may be formed. It may also be formed on the lower surface of the insulating plate 110.

이와 같이, 상기 절연 플레이트(110)의 적어도 한 면에는 상기와 같은 회로 패턴과 패드(125)가 형성되어 있으며, 도 5와 같이 상기 절연 플레이트(110)에 형성된 회로 패턴을 매립하도록 하는 솔더 레지스트(130)를 도포한다.As such, the circuit pattern and the pad 125 are formed on at least one surface of the insulating plate 110, and as shown in FIG. 5, a solder resist to fill the circuit pattern formed on the insulating plate 110 ( 130).

이때, 상기 솔더 레지스트(130)는 상기 패드(125)를 노출하는 개구부(135)를 포함하며, 상기 개구부(135)는 상기 패드(125)의 폭보다 작은 폭을 갖도록 형성됨으로써, 상기 패드(125)의 가장자리 영역은 상기 솔더 레지스트(130)에 의해 보호된다.In this case, the solder resist 130 includes an opening 135 exposing the pad 125, and the opening 135 is formed to have a width smaller than the width of the pad 125, thereby providing the pad 125. Edge region is protected by the solder resist 130.

이후, 도 6과 같이 상기 솔더 레지스트(130) 위에 마스크(140)를 적층한다.Thereafter, a mask 140 is stacked on the solder resist 130 as shown in FIG. 6.

상기 마스크(140)는 포토 레지스트나 드라이 필름을 사용할 수 있다. 이때, 상기 마스크(140)는 내열성이 강한 드라이 필름을 사용하는 것이 바람직하다.The mask 140 may use a photoresist or a dry film. At this time, it is preferable that the mask 140 uses a dry film having strong heat resistance.

상기 마스크(140)는 상기 솔더 레지스트(130)가 갖는 개구부(135)에 대응되는 윈도우(145)를 갖는다.The mask 140 has a window 145 corresponding to the opening 135 of the solder resist 130.

다시 말해서, 상기 마스크(140)에는 상기 패드(125)를 노출하도록 하는 윈도우(145)가 형성되어 있다.In other words, a window 145 is formed in the mask 140 to expose the pad 125.

이때, 상기 윈도우(145)는 상기 솔더 레지스트(130)가 갖는 개구부(135)와 동일한 위치에 동일한 면적으로 형성될 수 있다.In this case, the window 145 may be formed at the same area as the opening 135 of the solder resist 130.

다음으로, 도 7과 같이 상기 마스크(140)의 상측 표면 및 측면, 그리고 상기 솔더 레지스트(130)의 측면에 도금층(150)을 형성한다.Next, as shown in FIG. 7, the plating layer 150 is formed on the upper surface and the side surface of the mask 140 and the side surface of the solder resist 130.

상기 도금층(150)은 화학동도금 방식으로 상기 마스크(140) 및 솔더 레지스트(130)의 상면, 측면에 형성될 수 있다.The plating layer 150 may be formed on the top and side surfaces of the mask 140 and the solder resist 130 by chemical copper plating.

상기 화학동도금 방식은 탈지 과정, 소프트 부식 과정, 예비 촉매 처리 과정, 촉매 처리 과정, 활성화 과정, 무전해 도금 과정 및 산화방지 처리 과정의 순서로 진행될 수 있다.The chemical copper plating may be performed in the order of a degreasing process, a soft corrosion process, a precatalyst process, a catalyst process, an activation process, an electroless plating process, and an anti-oxidation process.

또한, 상기 동도금은 두께에 따라 헤비 동도금(Heavy Copper, 2㎛이상), 미디엄 동도금(Medium Copper, 1~2㎛), 라이트 동도금(Light Copper, 1㎛이하)으로 각각 구분되며, 여기에서는 미디엄 동도금 또는 라이트 동도금으로 0.5~1.5㎛를 만족하는 도금층(150)을 형성한다.In addition, the copper plating is divided into heavy copper plating (Heavy Copper, 2㎛ or more), medium copper plating (Medium Copper, 1 ~ 2㎛), light copper plating (Light Copper, 1㎛ or less) according to the thickness, here, medium copper plating Alternatively, the plating layer 150 that satisfies 0.5 to 1.5 μm is formed of light copper plating.

다음으로, 도 8과 같이 상기 솔더 레지스트(130)의 개구부(135) 및 상기 마스크(140)의 윈도우(145)를 매립하여 범프(160)를 형성한다.Next, as illustrated in FIG. 8, the bumps 160 may be formed by filling the opening 135 of the solder resist 130 and the window 145 of the mask 140.

상기 범프(160)는 전기동도금 처리에 의해 상기 개구부(135) 및 윈도우(145) 전체를 매립하여 형성될 수 있으며, 이와 달리 상기 개구부(135) 및 윈도우(145)의 일부만을 매립하여 형성될 수도 있다. The bumps 160 may be formed by burying the entirety of the opening 135 and the window 145 by electroplating. Alternatively, the bumps 160 may be formed by filling only a part of the opening 135 and the window 145. have.

이때, 상기 범프(160)는 상기 패드(125)와 동일한 구리를 포함하는 합금을 도금하여 형성될 수 있다.In this case, the bumps 160 may be formed by plating an alloy including the same copper as the pads 125.

또한, 이와 달리 상기 범프(160)는 주석을 포함하는 합금을 도금하여 형성될 수도 있다. 즉, 상기 범프(160)는 주석으로만 형성될 수 있으며, 상기 주석과 팔라듐을 일정 비율로 혼합한 합금으로 형성될 수 있으며, 상기 주석과 팔라듐 이외에도 은을 추가로 포함한 합금으로 형성될 수 있다.In addition, the bump 160 may be formed by plating an alloy including tin. That is, the bumps 160 may be formed only of tin, may be formed of an alloy in which tin and palladium are mixed at a predetermined ratio, and may be formed of an alloy including silver in addition to tin and palladium.

상기 범프(160)가 상기 구리를 포함하는 합금으로 형성되는 경우, 추후 상기 범프(160) 위에는 솔더가 추가적으로 형성될 수 있다.When the bumps 160 are formed of an alloy including the copper, solder may be additionally formed on the bumps 160 later.

또한, 상기 범프(160)가 주석을 포함하는 합금으로 형성되는 경우, 상기 범프(160) 자체가 솔더 역할을 수행할 수 있다.In addition, when the bumps 160 are formed of an alloy including tin, the bumps 160 themselves may serve as solders.

다음으로, 도 9와 같이 식각 과정을 수행하여 상기 마스크(140)의 상측 표면에 형성된 도금층(150)을 선택적으로 제거한다.Next, the etching process is performed as shown in FIG. 9 to selectively remove the plating layer 150 formed on the upper surface of the mask 140.

다음으로, 도 10과 같이 상기 솔더 레지스트(130) 위에 적층된 마스크(140)를 제거한다.Next, as shown in FIG. 10, the mask 140 stacked on the solder resist 130 is removed.

즉, 상기 범프(160)가 형성되면, 상기 범프(160) 형성시 씨드층으로 사용한 상기 도금층(150)을 선택적으로 제거한다. 이때, 상기 도금층(150)은 플래쉬 에층 공정에 의해 상기 마스크(140)의 상측 표면에서 제거될 수 있다.That is, when the bumps 160 are formed, the plating layer 150 used as the seed layer is selectively removed when the bumps 160 are formed. In this case, the plating layer 150 may be removed from the upper surface of the mask 140 by a flash evaporation process.

그리고, 상기 도금층(150)이 제거되면, 상기 솔더 레지스트(130) 위에 형성된 마스크(140)를 박리한다. 이때, 상기 마스크(140)가 박리되면, 크리닝 과정을 거쳐 상기 솔더 레지스트(130)의 표면에 잔재하는 용제 등을 제거할 수도 있다.When the plating layer 150 is removed, the mask 140 formed on the solder resist 130 is peeled off. In this case, when the mask 140 is peeled off, a solvent or the like remaining on the surface of the solder resist 130 may be removed through a cleaning process.

상기와 같이, 본 발명의 제 1 실시 예에 따른 인쇄회로기판의 제조 방법에 의하면, 상기 솔더 레지스트(130)의 표면에 실시하던 디스미어 공정을 생략할 수 있을 뿐 아니라, 상기 솔더 레지스트(130)의 표면에 발생하던 품질 문제를 해결할 수 있다.As described above, according to the method of manufacturing the printed circuit board according to the first embodiment of the present invention, the desmear process performed on the surface of the solder resist 130 may be omitted, and the solder resist 130 may be omitted. This can solve the quality problem that occurred on the surface of the machine.

이하, 도 11 내지 도 15를 참조하여 본 발명의 제 2 실시 예에 따른 인쇄회로기판을 설명한다. 이때, 설명의 편의상 실질적으로 상기 제 1 실시 예에 따른 인쇄회로기판과 동일한 부분에 대해서는 이에 대한 설명을 생략하기로 한다.Hereinafter, a printed circuit board according to a second exemplary embodiment of the present invention will be described with reference to FIGS. 11 to 15. At this time, for convenience of description, the description of substantially the same parts as the printed circuit board according to the first embodiment will be omitted.

도 11은 본 발명의 제 2 실시 예에 따른 인쇄회로기판을 나타낸 단면도이다.11 is a cross-sectional view illustrating a printed circuit board according to a second exemplary embodiment of the present invention.

도 11을 참조하면, 본 발명의 제 2 실시 예에 따른 인쇄회로기판(200)은 절연 플레이트(210), 상기 절연 플레이트(210) 위에 형성되는 회로 패턴(도시하지 않음)과 연결되어 있는 패드(225), 상기 패드(225) 위에 형성되는 제 1 범프(260). 상기 제 1 범프(260) 위에 형성되는 제 2 범프(270), 상기 제 1 범프(260) 및 제 2 범프(270)의 도금 씨드층(250) 및 상기 회로 패턴을 덮는 솔더 레지스트(230)를 포함한다.Referring to FIG. 11, a printed circuit board 200 according to a second embodiment of the present invention may include an insulating plate 210 and a pad connected to a circuit pattern (not shown) formed on the insulating plate 210. 225), a first bump (260) formed over the pad (225). The second bump 270 formed on the first bump 260, the plating seed layer 250 of the first bump 260 and the second bump 270, and the solder resist 230 covering the circuit pattern may be formed. Include.

실질적으로, 상기 제 2 실시 예에 따른 인쇄회로기판(200)은 상기 제 1 실시 예에 따른 인쇄회로기판(100)과 범프 부분만이 상이할 뿐, 그 이외의 부분은 모두 동일한다.Substantially, the printed circuit board 200 according to the second embodiment differs from only the bump portion of the printed circuit board 100 according to the first embodiment, and all other portions are the same.

이에 따라, 상기 인쇄회로기판(100)과 상이한 범프 부분에 대해서만 설명하기로 한다.Accordingly, only the bump part different from the printed circuit board 100 will be described.

본 발명의 제 2 실시 예에 따른 인쇄회로기판(200)은 제 1 범프(260) 및 제 2 범프(270)를 포함한다.The printed circuit board 200 according to the second embodiment of the present invention includes a first bump 260 and a second bump 270.

상기 제1 범프(260)는 상기 패드(225) 위에 형성되며, 구리를 포함하는 합금으로 형성된다.The first bump 260 is formed on the pad 225 and is formed of an alloy including copper.

또한, 상기 제 2 범프(270)는 상기 제 1 범프(260) 위에 형성되며, 주석을 포함하는 합금으로 형성된다.In addition, the second bump 270 is formed on the first bump 260 and is formed of an alloy including tin.

즉, 상기 제 1 범프(260)는 상기 솔더 레지스트(230)의 개구부(235) 및 마스크(240)의 윈도우(245)의 일부만을 매립하도록 상기 구리를 포함하는 합금을 도금하여 형성된다.That is, the first bump 260 is formed by plating an alloy including copper to fill only a portion of the opening 235 of the solder resist 230 and the window 245 of the mask 240.

또한, 상기 제 2 범프(270)는 상기 형성된 제 1 범프(260) 위에 상기 솔더 레지스트(230)의 개구부(235) 및 마스크(240)의 윈도우(245)의 전체를 매립하도록 상기 주석을 포함하는 합금을 도금하여 형성된다.In addition, the second bump 270 includes the tin to fill the entirety of the opening 235 of the solder resist 230 and the window 245 of the mask 240 on the formed first bump 260. It is formed by plating an alloy.

도 12 내지 도 15를 참조하여, 도 11의 인쇄회로기판을 제조하는 방법을 설명한다.12 to 15, a method of manufacturing the printed circuit board of FIG. 11 will be described.

도 12 내지 도 15는 본 발명의 제 2 실시 예에 따른 인쇄회로기판의 제조 방법을 나타낸 단면도이다.12 to 15 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to the second embodiment of the present invention.

먼저, 도 12와 같이 절연 플레이트(210)를 준비한다. 상기 절연 플레이트(210)에는 복수의 회로 패턴이 형성되어 있으며, 절연 플레이트(210)의 하부에도 회로 패턴이 형성될 수 있다.First, the insulating plate 210 is prepared as shown in FIG. 12. A plurality of circuit patterns are formed on the insulating plate 210, and circuit patterns may also be formed on the lower portion of the insulating plate 210.

상기 절연 플레이트(110)는 열경화성 또는 열가소성 고분자 기판, 세라믹 기판, 유-무기 복합 소재 기판, 또는 글라스 섬유 함침 기판일 수 있으며, 고분자 수지를 포함하는 경우, 에폭시계 절연 수지를 포함할 수 있으며, 이와 달리 폴리 이미드계 수지를 포함할 수도 있다.The insulation plate 110 may be a thermosetting or thermoplastic polymer substrate, a ceramic substrate, an organic-inorganic composite material substrate, or a glass fiber impregnated substrate. When the insulation plate 110 includes a polymer resin, the insulation plate 110 may include an epoxy-based insulation resin. It may alternatively include polyimide resin.

이후, 상기 절연 플레이트(210) 위에 도전층(220)을 적층하고, 상기 적층된 도전층(220)을 선택적으로 식각하여 패드(225)를 형성한다.Thereafter, the conductive layer 220 is stacked on the insulating plate 210, and the stacked conductive layer 220 is selectively etched to form a pad 225.

상기 절연 플레이트(210)의 적어도 한 면에는 상기와 같은 회로 패턴과 패드(225)가 형성되어 있으며, 상기 절연 플레이트(110)에 형성된 회로 패턴을 매립하도록 하는 솔더 레지스트(230)를 도포한다.The circuit pattern and the pad 225 as described above are formed on at least one surface of the insulating plate 210, and a solder resist 230 is applied to bury the circuit pattern formed on the insulating plate 110.

이때, 상기 솔더 레지스트(230)는 상기 패드(225)를 노출하는 개구부(235)를 포함하며, 상기 개구부(235)는 상기 패드(225)의 폭보다 작은 폭을 갖도록 형성됨으로써, 상기 패드(225)의 가장자리 영역은 상기 솔더 레지스트(230)에 의해 보호된다.In this case, the solder resist 230 includes an opening 235 exposing the pad 225, and the opening 235 is formed to have a width smaller than the width of the pad 225, thereby providing the pad 225. Edge region is protected by the solder resist 230.

이후, 상기 솔더 레지스트(230) 위에 마스크(240)를 적층한다.Thereafter, a mask 240 is stacked on the solder resist 230.

상기 마스크(240)는 상기 솔더 레지스트(230)가 갖는 개구부(235)에 대응되는 윈도우(245)를 갖는다. 다시 말해서, 상기 마스크(240)에는 상기 패드(225)를 노출하도록 하는 윈도우(245)가 형성되어 있다.The mask 240 has a window 245 corresponding to the opening 235 of the solder resist 230. In other words, a window 245 is formed in the mask 240 to expose the pad 225.

다음으로, 상기 마스크(240)의 상측 표면 및 측면, 그리고 상기 솔더 레지스트(230)의 측면에 도금층(250)을 형성한다. 상기 도금층(250)은 화학동도금 방식으로 상기 마스크(240) 및 솔더 레지스트(230)의 상면, 측면에 형성될 수 있다.Next, the plating layer 250 is formed on the upper surface and the side of the mask 240 and the side of the solder resist 230. The plating layer 250 may be formed on the top and side surfaces of the mask 240 and the solder resist 230 by chemical copper plating.

다음으로, 상기 솔더 레지스트(230)의 개구부(235) 및 상기 마스크(240)의 윈도우(245)를 매립하여 제 1 범프(260)를 형성한다.Next, the opening 235 of the solder resist 230 and the window 245 of the mask 240 are buried to form a first bump 260.

상기 제 1 범프(260)는 전기동도금 처리에 의해 상기 개구부(235) 및 윈도우(245)의 일부만을 매립하여 형성된다.The first bump 260 is formed by filling only a part of the opening 235 and the window 245 by the electroplating process.

이때, 상기 제 1 범프(260)는 상기 패드(225)와 동일한 구리를 포함하는 합금을 도금하여 형성될 수 있다.In this case, the first bump 260 may be formed by plating an alloy including the same copper as the pad 225.

다음으로, 도 13과 같이 상기 제 1 범프(260) 위에 제 2 범프(270)를 형성한다. 상기 제 2 범프(270)는 상기 개구부(235) 및 윈도우(245) 전체를 매립하여 형성될 수 있다.Next, as shown in FIG. 13, a second bump 270 is formed on the first bump 260. The second bump 270 may be formed by filling the entire opening 235 and the window 245.

상기 제 2 범프(270)는 주석을 포함하는 합금을 도금하여 형성된다.즉, 상기 범프(160)는 주석으로만 형성될 수 있으며, 상기 주석과 팔라듐을 일정 비율로 혼합한 합금으로 형성될 수 있으며, 상기 주석과 팔라듐 이외에도 은을 추가로 포함한 합금으로 형성될 수 있다.The second bump 270 may be formed by plating an alloy including tin. That is, the bump 160 may be formed of only tin, and may be formed of an alloy in which tin and palladium are mixed at a predetermined ratio. In addition to the tin and palladium, it may be formed of an alloy further including silver.

다음으로, 도 14와 같이 식각 과정을 수행하여 상기 마스크(240)의 상측 표면에 형성된 도금층(250)을 선택적으로 제거한다.Next, the etching process is performed as shown in FIG. 14 to selectively remove the plating layer 250 formed on the upper surface of the mask 240.

다음으로, 도 15와 같이 상기 솔더 레지스트(230) 위에 적층된 마스크(240)를 제거한다.Next, as shown in FIG. 15, the mask 240 stacked on the solder resist 230 is removed.

즉, 상기 제 1 범프(260) 및 제 2 범프(270)가 형성되면, 상기 제 1 범프(260) 및 제 2 범프(270) 형성시 씨드층으로 사용한 상기 도금층(250)을 선택적으로 제거한다. 이때, 상기 도금층(250)은 플래쉬 에층 공정에 의해 상기 마스크(240)의 상측 표면에서 제거될 수 있다.That is, when the first bump 260 and the second bump 270 are formed, the plating layer 250 used as the seed layer is selectively removed when the first bump 260 and the second bump 270 are formed. . In this case, the plating layer 250 may be removed from the upper surface of the mask 240 by a flash evaporation process.

그리고, 상기 도금층(250)이 제거되면, 상기 솔더 레지스트(230) 위에 형성된 마스크(240)를 박리한다. 이때, 상기 마스크(240)가 박리되면, 크리닝 과정을 거쳐 상기 솔더 레지스트(130)의 표면에 잔재하는 용제 등을 제거할 수도 있다.When the plating layer 250 is removed, the mask 240 formed on the solder resist 230 is peeled off. In this case, when the mask 240 is peeled off, a solvent or the like remaining on the surface of the solder resist 130 may be removed through a cleaning process.

도 16 내지 도 20은 본 발명의 제 3 실시 예에 따른 인쇄회로기판의 제조 방법을 나타낸 단면도이다.16 to 20 are cross-sectional views illustrating a method of manufacturing a printed circuit board according to the third embodiment of the present invention.

도 16을 참조하면, 절연 플레이트(310)를 준비한다.Referring to FIG. 16, an insulating plate 310 is prepared.

절연 플레이트(310)에는 복수의 회로 패턴이 형성되어 있으며, 절연 플레이트(310)의 하부에도 회로 패턴이 형성될 수 있다.A plurality of circuit patterns are formed on the insulating plate 310, and circuit patterns may also be formed on the lower portion of the insulating plate 310.

즉, 상기 절연 플레이트(310)가 복수의 적층 구조 중 한 절연층을 의미하는 경우, 상기 절연 플레이트(310)의 상부 또는 하부에 복수의 회로 패턴(도시하지 않음)이 연속적으로 형성될 수 있으며, 그렇지 않은 경우, 상기 절연 플레이트(310)의 상부 및 하부 모두에 복수의 회로 패턴이 연속적으로 형성될 수 있다. That is, when the insulating plate 310 means one insulating layer among a plurality of stacked structures, a plurality of circuit patterns (not shown) may be continuously formed on the upper or lower portion of the insulating plate 310. Otherwise, a plurality of circuit patterns may be continuously formed on both the upper and lower portions of the insulating plate 310.

이후, 상기 절연 플레이트(310) 위에 도전층(320)을 적층한다.Thereafter, the conductive layer 320 is stacked on the insulating plate 310.

상기 도전층(320)은 상기 절연 플레이트(310) 위에 구리를 포함하는 금속을 비전해 도금하여 형성될 수 있으며, CCL(Copper Clad Laminate)을 사용할 수도 있다.The conductive layer 320 may be formed by electroless plating a metal including copper on the insulating plate 310, or may use a copper clad laminate (CCL).

이후, 상기 절연 플레이트(310)와 도전층(320)의 적층 구조에서 상기 도전층(320)을 식각하여 패드(325) 및 회로 패턴(도시 하지 않음)을 형성한다.Thereafter, the conductive layer 320 is etched in the stacked structure of the insulating plate 310 and the conductive layer 320 to form a pad 325 and a circuit pattern (not shown).

이때, 상기 절연 플레이트(310)에 형성된 도전층(320)은 상기 절연 플레이트(310)의 상면 및 하면에 각각 형성되어 있을 수 있으며, 이에 따라 상기 회로 패턴(도시하지 않음) 및 패드(325)는 상기 절연 플레이트(310)의 하면에도 형성될 수 있다.In this case, the conductive layer 320 formed on the insulating plate 310 may be formed on the upper and lower surfaces of the insulating plate 310, and accordingly, the circuit pattern (not shown) and the pad 325 may be formed. It may also be formed on the lower surface of the insulating plate 310.

이와 같이, 상기 절연 플레이트(310)의 적어도 한 면에는 상기와 같은 회로 패턴과 패드(325)가 형성되어 있으며, 상기 절연 플레이트(110)에 형성된 회로 패턴 및 패드(325)를 매립하도록 하는 솔더 레지스트(330)를 도포한다.As such, the circuit pattern and the pad 325 as described above are formed on at least one surface of the insulating plate 310, and the solder resist to fill the circuit pattern and the pad 325 formed in the insulating plate 110. 330 is applied.

이때, 상기 솔더 레지스트(330)는 상기 패드(325)도 매립한다.In this case, the solder resist 330 also fills the pad 325.

이후, 도 17과 같이 상기 솔더 레지스트(330) 위에 마스크(340)를 적층한다.Thereafter, a mask 340 is stacked on the solder resist 330 as shown in FIG. 17.

상기 마스크(340)는 포토 레지스트나 드라이 필름을 사용할 수 있다. 이때, 상기 마스크(340)는 내열성이 강한 드라이 필름을 사용하는 것이 바람직하다.The mask 340 may use a photoresist or a dry film. In this case, it is preferable that the mask 340 uses a dry film having high heat resistance.

다음으로, 도 18과 같이 레이저 공정을 수행하여 상기 솔더 레지스트(330) 및 마스크(340)에 상기 패드(325)를 노출하는 개구부(350)를 형성한다.Next, as shown in FIG. 18, an opening 350 exposing the pad 325 is formed in the solder resist 330 and the mask 340 by performing a laser process.

상기 레이저 공정은 작업의 유연성이 높고, 복잡한 형상이나 소량의 제품을 비싼 금형비 부담 없이 가공할 수 있으며, 다품종 소량 생산의 최근 시장 상황에 적합하여 시제품 가공에도 많이 적용된다.The laser process is highly flexible, can process complex shapes or small quantities of products without expensive mold costs, and is also suitable for prototyping as it is suitable for the recent market situation of small quantity production of various kinds.

상기 레이저 공정은 광학 에너지를 표면에 집중시켜 재료의 일부를 녹이고 증발시켜, 원하는 형태를 취하는 절단 방법으로, 컴퓨터 프로그램에 의해 복잡한 형성도 쉽게 가공할 수 있고, 다른 방법으로는 절단하기 어려운 복합재료도 가동할 수 있다. 절단 직경이 최소 0.005mm까지도 가능하며, 가공 가능한 두께 범위도 넓다.The laser process concentrates optical energy on the surface to melt and evaporate a part of the material, and takes a desired shape. The laser process can easily process complex formations by a computer program, and a composite material that is difficult to cut by other methods. Can be operated. Cut diameters as small as 0.005 mm are possible, and the thickness range is wide.

레이저 드릴로, YAG(Yttrium Aluminum Garnet)레이저나 CO2 레이저를 이용하는 것이 바람직하다. YAG 레이저는 동박층 및 절연층 모두를 가공할 수 있는 레이저이고, CO2 레이저는 절연층만 가공할 수 있는 레이저이다.As a laser drill, it is preferable to use a Yttrium Aluminum Garnet (YAG) laser or a CO2 laser. The YAG laser is a laser capable of processing both a copper foil layer and an insulating layer, and the CO2 laser is a laser capable of processing only an insulating layer.

다시 말해서, 상기 솔더 레지스트(330)와 마스크(340)를 적층한 상태에서 레이저 가공에 의해 상기 솔더 레지스트(330)의 개구부 및 상기 마스크(340)의 윈도우를 한번에 형성한다.In other words, an opening of the solder resist 330 and a window of the mask 340 are formed at a time by laser processing in a state where the solder resist 330 and the mask 340 are stacked.

다음으로, 도 19와 같이 상기 마스크(340)의 상측 표면 및 측면, 그리고 상기 솔더 레지스트(330)의 측면에 도금층(360)을 형성한다. 상기 도금층(360)은 화학동도금 방식으로 상기 마스크(340) 및 솔더 레지스트(330)의 상면, 측면에 형성될 수 있다.Next, as shown in FIG. 19, the plating layer 360 is formed on the upper surface and the side surface of the mask 340 and the side surface of the solder resist 330. The plating layer 360 may be formed on the top and side surfaces of the mask 340 and the solder resist 330 by chemical copper plating.

그리고, 상기 솔더 레지스트(330)의 개구부 및 상기 마스크(340)의 윈도우를 포함하는 개구부(350)를 매립하여 범프(370)를 형성한다.The bump 370 is formed by filling the opening 350 including the opening of the solder resist 330 and the window of the mask 340.

상기 범프(370)는 전기동도금 처리에 의해 상기 개구부(350) 전체를 매립하여 형성될 수 있으며, 이와 달리 상기 개구부(350)의 일부만을 매립하여 형성될 수도 있다. The bump 370 may be formed by filling the entire opening 350 by an electroplating process. Alternatively, the bump 370 may be formed by filling only a part of the opening 350.

이때, 상기 범프(370)는 상기 패드(325)와 동일한 구리를 포함하는 합금을 도금하여 형성될 수 있다. 또한, 이와 달리 상기 범프(370)는 주석을 포함하는 합금을 도금하여 형성될 수도 있다. 즉, 상기 범프(370)는 주석으로만 형성될 수 있으며, 상기 주석과 팔라듐을 일정 비율로 혼합한 합금으로 형성될 수 있으며, 상기 주석과 팔라듐 이외에도 은을 추가로 포함한 합금으로 형성될 수 있다.In this case, the bump 370 may be formed by plating an alloy including the same copper as the pad 325. Alternatively, the bump 370 may be formed by plating an alloy including tin. That is, the bump 370 may be formed only of tin, may be formed of an alloy in which tin and palladium are mixed at a predetermined ratio, and may be formed of an alloy including silver in addition to tin and palladium.

또한, 상기 범프(370)는 구리를 포함하는 합금으로 형성된 제 1 범프와, 주석을 포함하는 합금으로 형성된 제 2 범프를 포함할 수도 있다.In addition, the bump 370 may include a first bump formed of an alloy containing copper and a second bump formed of an alloy containing tin.

다음으로, 도 20과 같이 식각 과정을 수행하여 상기 마스크(340)의 상측 표면에 형성된 도금층(360)을 선택적으로 제거한다. 그리고, 상기 솔더 레지스트(330) 위에 적층된 마스크(340)를 제거한다.Next, as shown in FIG. 20, the etching process may be performed to selectively remove the plating layer 360 formed on the upper surface of the mask 340. In addition, the mask 340 stacked on the solder resist 330 is removed.

이때, 상기 마스크(140)가 박리되면, 크리닝 과정을 거쳐 상기 솔더 레지스트(130)의 표면에 잔재하는 용제 등을 제거할 수도 있다.In this case, when the mask 140 is peeled off, a solvent or the like remaining on the surface of the solder resist 130 may be removed through a cleaning process.

이상의 설명은 본 발명의 기술 사상을 예시적으로 설명한 것에 불과한 것으로서, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시 예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시 예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리 범위에 포함되는 것으로 해석되어야 할 것이다.The above description is merely illustrative of the technical idea of the present invention, and those skilled in the art to which the present invention pertains may make various modifications and variations without departing from the essential characteristics of the present invention. Therefore, the embodiments disclosed in the present invention are intended to illustrate rather than limit the scope of the present invention, and the scope of the technical idea of the present invention is not limited by these embodiments. The protection scope of the present invention should be interpreted by the following claims, and all technical ideas within the scope equivalent thereto should be construed as being included in the scope of the present invention.

110: 절연 플레이트
125: 패드
130: 솔더 레지스트
160: 범프
110: insulation plate
125: pad
130: solder resist
160: bump

Claims (18)

절연층;
상기 절연층 위에 형성되어 있는 적어도 하나의 회로 패턴 또는 패드;
상기 절연층 위에 형성되어 상기 패드의 상면을 노출하는 개구부를 갖는 솔더 레지스트;
상기 패드 위에 도금으로 형성되어 상기 솔더 레지스트의 표면 위로 돌출되어 있으며, 사기 패드의 상면 면적보다 좁은 하면 면적을 갖는 범프; 및
상기 솔더 레지스트 및 상기 범프 사이에 상기 솔더 레지스트 위로 돌출되어 상기 범프의 측면에 형성되는 도금 씨드층을 포함하고,
상기 도금 씨드층의 제 1 측면은 상기 범프와 접촉하며,
상기 도금 씨드층의 제 2 측면의 일부는 상기 솔더 레지스트의 측면과 접촉하고, 나머지 일부는 상기 솔더 레지스트의 상면 위로 돌출되어 외부로 노출되는 인쇄회로기판.
Insulating layer;
At least one circuit pattern or pad formed on the insulating layer;
A solder resist formed on the insulating layer and having an opening exposing an upper surface of the pad;
A bump formed on the pad and protruding over the surface of the solder resist, the bump having a lower surface area narrower than an upper surface area of the fraud pad; And
A plating seed layer protruding over the solder resist between the solder resist and the bump and formed on a side surface of the bump,
A first side of the plating seed layer is in contact with the bump,
A portion of the second side surface of the plating seed layer is in contact with the side surface of the solder resist, and the other portion protrudes over the top surface of the solder resist and is exposed to the outside.
제 1항에 있어서,
상기 범프는 상면 및 상기 상면과 대향하는 하면의 면적이 동일한 인쇄회로기판.
The method of claim 1,
The bump is the printed circuit board having the same area of the upper surface and the lower surface facing the upper surface.
제 1항에 있어서,
상기 범프는 상기 솔더 레지스트 개구부의 면적과 동일한 면적을 갖는 인쇄회로기판.
The method of claim 1,
The bumps have an area equal to that of the solder resist openings.
제 1항에 있어서,
상기 범프는 구리를 포함하는 합금 또는 주석을 포함하는 합금으로 형성되는 인쇄회로기판.
The method of claim 1,
The bump is a printed circuit board formed of an alloy containing copper or an alloy containing tin.
제 1항에 있어서,
상기 범프는
구리를 포함하는 합금으로 형성된 제 1 범프와,
주석을 포함하는 합금으로 형성된 제 2 범프를 포함하는 인쇄회로기판.
The method of claim 1,
The bump is
A first bump formed of an alloy comprising copper,
A printed circuit board comprising a second bump formed of an alloy comprising tin.
삭제delete 삭제delete 절연 기판 위에 패드를 형성하는 단계;
상기 절연 기판 위에 상기 패드를 노출하는 개구부를 갖는 솔더 레지스트를 도포하는 단계;
상기 솔더 레지스트 위에 상기 개구부를 개방하는 윈도우를 갖는 마스크를 형성하는 단계;
상기 마스크 위에 상기 마스크의 상면 및 측면을 감싸는 도금층을 형성하는 단계; 및
상기 형성된 도금층을 씨드층으로 이용하여 상기 솔더 레지스트의 개구부 및 상기 마스크의 윈도우를 매립하는 범프를 형성하는 단계를 포함하여 이루어지는 인쇄회로기판의 제조 방법.
Forming a pad over the insulating substrate;
Applying a solder resist having an opening exposing the pad over the insulating substrate;
Forming a mask having a window for opening the opening over the solder resist;
Forming a plating layer surrounding the top and side surfaces of the mask on the mask; And
And forming a bump to fill an opening of the solder resist and a window of the mask by using the formed plating layer as a seed layer.
제 8 항에 있어서,
상기 마스크를 형성하는 단계는
상기 개구부를 개방하는 드라이 필름을 상기 솔더 레지스트 위에 적층하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the mask
Laminating a dry film for opening the opening on the solder resist.
제 8항에 있어서,
상기 마스크를 형성하는 단계는
상기 솔더 레지스트의 개구부와 동일한 면적의 윈도우를 갖는 마스크를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the mask
And forming a mask having a window having the same area as the opening of the solder resist.
제 8항에 있어서,
상기 범프를 형성하는 단계는,
상기 도금층을 씨드층으로 구리를 포함하는 합금 또는 주석을 포함하는 합금을 도금하여 상기 개구부와 윈도우로 형성된 공간의 전체를 매립하는 범프를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the bumps,
And plating an alloy including copper or an alloy including tin using the plating layer as a seed layer to form bumps filling the entire space formed by the openings and the windows.
제 8항에 있어서,
상기 범프를 형성하는 단계는
상기 도금층을 씨드층으로 구리를 포함하는 합금을 도금하여 상기 개구부와 윈도우로 형성된 공간의 일부를 매립하는 제 1 범프를 형성하는 단계와,
상기 제 1 범프 위에 주석을 포함하는 합금을 도금하여 상기 개구부와 상기 윈도우로 형성된 공간의 전체를 매립하는 제 2 범프를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the bumps
Plating the alloy including copper using the plating layer as a seed layer to form a first bump filling a portion of the space formed by the opening and the window;
And plating a tin-containing alloy on the first bump to form a second bump filling a whole of the space formed by the opening and the window.
제 8항에 있어서,
상기 솔더 레지스트를 도포하는 단계는
상기 패드를 매립하는 솔더 레지스트를 상기 절연기판 위에 도포하는 단계와,
상기 도포된 솔더 레지스트를 레이저 가공하여 상기 패드를 노출하는 개구부를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
The step of applying the solder resist
Applying a solder resist filling the pad onto the insulating substrate;
Laser processing the applied solder resist to form an opening for exposing the pad.
제 8항에 있어서,
상기 마스크를 형성하는 단계는
상기 패드를 매립하는 마스크를 상기 솔더 레지스트 위에 적층하는 단계와,
상기 적층된 마스크를 레이저 가공하여 상기 패드를 노출하는 윈도우를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the mask
Laminating a mask for embedding the pad over the solder resist;
And laser processing the laminated mask to form a window that exposes the pad.
제 8항에 있어서,
상기 솔더 레지스트의 개구부 및 상기 패드의 윈도우는 레이저 가공에 의해 동시에 형성되는 인쇄회로기판의 제조 방법.
The method of claim 8,
The opening of the solder resist and the window of the pad is formed at the same time by laser processing.
삭제delete 제 8항에 있어서,
상기 범프를 형성하는 단계는
상면 및 상기 상면과 대향하는 하면의 면적이 동일한 범프를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the bumps
A method of manufacturing a printed circuit board comprising forming a bump having an upper surface and an area of a lower surface facing the upper surface.
제 8항에 있어서,
상기 범프를 형성하는 단계는
상기 솔더 레지스트 개구부 및 상기 마스크의 윈도우 중 적어도 어느 하나의 면적과 동일한 면적을 갖는 범프를 형성하는 단계를 포함하는 인쇄회로기판의 제조 방법.
The method of claim 8,
Forming the bumps
Forming a bump having an area equal to an area of at least one of the solder resist opening and the window of the mask.
KR1020100134547A 2010-12-24 2010-12-24 The printed circuit board and the method for manufacturing the same KR101231522B1 (en)

Priority Applications (6)

Application Number Priority Date Filing Date Title
KR1020100134547A KR101231522B1 (en) 2010-12-24 2010-12-24 The printed circuit board and the method for manufacturing the same
EP11852118.6A EP2645829B1 (en) 2010-12-24 2011-12-23 Printed circuit board and method for manufacturing same
CN201180068501.8A CN103404244B (en) 2010-12-24 2011-12-23 Printed circuit board and manufacturing methods
US13/997,596 US9706652B2 (en) 2010-12-24 2011-12-23 Printed circuit board and method for manufacturing same
PCT/KR2011/010057 WO2012087072A2 (en) 2010-12-24 2011-12-23 Printed circuit board and method for manufacturing same
TW100148569A TWI442854B (en) 2010-12-24 2011-12-26 The printed circuit board and the method for manufacturing the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1020100134547A KR101231522B1 (en) 2010-12-24 2010-12-24 The printed circuit board and the method for manufacturing the same

Publications (2)

Publication Number Publication Date
KR20120072685A KR20120072685A (en) 2012-07-04
KR101231522B1 true KR101231522B1 (en) 2013-02-07

Family

ID=46707328

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1020100134547A KR101231522B1 (en) 2010-12-24 2010-12-24 The printed circuit board and the method for manufacturing the same

Country Status (1)

Country Link
KR (1) KR101231522B1 (en)

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001077140A (en) * 1999-09-02 2001-03-23 Denso Corp Structure and manufacture of metallic bump
JP2004079839A (en) * 2002-08-20 2004-03-11 Fcm Kk Method for manufacturing wafer provided with bump
KR20070116967A (en) * 2005-06-30 2007-12-11 이비덴 가부시키가이샤 Printed wiring board
WO2010046235A1 (en) * 2008-10-21 2010-04-29 Atotech Deutschland Gmbh Method to form solder deposits on substrates

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001077140A (en) * 1999-09-02 2001-03-23 Denso Corp Structure and manufacture of metallic bump
JP2004079839A (en) * 2002-08-20 2004-03-11 Fcm Kk Method for manufacturing wafer provided with bump
KR20070116967A (en) * 2005-06-30 2007-12-11 이비덴 가부시키가이샤 Printed wiring board
WO2010046235A1 (en) * 2008-10-21 2010-04-29 Atotech Deutschland Gmbh Method to form solder deposits on substrates

Also Published As

Publication number Publication date
KR20120072685A (en) 2012-07-04

Similar Documents

Publication Publication Date Title
CN106165554B (en) Printed circuit board, package substrate and manufacturing method thereof
KR20160002069A (en) Pcb, package substrate and a manufacturing method thereof
KR101281410B1 (en) Multilayer Wiring Substrate
JP2010135721A (en) Printed circuit board comprising metal bump and method of manufacturing the same
JP7074409B2 (en) Built-in element type printed circuit board
JP6092117B2 (en) Printed circuit board and manufacturing method thereof
EP2645829B1 (en) Printed circuit board and method for manufacturing same
US20120152606A1 (en) Printed wiring board
JP2014063932A (en) Wiring board and manufacturing method of the same
KR20120040892A (en) The printed circuit board and the method for manufacturing the same
KR20120115034A (en) The printed circuit board and the method for manufacturing the same
KR101154739B1 (en) The printed circuit board and the method for manufacturing the same
KR101199174B1 (en) The printed circuit board and the method for manufacturing the same
KR101189337B1 (en) The printed circuit board and the method for manufacturing the same
KR101219929B1 (en) The printed circuit board and the method for manufacturing the same
KR101231522B1 (en) The printed circuit board and the method for manufacturing the same
KR101222828B1 (en) Method of manufacturing coreless substrate
KR101189330B1 (en) The printed circuit board and the method for manufacturing the same
KR20130046716A (en) The printed circuit board and the method for manufacturing the same
KR20150107141A (en) The printed circuit board and the method for manufacturing the same
KR101173397B1 (en) The printed circuit board and the method for manufacturing the same
KR101241649B1 (en) The printed circuit board and the method for manufacturing the same
KR101154588B1 (en) The printed circuit board and the method for manufacturing the same
KR101199112B1 (en) The printed circuit board and the method for manufacturing the same
KR101231263B1 (en) The printed circuit board and the method for manufacturing the same

Legal Events

Date Code Title Description
A201 Request for examination
AMND Amendment
E601 Decision to refuse application
AMND Amendment
X701 Decision to grant (after re-examination)
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20160107

Year of fee payment: 4

FPAY Annual fee payment

Payment date: 20170105

Year of fee payment: 5

FPAY Annual fee payment

Payment date: 20180105

Year of fee payment: 6

FPAY Annual fee payment

Payment date: 20190114

Year of fee payment: 7