KR101174722B1 - 플라즈마 디스플레이 패널 구동방법 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 패널 구동 방법을 개시한다. 이에 의하면, 스캔 전극과 서스테인 전극에 의한 전압강하로부터 어드레스 방전에 미치는 영향을 감소시키고 어드레스방전 때에 과도한 변위전류 및 방전전류의 집중을 방지함으로써 구동회로의 구동파형 안정화 및 전력소모 감소를 가능하게 한다.
플라즈마 디스플레이 패널, 스캔 전극, 서스테인 전극, 전압강하, 어드레스 방전, 구동파형 안정화

Description

플라즈마 디스플레이 패널 구동방법{Method for Driving Plasma Display Panel}
본 발명은 플라즈마 디스플레이 패널(plasma display panel: PDP) 구동방법에 관한 것으로, 더욱 상세하게는 스캔 전극과 서스테인 전극에서의 전압강하를 감소시켜 어드레스 방전 때에 과도한 변위전류 및 방전전류의 집중을 방지함으로써 구동회로의 구동파형 안정화 및 전력소모 감소가 가능하도록 한 플라즈마 디스플레이 패널 구동방법에 관한 것이다.
일반적으로, 플라즈마 디스플레이 패널은, 셀 내부에서 가스 방전을 발생시킴으로써 휘도를 나타내는 디스플레이 소자이다. 플라즈마 디스플레이 패널은 방전방식에 따라 교류(AC)형과 직류(DC)형으로 구분된다. 교류형 플라즈마 디스플레이 패널 중에서는 현재 교류형 3전극 면방전 플라즈마 디스플레이 패널이 주로 채용되고 있다.
일반적인 교류형 3전극 면방전 플라즈마 디스플레이 패널은 도 1에 도시된 바와 같이 스캔 전극(Y), 서스테인 전극(X) 및 어드레스 전극(A)의 3개 전극을 가진다. 스캔 전극(Y)은 스캔 펄스를 인가하기 위한 전극으로서, 가로방향으로 연장하며 전면기판(미도시)의 표면에 배치된다. 서스테인 전극(X)은 유지방전전압을 인가하기 위한 전극으로서, 가로방향으로 연장하며 전면기판(미도시)의 표면에 배치된다. 도면에 도시되지 않았지만, 스캔 전극(Y) 및 서스테인 전극(X)은 예를 들어, 아이티오(ITO: indium tin oxide)와 같은 투명 재질의 전극층과 버스(BUS) 전극층의 적층구조로 구성된다. 어드레스 전극(A)은 스캔 펄스가 인가됨과 동시에 서스테인 구간 동안에 방전을 해야 할 셀을 선택하기 위하여 데이터전압(Vd)을 인가하기 위한 전극으로서, 스캔 전극(Y)과 서스테인 전극(X)에 직교하며 후면기판의 표면에 배치된다.
이러한 전극구조를 가진 교류형 3전극 면방전 플라즈마 디스플레이 패널의 구동방법은 도 2에 도시된 바와 같이, 벽전하를 균일화하기 위하여 램프업(ramp up)과 램프다운(ramp down)을 포함하는 리셋 구간, 방전 셀과 비방전 셀을 구분하여 선택하기 위한 어드레스 구간 및 상기 선택된 방전 셀만을 유지방전하는 서스테인 구간의 3구간으로 구분된 구동파형을 사용한다. 리셋 구간에서, 모든 셀(cell)의 벽전하의 상태를 균일하게 하여 어드레스 방전에서 동일한 구동전압에 의하여 안정적으로 방전 셀과 비방전 셀을 구분할 수 있도록 한다. 어드레스 구간에서, 일련의 선택된 스캔 전극 각각에 대하여 데이터전압을 다르게 인가함으로써 방전 셀과 비방전 셀을 구분한다. 서스테인 구간에서, 선택된 방전 셀만을 지속적으로 유지방전 시킴으로써 휘도를 나타내도록 한다.
여기서 어드레스 방전은, 스캔 전극(X)과 어드레스 전극(A)에 각각 인가되는 스캔 펄스와 데이터전압에 의하여 트리거(trigger) 방전이 발생한다. 이때 발생한 방전공간의 하전입자에 의하여 감소한 방전개시전압의 영향으로 스캔 전극(Y)과 서스테인 전극(X) 사이에 주 방전이 발생하는 절차에 의하여 이루어진다. 방전은 셀 내부에 존재하는 벽전하에 의하여 나타나는 벽전압(Vw)과 외부에서 인가하는 전압(Va)의 합이 그 셀의 방전개시전압(Vf)보다 높을 경우에 발생한다.
한편, 상기 플라즈마 디스플레이 패널의 구조상, 도 1에 도시된 바와 같이, 스캔 전극(Y1,Y2,Y3,…,Yn)이 전면기판의 일측단으로부터 스캔 전압을 인가받고, 서스테인 전극(X)이 전면기판의 그 반대되는 일측단으로부터 서스테인 전압을 인가받을 수밖에 없다. 또한 스캔 전극(Y1,Y2,Y3,…,Yn)과 서스테인 전극(X)의 종단부는 다른 어떠한 연결선을 통하여 전기적으로 연결되지 아니 하는 플로팅(floating) 상태로 되어 있다. 따라서 각각의 구동파형을 생성하여 공급하기 위한 보드(board)(미도시)에서 출력하는 스캔 전압과 서스테인 전압이 스캔 전극과 서스테인 전극의 인입부로부터만 인가될 수밖에 없다.
더욱이 상기 플라즈마 디스플레이 패널에 형성된 각각의 전극에는 저항성분이 존재한다. 그러므로 방전에 의한 방전 전류나 각 전극에 인가하는 전압의 크기가 변화함에 따른 변위 전류가 상기 플라즈마 디스플레이 패널을 통하여 흐르지 않으면, 각 전극의 인입부의 전압이 해당 전극의 종단부의 전압과 동일하게 유지될 수 있다.
반면에, 방전 전류나 변위 전류가 각 전극을 통하여 흐르면, 각 전극의 인입 부로부터 멀어짐에 따라 각 전극의 해당 부분의 전압이 각 전극의 인입부의 전압보다 감소하는 전압강하가 발생한다. 따라서 어드레스 방전이 발생하는 경우에도 전압강하가 발생한다.
이러한 전압강하는 플라즈마 디스플레이 패널의 구동에 있어서 모든 셀에 동일한 외부 인가전압을 공급할 수 없게 만든다. 특히 방전과 직접적으로 연관이 있는 방전 전류의 경우에는 더욱 큰 영향을 미친다. 즉, 스캔 전극에 인가하는 스캔 전압(Vsc)에 나타나는 전압강하는, 선택 셀에 대한 충분히 강한 어드레스 방전을 유도할 수 없게 만들거나, 설령 어드레스 방전을 유도할 수 있다고 하더라도 상대적으로 약한 어드레스 방전을 유도한다. 이로 인하여 어드레스 전극에 보다 높은 데이터전압(Vd)의 인가가 요구되어 질 수 있다.
이를 좀 더 상세히 언급하면, 도 3에 도시된 바와 같이, 도 2의 스캔 전극(Y: Y1,Y2,Y3,…,Yn) 중 1개의 스캔전극(Y1)에 1개의 스캔펄스가 인가될 때, 상기 스캔펄스와, 어드레스전극(A: A1,A2,A3,…,Am-2,Am-1,Am) 중 1개의 어드레스 전극(A1)에 인가하는 1개의 데이터전압(Vd) 펄스의 인가 개시점(T1)과 종료점(T2)은 서로 일치한다.
일반적으로, 스캔 펄스는 수많은 스캔 전극들(Y1,Y2,Y3,…,Yn)에 순차적으로 인가되며 이와 동시에 각각의 스캔 전극(Y)의 해당 셀에 대하여 방전 셀과 비방전 셀의 선택을 위하여 데이터전압이 인가된다. 해당 스캔 전극에 방전 셀이 많으면 많은 어드레스 방전을 하고 더 많은 전류가 흐르게 되는데, 이는 더 큰 전압강하를 가져온다.
여기서 어드레스 전극에 전압을 인가할 경우, 각각의 스캔 전극에 스캔 펄스를 인가하기 시작하는 시점에 데이터 전압이 해당 스캔 전극의 방전에만 영향을 주며 각각의 스캔 펄스가 인가되는 하나의 셀에 의한 전류성분만이 발생하므로 상대적으로 스캔 전극의 전압강하나 서스테인 전극의 전압강하와 비교하여 그다지 크지 않다.
그러나 도 4에 도시된 바와 같이, 어드레스 방전에서 스캔 전극(Y)에 인가되는 스캔 펄스의 전압(Vsc)과 서스테인 전극(X)에 인가되는 레벨전압(Vxl)이 선택된 스캔 라인에서 전 셀의 어드레스 방전이 발생하다면, 각 전극에 존재하는 저항성분에 의하여 전압강하가 발생하여, 스캔 전극(Y)의 종단부에서는 스캔 전압의 전압강하(△Vsc)가 발생하고 서스테인 전극(X)의 종단부에서는 레벨전압(Vxl)의 전압강하(△Vxl)가 발생한다. 특히 하나의 스캔 펄스가 인가되는 모든 셀에서 방전이 발생한다면 순간적으로 많은 전류가 흐르게 되며 따라서 전극의 전압강하는 더욱 크게 나타난다. 이러한 전압강하는 어드레스 방전의 크기를 감소시키거나 최악의 경우에는 소거현상을 나타낸다. 비록 소거현상이 나타나지 않더라도 데이터전압(Vd)을 상승시키는 원인이 된다. 이를 방지하기 위해서는 보다 높은 데이터전압(Vd)을 인가할 필요가 발생한다.
또한 하나의 스캔 전극의 많은 셀에서 어드레스 방전 부하가 많이 발생하는 경우에 순간적인 데이터전압 및 전류의 공급이 발생하여 서스테인 전극(X)과 스캔 전극(Y)에 오버슈트(overshoot)성 전압과 전류를 크게 유발한다. 이때 발생한 오버슈트성 과전압과 과전류 성분은 서스테인 전극(X) 및 스캔 전극(Y)에 각각 대응하 는 X보드 및 Y보드에 유기되어 패널에 인가하고자 하는 전압 파형을 왜곡시킬 뿐만 아니라 과전류를 발생시킴으로써 회로의 안정성을 저하시키고 추가 전력소모를 발생시킨다.
그러므로 각각의 전극에 인가하는 전압의 전기적 저항성분에 의한 전압강하를 감소시킬 수 있는 방법이 절실히 요구되는 실정이다.
따라서 본 발명의 목적은, 플라즈마 디스플레이 패널의 전극에 의한 전압강하로부터 어드레스 방전에 미치는 영향을 감소시키고 어드레스 방전 때에 발생하는 과도한 변위 전류 및 방전 전류의 집중을 방지함으로써 구동회로의 안정성을 향상시키는데 있다.
이와 같은 목적을 달성하기 위한 본 발명에 의한 플라즈마 디스플레이 패널 구동방법은, 스캔펄스 및 유지방전 전압을 인가하는 스캔 전극과 유지방전 전압을 인가하는 서스테인 전극을 가지며, 어드레스 구간에서 방전 셀을 선택하기 위한 데이터전압 펄스를 인가하는 어드레스 전극을 갖는 3전극 구조의 플라즈마 디스플레이 패널을 구동하는 방법에 있어서, 벽전하를 균일화하기 위한 리셋 구간, 방전 셀과 비방전 셀을 구분하기 위한 어드레스 구간 및 선택된 방전 셀만을 서스테인 방전하는 서스테인 구간을 포함하는 구동파형을 이용하며, 스캔 전극에 스캔전압 펄스를 인가하고, 복수개의 어드레스 전극으로 각각 이루어진 복수개의 어드레스 전극군에, 데이터전압 펄스를 상이한 시점에 각각 인가하는 것을 특징으로 한다.
바람직하게는, 상기 데이터전압 펄스는 상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 가장 멀리 떨어진 어드레스 전극군으로부터 상기 스캔 전극의 전압 인입부로부터 가장 가까운 곳의 어드레스 전극군으로 갈 수록 먼저 인가되는 것이 가능하다.
바람직하게는, 상기 데이터전압 펄스의 폭이 상기 복수개의 어드레스 전극군에서 모두 동일한 것이 가능하다.
바람직하게는, 상기 데이터전압 펄스의 폭이 상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 가장 멀리 떨어진 어드레스 전극군으로부터 상기 스캔 전극의 전압 인입부로부터 가장 가까운 곳의 어드레스 전극군으로 갈수록 좁아지는 것이 가능하다.
바람직하게는, 상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 가장 멀리 떨어진 어드레스 전극군에 인가되는 상기 데이터전압 펄스의 최초 출력 시점과 상기 스캔 전극의 전압 인입부로부터 가장 가까운 곳의 어드레스 전극군에 인가되는 상기 데이터전압 펄스의 최초 출력 시점 사이의 간격이 400 나노초(㎱) 미만인 것이 가능하다.
본 발명에 의하면, 플라즈마 디스플레이 패널 구동방법은 패널 전극에 의한 전압강하로부터 어드레스방전에 미치는 영향을 감소시키고 어드레스방전 때에 과도한 변위전류 및 방전전류의 집중을 방지함으로써 구동회로의 구동파형 안정화 및 전력소모 감소를 가능하게 한다.
이하, 본 발명의 실시예에 따른 플라즈마 디스플레이 패널 구동방법을 첨부된 도면을 참조하여 상세히 설명하기로 한다.
도 5는 본 발명에 의한 플라즈마 디스플레이 패널 구동방법에 적용된 구동회로부를 개략적으로 나타낸 구성도이다.
도 5에 도시된 바와 같이, 본 발명의 플라즈마 디스플레이 패널을 구동하기 위한 구동회로부는 기판, 예를 들어 패널 방열판(10) 상에 배치된 스캔 구동부(11), 서스테인 구동부(13), 전원부(15), 디지털부(17) 및 복수개의 어드레스 접속단자군(G1),(G2),(G3)을 포함하여 구성된다.
여기서, 디지털부(17)는 데이터전압 펄스의 인가시점을 제어하는 제어신호(s1),(s2),(s3)를 생성한다.
또한, 2개 이상 복수개의 어드레스 접속단자군은, 패널의 해당하는 어드레스 전극군과의 전기적 연결을 위하여, 디지털부(17)에 인접한 패널 방열판(10)의 일측변을 따라 배열될 수 있다. 도면에서는 설명의 편의상, 예를 들어 3개의 어드레스 접속단자군(G1),(G2),(G3)이 디지털부(17)에 인접한 패널 방열판(10)의 일측변을 따라 배열하였다. 각각의 어드레스 접속단자군(G1),(G2),(G3)은 어드레스 전극들에 각각 대응하는 복수개의 어드레스 접속단자(미도시)를 가지며 내부에 어드레스 전극 구동부(미도시)를 포함하고, 디지털부(17)로부터 출력되는 해당하는 제어신호(s1),(s2),(s3)를 각각 인가받는다. 어드레스 접속단자군(G1), (G2), (G3)은 디지털부(17)로부터 출력되는 해당하는 제어신호(s1),(s2),(s3)를 입력받아 이를 내부의 어드레스 전극 구동부에서 데이터전압 펄스로 변환한 후 변환된 데이터전압 펄스를 각각의 어드레스 전극들에 인가한다. 도면에서는 예를 들어 3개의 어드레스 접속단자군(G1),(G2),(G3)을 명확하게 구분하여 3개의 각기 다른 회로기판 상에 구성되어 있는 것과 같이 표현하였으나, 이는 기구적인 구조의 구분이 아니라 전기적인 구조의 구분이다. 예를 들어 상기의 어드레스 접속단자군(G1),(G2),(G3)이 하나의 회로기판에 구성되어 상기의 전기적인 제어신호(s1),(s2),(s3)에 의하여 구분될 수 있다.
이와 같이 구성되는 구동회로부에 적용한 본 발명에 의한 플라즈마 디스플레이 패널 구동방법을 도 6 및 도 7을 참조하여 설명하기로 한다.
도 6은 본 발명에 의한 플라즈마 디스플레이 패널 구동방법에 있어서, 스캔펄스와, 상이한 인가 개시점 및 상이한 종료점을 가진 동일한 폭의 데이터전압 펄스들 및 출력 제어신호들을 나타낸 타이밍도이고, 도 7은 본 발명에 의한 플라즈마 디스플레이 패널 구동방법에 있어서, 스캔펄스와 상이한 인가 개시점 및 동일한 종료점을 가진 상이한 폭의 데이터전압 펄스들을 나타낸 타이밍도이다.
도 6 및 도 7을 참조하면, 본 발명에 의한 플라즈마 디스플레이 패널 구동방법은 도 1에 도시된 바와 같이 스캔 전극(Y), 서스테인 전극(X) 및 어드레스 전극(A)이 배열된 플라즈마 디스플레이 패널(미도시)을 도 5에 도시된 구동회로부로부터 공급되는 도 2에 도시된 파형에 의해 구동한다.
이를 좀 더 상세히 언급하면, 도 5의 구동회로부에서는 도 6에 도시된 바와 같이, 스캔전극 구동부(11)가 스캔펄스를 스캔 전극들(Y)에 인가함과 아울러 디지 털부(17)가 출력 제어신호(s1),(s2),(s3),(s1'),(s2'),(s3')를 어드레스 접속단자군(G1),(G2),(G3)에 인가함으로써 해당하는 어드레스 전극군(G11),(G12),(G13)에 동일한 폭의 데이터전압 펄스를 각기 상이한 시점에 인가한다.
즉, 시점(t0)에서, 스캔펄스를 스캔 전극(Y1)에 인가하기 시작한다. 이와 동시에 출력 제어신호(s1)가 어드레스 접속단자군(G1)에 인가되고 어드레스 접속단자군(G1) 내부의 어드레스전극 구동부가 데이터전압 펄스를 발생하여 이를 어드레스 전극군(G11)에 인가하기 시작한다. 이 때 어드레스 전극군(G12),(G13)에는 데이터전압펄스를 인가하지 않는다.
시점(t0)으로부터 소정의 시간이 경과한 시점(t1)에서, 스캔펄스를 스캔 전극(Y1)에 계속 인가하고, 어드레스 전극군(G11)에도 데이터전압 펄스를 계속 인가하는 상태에서 출력 제어신호(s2)가 어드레스 접속단자군(G2)에 인가됨에 따라 어드레스 전극군(G12)에 데이터전압 펄스가 인가되기 시작한다. 이때 어드레스 전극군(G13)에는 데이터전압 펄스를 인가하지 않는다.
시점(t1)으로부터 소정이 시간이 경과한 시점(t2)에서, 스캔펄스를 스캔 전극(Y1)에 계속 인가하고, 어드레스 전극군(G11),(G12)에도 데이터전압 펄스를 계속 인가하는 상태에서 출력 제어신호(s3)가 어드레스 접속단자군(G3)에 인가됨에 따라 어드레스 전극군(G13)에 데이터전압 펄스가 인가되기 시작한다.
한편, 시점(t2)으로부터 소정이 시간이 경과한 시점(t3)에서, 스캔펄스를 스캔 전극(Y1)에 인가하는 것을 종료한다. 이와 동시에 출력 제어신호(s1')이 어드레스 접속단자군(G1)에 인가됨에 따라 어드레스 전극군(G11)에 데이터전압 펄스를 인 가하는 것을 종료한다. 이때 어드레스 전극군(G12),(G13)에는 계속해서 데이터전압 펄스를 인가한다.
시점(t3)으로부터 소정의 시간이 경과한 시점(t4)에서, 스캔펄스를 스캔 전극(Y1)에 계속 인가하지 않고, 어드레스 전극군(G11)에도 데이터전압 펄스를 인가하지 않는다. 이와 동시에 출력 제어신호(s2')이 어드레스 접속단자군(G2)에 인가됨에 따라 어드레스 전극군(G12)에 데이터전압 펄스를 인가하는 것을 종료한다. 이때 어드레스 전극군(G13)에는 계속해서 데이터전압 펄스를 인가한다.
시점(t4)으로부터 소정이 시간이 경과한 시점(t5)에서, 스캔펄스를 스캔 전극(Y1)에 인가하지 않고, 어드레스 전극군(G11),(G12)에도 데이터전압 펄스를 인가하지 않는다. 이와 동시에 출력 제어신호(s3')이 어드레스 접속단자군(G3)에 인가됨에 따라 어드레스 전극군(G13)에 데이터 전압펄스를 인가하는 것을 종료한다.
따라서 본 발명은 상기한 바와 같은 방식을 이용하여 복수개의 구분된 어드레스 전극군에 각기 다른 시점에 동일한 폭의 데이터전압 펄스를 인가하면, 순간적인 방전전류의 크기를 종래에 비하여 상대적으로 감소시킬 수 있다.
그러므로 각 전극 자체의 저항성분에 의한 절대적인 전압강하도 감소시킬 수 있을 뿐만 아니라 오버슈트성으로 나타나는 유도성 전압의 크기도 감소시킬 수가 있다.
반면에, 종래에는 도 3에 도시된 바와 같이, 1개의 스캔펄스가 1개의 스캔 전극에 인가되는 시점과 동시에 모든 어드레스 전극들의 데이터전압 펄스를 인가하거나, 일정 시간의 간격을 두고 모든 어드레스 전극들의 데이터전압 펄스를 동시에 상승시킨다. 이렇게 하면 각각의 스캔 전극에서 방전을 위하여 선택되는 셀의 수에 따라 한 순간에 높은 과전류 및 유도성 전압이 유발된다. 이와 같이 순간적인 과전류나 유도성 전압이 발생하는 것은 플라즈마 디스플레이 패널의 휘도를 발휘하기 위하여 설계되는 방전 셀의 구조가 전기적으로 커패시터 해당하며, 순간적인 과전류와 유도성 전압은 이러한 커패시터의 특성으로부터 유래되기 때문이다.
또한 방전 전류가 스캔 전극 및 서스테인 전극으로부터 흐름으로 인하여 상대적으로 해당 전극의 인입부로부터 거리상 먼 위치에 존재하는 셀은 해당 전극 상에 존재하는 저항성분에 의하여 상대적으로 낮은 외부 인가전압을 받는데, 이는 상대적으로 약한 방전을 발생시킨다. 이렇게 상대적으로 약한 방전은 벽전하의 생성량을 감소시키게 되며, 이는 지속적인 유지방전을 하는 서스테인 방전에도 영향을 미친다. 특히 서스테인 펄스의 개수가 적은 경우에는 더욱 취약해질 수 있다.
한편, 도 7에 도시된 바와 같이, 상기 출력 제어신호(s1),(s2),(s3),(s1'),(s2'),(s3')를 이용하여 어드레스 접속단자군(G1),(G2),(G3)에 상이한 폭의 데이터전압 펄스를 인가함으로써 해당하는 어드레스 전극군(G11),(G12),(G13)에 상이한 폭의 데이터전압 펄스를 인가하는 것도 가능하다. 예를 들면, 상이한 시점(t0),(t1),(t2)에서 어드레스 접속단자군(G1),(G2),(G3)에 출력 제어신호 (s1),(s2),(s3)를 각각 인가함으로써 어드레스 전극군(G11),(G12),(G13)에 데이터전압 펄스를 각각 인가하기 시작하고, 동일한 시점(t3)에서 어드레스 접속단자군(G1),(G2),(G3)에 출력 제어신호 (s1'),(s2'),(s3')를 각각 인가함으로써 어드레스 전극군(G11),(G12),(G13)에 데이 터전압 펄스를 인가하는 것을 동시에 종료하면, 상이한 폭의 데이터전압 펄스를 어드레스 전극군(G11),(G12),(G13)에 인가할 수가 있다.
이때 방전지연시간을 초과하는 경우를 피하도록 주의하여야 한다. 일반적으로 방전지연시간 즉, 최초 데이터전압 출력시점과 최후 데이터전압 출력시점 사이의 시간이 크게 400 나노초(㎱) 정도로 나타나기 때문에 최대한 이를 초과하지 않는 것이 바람직하다.
또한 여기서 데이터전압 펄스를, 스캔 전극의 전압 인입부로부터 거리상 멀리 떨어진 어드레스 전극군에서 먼저 출력하는 것이 바람직하다. 왜냐하면, 상기 멀리 떨어진 어드레스 전극군의 경우, 어드레스 방전 중에 흐르는 전류에 의하여 발생하는 전압강하의 크기가 상기 전압 인입부로부터 거리상 멀리 가까운 어드레스 전극군에 비하여 크기 때문에 방전지연시간이 더 길다. 따라서 상기 멀리 떨어진 어드레스 전극군에서는 스캔펄스와 데이터전압 펄스가 인가되는 시간을 상대적으로 더 길게 설정해줄 필요가 있다. 이렇게 함으로써 전극 자체의 저항성분에 의한 전압강하와 이로 인한 과전류 및 상대적인 방전 약화를 개선할 수 있다.
한편, 도 7의 구동 방식은 도 6의 구동방식과 유사하므로 설명의 편의상, 도 7의 구동방식에 대한 설명을 생략하기로 한다.
또한, 설명의 편의상, 도 6 및 도 7에서 시점(t0),(t1),(t2) 사이의 시간 간격이 모두 동일한 것으로 도시되어 있으나, 시점(t0),(t1),(t2) 사이의 시간 간격이 상이하여도 무방하다.
한편, 본 발명은 도시된 도면과 상세한 설명에 기술된 내용에 한정하지 않으 며 본 발명의 사상을 벗어나지 않는 범위 내에서 다양한 형태의 변형도 가능함은 이 분야에 통상의 지식을 가진 자에게는 자명한 사실이다.
도 1은 일반적인 교류형 3전극 플라즈마 디스플레이 패널의 스캔 전극, 서스테인 전극 및 어드레스 전극을 나타낸 배치 구성도.
도 2는 일반적인 교류형 3전극 플라즈마 디스플레이 패널의 구동 파형을 나타낸 파형도.
도 3은 종래의 플라즈마 디스플레이 패널 구동방법에 있어서, 스캔 펄스와 데이터전압 펄스의 동일한 인가 개시점 및 종료점을 나타낸 타이밍도.
도 4는 스캔 전극과 서스테인 전극에서의 전압강하를 나타낸 예시도.
도 5는 본 발명에 의한 플라즈마 디스플레이 패널 구동방법이 적용된 구동회로부를 나타낸 구성도.
도 6은 본 발명에 의한 플라즈마 디스플레이 패널 구동방법에 있어서, 스캔 펄스와, 상이한 인가 개시점 및 상이한 종료점을 가진 동일한 폭의 데이터전압 펄스들 및 출력 제어신호들을 나타낸 타이밍도.
도 7은 본 발명에 의한 플라즈마 디스플레이 패널 구동방법에 있어서, 스캔 펄스와 상이한 인가 개시점 및 동일한 종료점을 가진 상이한 폭의 데이터전압 펄스들을 나타낸 타이밍도.

Claims (5)

  1. 스캔펄스를 인가하는 스캔 전극과 유지방전 전압을 인가하는 서스테인 전극을 가지며, 어드레스 구간에서 방전 셀을 선택하기 위한 데이터전압 펄스를 인가하는 어드레스 전극을 갖는 3전극 구조의 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    벽전하를 균일화하기 위한 리셋 구간, 방전 셀과 비방전 셀을 구분하기 위한 어드레스 구간 및 선택된 방전 셀만을 서스테인 방전하는 서스테인 구간을 포함하는 구동파형을 이용하며,
    스캔 전극에 스캔전압 펄스를 인가하고,
    복수개의 어드레스 전극으로 각각 이루어진 복수개의 어드레스 전극군에, 데이터전압 펄스를 상이한 시점에 각각 인가하되,
    여기서, 상기 데이터전압 펄스는 상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 멀리 떨어진 어드레스 전극군일수록 먼저 인가되고,
    상기 데이터전압 펄스의 폭이 상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 가장 멀리 떨어진 어드레스 전극군으로부터 상기 스캔 전극의 전압 인입부로부터 가장 가까운 곳의 어드레스 전극군으로 갈수록 좁아지는 것을 특징으로 하는 플라즈마 디스플레이 패널 구동방법.
  2. 삭제
  3. 삭제
  4. 삭제
  5. 제1항에 있어서,
    상기 복수개의 어드레스 전극군 중에서 상기 스캔 전극의 전압 인입부로부터 가장 멀리 떨어진 어드레스 전극군에 인가되는 상기 데이터전압 펄스의 최초 출력 시점과 상기 스캔 전극의 전압 인입부로부터 가장 가까운 곳의 어드레스 전극군에 인가되는 상기 데이터전압 펄스의 최초 출력 시점 사이의 간격이 400 나노초(㎱) 미만인 것을 특징으로 하는 플라즈마 디스플레이 패널 구동방법.
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