KR101097859B1 - 마이크로웨이브 주파수를 사용하는 송신기용 디지털 선형화장치 - Google Patents

마이크로웨이브 주파수를 사용하는 송신기용 디지털 선형화장치 Download PDF

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Abstract

본 발명은 마이크로웨이브 주파수를 사용하는 송신기의 고출력 증폭기에 적용 가능한 디지털 선형화 장치에 관한 것으로, 더욱 상세하게는 증폭기의 선형화 특성을 개선하여 높은 전력 효율 및 주파수 사용 효율을 개선할 수 있는 디지털 선형화 장치에 관한 것이다.
디지털, 선형화, 마이크로웨이브, 위성통신, TWTA, SSPA

Description

마이크로웨이브 주파수를 사용하는 송신기용 디지털 선형화 장치 {Digital Linearizer For Transmitter Using Microwave Frequency}
본 발명은 마이크로웨이브 주파수를 사용하는 송신기의 고출력 증폭기에 적용 가능한 디지털 선형화 장치에 관한 것으로, 더욱 상세하게는 증폭기의 선형화 특성을 개선하여 높은 전력 효율 및 주파수 사용 효율을 개선할 수 있는 디지털 선형화 장치에 관한 것이다.
특히, 본 발명은 C-Band, X-Band, Ku-Band, Ka-Band를 사용하는 마이크로웨이브 통신 송신기에 모두 적용 가능하다.
일반적으로 마이크로웨이브 송신기에서는 고출력 고주파 특성을 위해 진행파관 증폭기 TWTA (Traveling Wave Tube Amplifier)와 반도체를 이용한 고체전력 증폭기 SSPA (Solid State Power Amplifier)가 주로 사용된다.
도 1은 종래의 고출력 증폭기가 포함된 마이크로웨이브 송신기를 개략적으로 도시한 구성도이다.
도 1을 참조하면, 종래의 마이크로웨이브 송신기는 입력된 IF 신호(Typically L-Band)를 마이크로웨이브 주파수 대역(C-Band, X-Band, Ku-Band, Ka-Band) 신호로 상향하는 주파수 상향 변환기(Up-converter), 상기 상향된 주파수 대역 신호를 증폭하는 고출력 증폭기 및 상기 증폭된 신호를 방사하는 안테나를 포함하여 구성된다.
그리고 종래의 마이크로웨이브 송신기는 상기 입력된 IF 신호가 강우 등에 의해 약해질 경우 내부에 실장된 감쇄기를 제어하여 약해진 만큼 송신 신호를 증폭하기 위해 상기 주파수 상향 변환기 전단에 형성되는 UPC로 구성된다.
그러나 종래의 마이크로웨이브 송신기는 상기 고출력 증폭기를 최대 전력 레벨까지 증폭하여 비선형 특성을 갖는 포화영역 부근에서 동작시킬 경우, 일반적으로 AM/AM 왜곡과 AM/PM 왜곡으로 대역 및 대역 외에서 원하지 않는 혼변조(Intermodulation) 성분들이 증폭기의 잡음원으로 발생하여 전송 품질을 저하시키는 요인으로 작용한다.
따라서 종래의 다수의 반송파가 입력되는 마이크로웨이브 송신기에서는 혼변조 잡음을 줄이기 위하여 수 dB에서 수십 dB의 출력을 낮춰서(Back-off) 선형 영역에서 동작되도록 제어하고 있다.
그러나, 선형 영역에서 동작시키기 위해 최대출력보다 수 dB에서 수십 dB 출력을 낮추어야 하므로 효율이 낮아 전력 소모가 많고 원하는 출력보다 더 큰 출력 용량을 가지는 전력 증폭기를 필요로하므로 송신기 구축 비용이 증가하는 문제가 있었다.
상기와 같은 문제점을 해결하기 위해 안출된 것으로써 본 발명의 목적은 마이크로웨이브 송신기용 고출력 증폭기의 선형화 특성을 개선하여 Back-off 마진을 줄임으로써 높은 전력 효율 및 주파수 사용 효율을 높일 수 있는 디지털 선형화 장치를 제공하는 데 있다.
상기와 같은 목적을 달성하기 위해 본 발명에 따른 디지털 선형화 장치는 입력되는 IF 신호에 대한 주파수를 하향 변환하고 다중 반송파를 자동으로 검출 또는 설정하는 입력 주파수 하향 변환부와 상기 변환된 IF 신호를 디지털 신호로 변환하는 제 1 A/D 변환부와 상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 이용하여 비선형 특성으로 인해 발생하는 혼변조 신호를 제거하는 디지털 전치 왜곡 선형화부와 증폭기로부터 출력된 신호를 상기 디지털 전치 왜곡 선형화부에 입력하기 위한 피드백 신호로 변환하는 피드백 처리부와 상기 디지털 전치 왜곡 선형화부에서 처리된 디지털 신호를 IF 신호로 변환하는 D/A 변환부와 상기 D/A 변환부에서 출력된 IF 신호를 마이크로웨이브 주파수로 변환하여 증폭기로 전송하는 주파수 상향 변환부를 포함하는 것을 특징으로 한다.
여기서, 상기 입력 주파수 하향 변환부는 입력신호와 선택된 주파수를 혼합 하여 출력하는 입력신호 처리부와 상기 입력신호 처리부를 통해 출력된 신호를 증폭기로 출력하기 위한 증폭 경로와 사용 중인 중심 주파수와 대역폭을 자동으로 검색하기 위한 검출 경로로 신호를 분배하는 RF 분배기와 상기 증폭 경로로 출력된 신호를 IF 신호로 변환하는 출력신호 처리부와 상기 검출 경로로 출력된 신호를 주파수 하향 변환후 일정 간격으로 주파수를 가변하고, 상기 가변된 신호의 전력을 측정하는 신호판단부 및 상기 입력신호 처리부, RF 분배기, 출력신호 처리부 및 신호 판단부를 제어하는 제어부를 포함하는 것을 특징으로 한다.
그리고 상기 입력신호 처리부는 입력 주파수를 블록 별로 선택하는 주파수 블록 선택 PLL과 상기 입력신호와 주파수 블록 선택 PLL에서 선택된 주파수를 혼합하여 출력하는 믹서를 포함하는 것을 특징으로 한다.
또한, 상기 출력신호 처리부는 상기 제어부에서 검색한 중심 주파수와 대역폭을 고려하여 설정한 특정 주파수를 공급하는 제 1 가변 PLL과 상기 증폭 경로로 출력된 신호와 상기 제 1 가변 PLL에서 설정된 특정 주파수를 혼합하여 출력하는 믹서와 상기 믹서로 출력된 신호 중 디지털 전치 왜곡 선형화부를 통해 선형화 처리가 가능하도록 선택된 중심주파수와 대역폭에 맞게 여과하는 제 1 협대역 대역 통과 필터를 포함하는 것을 특징으로 한다.
그리고 상기 신호판단부는 상기 검출 경로로 입력된 신호를 주파수 하향 변환한 후 중심 주파수와 대역폭을 검색하기 위해 일정 간격으로 주파수를 가변하는 제 2 가변 PLL과 상기 검출 경로로 출력된 신호와 상기 제 2 가변 PLL에서 가변된 주파수를 혼합하는 믹서와 상기 일정 간격으로 가변된 신호의 전력을 측정하기 위 해 불요파를 제거하는 제 2 협대역 대역 통과 필터 및 상기 제 2 협대역 대역 통과 필터를 통과한 IF 신호의 전력을 DC 전압값으로 변환하여 제어부로 전송하는 전력 검출부을 포함하는 것을 특징으로 한다.
또한, 상기 제어부는 입력 주파수를 블록 별로 선택하기 위해 상기 주파수 블록 선택 PLL의 주파수를 천이하고, 검출 경로로 입력되는 신호의 세기를 검출하기 위해 상기 제 2 가변 PLL의 주파수를 천이하고, 상기 전력 검출부에서 출력된 신호 크기로부터 신호 세기를 검출하고, 상기 신호의 크기를 판단하여 신호의 유무를 판단하되, 신호가 검출되면 중심주파수와 대역폭을 계산하고, 신호가 검출되지 않으면 상기 주파수 블록 선택 PLL과 제 2 가변 PLL의 주파수를 천이시켜 신호를 검출하도록 제어하는 것을 특징으로 한다. 보다 상세하게 설명하면, 상기 제어부는: 입력 주파수를 블록별로 선택하기 위해 상기 주파수 블록 선택 PLL의 주파수를 천이하고, 상기 검출 경로로 입력되는 신호의 세기를 검출하기 위해 상기 제 2 가변 PLL의 주파수를 천이하고, 상기 전력 검출부에서 출력된 전력값으로부터 신호 세기를 검출하고, 상기 전력값에서 검출된 상기 신호 세기로부터 신호 크기를 판단하여 상기 검출 경로로 입력되는 신호의 유무를 판단하되, 상기 검출 경로로 입력되는 신호가 검출되면 중심주파수와 대역폭을 계산하고, 상기 검출 경로로 입력되는 신호가 검출되지 않으면 상기 주파수 블록 선택 PLL과 제 2 가변 PLL의 주파수를 천이시켜 상기 검출경로로 입력되는 신호를 검출하도록 제어한다.
그리고 상기 제어부는 상기 중심주파수와 대역폭 계산시 제 2 가변 PLL 주파수 천이 값과 신호 크기 값을 계산하여 중심 주파수와 대역폭을 계산하되, 계산된 중심 주파수와 대역폭의 값이 설정된 임계값보다 크면 중심 주파수와 대역폭의 변화가 있다고 판단하여 제 2 가변 PLL의 주파수 천이를 실행하고 제 1 가변 PLL의 주파수 천이를 실행하여 중심 주파수를 설정하고, 임계값보다 작은 경우 중심 주파수와 대역폭의 변화가 없다고 판단하여 제 1 가변 PLL의 주파수를 유지하는 것을 특징으로 한다.
또한, 상기 디지털 전치 왜곡 선형화부는 상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 입력받아 CFR(Crest Factor Reduction) 기능과 DPD(Digital Pre-Distortion) 기능을 이용하여 비선형 특성과 반대되는 신호를 생 성하여 비선형 특성에 의한 혼변조 신호를 제거하는 것을 특징으로 한다.
그리고 상기 피드백 처리부는 상기 증폭기의 커플링 단자로부터 출력되는 마이크로 웨이브 신호를 IF 신호로 변환하는 재귀 주파수 하향 변환부와 상기 재귀 주파수 하향 변환부로부터 변환된 IF 신호를 디지털 신호로 변환하는 제 2 A/D 변환부를 포함하는 것을 특징으로 한다.
상기에서 살펴본 바와 같이 본 발명에 따른 디지털 선형화 장치는 고출력 증폭기의 선형화 특성을 개선하여 Back-off 마진을 줄임으로써 높은 전력 효율을 얻을 수 있는 탁월한 효과가 발생한다.
또한, 중심 주파수 및 대역폭 자동 검색을 통해 주파수 사용 효율을 높일 수 있으며 디지털 선형화 장치의 성능을 최적화하여 증폭기의 성능을 최대화 하는데 탁월한 효과가 발생한다.
이하, 본 발명의 구체적인 실시예에 대하여 도면을 참조하여 상세하게 설명하기로 한다.
본 발명에 따른 디지털 선형화 장치는 입력신호와 증폭기 사이에 형성되어 상기 증폭기의 비선형 특성을 제거하여 선형화 특성을 개선시키는 장치로써 마이크로웨이브 통신용 송신기에 적용될 수 있다.
도 2는 본 발명의 바람직한 실시예에 따른 디지털 선형화 장치를 개략적으로 도시한 구성도이다.
도 2를 참조하면, 본 발명에 따른 디지털 선형화 장치(10)는 입력신호와 증폭기 사이에 형성되고, 입력되는 IF 신호에 대한 주파수를 하향 변환하고 다중 반송파를 자동으로 검출 또는 설정하는 입력 주파수 하향 변환부(110)와 상기 변환된 IF 신호를 디지털 신호로 변환하는 제 1 A/D 변환부(120)와 상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 이용하여 비선형 특성으로 인해 발생하는 혼변조 신호를 제거하는 디지털 전치 왜곡 선형화부(130)와 증폭기로부터 출력된 신호를 상기 디지털 전치 왜곡 선형화부에 입력하기 위한 피드백 신호로 변환하는 피드백 처리부(160)와 상기 디지털 전치 왜곡 선형화부에서 처리된 신호를 IF 신호로 변환하는 D/A 변환부(140)와 상기 D/A 변환부에서 출력된 IF 신호를 마이크로웨이브 주파수로 변환하여 증폭기로 전송하는 주파수 상향 변환부(150)를 포함하여 구성될 수 있다.
여기서, 상기 입력 주파수 하향 변환부(110)는 입력되는 IF 신호를 제 1 A/D 변환부에서 디지털 신호로 변환될 수 있도록 주파수를 하향 변환하는 역할을 담한다.
특히, 상기 입력 주파수 하향 변환부(110)는 디지털 선형화 특성이 최적화될 수 있도록 광대역 송신기에서 사용되는 다중 반송파의 중심주파수와 대역폭를 자동으로 검출 및 설정하는 기능을 수행한다.
도 3은 도 2의 입력 주파수 하향 변환부의 상세 블럭도이다.
도 3을 참조하면, 상기 입력 주파수 하향 변환부(110)는 입력신호와 선택된 주파수를 혼합하여 출력하는 입력신호 처리부(111)와 상기 입력신호 처리부를 통해 출력된 신호를 증폭기로 출력하기 위한 증폭 경로와 사용 중인 중심 주파수와 대역폭을 자동으로 검색하기 위한 검출 경로로 신호를 분배하는 RF 분배기(112)와 상기 증폭 경로로 출력된 신호를 IF 신호로 변환하는 출력신호 처리부(113)와 상기 검출 경로로 출력된 신호를 주파수 하향 변환후 일정 간격으로 주파수를 가변하고, 상기 가변된 신호의 전력을 측정하는 신호판단부(114) 및 상기 입력신호 처리부, RF 분배기, 출력신호 처리부 및 신호판단부를 제어하는 제어부(115)를 포함하여 구성될 수 있다.
여기서, 상기 입력신호 처리부(111)는 입력 주파수를 블록 별로 선택하기 위한 주파수 블록 선택 위상동기루프(Phase Lock Loop, 이하 PLL 이라 함)(111a)와 입력 IF 신호와 상기 주파수 블록 선택 PLL에 의해 선택된 입력 주파수를 혼합하는 믹서(111b)를 포함하여 구성될 수 있다.
그리고 상기 출력신호 처리부(113)는 상기 제어부에서 검색한 중심 주파수와 대역폭을 고려하여 설정한 특정 주파수를 공급하는 제 1 가변 PLL(113a)과 상기 증폭 경로로 출력된 신호와 상기 제 1 가변 PLL에서 설정된 특정 주파수를 혼합하여 출력하는 믹서(113b)와 상기 믹서로 출력된 신호 중 디지털 전치 왜곡 선형화부를 통해 선형화 처리가 가능하도록 선택된 중심 주파수와 대역폭에 맞게 여과하는 제 1 협대역 대역 통과 필터(113c)를 포함하여 구성될 수 있다.
그리고 상기 신호 판단부(114)는 상기 검출 경로로 입력된 신호를 주파수 하 향 변환한 후 중심 주파수와 대역폭을 검색하기 위해 일정 간격으로 주파수를 가변하는 제 2 가변 PLL(114a)과 상기 검출 경로로 출력된 신호와 상기 제 2 가변 PLL에서 가변된 주파수를 혼합하는 믹서(114b)와 상기 일정 간격으로 가변된 신호의 전력을 측정하기 위해 불요파를 제거하는 제 2 협대역 대역 통과 필터 (114c) 및 상기 제 2 협대역 대역 통과 필터를 통과한 IF 신호의 전력을 DC 전압값으로 변환하여 제어부로 전송하는 전력 검출부(114d)를 포함하여 구성될 수 있다.
도 4는 본 발명의 입력 주파수 하향 변환부의 제어부의 동작 알고리즘를 개략적으로 도시한 순서도이다.
도 4를 참조하면, 먼저 제어부는 입력 주파수를 블록 별로 선택하기 위해 주파수 블록 선택 PLL의 주파수를 천이한다.
이어서, 검출 경로로 입력되는 신호의 세기를 검출하기 위해 제 2 가변 PLL의 주파수를 천이한다.
다음으로 전력 검출부에서 출력된 신호 크기에 대한 정보가 전압값으로 출력되며, 이 값을 제어부 내부의 A/D 변화기를 사용하여 신호 세기를 검출한다.
상기 신호 세기가 검출되면 신호의 크기를 판단하여 신호의 유무를 판단한다. 이 때 신호가 검출되면 중심주파수와 대역폭을 계산하고, 신호가 검출되지 않으면 피드백하여 주파수 블록 선택 PLL과 제 2 가변 PLL의 주파수를 천이시킨다.
상기 중심 주파수와 대역폭 계산시 제 2 가변 PLL 주파수 천이값과 신호 크기 값을 계산하여 중심주파수와 대역폭을 계산한다.
상기 계산된 중심 주파수와 대역폭의 값이 설정된 임계값보다 크면 중심 주 파수와 대역폭의 변화가 있다고 판단하여 제 2 가변 PLL의 주파수를 천이하고, 임계값보다 작은 경우 중심 주파수와 대역폭의 변화가 없다고 판단하고 피드백하여 주파수 블록 선택 PLL 주파수 천이 블록으로 이동한다.
여기서, 상기 계산된 중심 주파수와 대역폭의 값이 임계값 보다 큰 경우 제 1 가변 PLL의 주파수 천이를 실행함으로써 중심 주파수를 설정하게 된다.
상기와 같이 입력 주파수 하향 변환부를 통해 입력신호에 대한 중심 주파수 및 대역폭이 산출되면 제 1 A/D 변환부에 의해 디지털 신호로 변환되어 디지털 전치 왜곡 선형화부에 입력된다.
상기 디지털 전치 왜곡 선형화부는 상기 제 1 A/D 변환부로부터 출력된 신호와 증폭기로부터 피드백 처리부를 통해 피드백된 신호를 입력받아 증폭기의 비선형 특성에 의해 발생하는 혼변조 신호를 제거한다.
여기서, 상기 피드백 처리부는 상기 증폭기의 커플링 단자로부터 출력되는 마이크로 웨이브 신호를 IF 신호로 변환하는 재귀 주파수 하향 변환부와 상기 재귀 주파수 하향 변환부로부터 변환된 IF 신호를 디지털 신호로 변환하는 제 2 A/D 변환부를 포함하여 구성될 수 있다.
보다 구체적으로, 상기 제 1 A/D 변환부로부터 출력된 신호와 증폭기로부터 피드백 처리부를 통해 피드백된 신호를 입력받아 CFR(Crest Factor Reduction)기능과 적응 알고리즘을 수행하는 DPD(Digital Pre-Distortion) 기능을 이용하여 증폭기의 비선형 특성과 반대되는 신호를 생성하여 비선형 특성에 의해 발생하는 혼변조 신호를 제거하고 선형 신호만을 증폭기로 출력한다.
여기서, 상기 CFR기능과 DPD 기능은 FPGA, DSP(Digital Signal Processor), 전용 ASIC 또는 혼합 구조를 이용하여 구현될 수 있으며, 상기 CFR 기능과 DPD 기능을 구현하는 알고리즘은 본 발명의 통상의 지식을 자진 자에게 자명한 사항이므로 구체적인 설명은 생략하도록 한다.
따라서, 고출력 증폭기의 비선형 특성에 의한 혼변조 신호를 제거하고 선형화 특성을 개선하여 Back-off 마진을 줄임으로써 증폭기의 전력 효율을 높일 수 있다.
이상에서 설명한 본 발명의 상세한 설명에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 본 발명의 보호범위는 상기 실시예에 한정되는 것이 아니며, 해당 기술분야의 통상의 지식을 갖는 자라면 본 발명의 사상 및 기술영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
도 1은 종래의 고출력 증폭기가 포함된 마이크로웨이브 송신기를 개략적으로 도시한 구성도이다.
도 2는 본 발명의 바람직한 실시예에 따른 디지털 선형화 장치를 개략적으로 도시한 구성도이다.
도 3은 도 2의 입력 주파수 하향 변환부의 상세 블럭도이다.
도 4는 본 발명의 입력 주파수 하향 변환부의 제어부의 동작 알고리즘를 개략적으로 도시한 순서도이다.
*도면의 주요부분에 대한 부호의 설명*
10 : 디지털 선형화 장치 110 : 입력 주파수 하향 변환부
120 : 제 1 A/D 변환부 130 : 디지털 전치 왜곡 선형화부
140 : D/A 변환부 150 : 주파수 상향 변환부
160 : 피드백 처리부

Claims (9)

  1. 입력되는 IF 신호에 대한 주파수를 하향 변환하고 다중 반송파의 중심주파수와 대역폭을 자동으로 검출 또는 설정하는 입력 주파수 하향 변환부와;
    상기 변환된 IF 신호를 디지털 신호로 변환하는 제 1 A/D 변환부와;
    상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 이용하여 비선형 특성으로 인해 발생하는 혼변조 신호를 제거하는 디지털 전치 왜곡 선형화부와;
    증폭기로부터 출력된 신호를 상기 디지털 전치 왜곡 선형화부에 입력하기 위한 피드백 신호로 변환하는 피드백 처리부와;
    상기 디지털 전치 왜곡 선형화부에서 처리된 신호를 IF 신호로 변환하는 D/A 변환부와;
    상기 D/A 변환부에서 출력된 IF 신호를 마이크로웨이브 주파수로 변환하여 상기 증폭기로 전송하는 주파수 상향 변환부를 포함하여 구성되는 디지털 선형화 장치로서:
    상기 디지털 전치 왜곡 선형화부는;
    상기 변환된 디지털 신호와 상기 증폭기로부터 피드백된 신호를 입력받아 CFR(Crest Factor Reduction) 기능과 DPD(Digital Pre-Distortion) 기능을 이용하여 비선형 특성과 반대되는 신호를 생성하여 비선형 특성에 의한 혼변조 신호를 제거하는 것을 특징으로 하는 디지털 선형화 장치.
  2. 입력되는 IF 신호에 대한 주파수를 하향 변환하고 다중 반송파의 중심주파수와 대역폭을 자동으로 검출 또는 설정하는 입력 주파수 하향 변환부와;
    상기 변환된 IF 신호를 디지털 신호로 변환하는 제 1 A/D 변환부와;
    상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 이용하여 비선형 특성으로 인해 발생하는 혼변조 신호를 제거하는 디지털 전치 왜곡 선형화부와;
    증폭기로부터 출력된 신호를 상기 디지털 전치 왜곡 선형화부에 입력하기 위한 피드백 신호로 변환하는 피드백 처리부와;
    상기 디지털 전치 왜곡 선형화부에서 처리된 신호를 IF 신호로 변환하는 D/A 변환부와;
    상기 D/A 변환부에서 출력된 IF 신호를 마이크로웨이브 주파수로 변환하여 상기 증폭기로 전송하는 주파수 상향 변환부를 포함하여 구성되는 디지털 선형화 장치로서:
    상기 피드백 처리부는;
    상기 증폭기의 커플링 단자로부터 출력되는 마이크로 웨이브 신호를 IF 신호로 변환하는 재귀 주파수 하향 변환부와;
    상기 재귀 주파수 하향 변환부로부터 변환된 IF 신호를 디지털 신호로 변환하는 제 2 A/D 변환부를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  3. 제 1항에 있어서,
    상기 입력 주파수 하향 변환부는:
    입력신호와 선택된 주파수를 혼합하여 출력하는 입력신호 처리부와;
    상기 입력신호 처리부를 통해 출력된 신호를 증폭기로 출력하기 위한 증폭 경로와 사용 중인 중심 주파수와 대역폭을 자동으로 검색하기 위한 검출 경로로 신호를 분배하는 RF 분배기와;
    상기 증폭 경로로 출력된 신호를 IF 신호로 변환하는 출력신호 처리부와;
    상기 검출 경로로 출력된 신호를 주파수 하향 변환후 일정 간격으로 주파수를 가변하고, 상기 가변된 신호의 전력을 측정하는 신호판단부; 및
    상기 입력신호 처리부, RF 분배기, 출력신호 처리부 및 신호판단부를 제어하는 제어부를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  4. 입력되는 IF 신호에 대한 주파수를 하향 변환하고 다중 반송파의 중심주파수와 대역폭을 자동으로 검출 또는 설정하는 입력 주파수 하향 변환부와;
    상기 변환된 IF 신호를 디지털 신호로 변환하는 제 1 A/D 변환부와;
    상기 변환된 디지털 신호와 증폭기로부터 피드백된 신호를 이용하여 비선형 특성으로 인해 발생하는 혼변조 신호를 제거하는 디지털 전치 왜곡 선형화부와;
    증폭기로부터 출력된 신호를 상기 디지털 전치 왜곡 선형화부에 입력하기 위한 피드백 신호로 변환하는 피드백 처리부와;
    상기 디지털 전치 왜곡 선형화부에서 처리된 신호를 IF 신호로 변환하는 D/A 변환부와;
    상기 D/A 변환부에서 출력된 IF 신호를 마이크로웨이브 주파수로 변환하여 상기 증폭기로 전송하는 주파수 상향 변환부를 포함하여 구성되는 디지털 선형화 장치로서:
    상기 입력 주파수 하향 변환부는:
    입력신호와 선택된 주파수를 혼합하여 출력하는 입력신호 처리부와;
    상기 입력신호 처리부를 통해 출력된 신호를 증폭기로 출력하기 위한 증폭 경로와 사용 중인 중심 주파수와 대역폭을 자동으로 검색하기 위한 검출 경로로 신호를 분배하는 RF 분배기와;
    상기 증폭 경로로 출력된 신호를 IF 신호로 변환하는 출력신호 처리부와;
    상기 검출 경로로 출력된 신호를 주파수 하향 변환후 일정 간격으로 주파수를 가변하고, 상기 가변된 신호의 전력을 측정하는 신호판단부; 및
    상기 입력신호 처리부, RF 분배기, 출력신호 처리부 및 신호판단부를 제어하는 제어부를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  5. 제 3항 또는 제 4항에 있어서,
    상기 입력신호 처리부는:
    입력 주파수를 블록 별로 선택하는 주파수 블록 선택 PLL과;
    상기 입력신호와 주파수 블록 선택 PLL에서 선택된 주파수를 혼합하여 출력하는 믹서를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  6. 제 3항 또는 제 4항에 있어서,
    상기 출력신호 처리부는:
    상기 제어부에서 검색한 중심 주파수와 대역폭을 고려하여 설정한 특정 주파수를 공급하는 제 1 가변 PLL과;
    상기 증폭 경로로 출력된 신호와 상기 제 1 가변 PLL에서 설정된 특정 주파수를 혼합하여 출력하는 믹서와;
    상기 믹서로 출력된 신호 중 디지털 전치 왜곡 선형화부를 통해 선형화 처리가 가능하도록 중심주파수와 대역폭에 맞게 여과하는 제 1 협대역 대역 통과 필터를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  7. 제 3항 또는 제 4항에 있어서,
    상기 신호 판단부는:
    상기 검출 경로로 출력된 신호를 주파수 하향 변환한 후 중심 주파수와 대역폭을 검색하기 위해 일정 간격으로 주파수를 가변하는 제 2 가변 PLL과;
    상기 검출 경로로 출력된 신호와 상기 제 2 가변 PLL에서 가변된 주파수를 혼합하는 믹서와;
    상기 일정 간격으로 가변된 신호의 전력을 측정하기 위해 불요파를 제거하는 제 2 협대역 대역 통과 필터 및;
    상기 제 2 협대역 대역 통과 필터를 통과한 IF 신호의 전력을 DC 전압값으로 변환하여 제어부로 전송하는 전력 검출부를 포함하는 것을 특징으로 하는 디지털 선형화 장치.
  8. 제 3항 또는 제 4항에 있어서,
    상기 신호 판단부는, 상기 검출 경로로 출력된 신호를 주파수 하향 변환한 후 중심주파수와 대역폭을 검색하기 위해 일정 간격으로 주파수를 가변하는 제 2 가변 PLL과, 상기 검출 경로로 출력된 신호와 상기 제 2 가변 PLL에서 가변된 주파수를 혼합하는 믹서와, 상기 일정 간격으로 가변된 신호의 전력을 측정하기 위해 불요파를 제거하는 제 2 협대역 대역 통과 필터와, 상기 제 2 협대역 대역 통과 필터를 통과한 IF 신호의 전력을 DC 전압값으로 변환하여 제어부로 전송하는 전력 검출부를 포함하며;
    상기 제어부는, 입력 주파수를 블록 별로 선택하는 주파수 블록 선택 PLL의 주파수를 천이하고, 상기 검출 경로로 입력되는 신호의 세기를 검출하기 위해 상기 제 2 가변 PLL의 주파수를 천이하고, 상기 전력 검출부에서 출력된 전력값으로부터 신호 세기를 검출하고, 상기 전력값에서 검출된 상기 신호 세기로부터 신호 크기를 판단하여 상기 검출 경로로 입력되는 신호의 유무를 판단하되, 상기 검출 경로로 입력되는 신호가 검출되면 상기 중심주파수와 대역폭을 계산하고, 상기 검출 경로로 입력되는 신호가 검출되지 않으면 상기 주파수 블록 선택 PLL과 제 2 가변 PLL의 주파수를 천이시켜 상기 검출 경로로 입력되는 신호를 검출하도록 제어하는 것을 특징으로 하는 디지털 선형화 장치.
  9. 제 8항에 있어서,
    상기 제어부는:
    상기 중심주파수와 대역폭 계산시,
    제 2 가변 PLL 주파수 천이 값과 신호 크기 값을 계산하여 중심 주파수와 대역폭을 계산하되, 계산된 중심 주파수와 대역폭의 값이 설정된 임계값보다 크면 중심 주파수와 대역폭의 변화가 있다고 판단하여 제 2 가변 PLL의 주파수 천이를 실행하고 제 1 가변 PLL의 주파수 천이를 실행하여 중심 주파수를 설정하고, 임계값보다 작은 경우 중심 주파수와 대역폭의 변화가 없다고 판단하는 것을 특징으로 하는 디지털 선형화 장치.
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