KR101017818B1 - Amplifier circuit - Google Patents
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Abstract
출력 앰프의 입력 경로에, 인발 회로를 접속한다. 인발 회로는, 전원 상승 시에서, 통상의 전원 전압의 상승과, 이를 지연시킨 지연 전원 전압의 차분에 기초한 전류를 뽑아낸다. 따라서, 출력 앰프의 입력에서의 전원 상승 시의 급준한 상승을 제거할 수 있다.A drawing circuit is connected to the input path of the output amplifier. The drawing circuit extracts a current based on the difference between the normal power supply voltage rise and the delayed power supply voltage delayed at the time of power supply rise. Therefore, the steep rise in power supply rise at the input of the output amplifier can be eliminated.
입력 앰프, 입력 기준 앰프, 출력 앰프, 출력 기준 앰프, 인발 회로 Input amplifier, input reference amplifier, output amplifier, output reference amplifier, drawing circuit
Description
본 발명은, 음성 신호를 증폭하는 앰프 회로에 관한 것이다.The present invention relates to an amplifier circuit for amplifying an audio signal.
CD, 메모리, 레코드, 테이프, 라디오, 텔레비전 등에서, 오디오 신호가 출력되고, 이것이 스피커로부터 출력된다. 이 스피커로부터 출력하기 위해 오디오 신호를 증폭하는 출력 앰프가 이용된다.In a CD, a memory, a record, a tape, a radio, a television, and the like, an audio signal is output, which is output from a speaker. An output amplifier is used to amplify the audio signal for output from this speaker.
이 출력 앰프에서는, 출력 신호 레벨이 크게 변화하면, 스피커로부터 팝음이 출력된다. 따라서,이 팝음을 방지하는 각종의 회로가 알려져 있다.In this output amplifier, a pop sound is output from a speaker when the output signal level changes greatly. Therefore, various circuits for preventing this pop sound are known.
특히, 전원의 기동 시에는, 각종의 회로가 동작을 개시하기 때문에, 그 때의 변화가, 출력 앰프의 출력에 영향을 미쳐 팝음이 발생하기 쉽다.In particular, at the start of the power supply, various circuits start to operate, so that the change at that time affects the output of the output amplifier and is likely to generate pop sounds.
본 발명에서는, 전원 전압과, 전원 전압을 지연시켜 상승하게 된 지연 전원 전압의 차분에 기초하는 인발 전류를 생성하고, 이 인발 전류를 출력 앰프의 출력에 작용시킴으로써, 팝음을 방지한다.In the present invention, a draw current is generated based on the difference between the power supply voltage and the delayed supply voltage that is increased by delaying the power supply voltage, and the drawing current is applied to the output of the output amplifier to prevent popping sounds.
이하, 발명의 일 실시 형태에 대해, 도면에 기초하여 설명한다. 도 1은, 일 실시 형태의 구성을 도시하는 도면이다.EMBODIMENT OF THE INVENTION Hereinafter, one Embodiment of this invention is described based on drawing. 1 is a diagram illustrating a configuration of an embodiment.
오디오 신호는, 입력단 IN에 입력된다. 이 입력단 IN은, 입력 앰프(10)의 일단(정 또는 부입력단)에 접속되어 있다. 또한, 소정의 기준 전압을 발생하는 입력 기준 앰프(12)가 설치되어 있고, 이 입력 기준 앰프(12)의 출력이 저항(R5)을 통해, 입력 앰프(10)의 타단(부 또는 정입력단)에 입력된다. 또한, 입력 기준 앰프(12)의 출력은 저항(R6)을 통해, 입력 앰프(10)의 일단에도 공급되어 있다.The audio signal is input to the input terminal IN. This input terminal IN is connected to one end (positive or negative input terminal) of the input amplifier 10. In addition, an
따라서, 입력 앰프(10)로부터는, 입력 기준 앰프(12)의 출력에서의 기준 전압(직류 전압)을 기준으로 하여, 오디오 신호가 중첩된 신호가 출력된다. 또한,이 예에서, 입력 앰프(10)는 정부 한 쌍의 출력단을 갖고 있고, 위상이 반대인 2개의 신호를 출력한다. 이와 같은 입력 앰프(10)는, 한 쌍의 차동 트랜지스터를 갖는 차동 앰프로 용이하게 구성할 수 있다.Therefore, the input amplifier 10 outputs a signal in which the audio signal is superimposed on the basis of the reference voltage (direct current voltage) at the output of the
입력 앰프(10)의 1개의 출력은, 출력 앰프(14)의 정입력단에 입력되고, 다른 1개의 출력은 출력 앰프(16)의 정입력단에 입력된다. 출력 앰프(14)의 부입력단에는, 출력 기준 앰프(20)의 출력이 저항(R2)을 통해 접속되어 있다. 또한, 출력 앰프(14)의 출력단은, 저항(R1)을 통해 부입력단으로 귀환되어 있다. 따라서, 출력 앰프(10)의 출력은, 입력 기준 앰프(12)의 출력과, 출력 기준 앰프(20)의 출력에 따른 직류 전압으로 되고, 거기에 입력 신호의 교류 성분이 중첩된다.One output of the input amplifier 10 is input to the positive input terminal of the
또한, 출력 앰프(16)의 부입력단에는, 출력 기준 앰프(20)의 출력이 저항(R4)을 통해 접속되고, 출력 앰프(14)의 출력단은, 저항(R1)을 통해 부입력단으 로 귀환되어 있다. 따라서, 출력 앰프(10)의 출력도, 입력 기준 앰프(12)의 출력과, 출력 기준 앰프(20)의 출력에 따른 직류 전압으로 되고, 거기에 입력 신호의 교류 성분이 중첩된다.In addition, the output of the
또한, 출력 기준 앰프(20)의 출력은, 저항(R7)을 통해, 입력 앰프(10)의 출력에 접속되어 있다. 여기서, 도면에서는, 입력 앰프(10)의 한쪽의 출력에 접속하도록 기재되어 있지만, 입력 앰프(10)는 차동 앰프로 구성되어 있고, 그 출력의 직류 성분은 동일하다. 따라서, 직류적으로는, 출력 기준 앰프(20)의 출력이 저항(R7)을 통해, 입력 앰프(10)의 2개의 출력에 접속되어 있다.In addition, the output of the
그리고, 본 실시 형태에서는, 인발 회로(40)를 갖고 있고, 이것이 입력 앰프(10)의 출력(출력 앰프(14, 16)의 정입력단)에 접속되어 있다.In the present embodiment, a
다음에, 인발 회로(40)의 구성을 설명한다. 전원 전압 Vdd가 세트되는 전원 라인 Vdd와 그라운드 사이에는, 저항(R11)과 저항(R12)의 직렬 접속이 배치되어 있다. 따라서, 이 저항(R11, R12)의 접속점에 전원 전압 Vdd를 저항(R11, R12)의 저항비로 분압한 전압이 얻어진다.Next, the configuration of the
전원 라인 Vdd에는, 정전류원(42)을 통해, 2개의 PNP 트랜지스터(Q3, Q5)의 에미터가 접속되어 있다. 트랜지스터(Q5)는, 컬렉터가 그라운드에 접속되고, 베이스가 저항(R11, R12)의 접속점에 접속되어 있다. 또한, 트랜지스터(Q3)의 컬렉터는, NPN 트랜지스터(Q4)의 컬렉터에 접속되고, 트랜지스터(Q4)의 에미터는, 그라운드에 접속되어 있다.Emitters of the two PNP transistors Q3 and Q5 are connected to the power supply line Vdd via the constant
또한, 트랜지스터(Q4)는, 컬렉터ㆍ베이스간이 단락(다이오드 접속)되어 있 고, 그 베이스에는 NPN 트랜지스터(Q1, Q2)의 베이스가 접속되어 있다. 이들 트랜지스터(Q1, Q2)의 에미터는 그라운드에 접속되어 있고, 따라서 트랜지스터(Q1, Q2)는 트랜지스터(Q4)와 커런트 미러를 구성한다.The transistor Q4 is short-circuited (diode connected) between the collector and the base, and the bases of the NPN transistors Q1 and Q2 are connected to the base. The emitters of these transistors Q1 and Q2 are connected to ground, so the transistors Q1 and Q2 form a current mirror with the transistor Q4.
그리고, 트랜지스터(Q1, Q2)의 컬렉터는, 출력 앰프(14, 16)의 정입력단(입력 앰프(10)의 2개의 출력)에 각각 접속되어 있다.The collectors of the transistors Q1 and Q2 are connected to positive input terminals (two outputs of the input amplifier 10) of the
또한, 이와 같은 회로는, 1개의 반도체 집적 회로 내에 형성되지만, 상술한 트랜지스터(Q3)의 베이스에의 지연 입력을 작성하는 회로는, 외장의 컨덴서를 갖는다. 즉, 도 2에 도시한 바와 같이, 전원 라인 Vdd는, 저항(R), 핀(P)을 통해, 외장의 컨덴서(C)의 일단에 접속되어 있다. 이 외장 컨덴서(C)의 타단은, 어스에 접속되어 있다. 따라서, 이 핀(P)의 전압은, 전원 전압 Vdd의 상승 시에서는, 저항(R)의 저항 값과 컨덴서(C)의 용량 값에 따라서 결정된 시상수로 상승하게 된다.In addition, although such a circuit is formed in one semiconductor integrated circuit, the circuit which creates the delay input to the base of the transistor Q3 mentioned above has an external capacitor. That is, as shown in FIG. 2, the power supply line Vdd is connected to one end of the external capacitor C through the resistor R and the pin P. As shown in FIG. The other end of this external capacitor C is connected to earth. Therefore, the voltage of this pin P rises at the time constant determined according to the resistance value of the resistor R and the capacitance value of the capacitor C when the power supply voltage Vdd rises.
그리고,이 핀(P)이 트랜지스터(Q3)의 베이스에 접속되어 있다. 또한,이 핀(P)에는, 다른 회로도 접속되어 있는 것이 바람직하다. 예를 들면, 전원 전압이 충분히 상승한 후에, 동작할 회로나, 출력될 신호에 대해서는, 이 핀(P)의 전압을 소정의 임계 값 전압과 비교하여, 얻어지는 상승 완료 신호에 따라서 허가를 제어하면 된다.This pin P is connected to the base of the transistor Q3. Moreover, it is preferable that the other circuit is also connected to this pin P. For example, after the power supply voltage sufficiently rises, for the circuit to be operated or the signal to be output, the permission of the pin P may be compared with a predetermined threshold voltage, and the permission may be controlled according to the rising completion signal obtained. .
이와 같은 회로에서, 전원이 온되면, 회로에 전압이 공급되도록 되어, 전원 전압 Vdd가 상승한다. 이에 의해, 입력 기준 앰프(12), 입력 앰프(10), 출력 앰프(14, 16), 출력 기준 앰프(20) 등에 전원 전압 Vdd가 공급되고, 이들 회로가 동작을 개시한다. 특히, 출력 기준 앰프(20)가 동작을 개시한 경우, 이 출력은 전원 전압 Vdd의 상승에 수반하여, 어느 정도 상승하게 된다.In such a circuit, when the power supply is turned on, a voltage is supplied to the circuit, so that the power supply voltage Vdd rises. Thereby, the power supply voltage Vdd is supplied to the
한편, 인발 회로(40)에서, 트랜지스터(Q3)의 베이스는, 소정의 시상수로 상승한다. 이 때문에, 트랜지스터(Q5)는, 전원 전압 Vdd의 상승에 따라서, 그대로 전류를 흘리지만, 트랜지스터(Q3)는 소정의 시상수로 상승하는 전압에 따라서 전류를 흘린다. 이 때문에, 트랜지스터(Q5, Q3)는 PNP 트랜지스터이며, 그 베이스 전압이 낮은 쪽의 트랜지스터(Q3)가, 그 베이스 전압이 Vdd에까지 상승할 때까지, 전류를 많이 흘린다. 즉, 전원 전압 Vdd가 상승한 경우에, 트랜지스터(Q3)의 베이스 전압이 소정의 시상수로 상승이 지연되고, 이 지연 전원 전압 d-Vdd와, 전원 전압 Vdd의 차분에 따른 전류가 트랜지스터(Q3)에 흐르고, 이것이 트랜지스터(Q4)를 통해, 트랜지스터(Q1, Q2)에 흐른다. 즉, 지연 전원 전압 d-Vdd가 전원 전압 Vdd에 달할 때까지, 양자의 차분에 따른 전류가 트랜지스터(Q3)에 흐른다.On the other hand, in the
따라서, 전원 상승 시에서, 출력 앰프(14, 16)의 입력측으로부터, 전원 전압 Vdd의 상승 시에서, 상기 차분에 기초하는 전류분이 차감된다. 따라서, 출력 앰프(14, 16)의 출력에서 생긴, 전원 상승 시에서의 급준한 상승을 방지할 수 있고, 이것이 스피커에 공급됨으로써 발생하는 팝음의 발생을 방지할 수 있다.Therefore, at the time of power supply rise, the electric current based on the said difference is subtracted from the input side of the
또한, 도 1에 도시한 바와 같이, 출력 기준 앰프(20)에서의 출력은, 전원 상승 시에 서서히 상승하도록 설정하고 있다. 즉, 입력 신호를 서서히 상승하도록 하여, 출력에 대해서도 서서히 상승하도록 하고 있다. 그러나, 앰프에서, 그 전원이 상승한 경우에는, 앰프의 동작 개시에 수반하여, 그 출력이 일정 전압에까지 상승한다. 이 출력 기준 앰프(20)의 상승에 수반하는 그 출력의 상승을 방지하는 것 이 본 실시 형태의 목적이며, 상술한 바와 같은 인발 회로(40)에 의해, 전원 온에 수반하는 전원 전압 Vdd의 상승 시에서, 출력 기준 앰프(20)의 동작 개시에 수반하는, 그 출력의 상승을 억제하여, 출력 앰프(14, 16)의 출력에서의 출력의 급준한 상승을 방지할 수 있다.In addition, as shown in FIG. 1, the output from the
도 1은, 실시 형태에 따른 앰프 회로의 구성을 도시하는 도면.1 is a diagram illustrating a configuration of an amplifier circuit according to the embodiment.
도 2는, 전원 전압 Vdd의 상승 시의 지연을 위한 회로를 도시하는 도면.Fig. 2 is a diagram showing a circuit for delay in rising power supply voltage Vdd.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
10 : 입력 앰프10: input amplifier
12 : 입력 기준 앰프12: input reference amplifier
14 : 출력 앰프14: output amplifier
16 : 출력 앰프16: output amplifier
20 : 출력 기준 앰프20: output reference amplifier
40 : 인발 회로40: drawing circuit
42 : 정전류원42: constant current source
R : 저항R: resistance
P : 핀P: pin
Q : 트랜지스터Q: transistor
C : 컨덴서C: Condenser
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Citations (4)
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- 2007-08-27 KR KR1020070086003A patent/KR101017818B1/en not_active IP Right Cessation
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