KR101001832B1 - Light Receiving Element Array Including Current-blocking layer and Method for Fabrication The Same - Google Patents

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Abstract

수광소자 어레이 및 그의 제조방법을 제공한다. 수광소자 어레이는 베이스 기판, 베이스 기판 상에 배치된 전류차단층 및 전류차단층 상에 서로 이격하여 위치하는 다수 개의 단위 셀들을 포함하되, 각 단위 셀은 차례로 배치된 제1형 반도체층, 광전변환층 및 제2형 반도체층을 구비하는 단위 수광소자를 포함한다. 또한, 수광소자 어레이 제조방법은 베이스 기판 상에 전류차단층을 형성하는 단계, 전류차단층 상에 차례로 제1형 반도체층, 광전변환층 및 제2형 반도체층을 형성하는 단계 및 제2형 반도체층, 광전변환층 및 제1형 반도체층을 차례로 패터닝하여 전류차단층 상에 위치하고 서로 분리된 단위 셀들을 형성하는 단계를 포함하되, 각 단위 셀은 단위 수광소자를 구비한다. A light receiving element array and a method of manufacturing the same are provided. The light-receiving element array includes a base substrate, a current blocking layer disposed on the base substrate, and a plurality of unit cells spaced apart from each other on the current blocking layer, each unit cell being a first type semiconductor layer disposed in turn, a photoelectric conversion And a unit light receiving element having a layer and a second type semiconductor layer. In addition, a method of manufacturing a light-receiving device array includes forming a current blocking layer on a base substrate, sequentially forming a first type semiconductor layer, a photoelectric conversion layer, and a second type semiconductor layer on the current blocking layer, and a second type semiconductor. Patterning the layer, the photoelectric conversion layer, and the first type semiconductor layer in order to form unit cells positioned on the current blocking layer and separated from each other, wherein each unit cell includes a unit light receiving element.

수광소자, 반절연 기판, 전류차단층 Light-Receiving Devices, Semi-Insulated Substrates, Current Blocking Layers

Description

전류차단층을 구비하는 수광소자 어레이 및 그의 제조방법{Light Receiving Element Array Including Current-blocking layer and Method for Fabrication The Same}Light-receiving element array having a current blocking layer and a method of manufacturing the same {Light Receiving Element Array Including Current-blocking layer and Method for Fabrication The Same

본 발명은 수광소자에 관한 것으로, 더욱 상세하게는 전류차단층을 구비하는 수광소자 어레이 및 그의 제조방법에 관한 것이다. The present invention relates to a light receiving element, and more particularly, to a light receiving element array having a current blocking layer and a manufacturing method thereof.

수광소자는 빛 에너지를 전기 에너지로 변환시키는 소자로서 작동 파장의 고민감도, 빠른 응답속도, 최소 잡음이라는 장점을 지니고 있어 광통신에서 광신호를 검출하는 소자로 널리 이용된다. A light receiving device is a device that converts light energy into electrical energy, and has the advantages of operating wavelength sensitivity, fast response speed, and minimum noise, and thus is widely used as an optical signal detecting device in optical communication.

이러한 광통신에서 10Gbps 이상의 전송속도를 얻기 위해 병렬광접속(parallel optical interconnection)이 이용되는데, 여기서 다채널 수광소자는 거의 필수적으로 사용된다. 그러나, 상기 다채널 수광소자는 다수 개의 단위 수광소자가 집적된 것으로 상기 단위 수광소자들 사이의 전기적인 분리가 용이하지 않아 크로스 토크가 발생되는 문제점이 있다. In such optical communication, parallel optical interconnection is used to obtain a transmission speed of 10 Gbps or more, where a multi-channel light receiving element is almost used. However, the multi-channel light receiving device has a problem in that crosstalk is generated because a plurality of unit light receiving devices are integrated and electrical separation between the unit light receiving devices is not easy.

상술한 문제점을 해결하기 위한 본 발명의 목적은 크로스 토크의 발생을 방지할 수 있는 전류차단층을 구비하는 수광소자 어레이 및 그의 제조방법을 제공하는데 있다. An object of the present invention for solving the above problems is to provide a light-receiving element array having a current blocking layer that can prevent the occurrence of crosstalk and a manufacturing method thereof.

상술한 제1 목적을 달성하기 위한 본 과제는 베이스 기판, 상기 베이스 기판 상에 배치된 전류차단층 및 상기 전류차단층 상에 서로 이격하여 위치하는 다수 개의 단위 셀들을 포함하되, 상기 각 단위 셀은 차례로 배치된 제1형 반도체층, 광전변환층 및 제2형 반도체층을 구비하는 단위 수광소자를 포함하는 수광소자 어레이를 제공한다. The present invention for achieving the above-described first object includes a base substrate, a current blocking layer disposed on the base substrate and a plurality of unit cells spaced apart from each other on the current blocking layer, wherein each unit cell A light receiving element array including a unit light receiving element including a first type semiconductor layer, a photoelectric conversion layer, and a second type semiconductor layer, which are sequentially disposed.

상기 전류차단층은 반절연층일 수 있으며, 상기 반절연층은 GaAs층 또는 InP층일 수 있다. The current blocking layer may be a semi-insulating layer, and the semi-insulating layer may be a GaAs layer or an InP layer.

상기 단위 셀은 상기 단위 수광소자를 둘러싸는 측벽 구조체를 더 포함할 수 있다. 상기 수광소자 어레이는 상기 단위 수광소자들의 적어도 측벽들 상에 배치된 보호층을 더 포함할 수 있으며, 상기 단위 수광소자들의 적어도 측벽들, 상기 측벽 구조체의 측벽들 및 상기 측벽 구조체의 상부면 상에 배치된 보호층을 더 포함할 수도 있다. The unit cell may further include a sidewall structure surrounding the unit light receiving element. The light receiving element array may further include a protective layer disposed on at least sidewalls of the unit light receiving elements, and on at least sidewalls of the unit light receiving elements, sidewalls of the sidewall structure, and an upper surface of the sidewall structure. It may further include a protective layer disposed.

상술한 제2 목적을 달성하기 위한 본 과제는 베이스 기판 상에 전류차단층을 형성하는 단계, 상기 전류차단층 상에 차례로 제1형 반도체층, 광전변환층 및 제2 형 반도체층을 형성하는 단계 및 상기 제2형 반도체층, 광전변환층 및 제1형 반도체층을 차례로 패터닝하여 상기 전류차단층 상에 위치하고 서로 분리된 단위 셀들을 형성하는 단계를 포함하되, 상기 각 단위 셀은 단위 수광소자를 구비하는 수광소자 어레이 제조방법을 제공한다. The present invention for achieving the above-described second object is to form a current blocking layer on the base substrate, the step of forming a first type semiconductor layer, a photoelectric conversion layer and a second type semiconductor layer on the current blocking layer in order And patterning the second type semiconductor layer, the photoelectric conversion layer, and the first type semiconductor layer in order to form unit cells positioned on the current blocking layer and separated from each other, wherein each unit cell comprises a unit light receiving element. It provides a light receiving element array manufacturing method provided.

상기 분리된 단위 셀들을 형성하는 단계는 상기 제2형 반도체층, 광전변환층 및 제1형 반도체층을 차례로 제1 패터닝하여 단위 수광소자들 및 단위 수광소자들을 둘러싸는 측벽 구조체들을 형성하는 단계 및 상기 측벽 구조체들을 제2 패터닝하여 단위 셀들 별로 분리하는 단계를 포함할 수 있다. The forming of the separated unit cells may include forming a sidewall structure surrounding unit light receiving elements and unit light receiving elements by first patterning the second type semiconductor layer, the photoelectric conversion layer, and the first type semiconductor layer in sequence; The second patterning of the sidewall structures may include separating the unit cells by unit cells.

상기 수광소자 어레이 제조방법은 상기 분리된 단위 셀들을 형성한 후에, 상기 단위 수광소자들의 적어도 측벽들, 상기 측벽 구조체의 측벽들 및 상기 측벽 구조체의 상부면 상에 보호층을 형성하는 단계를 더 포함할 수 있다. The method of manufacturing a light receiving element array further includes forming a protective layer on at least sidewalls of the unit light receiving elements, sidewalls of the sidewall structure, and an upper surface of the sidewall structure after forming the separated unit cells. can do.

상술한 바와 같이 전류차단층을 구비하는 수광소자 어레이를 제조하였다. 그 결과, 상기 단위 셀들 즉, 상기 단위 수광소자는 상기 전류차단층 상에 서로 분리되어 위치하므로, 전기적으로 완전히 분리될 수 있다. 따라서, 상기 단위 셀들 즉, 상기 단위 수광소자들 사이에 크로스 토크의 발생을 방지할 수 있다. As described above, a light receiving element array having a current blocking layer was manufactured. As a result, since the unit cells, that is, the unit light receiving element are separated from each other on the current blocking layer, it can be completely electrically separated. Therefore, it is possible to prevent the occurrence of crosstalk between the unit cells, that is, the unit photoreceptors.

또한, 반절연 기판이 아닌 일반 베이스 기판 상에 전류차단층을 형성한 후 상기 전류차단층 상에 단위 수광소자들을 형성함으로써, 단위 수광소자들 사이의 전기적 분리와 함께 공정비용을 감소시킬 수 있다.In addition, by forming the current blocking layer on the general base substrate, not the semi-insulating substrate, and then forming the unit light receiving elements on the current blocking layer, it is possible to reduce the process cost together with the electrical separation between the unit light receiving elements.

첨부한 도면들을 참조하여, 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다. 그러나, 이는 본 발명을 특정한 실시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다. 이하, 도면상의 동일한 구성요소에 대해서는 동일한 참조부호를 사용하고 동일한 구성요소에 대해서 중복된 설명은 생략한다. With reference to the accompanying drawings, it will be described in detail a preferred embodiment of the present invention. However, this is not intended to limit the present invention to specific embodiments, it should be understood to include all modifications, equivalents, and substitutes included in the spirit and scope of the present invention. Hereinafter, the same reference numerals are used for the same components in the drawings, and duplicate descriptions of the same components are omitted.

도 1a 내지 도 1f는 본 발명의 일 실시예에 따른 수광소자 어레이 제조방법을 나타내는 개략도이다. 도 2는 본 발명의 일 실시예에 따른 다채널 수광소자 어레이의 구조를 나타내는 사시도로서, 도 1f는 도 2의 절단선 I-I'에 대응한다. 1A to 1F are schematic views illustrating a method of manufacturing a light receiving element array according to an exemplary embodiment of the present invention. FIG. 2 is a perspective view illustrating a structure of a multi-channel light receiving element array according to an embodiment of the present invention, and FIG. 1F corresponds to the cutting line I-I 'of FIG. 2.

도 1a를 참조하면, 베이스기판(11) 상에 전류차단층(13)을 형성할 수 있다. 상기 베이스기판(11)은 화합물 반도체 기판일 수 있다. 일 예로서, 상기 베이스 기판(11)은 Ⅲ-Ⅴ족 반도체 기판일 수 있다. 상기 Ⅲ-Ⅴ족 반도체 기판은 GaAs 기판 또는 InP기판일 수 있다.Referring to FIG. 1A, a current blocking layer 13 may be formed on the base substrate 11. The base substrate 11 may be a compound semiconductor substrate. As an example, the base substrate 11 may be a III-V group semiconductor substrate. The III-V semiconductor substrate may be a GaAs substrate or an InP substrate.

상기 전류차단층(13)은 반절연층일 수 있다. 상기 반절연층은 화합물 반도체에 특수한 처리를 가하여 비저항을 높인 물질층으로서, 일 예로서 불순물이 도핑된 화합물 반도체층일 수 있다. 구체적으로, 저항이 1x107Ω·cm 이상의 값을 갖는 C가 도핑된 GaAs층 또는 Fe가 도핑된 InP층일 수 있다.The current blocking layer 13 may be a semi-insulating layer. The semi-insulating layer is a material layer having a high specific resistance by applying a special treatment to the compound semiconductor, and may be, for example, a compound semiconductor layer doped with impurities. Specifically, the resistance may be a C-doped GaAs layer having a value of 1 × 10 7 Ω · cm or more, or an InP layer doped with Fe.

상기 전류차단층(13)을 형성하기 전에 상기 베이스 기판(11) 상에 완충층(12)을 형성할 수 있다. 상기 완충층(12)은 GaAs층 또는 InP층일 수 있다. 상기 완충층(12)은 상기 전류차단층(13) 내의 결함을 최소화시키기 위해 형성할 수 있다. 그러나, 상기 완충층(12)은 생략될 수도 있다.Before forming the current blocking layer 13, the buffer layer 12 may be formed on the base substrate 11. The buffer layer 12 may be a GaAs layer or an InP layer. The buffer layer 12 may be formed to minimize defects in the current blocking layer 13. However, the buffer layer 12 may be omitted.

상기 완충층(12) 및 상기 전류차단층(13)은 결정 성장법을 이용하여 형성할 수 있으며, 상기 결정 성장법은 MOCVD법(Metal Organic Chemical Vapor Deposition), MBE법(molecular beam deposition), HVPE법(hydride or halide vapor phase epitaxy) 또는 SVPE법(sublimation vapor phase epitaxy)일 수 있다.The buffer layer 12 and the current blocking layer 13 may be formed using a crystal growth method, and the crystal growth method may be a metal organic chemical vapor deposition (MOCVD) method, a molecular beam deposition (MBE) method, or an HVPE method. (hydride or halide vapor phase epitaxy) or SVPE (sublimation vapor phase epitaxy).

도 1b를 참조하면, 상기 전류차단층(13) 상에 제1형 반도체층(21)을 형성할 수 있다. Referring to FIG. 1B, a first type semiconductor layer 21 may be formed on the current blocking layer 13.

상기 제1형 반도체층(21)은 n형 불순물이 고농도로 첨가된 반도체층일 수 있으며, 구체적으로 GaAs층 또는 InP층일 수 있다. 상기 n형 불순물은 Si 일 수 있다. The first type semiconductor layer 21 may be a semiconductor layer to which n-type impurities are added at a high concentration, and specifically, may be a GaAs layer or an InP layer. The n-type impurity may be Si.

상기 제1형 반도체층(21) 상에 광전변환층(22)을 형성할 수 있다. 상기 광전변환층(22)은 외부로부터 입사되는 광을 흡수하여 전자-홀 쌍을 형성시키는 층으로서, 진성(intrinsic) 반도체층 또는 n형 불순물이 상기 제1 형 반도체층(21)에 비해 저농도로 첨가된 반도체층일 수 있으며, 구체적으로 GaAs층 또는 InP층일 수 있다. The photoelectric conversion layer 22 may be formed on the first type semiconductor layer 21. The photoelectric conversion layer 22 is a layer for absorbing light incident from the outside to form an electron-hole pair, wherein an intrinsic semiconductor layer or n-type impurity has a lower concentration than the first type semiconductor layer 21. The semiconductor layer may be added, and specifically, may be a GaAs layer or an InP layer.

상기 광전변환층(22) 상에 제2형 반도체층(23)을 형성할 수 있다. 상기 제2형 반도체층(23)은 p형 불순물이 첨가된 반도체층일 수 있으며, 구체적으로 GaAs층 또는 InP층일 수 있다. 상기 p형 불순물은 Zn 또는 Mg 일 수 있다. The second type semiconductor layer 23 may be formed on the photoelectric conversion layer 22. The second type semiconductor layer 23 may be a semiconductor layer to which p-type impurities are added, and specifically, may be a GaAs layer or an InP layer. The p-type impurity may be Zn or Mg.

상기 제2형 반도체층(23) 상에 오믹콘택층(24)을 형성할 수 있다. 상기 오믹 콘택층(24)은 후술하는 전극과의 오믹 콘택을 위해 형성되는 층이나, 경우에 따라서는 예를 들어, 상기 제2형 반도체층(23)의 상부 부분의 불순물 농도가 충분히 높은 경우에는 생략될 수도 있다. 상기 오믹콘택층(24)은 상기 제2형 반도체층(23)에 비해 p형 불순물이 고농도로 도핑된 층일 수 있다. 예컨대, 상기 제2형 반도체층(23)의 불순물 농도가 1018-3인 경우, 상기 오믹콘택층(24)의 불순물 농도는 1018 내지 1020-3일 수 있다. An ohmic contact layer 24 may be formed on the second type semiconductor layer 23. The ohmic contact layer 24 is a layer formed for ohmic contact with an electrode to be described later, but in some cases, for example, when the impurity concentration of the upper portion of the second type semiconductor layer 23 is sufficiently high, May be omitted. The ohmic contact layer 24 may be a layer doped with a higher p-type impurity than the second type semiconductor layer 23. For example, when the impurity concentration of the second type semiconductor layer 23 is 10 18 cm −3 , the impurity concentration of the ohmic contact layer 24 may be 10 18 to 10 20 cm −3 .

상기 제1형 반도체층(21), 광전변환층(22), 제2형 반도체층(23) 및 오믹콘택층(24)은 결정 성장법을 이용하여 형성할 수 있으며, 상기 결정 성장법은 MOCVD법, MBE법, HVPE법 또는 SVPE법일 수 있다.The first type semiconductor layer 21, the photoelectric conversion layer 22, the second type semiconductor layer 23, and the ohmic contact layer 24 may be formed using a crystal growth method, and the crystal growth method is MOCVD. Method, MBE method, HVPE method or SVPE method.

도 1c 및 도 2를 참조하면, 상기 오믹콘택층(24), 제2형 반도체층(23) 및 광전변환층(22)을 제1 패터닝하여 제1형 반도체층(21)의 일부를 노출시킬 수 있다. 이때, 상기 제1형 반도체층(21)의 상부 일부 또한 식각될 수 있다. 이에 따라, 상기 전류차단층(13) 상에 다수 개의 단위 수광소자들(32)이 형성될 수 있다. 상기 각 단위 수광소자(32)는 제1형 반도체층(21), 광전변환층(22), 제2형 반도체층(23) 및 오믹콘택층(24)을 구비할 수 있다. 1C and 2, the ohmic contact layer 24, the second type semiconductor layer 23, and the photoelectric conversion layer 22 are first patterned to expose a portion of the first type semiconductor layer 21. Can be. In this case, a portion of the upper portion of the first type semiconductor layer 21 may also be etched. Accordingly, a plurality of unit light receiving elements 32 may be formed on the current blocking layer 13. Each unit light receiving element 32 may include a first type semiconductor layer 21, a photoelectric conversion layer 22, a second type semiconductor layer 23, and an ohmic contact layer 24.

상기 각 단위 수광소자(32)는 측벽 구조체(34)에 의해 둘러 싸여질 수 있다. 상기 측벽 구조체(34) 또한 제1형 반도체층(21), 광전변환층(22), 제2형 반도체층(23) 및 오믹콘택층(24)을 구비할 수 있다. Each unit light receiving element 32 may be surrounded by the sidewall structure 34. The sidewall structure 34 may also include a first type semiconductor layer 21, a photoelectric conversion layer 22, a second type semiconductor layer 23, and an ohmic contact layer 24.

도 1d를 참조하면, 상기 측벽 구조체(34)를 제2 패터닝하여 단위 셀들(30)을 분리시킬 수 있다. 구체적으로, 상기 측벽 구조체(34)의 오믹콘택층(24), 제2형 반도체층(23) 광전변환층(22) 및 제1형 반도체층(21)을 식각하여 전류차단층(13) 일부를 노출시킬 수 있다. 이때, 상기 전류차단층(13)의 상부 일부 또한 식각될 수 있다. Referring to FIG. 1D, the sidewall structures 34 may be second patterned to separate the unit cells 30. Specifically, the ohmic contact layer 24, the second type semiconductor layer 23, the photoelectric conversion layer 22, and the first type semiconductor layer 21 of the sidewall structure 34 are etched to partially expose the current blocking layer 13. Can be exposed. In this case, a portion of the upper portion of the current blocking layer 13 may also be etched.

만약, 상기 단위 수광소자(32) 및 상기 측벽 구조체(34)에 완충층(12)이 구비되는 경우, 상기 측벽 구조체(34)의 오믹콘택층(24), 제2형 반도체층(23) 광전변환층(22), 제1형 반도체층(21) 및 전류차단층(13)을 제2 패터닝하여 완충층(12) 일부를 노출시킬 수 있다. 이때, 상기 완충층(12)의 상부 일부 또한 식각될 수 있다.When the buffer layer 12 is provided in the unit light receiving device 32 and the sidewall structure 34, the ohmic contact layer 24 and the second type semiconductor layer 23 of the sidewall structure 34 are photoelectric converted. A portion of the buffer layer 12 may be exposed by second patterning the layer 22, the first type semiconductor layer 21, and the current blocking layer 13. In this case, a portion of the upper portion of the buffer layer 12 may also be etched.

상기 단위 셀들(30)은 단위 수광소자(32)와 상기 단위 수광소자(32)를 둘러싸는 측벽 구조체들(34)을 구비할 수 있다. 그러나, 이에 한정되지 않고 상기 측벽 구조체들(34)은 생략될 수도 있다. 상기 단위 셀들(30) 즉 상기 단위 수광소자(32)는 상기 전류차단층(13) 상에 서로 분리되어 위치하므로, 전기적으로 완전히 분리될 수 있다. 따라서, 상기 단위 셀들(30) 즉, 상기 단위 수광소자들(32) 사이에 크로스 토크가 발생되기 어렵다.The unit cells 30 may include a unit light receiving element 32 and sidewall structures 34 surrounding the unit light receiving element 32. However, the present invention is not limited thereto, and the sidewall structures 34 may be omitted. Since the unit cells 30, that is, the unit light receiving elements 32 are separated from each other on the current blocking layer 13, they may be electrically separated completely. Therefore, cross talk between the unit cells 30, that is, the unit photoreceptors 32, is unlikely to occur.

반면, 종래에는 기판 자체를 반절연 물질로 이루어진 반절연 기판으로 사용하여 단위 수광소자를 전기적으로 분리시켰으나, 상기 반절연 기판은 고가인 단점이 있다. 그러나, 본 발명의 일 실시예에 따른 수광소자 어레이는 반절연 기판이 아닌 일반 베이스 기판 상에 전류차단층을 형성한 후 상기 전류차단층 상에 단위 수광소자들을 형성함으로써, 단위 수광소자들 사이의 전기적 분리와 함께 공정비용을 감소시킬 수 있다.On the other hand, in the related art, the unit light receiving element is electrically separated by using the substrate itself as a semi-insulating substrate made of a semi-insulating material, but the semi-insulating substrate has a disadvantage of being expensive. However, the light-receiving element array according to the embodiment of the present invention forms a current blocking layer on the general base substrate, not the semi-insulating substrate, and then forms the unit light receiving elements on the current blocking layer. Process costs can be reduced with electrical separation.

도 1e를 참조하면, 상기 단위 수광소자들(30)의 적어도 측벽들 상에 보호층(25)을 형성할 수 있다. 이때, 상기 보호층(25)은 오믹콘택층(24), 제1형 반도체층(21) 및 전류차단층(13)의 노출된 영역에 형성될 수 있으며, 상기 단위 수광소자들(30)에 완충층(12)이 구비되는 경우, 상기 보호층(25)은 상기 오믹콘택층(24, 제1형 반도체층(21) 및 전류차단층(13)의 노출된 영역 외에 완충층(12)의 노출된 영역에도 형성될 수 있다. Referring to FIG. 1E, a protective layer 25 may be formed on at least sidewalls of the unit light receiving elements 30. In this case, the protective layer 25 may be formed in the exposed regions of the ohmic contact layer 24, the first type semiconductor layer 21, and the current blocking layer 13, and may be formed on the unit light receiving elements 30. When the buffer layer 12 is provided, the protective layer 25 is exposed to the buffer layer 12 in addition to the exposed regions of the ohmic contact layer 24, the first type semiconductor layer 21, and the current blocking layer 13. It can also be formed in the area.

상기 보호층(25)은 단위 수광소자들(30)을 보호할 수 있으며, 외부로부터 입사되는 광이 반사되지 않도록 반사방지막 역할을 할 수도 있다. The protective layer 25 may protect the unit light receiving elements 30 and may serve as an anti-reflection film so that light incident from the outside is not reflected.

또한, 상기 보호층(25)은 측벽 구조체(34)의 측벽들과 상기 측벽 구조체(34)의 상부면 상에 형성될 수도 있다. 이에 따라 후술하는 전극패드들과 측벽 구조체들(34)을 절연시킬 수 있다. 상기 보호층(25)은 SiN층 또는 SiO2층일 수 있다. In addition, the protective layer 25 may be formed on the sidewalls of the sidewall structure 34 and the top surface of the sidewall structure 34. Accordingly, the electrode pads and the sidewall structures 34 to be described later may be insulated. The protective layer 25 may be a SiN layer or a SiO 2 layer.

도 1f 및 도 2를 참조하면, 제1형 반도체층(21) 및 오믹콘택층(24)과 전기적으로 접속하는 각각의 제1 전극(26) 및 제2 전극(27)을 형성할 수 있다. 이때, 상기 제1형 반도체층(21) 및 오믹콘택층(24)은 보호층(25)의 일부를 제1 식각하여 상기 제1형 반도체층(21) 및 오믹콘택층(24)를 노출시킴으로써 상기 전극들(26, 27)과 접속시킬 수 있다. 상기 제1 식각은 건식식각 또는 습식식각 일 수 있다. 1F and 2, each of the first electrode 26 and the second electrode 27 electrically connected to the first type semiconductor layer 21 and the ohmic contact layer 24 may be formed. In this case, the first type semiconductor layer 21 and the ohmic contact layer 24 may first etch a part of the protective layer 25 to expose the first type semiconductor layer 21 and the ohmic contact layer 24. The electrodes 26 and 27 may be connected to each other. The first etching may be dry etching or wet etching.

상기 전극들(26, 27)은 Au를 함유할 수 있다. 구체적으로 상기 전극(26, 27)은 Ni/AuGe/Ti/Au 일 수 있고, 전극(27)은 Ti/Pt/Au 일 수 있다. 상기 오믹콘택층(24)이 생략되는 경우, 상기 제2 전극(27)은 제2형 반도체층(23)과 전기적으로 접속될 수 있다. 상기 전극들(26, 27)은 리소그라피를 이용하여 고리형상으로 형성할 수 있다.  The electrodes 26 and 27 may contain Au. Specifically, the electrodes 26 and 27 may be Ni / AuGe / Ti / Au, and the electrodes 27 may be Ti / Pt / Au. When the ohmic contact layer 24 is omitted, the second electrode 27 may be electrically connected to the second type semiconductor layer 23. The electrodes 26 and 27 may be formed in a ring shape using lithography.

또한, 외부 회로와의 연결을 용이하게 하기 위해, 상기 측벽 구조체(34)의 상부면 상에 제1 전극패드(28) 및 제2 전극패드(29)를 형성할 수 있다. 상기 제1 전극패드(28) 및 제2 전극패드(29)는 상기 제1 전극(26) 및 제2 전극(27)과 서로 접속되어 있을 수 있다. 상기 제1 전극패드(28) 및 제2 전극패드(29)는 Ti/Au일 수 있다. In addition, in order to facilitate connection with an external circuit, a first electrode pad 28 and a second electrode pad 29 may be formed on the upper surface of the sidewall structure 34. The first electrode pad 28 and the second electrode pad 29 may be connected to the first electrode 26 and the second electrode 27. The first electrode pad 28 and the second electrode pad 29 may be Ti / Au.

상술한 바와 같이 제조된 전류차단층을 구비하는 수광소자 어레이는 상기 단위 셀들 즉, 상기 단위 수광소자는 상기 전류차단층 상에 서로 분리되어 위치하므로, 전기적으로 완전히 분리될 수 있다. 따라서, 상기 단위 셀들 즉, 상기 단위 수광소자들 사이에 크로스 토크가 발생되기 어렵다.In the light receiving element array including the current blocking layer manufactured as described above, the unit cells, that is, the unit light receiving elements may be separated from each other on the current blocking layer, and thus may be electrically separated completely. Therefore, cross talk between the unit cells, that is, the unit photoreceptors is difficult to occur.

상기에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. It will be apparent to those skilled in the art that various modifications and variations can be made in the present invention without departing from the spirit or scope of the present invention as defined by the following claims It can be understood that

도 1a 내지 도 1f는 본 발명의 일 실시예에 따른 수광소자 어레이 제조방법을 나타내는 개략도이다. 1A to 1F are schematic views illustrating a method of manufacturing a light receiving element array according to an exemplary embodiment of the present invention.

도 2는 본 발명의 일 실시예에 따른 다채널 수광소자 어레이의 구조를 나타내는 사시도이다. 2 is a perspective view showing the structure of a multi-channel light receiving element array according to an embodiment of the present invention.

<도면의 주요부분에 대한 부호의 설명> <Description of the symbols for the main parts of the drawings>

11: 베이스 기판 12: 완충층11: base substrate 12: buffer layer

13: 전류차단층 21: 제1형 반도체층13: current blocking layer 21: first type semiconductor layer

22: 광전변환층 23: 제2형 반도체층 22: photoelectric conversion layer 23: second type semiconductor layer

24: 오믹콘택층 25: 보호층24: ohmic contact layer 25: protective layer

26, 27: 전극 28, 29: 전극패드26, 27: electrode 28, 29: electrode pad

32: 단위 수광소자 34: 측벽 구조체32: unit light receiving element 34: side wall structure

Claims (9)

베이스 기판;A base substrate; 상기 베이스 기판 상에 배치된 전류차단층; 및A current blocking layer disposed on the base substrate; And 상기 전류차단층 상에 서로 이격하여 위치하는 다수 개의 단위 셀들을 포함하며,Comprising a plurality of unit cells are spaced apart from each other on the current blocking layer, 상기 각 단위 셀은 상기 전류차단층 상에 차례로 배치된 제1형 반도체층, 광전변환층 및 제2형 반도체층을 구비하고,Each unit cell includes a first type semiconductor layer, a photoelectric conversion layer, and a second type semiconductor layer sequentially disposed on the current blocking layer. 상기 단위 셀들 사이의 상기 전류차단층이 노출되는 단위 수광소자를 포함하는 수광소자 어레이.And a unit light receiving element to which the current blocking layer between the unit cells is exposed. 제 1 항에 있어서, The method of claim 1, 상기 전류차단층은 반절연층인 수광소자 어레이.And the current blocking layer is a semi-insulating layer. 제 2 항에 있어서, The method of claim 2, 상기 반절연층은 GaAs층 또는 InP층인 수광소자 어레이.The semi-insulating layer is a GaAs layer or InP layer. 제 1 항에 있어서, The method of claim 1, 상기 단위 수광소자들의 적어도 측벽들 상에 배치된 보호층을 더 포함하는 수광소자 어레이. And a protective layer disposed on at least sidewalls of the unit light receiving elements. 제 1 항에 있어서,The method of claim 1, 상기 단위 셀은 상기 단위 수광소자를 둘러싸는 측벽 구조체를 포함하는 수 광소자 어레이. The unit cell includes a sidewall structure surrounding the unit light receiving element. 제 5 항에 있어서, The method of claim 5, 상기 단위 수광소자들의 적어도 측벽들, 상기 측벽 구조체의 측벽들 및 상기 측벽 구조체의 상부면 상에 배치된 보호층을 더 포함하는 수광소자 어레이.And a protective layer disposed on at least sidewalls of the unit light receiving elements, sidewalls of the sidewall structure, and an upper surface of the sidewall structure. 베이스 기판 상에 전류차단층을 형성하는 단계;Forming a current blocking layer on the base substrate; 상기 전류차단층 상에 차례로 제1형 반도체층, 광전변환층 및 제2형 반도체층을 형성하는 단계; 및Forming a first type semiconductor layer, a photoelectric conversion layer, and a second type semiconductor layer on the current blocking layer in sequence; And 상기 제2형 반도체층, 광전변환층 및 제1형 반도체층을 차례로 패터닝하여 상기 전류차단층 상에 위치하고 서로 분리된 단위 셀들을 형성하는 단계를 포함하되, 상기 각 단위 셀은 단위 수광소자를 구비하는 수광소자 어레이 제조방법.Patterning the second semiconductor layer, the photoelectric conversion layer, and the first semiconductor layer in order to form unit cells positioned on the current blocking layer and separated from each other, wherein each unit cell includes a unit light receiving element. The light receiving element array manufacturing method. 제 7 항에 있어서, The method of claim 7, wherein 상기 분리된 단위 셀들을 형성하는 단계는 상기 제2형 반도체층, 광전변환층 및 제1형 반도체층을 차례로 제1 패터닝하여 단위 수광소자들 및 단위 수광소자들을 둘러싸는 측벽 구조체들을 형성하는 단계; 및The forming of the separated unit cells may include forming a sidewall structure surrounding unit light receiving elements and unit light receiving elements by first patterning the second type semiconductor layer, the photoelectric conversion layer, and the first type semiconductor layer; And 상기 측벽 구조체들을 제2 패터닝하여 단위 셀들 별로 분리하는 단계를 포함하는 수광소자 어레이 제조방법. And second patterning the sidewall structures and separating the sidewall structures for respective unit cells. 제 8 항에 있어서, The method of claim 8, 상기 분리된 단위 셀들을 형성한 후에,After forming the separated unit cells, 상기 단위 수광소자들의 적어도 측벽들, 상기 측벽 구조체의 측벽들 및 상기 측벽 구조체의 상부면 상에 보호층을 형성하는 단계를 더 포함하는 수광소자 어레이 제조방법.And forming a protective layer on at least sidewalls of the unit light receiving elements, sidewalls of the sidewall structure, and an upper surface of the sidewall structure.
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