KR100998801B1 - Power semiconductor device and manufacturing method thereof - Google Patents
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Abstract
본 발명은 전력용 반도체 장치 및 그 제조 방법에 관한 것으로, 해결하고자 하는 기술적 과제는 반도체 다이와 리드를 연결하는 브릿지 개구에 따라 결합력이 떨어지는 현상과 저항성이 높아지는 문제를 방지하는데 있다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a power semiconductor device and a method of manufacturing the same, and a technical problem to be solved is to prevent a problem of a decrease in bonding force and a problem of increasing resistance along a bridge opening connecting a semiconductor die and a lead.
이를 위해 본 발명은 적어도 하나의 제 1리드와, 제 1리드와 이격되어 형성된 적어도 하나의 제 2리드와, 제 1리드에 전기적으로 접속된 반도체 다이와, 반도체 다이와 제 2리드를 제 1도전성 접착제로 연결하는 브릿지와, 제 1리드, 제 2리드, 반도체 다이, 브릿지 및 제 1도전성 접착제를 봉지하는 봉지재와, 여기서 브릿지는 제 2리드와 대응되는 끝단에 제 1개구가 형성되고, 제 1도전성 접착제는 제 1개구, 제 1개구와 대응되는 상단, 제 1개구와 대응되는 하단 및 제 1개구의 측벽까지 둘러싸여 이루어진 전력용 반도체 장치 및 그 제조 방법을 개시한다. To this end, the present invention provides at least one first lead, at least one second lead spaced apart from the first lead, a semiconductor die electrically connected to the first lead, and the semiconductor die and the second lead as the first conductive adhesive. An encapsulant for encapsulating the bridge to be connected, the first lead, the second lead, the semiconductor die, the bridge, and the first conductive adhesive, wherein the bridge has a first opening formed at an end corresponding to the second lead, and the first conductive The adhesive discloses a power semiconductor device including a first opening, an upper end corresponding to the first opening, a lower end corresponding to the first opening, and a side wall of the first opening, and a manufacturing method thereof.
반도체 패키지, 봉지, 본딩 Semiconductor Package, Encapsulation, Bonding
Description
본 발명은 전력용 반도체 장치 및 그 제조 방법에 관한 것이다.The present invention relates to a power semiconductor device and a manufacturing method thereof.
일상생활에서 사용하는 휴대 전화, 비디오, 카메라 등의 충전기, 사무 자동화(OA)기기 등의 전원회로, 자동차 전장 기기 등에는 트랜지스터(transistor)를 사용하고 있다. 이런 트랜지스터에는 MOSFET(Metal-Oxide Semiconductor Field Effect Transistor:금속 산화막 반도체 전계 효과 트랜지스터), IGBT(Insulated Gate Bipolar Transistor:절연 게이트 형 양극성 트랜지스터) 및 BJT(Bipolar Junction Transistor:바이폴라 트랜지스터) 등이 있다. 이러한 트랜지스터 중 공업 규격 패키지(package) 외형에는 TO220형(방열판이 붙어있는 네모난 트랜지스터)이나 TO247형의 MOSFET가 제안 되어있다. 이 중 MOSFET는 전압 구동 형 소자이어서 구동 회로의 전력 소비가 낮다. 그리고 다수 캐리어 장치(device)이며 본질적으로 고속 스위칭(switching)이 가능하고 스위칭 손실도 적다. 이러한 특성을 지닌 반도체 장치의 패키지에서는 반도체 다이를 연결하기 위해 브릿지(bridge)를 이용한다. 이러한 브릿지는 넓은 면적으로 형성되어 있기 때문에 반도체 다이와 리드 사이의 전류저항을 상당히 감소시키고, 방열 특성도 향상시킨다. 그러나, 이러한 브릿지는 접착제와의 접착면적이 작음으로써, 리드와의 결합력이 떨어지고, 또한 브릿지 접착공정에서 브릿지의 위치가 변화하는 문제가 있다. Transistors are used in cell phones, video and camera chargers, power supply circuits such as office automation (OA) devices, and automotive electronic devices used in daily life. Such transistors include MOSFETs (Metal-Oxide Semiconductor Field Effect Transistors), Insulated Gate Bipolar Transistors (IGBTs), and Bipolar Junction Transistors (BJTs). Among the transistors, TO220 type (square transistors with a heat dissipation plate) or TO247 type MOSFETs have been proposed for the industrial standard package appearance. Among them, MOSFETs are voltage-driven devices, which lower the power consumption of the drive circuit. It is a multi-carrier device, inherently capable of fast switching and low switching losses. In a package of a semiconductor device having these characteristics, a bridge is used to connect the semiconductor dies. Since the bridge is formed with a large area, it significantly reduces the current resistance between the semiconductor die and the lead, and also improves heat dissipation characteristics. However, such a bridge has a problem in that the bonding area with the lead is reduced because the adhesive area with the adhesive is small, and the position of the bridge changes in the bridge bonding process.
본 발명은 상술한 종래의 문제점을 극복하기 위한 것으로서, 본 발명의 목적은 브릿지의 끝단에 다수의 개구를 형성함으로써, 브릿지와 리드 및 브릿지와 반도체 다이의 결합력을 향상시킬 수 있는 전력용 반도체 장치 및 그 제조 방법을 제공하는데 있다.SUMMARY OF THE INVENTION The present invention has been made to overcome the above-mentioned conventional problems, and an object of the present invention is to form a plurality of openings at the ends of a bridge, whereby a power semiconductor device capable of improving the coupling force between the bridge and the lead and the bridge and the semiconductor die, and It is providing the manufacturing method.
본 발명의 또 다른 목적은 브릿지와 리드 및 브릿지와 반도체 다이 사이의 접착면적을 증가시킴으로써, 전류 저항을 낮추고 방열 특성을 향상 시킬 수 있는 전력용 반도체 장치 및 그 제조 방법을 제공하는데 있다.It is still another object of the present invention to provide a power semiconductor device and a method of manufacturing the same, which can lower current resistance and improve heat dissipation by increasing the adhesion area between the bridge and the lead and the bridge and the semiconductor die.
상기한 목적을 달성하기 위해 본 발명에 의한 전력용 반도체 장치는 In order to achieve the above object, the power semiconductor device according to the present invention
적어도 하나의 제 1리드와, 상기 제 1리드와 이격되어 형성된 적어도 하나의 제 2리드와, 상기 제 1리드에 전기적으로 접속된 반도체 다이와, 상기 반도체 다이와 상기 제 2리드를 제 1도전성 접착제로 연결하는 브릿지와, 상기 제 1리드, 상기 제 2리드, 상기 반도체 다이, 상기 브릿지 및 상기 제 1도전성 접착제를 봉지하는 봉지재를 포함하고 상기 브릿지는 상기 제 2리드와 대응되는 끝단에 제 1개구가 형성되고, 상기 제 1도전성 접착제는 상기 제 1개구, 상기 제 1개구와 대응되는 상단, 상기 제 1개구와 대응되는 하단 및 상기 제 1개구의 측벽까지 둘러싸여 이루어 질 수 있다. At least one first lead, at least one second lead spaced apart from the first lead, a semiconductor die electrically connected to the first lead, the semiconductor die and the second lead with a first conductive adhesive And an encapsulant for encapsulating the first lead, the second lead, the semiconductor die, the bridge, and the first conductive adhesive, wherein the bridge has a first opening at an end corresponding to the second lead. The first conductive adhesive may be formed to be surrounded by the first opening, the upper end corresponding to the first opening, the lower end corresponding to the first opening, and the side wall of the first opening.
이때, 상기 브릿지는 상기 제 2리드에 상기 제 1도전성 접착제로 접착되고 상기 제 1개구가 형성된 제 1영역과 상기 반도체 다이에 제 2도전성 접착제로 접착된 제 2영역 및, 상기 제 1영역과 상기 제 2영역을 연결하는 제 3영역을 포함하여 이루어질 수 있다. At this time, the bridge is bonded to the second lead with the first conductive adhesive and the first region formed with the first opening and the second region bonded to the semiconductor die with a second conductive adhesive, the first region and the It may include a third region connecting the second region.
상기 제 2리드는 상기 제 1개구와 대응되는 영역에 홀이 형성되고, 상기 홀에는 상기 제 1도전성 접착제가 충진될 수 있다.The second lead may have a hole formed in an area corresponding to the first opening, and the hole may be filled with the first conductive adhesive.
여기서, 상기 제 1개구는 원형, 삼각형, 사각형, 평행사변형 및 사다리꼴의 다각형 구조 중에서 선택된 적어도 어느 하나를 제 1개구로 이용할 수 있고, 상기 제 1개구의 중심점은 상기 브릿지의 내측에 위치할 수 있다. Here, the first opening may use at least one selected from a circular, triangular, rectangular, parallelogram and trapezoidal polygonal structure as a first opening, and a center point of the first opening may be located inside the bridge. .
또한 상기 브릿지는 상기 제 2영역의 끝단에 다수의 제 2개구를 형성할 수 있다. In addition, the bridge may form a plurality of second openings at ends of the second region.
여기서, 상기 제 2개구는 원형, 삼각형, 사각형, 평행사변형 및 사다리꼴의 다각형 구조 중에서 선택된 적어도 어느 하나를 제 2개구로 이용할 수 있고, 상기 제 2개구의 중심점이 상기 브릿지의 내측에 위치할 수 있다.Here, the second opening may use at least one selected from a circular, triangular, rectangular, parallelogram and trapezoidal polygonal structure as a second opening, and a center point of the second opening may be located inside the bridge. .
상기한 전력용 반도체 장치에 있어서, 상기 제 2리드의 측부에는 제3리드가 구비되고, 상기 반도체 다이에는 게이트 패드가 구비되며, 상기 제 3리드와 상기 게이트 패드는 도전성 와이어로 본딩할 수 있다.In the power semiconductor device described above, a third lead may be provided on a side of the second lead, a gate pad may be provided on the semiconductor die, and the third lead and the gate pad may be bonded by a conductive wire.
상기한 또 다른 목적을 달성하기 위해 본 발명에 의한 전력용 반도체 장치의 제조 방법은 적어도 하나의 제 1리드와 상기 제 1리드와 이격되어 형성된 적어도 하나의 제 2리드를 준비하는 제 1리드 및 제 2리드 준비 단계와, 상기 제 1리드에 반도체 다이를 탑재하여 전기적으로 접착하는 반도체 다이 본딩 단계와, 상기 반도체 다이와 상기 제 2리드를 제 1도전성 접착제를 개재하여 브릿지로 연결하는 브릿지 본딩 단계와, 상기 제 1리드, 상기 제 2리드, 상기 반도체 다이, 상기 브릿지 및 상기 제 1도전성 접착제를 봉지하는 봉지 단계를 포함할 수 있다.In order to achieve the above another object, a method of manufacturing a power semiconductor device according to the present invention includes a first lead and a first lead and at least one second lead prepared to be spaced apart from the first lead A two-lead preparation step, a semiconductor die bonding step of mounting and electrically bonding a semiconductor die to the first lead, a bridge bonding step of connecting the semiconductor die and the second lead to a bridge via a first conductive adhesive; The method may include encapsulating the first lead, the second lead, the semiconductor die, the bridge, and the first conductive adhesive.
이때, 상기 브릿지 본딩 단계에 이용된 상기 브릿지는 상기 제 2리드와 대응되는 끝단에 제 1개구가 형성되고, 상기 제 1도전성 접착제는 상기 제 1개구, 상기 제 1개구와 대응되는 상단, 상기 제 1개구와 대응되는 하단 및 상기 제 1개구의 측벽까지 둘러싸여 이루어 질 수 있다. In this case, the bridge used in the bridge bonding step has a first opening is formed at the end corresponding to the second lead, the first conductive adhesive is the first opening, the top corresponding to the first opening, the first The lower end corresponding to one opening and the side wall of the first opening may be surrounded.
상기 브릿지 본딩 단계에 이용된 상기 브릿지는 상기 제 2리드에 상기 제 1도전성 접착제로 접착되어 상기 제 1개구가 형성된 제1영역, 상기 반도체 다이에 제 2도전성 접착제로 접착된 제 2영역 및, 상기 제 1영역과 상기 제 2영역을 연결하는 제 3영역을 포함하여 이루어 질 수 있다. The bridge used in the bridge bonding step may include a first region in which the first opening is bonded to the second lead by the first conductive adhesive, a second region bonded to the semiconductor die by a second conductive adhesive, and It may include a third region connecting the first region and the second region.
상기 브릿지 본딩 단계는 상기 제 2리드에 상기 제 1개구와 대응되는 영역에 홀이 형성되고, 상기 홀에는 상기 제 1도전성 접착제가 충진 될 수 있다.In the bridge bonding step, a hole may be formed in a region corresponding to the first opening in the second lead, and the hole may be filled with the first conductive adhesive.
여기서. 제 1개구는 원형, 삼각형, 사각형, 평행사변형 및 사다리꼴의 다각 형 구조 중에서 선택된 적어도 어느 하나를 제 1개구로 이용할 수 있고, 상기 제 1개구의 중심점이 상기 브릿지의 내측에 위치할 수 있다. here. The first opening may use at least one selected from a circular, triangular, square, parallelogram and trapezoidal polygonal structure as the first opening, and a center point of the first opening may be located inside the bridge.
또한 상기 브릿지 본딩 단계는 상기 제 2영역의 끝단에 다수의 제 2개구가 형성될 수 있다. In the bridge bonding step, a plurality of second openings may be formed at the end of the second region.
여기서, 상기 제 2개구가 원형, 삼각형, 사각형, 평행사변형 및 사다리꼴의 다각형 구조 중에서 선택된 적어도 어느 하나를 제 2개구로 이용할 수 있고, 상기 제 2개구의 중심점이 상기 브릿지의 내측에 위치할 수 있다. Here, the second opening may use at least one selected from a circular, triangular, rectangular, parallelogram and trapezoidal polygonal structure as a second opening, and a center point of the second opening may be located inside the bridge. .
상기한 전력용 반도체 장치의 제조방법에 있어서, 상기 제 1리드 및 상기 제 2리드 준비 단계에서는 상기 제 2리드의 측부에 제 3리드가 구비되고, 상기 반도체 다이 본딩 단계에서는 상기 반도체 다이에 게이트 패드가 구비되며, 상기 브릿지 본딩 단계 후 상기 제3리드와 상기 게이트 패드를 도전성 와이어로 본딩하는 와이어 본딩 단계를 더 수행할 수 있다. In the method of manufacturing a power semiconductor device, a third lead is provided at a side of the second lead in the first lead and the second lead preparation step, and a gate pad is formed on the semiconductor die in the semiconductor die bonding step. And a wire bonding step of bonding the third lead and the gate pad with a conductive wire after the bridge bonding step.
상술한 바와 같이, 본 발명에 따른 전력용 반도체 장치 및 그 제조 방법은 반도체 다이와 리드를 연결하는 브릿지에 개구를 형성한다. 개구는 원형, 사각형, 삼각형, 평행사변형 및 사다리꼴 등의 다각형(polygon) 구조 중에서 선택된 적어도 어느 하나로 형성한다. As described above, the power semiconductor device and the manufacturing method thereof according to the present invention form an opening in a bridge connecting the semiconductor die and the lead. The opening is formed in at least one selected from polygonal structures such as circles, squares, triangles, parallelograms, and trapezoids.
이와 같은 다수의 개구로 도전성 접착제가 개구의 외부 측벽까지 형성됨에 따라 브릿지와 리드 및 브릿지와 반도체 다이의 결합력을 향상시킬 수 있다. With such a plurality of openings, the conductive adhesive is formed to the outer sidewall of the opening, thereby improving the bonding force of the bridge and the lead and the bridge and the semiconductor die.
또한 브릿지와 리드 및 브릿지와 반도체 다이사이의 접착면적을 증가시킴으 로써, 전류 저항을 낮추고, 방열 특성을 향상 시킬 수 있다.In addition, by increasing the adhesion area between the bridge and the lead and the bridge and the semiconductor die, it is possible to lower the current resistance and improve heat dissipation characteristics.
이하, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있을 정도로 본 발명의 바람직한 실시 예를 첨부된 도면을 참조하여 상세하게 설명하면 다음과 같다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings such that those skilled in the art may easily implement the present invention.
여기서, 명세서 전체를 통하여 유사한 구성 및 동작을 갖는 부분에 대해서는 동일한 도면 부호를 붙였다. Here, parts having similar configurations and operations throughout the specification are denoted by the same reference numerals.
도 1은 본 발명에 따른 전력용 반도체 장치를 도시한 단면도이다. 1 is a cross-sectional view showing a power semiconductor device according to the present invention.
도 1과 같이 본 발명의 실시 예에 따른 전력용 반도체 장치는 적어도 하나의 제 1리드(110)와 상기 제1리드(110)와 이격되어 형성된 적어도 하나의 제 2리드(120)와, 상기 제 1리드(110)에 도전성 접착제(140)를 이용하여 전기적으로 접속된 반도체 다이(150)와, 상기 반도체 다이(150)와 상기 제 2리드(120)를 연결하기 위해 형성한 브릿지(200)와, 상기 브릿지(200)를 연결하기 위해 제 1 영역의 상기 브릿지 끝단(210)에 충진 된 제 1도전성 접착제(180) 및 제 2 영역의 상기 브릿지 끝단(220)에 충진 된 제 2도전성 접착제(190)와, 상기 제 1리드(110), 상기 제 2리드(120), 상기 반도체 다이(150), 상기 브릿지(200) 및 상기 도전성 접착제(140, 180, 190)를 봉지하는 봉지재(230)를 포함한다.As shown in FIG. 1, a power semiconductor device according to an embodiment of the present invention includes at least one
도 2a 내지 도 2d는 상기 반도체 다이와 상기 제 2리드를 연결하기 위해 형성한 브릿지를 도시한 단면도이다. 2A to 2D are cross-sectional views illustrating bridges formed to connect the semiconductor die and the second lead.
그리고 도 3a 내지 도 3f를 참조하면, 상기 브릿지(200)에 형성한 개구의 구조를 도시한 평면도이다. 3A to 3F are plan views illustrating the structure of the opening formed in the
먼저, 도 2a를 참조하면, 상기 브릿지(200) 끝단에 형성된 개구의 위치가 도시되어 있다. 상기 브릿지(200)는 상기 제 2리드를 연결하기 위해 상기 브릿지 끝단에 제 1개구(210)가 형성된 제 1영역, 상기 반도체 다이(150)를 연결하기 위해 상기 브릿지 끝단에 형성한 제 2개구(220)를 형성한 제 2영역 및 상기 제 1영역 및 상기 제 2영역을 연결하는 제 3영역으로 구성할 수 있다.First, referring to FIG. 2A, the position of the opening formed at the end of the
도 2b를 참조하면, 상기 제 2리드(120)와 상기 브릿지(200)를 연결한 모습이 도시되어 있다. 상기 브릿지 끝단에 형성된 상기 제 1개구(210)에 상기 제 1도전성 접착제(180)를 충진하여 연결할 수 있다. 여기서, 상기 브릿지 끝단에 형성된 상기 제 1개구(210)의 평면도는 도 3a 내지 도 3f에 도시되어 있다.Referring to FIG. 2B, the
상기 제 1개구(210)는 원형(도 3a), 삼각형(도 3b), 사각형(도 3c), 평행사변형(도 3d) 및 사다리꼴(도 3e, 도 3f)의 다각형 구조 중에서 선택된 적어도 어느 하나를 상기 제 1개구(210)로 이용할 수 있으나, 상기 제 1개구(210)의 구조를 한정하는 것은 아니다. 여기서 원형의 상기 제 1개구(210)의 중심점은 상기 브릿지(200)의 내측에 위치될 수 있다. 상기 제 1개구(210)는 상기 제 2리드(120)와 연결하기 위해 상기 제 1도전성 접착제(180)를 충진한다. 상기 제 1도전성 접착 제(180)는 상기 제 1개구(210), 상기 제 1개구(210)와 대응되는 상단(210a), 상기 제 1개구(210)와 대응되는 하단(210b) 및 상기 제 1개구(210)의 측벽(210c)까지 둘러싸여 형성된다. The
본 발명의 다른 실시 예로 도 2c를 참조하면, 상기 제 2리드(120)에는 상기 제 1개구(210)와 대응되는 영역에 홀(120a)이 형성되고, 상기 홀(120a)에는 상기 제 1도전성 접착제(180)가 충진된 모습을 도시한 단면도가 도시되어 있다. 상기 홀(120a)과 상기 제 1개구(210)에 충진한 상기 제 1도전성 접착제(180)는 상기 제 1개구(210), 상기 제 1개구(210)와 대응되는 상단(210a), 상기 제 1개구(210)와 대응되는 하단(210b), 상기 제 1개구(210)의 측벽(210c) 및 상기 홀(120a)의 하부 측면까지 둘러싸여 형성된다. 2C, a
본 발명의 또 다른 실시 예로 도 2d를 참조하면, 상기 반도체 다이(150)와 상기 브릿지(200)를 연결한 모습이 도시되어 있다. 상기 제 1리드(110) 위에 형성한 상기 반도체 다이(150)와 상기 브릿지(200)를 연결하기 위해 상기 브릿지 끝단에 상기 제 2개구(220)를 형성한다. 상기 제 2개구(220)에 상기 제 2도전성 접착제(190)를 충진하여 연결할 수 있다. 여기서, 상기 브릿지 끝단에 형성된 상기 제 2개구(220)의 평면도는 도 3a 내지 도 3f에 도시되어 있다.As another embodiment of the present invention, referring to FIG. 2D, the semiconductor die 150 is connected to the
상기 제 2개구(220)는 원형(도 3a), 삼각형(도 3b), 사각형(도 3c), 평행사변형(도 3d) 및 사다리꼴(도 3e 및 도 3f)의 다각형 구조 중에서 선택된 적어도 어 느 하나를 상기 제 2개구(220)로 이용할 수 있으나, 상기 제 2개구(220)의 구조를 한정하는 것은 아니다. 여기서 원형의 상기 제 2개구(220)의 중심점은 상기 브릿지(200)의 내측에 위치될 수 있다. 상기 제 2개구(220)는 상기 반도체 다이(150)와 연결하기 위해 상기 제 2도전성 접착제(190)를 충진한다. 상기 제 2도전성 접착제(190)는 상기 제 2개구(220), 상기 제 2개구(220)와 대응되는 상단(220a), 상기 제 2개구(220)와 대응되는 하단(220b) 및 상기 제 2개구(220)의 측벽(220c)까지 둘러싸여 형성된다. The
이어서 도 4a 및 도 4b를 참조하면, 본 발명의 전력용 반도체 장치에서 게이트 패드가 도전성 와이어로 본딩(bonding) 된 평면도가 도시되어 있다. 4A and 4B, a plan view in which a gate pad is bonded with a conductive wire in the power semiconductor device of the present invention is shown.
먼저, 도 4a를 참조하면, 상기 제 2영역과 상기 제 1영역을 연결하기 위해 상기 도전성 와이어(170)가 형성되어 있다. 상기 제 1영역에는 상기 제 2리드(120), 제 3리드(130) 및 상기 브릿지의 끝단(210)으로 구성된다. 또한, 상기 제 2영역에는 상기 제 1리드(110), 상기 반도체 다이(150), 상기 반도체 다이(150) 위에 형성된 상기 게이트 패드(160) 및 상기 브릿지(200)로 구성된다. 제 3 영역은 상기 제 2리드(120)와 상기 반도체 다이(150)를 연결하기 위한 상기 브릿지(200) 및 상기 도전성 와이어(170)로 구성되어 있다. First, referring to FIG. 4A, the
본 발명의 또 다른 실시 예로 도 4b를 참조하면, 상기 반도체 다이(150)와 상기 브릿지(200)를 연결하기 위해 상기 브릿지 제 2영역 끝단에 형성된 개구(220)를 도시한 평면도이다. 4B, a plan view illustrating an
도 5를 참조하면, 본 발명의 실시 예에 따른 전력용 반도체 장치의 제조 방법이 도시되어 있다. Referring to FIG. 5, a method of manufacturing a power semiconductor device according to an embodiment of the present invention is illustrated.
도 5에 도시된 바와 같이, 본 발명의 실시 예에 따른 전력용 반도체 장치의 제조 방법은 적어도 하나의 제 1리드, 상기 제 1리드와 이격되어 형성된 적어도 하나의 제 2리드 및 상기 제 2리드 측부에 제 3리드를 준비하는 리드 준비단계(S1)와, 상기 제 1리드에 반도체 다이를 탑재하여 전기적으로 접착하는 반도체 다이 본딩 단계(S2)와, 상기 반도체 다이와 상기 제 2리드를 제 1도전성 접착제로 충진하여 브릿지를 연결하는 브릿지 본딩 단계(S3)와, 상기 제 3리드와 상기 반도체 다이에 구비된 게이트 패드를 도전성 와이어로 본딩하는 와이어 본딩 단계(S4)와, 상기 제 1리드, 상기 제 2리드, 상기 반도체 다이, 상기 브릿지 및 상기 제 1도전성 접착제를 봉지하는 봉지 단계(S5)를 포함한다.As shown in FIG. 5, a method of manufacturing a power semiconductor device according to an embodiment of the present invention includes at least one first lead, at least one second lead formed from the first lead, and the second lead side portion. A lead preparatory step (S1) for preparing a third lead in a semiconductor die; a semiconductor die bonding step (S2) for mounting and electrically bonding a semiconductor die to the first lead; A bridge bonding step (S3) for connecting the bridges by filling with a wire, a wire bonding step (S4) for bonding the third lead and the gate pad provided in the semiconductor die with a conductive wire, and the first lead and the second lead. And encapsulating the lead, the semiconductor die, the bridge, and the first conductive adhesive.
이러한, 본 발명의 실시 예에 따른 전력용 반도체 장치의 제조 방법을 도 6a 내지 도 6h를 이용하여 좀더 자세히 설명하기로 한다.This method of manufacturing a power semiconductor device according to an embodiment of the present invention will be described in more detail with reference to FIGS. 6A to 6H.
도 6a 내지 도 6h를 참조하면, 본 발명의 실시 예에 따른 전력용 반도체 장치의 제조 방법을 도시한 단면도이다. 6A through 6H are cross-sectional views illustrating a method of manufacturing a power semiconductor device according to an embodiment of the present invention.
먼저 도 6a를 참조하면, 리드 준비 단계(S1)가 도시되어 있다. 상기 리드 준비 단계(S1)에서는, 적어도 하나의 제 1리드(110)와 상기 제 1리드(110)와 이격되어 형성된 적어도 하나의 제 2리드(120)를 준비한다. 상기 제 1리드(110) 및 상기 제 2리드(120)는 구리(Cu), 철(Fe), 니켈(Ni) 및 alloy42(구리, 철 및 니켈 등의 고밀도 합금) 및 그 등가물 중 선택된 어느 하나일 수 있으나, 여기서 그 재질을 한정하는 것은 아니다.Referring first to FIG. 6A, a read preparation step S1 is illustrated. In the read preparation step (S1), at least one
도 6b 내지 도 6c를 참조하면, 반도체 다이 본딩 단계(S2)가 도시되어 있다. 상기 반도체 다이 본딩 단계(S2)에서는, 상기 반도체 다이(150)를 상기 제 1리드(110)위에 도전성 접착제(140)를 이용하여 전기적으로 접속할 수 있다.6B-6C, a semiconductor die bonding step S2 is shown. In the semiconductor die bonding step S2, the semiconductor die 150 may be electrically connected to the
먼저 도 6b를 참조하면, 상기 도전성 접착제(140)를 상기 제 1리드(110) 표면 상부에 약 2μm~3μm두께로 증착 도포시킨다. 상기 도전성 접착제(140)는 열팽창 계수가 큰 In(인듐)과 전단응력이 큰 Au(금), Su(주석) 및 Au(금), Ge(게르마늄) 및 그 등가물 중에서 선택된 어느 하나를 이용 할 수 있으나, 여기서 상기 도전성 접착제(140)를 한정하는 것은 아니다. First, referring to FIG. 6B, the
다음 도 6c를 참조하면, 상기 제 1리드(110)위에 형성된 상기 도전성 접착제(140)를 이용하여 상기 반도체 다이(150)를 본딩(bonding)한다. 여기서, 상기 반도체 다이(150)는 실리콘 계열일 수 있다. 상기 제 1리드(110)가 안착된 반응 챔버에서 200-360℃ 온도로 질소 분위기에서 상기 반도체 다이(150)를 부착하고 이를 다시 냉각한다. Next, referring to FIG. 6C, the semiconductor die 150 is bonded using the
상기와 같은 반도체 다이 본딩단계(S2)를 진행한 후, 상기 제 2리드(120)와 상기 반도체 다이(150)를 연결하기 위해 다음 단계에서 상기 브릿지 본딩을 한다.After performing the semiconductor die bonding step S2 as described above, the bridge bonding is performed in the next step to connect the
도 6d 및 도 6f를 참조하면, 브릿지 본딩단계(S3)가 도시되어 있다.6D and 6F, the bridge bonding step S3 is shown.
먼저, 도 6d를 참조하면, 상기 브릿지의 양 끝단에 형성된 상기 제 1개구(210) 및 상기 제 2개구(220)의 하부에는 제 1도전성 접착제(180) 및 제 2도전성 접착제(190)가 위치되어 있다. 상기 브릿지 본딩단계(S3)에 이용한 상기 브릿지(200)의 제 1영역은 상기 브릿지 끝단에 상기 제 1개구(210)를 형성하고, 상기 제 2리드(120)와 제 1도전성 접착제(180)를 사용하여 연결한다. 또한 상기 브릿지(200)의 제 2영역은 상기 브릿지 끝단에 상기 제 2개구(220)를 형성하고, 상기 반도체 다이(150)와 제 2도전성 접착제(190)를 사용하여 연결한다. 제 3영역은 상기 제 1영역 및 상기 제 2영역에 이용한 상기 브릿지(200)를 연결하기 위한 영역이다. First, referring to FIG. 6D, the first
이와 같이 상기 제 1도전성 접착제(180) 및 상기 제 2도전성 접착제(190)를 증착한 후, 상기 반도체 장치가 안착된 노(furnace)에서 150℃~250℃조건에서 상기 브릿지를 위치시킨 후 냉각한다. After depositing the first
여기서 상기 브릿지 양 끝단에 형성된 상기 제 1개구(210) 및 상기 제 2개구(220)의 구조는 도 3a 내지 도 3f를 참조하여 도시할 수 있다. 상기 제 1개구(210) 및 상기 제 2개구(220)의 구조를 원형(도 3a), 삼각형(도 3b), 사각형(도 3c), 평행사변형(도 3d) 및 사다리꼴(도 3e, 도 3f)의 다각형 구조 중에서 선택된 적어도 어느 하나를 상기 제 1개구(210) 및 상기 제 2개구(220)로 이용할 수 있으나, 상기 제 1개구(210) 및 상기 제 2개구(220)의 구조를 한정하는 것은 아니다. 상기와 같은 구조로 형성한 상기 제 1개구(210) 및 상기 제 2개구(220)의 중심점은 상기 브릿지(200)의 내측에 위치될 수 있다. Herein, the structures of the
이후, 도 6e를 참조하면, 상기 브릿지 끝단에 형성된 상기 제 1개구(210) 및 상기 제 2개구(220)에 상기 제 1도전성 접착제(180) 및 제 2도전성 접착제(190)가 충진 되어 상기 브릿지(200)가 연결된 모습을 도시한 단면도이다. 상기 브릿지의 양 끝단인 상기 제 1영역 및 상기 제 2영역에 형성된 상기 제 1개구(210) 및 상기 제 2개구(220)에 상기 제 1도전성 접착제(180) 및 상기 제 2도전성 접착제(190)가 충진 되어 있다. Thereafter, referring to FIG. 6E, the first
상기 제 1도전성 접착제(180) 및 상기 제 2도전성 접착제(190)는 상기 제 1개구(210) 및 상기 제 2개구(220)와 상기 제 1개구(210) 및 상기 제 2개구(220)와 대응되는 상단, 상기 제 1개구(210) 및 상기 제 2개구(220)와 대응되는 하단 및 상기 제 1개구(210) 및 상기 제 2개구(220)의 측벽까지 둘러싸여 형성한다. The first
또 다른 실시 예로, 도 6f를 참조하면, 상기 브릿지 본딩 단계(S3)에서는 상기 브릿지(200)와 상기 제 2리드(120)를 연결하기 위하여 상기 제 2리드(120)에 상기 제 1개구(210)와 대응되는 영역에 홀(120a)을 형성할 수도 있다. In another embodiment, referring to FIG. 6F, in the bridge bonding step S3, the
상기 홀(120a)은 상기 제 1도전성 접착제(180)로 충진한다. 상기 홀(120a)에 충진 된 상기 제 1도전성 접착제(180)는 상기 제 1개구(210), 상기 제 1개구(210)와 대응되는 상단, 상기 제 1개구(210)와 대응되는 하단, 상기 제 1개구(210)의 측벽, 및 상기 홀(120a)의 하단까지 둘러싸여 형성된다.The
이렇게 상기 제 2리드(120)와 상기 반도체 다이(150)를 연결하기 위해 상기 브릿지 본딩 단계(S3)를 진행한 후, 와이어 본딩 단계(S4)를 실시한다. After the bridge bonding step S3 is performed to connect the
도 6g를 참조하면, 와이어가 본딩된 단면도이다. 이러한 와이어 본딩 단계(S4)에서는 상기 반도체 다이(150) 위에 게이트 패드(gate pad)(160)를 구비하고 상기 제 2리드(120)의 측부에 구비된 제 3리드(130)를 도전성 와이어(170)로 본딩한다. 즉, 상기 반도체 다이(150)에 상기 게이트 패드(160)를 구비하고, 상기 제 3리드(130)를 도전성 와이어(170)를 이용하여 상호 전기적으로 연결한다. 상기 도전성 와이어(170)는 바람직하게 두께가 125㎛직경으로 하고 금(Au), 알루미늄(Al), 구리(Cu)의 도전성 물질 중에서 선택된 적어도 어느 하나로 형성할 수 있다. Referring to FIG. 6G, a cross-sectional view in which wires are bonded. In the wire bonding step S4, a
상기 와이어 본딩의 방법으로는 볼 본딩(ball bonding) 방법, 웨지 본딩(wedge bonding) 방법 및 범프 리버스 본딩(bump reverse bonding) 방법 등 중에서 선택된 적어도 어느 하나를 이용할 수 있다. As the wire bonding method, at least one selected from a ball bonding method, a wedge bonding method, a bump reverse bonding method, and the like may be used.
상기 볼 본딩(ball bonding) 방법은 본딩 와이어의 끝단에 볼을 형성하여 본딩 한 후, 일정한 궤적의 루프(loop)를 형성하여 리드 프레임에 스티치 본딩(stich bonding)으로 마무리 하는 것이다. The ball bonding method is to form a ball at the end of the bonding wire to bond, and then to form a loop (loop) of a certain trajectory to finish the stitch bonding (stich bonding) on the lead frame.
상기 볼 본딩의 특징은 볼의 높이를 높게 하고 일측으로 치우치지 않게 하는 것이다. 상기 웨지 본딩(wedge bonding) 방법은 별도의 제조공정이 추가됨이 없이 바로 와이어를 동일재질로 이루어진 본딩 패드에 웨지 본딩 하게 되어, 작업공수 및 제조원가를 절감하는 효과가 있다. 또한 범프 리버스 본딩(bump reverse bonding)은 반도체 다이패드에 범프(bump)를 형성한 다음, 리드에 볼 본딩 후 범프에 스티치 본딩으로 마무리 하는 것이다. 상기 본 발명의 와이어 본딩단계(S4)에서는 상기 반도체 다이(150)위에 형성된 게이트 패드(gate pad)(160)와 상기 제 3리드(130)에 연결되는 상기 와이어(170)의 방향을 용이하게 조절하기 위해 바람직하게 볼 본딩(ball bonding)으로 형성한다. 그러나 본 발명에서 와이어 본딩의 방법을 한정하는 것은 아니다.A feature of the ball bonding is to make the height of the ball high and not biased to one side. In the wedge bonding method, the wire is wedge-bonded to a bonding pad made of the same material without additional manufacturing process, thereby reducing labor and manufacturing cost. In addition, bump reverse bonding is to form a bump on the semiconductor die pad, and then ball bonding to the lead and finishing the stitch bonding to the bump. In the wire bonding step S4 of the present invention, the direction of the
마지막으로 도 6h를 참조하면, 봉지 단계(S5)가 도시되어 있다. 6H, the encapsulation step S5 is shown.
상기 본딩 단계(S5)에서는 상기 제 1리드(110), 상기 제 2리드(120), 상기 반도체 다이(150), 상기 브릿지(200), 상기 제 1도전성 접착제(180) 및 상기 제 2도전성 접착제(190)를 봉지재(230)로 봉지한다. 상기 봉지 단계(S5)에서 이용하는 봉지재로는 에폭시 수지(OCN + Byphenyl), 경화제(Phenol novolac), 충진제(silica(SiO2)) 및 촉매제(TPP계:Triphenyl Phosphate Phenolic resin) 등을 주성분으로 하여 혼합시킨 이엠씨(EMC:Epoxy Molding Compound)를 주로 사용한다. 상기 봉지재(230)에 사용되는 조성 성분들의 종류와 조성비는 상기 반도체 다이(150) 패키지(package)의 종류와 목적에 따라 다르게 할 수 있다. 상기 봉지공정은 바람직하게 170℃∼180℃의 고온 분위기에서 형성한다. In the bonding step S5, the
이렇게 본 발명에 의해 형성한 전력용 반도체 장치는 브릿지의 끝단에 다수의 개구를 형성함으로써, 브릿지와 리드 또는 브릿지와 반도체 다이의 결합력이 향 상된 전력용 반도체 소자를 제공할 수 있다.As described above, the power semiconductor device formed by the present invention can provide a power semiconductor device having improved coupling force between the bridge and the lead or the bridge and the semiconductor die by forming a plurality of openings at the ends of the bridge.
또한 브릿지와 리드 또는 브릿지와 반도체 다이사이의 접착면적을 증가시킴으로써, 전류 저항을 낮추고, 방열 특성이 향상된 전력용 반도체 소자를 제공할 수 있다. In addition, by increasing the adhesion area between the bridge and the lead or the bridge and the semiconductor die, it is possible to provide a power semiconductor device having low current resistance and improved heat dissipation characteristics.
이상에서 설명한 것은 본 발명에 따른 전력용 반도체 장치 및 그 제조 방법을 실시하기 위한 하나의 실시 예에 불과한 것으로서, 본 발명은 상기한 실시 예에 한정되지 않고, 이하의 특허 청구범위에서 청구하는 바와 같이 본 발명의 요지를 벗어남이 없이 당해 발명이 속하는 분야에서 통상의 지식을 가진 자라면 누구든지 다양한 변경 실시가 가능한 범위까지 본 발명의 기술적 정신이 있다고 할 것이다.What has been described above is only one embodiment for implementing the power semiconductor device and the manufacturing method according to the present invention, the present invention is not limited to the above-described embodiment, as claimed in the following claims Without departing from the gist of the present invention, anyone of ordinary skill in the art will have the technical spirit of the present invention to the extent that various modifications can be made.
도 1은 본 발명에 실시 예에 따른 전력용 반도체 장치를 도시한 단면도이다.1 is a cross-sectional view illustrating a power semiconductor device according to an embodiment of the present invention.
도 2a 내지 도 2d는 본 발명에 따른 전력용 반도체 장치에 이용한 브릿지를 도시한 단면도이다.2A to 2D are cross-sectional views showing bridges used in the power semiconductor device according to the present invention.
도 3a 내지 도 3f는 본 발명에 따른 전력용 반도체 장치에 이용한 브릿지 개구를 도시한 평면도이다.3A to 3F are plan views showing bridge openings used in the power semiconductor device according to the present invention.
도 4a 및 도 4b는 본 발명의 전력용 반도체 장치에서 게이트 패드가 도전성 와이어로 본딩 된 평면도이다.4A and 4B are plan views of a gate pad bonded to a conductive wire in the power semiconductor device of the present invention.
도 5는 본 발명의 실시 예에 따른 전력용 반도체 장치의 제조 방법의 순서도이다.5 is a flowchart of a method of manufacturing a power semiconductor device according to an embodiment of the present invention.
도 6a 내지 도 6h는 본 발명에 따른 전력용 반도체 장치의 제조 방법을 도시한 단면도이다.6A to 6H are cross-sectional views illustrating a method of manufacturing a power semiconductor device according to the present invention.
< 도면의 주요 부분에 대한 부호의 설명 ><Description of Symbols for Main Parts of Drawings>
110:제 1리드 120:제 2리드110: first lead 120: second lead
130:제 3리드 140:도전성 접착제130: third lead 140: conductive adhesive
150:반도체 다이 160:게이트 패드150: semiconductor die 160: gate pad
170:도전성 와이어 180:제 1도전성 접착제170: conductive wire 180: first conductive adhesive
190: 제 2도전성 접착제 200:브릿지190: second conductive adhesive 200: bridge
210:제 1개구 220:제 2개구210: The first opening 220: The second opening
230:봉지 230: bag
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