KR100988717B1 - 다중 입출력 시스템의 선처리 장치 및 방법 - Google Patents

다중 입출력 시스템의 선처리 장치 및 방법 Download PDF

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Abstract

본 발명은 다중 입출력 시스템의 선처리 장치 및 방법에 관한 것으로서, 이 선처리 장치는 채널 상태 정보를 이용하여 선처리 행렬을 계산하는 피드백 처리부, 선처리 행렬을 이용하여 심벌을 위상 회전시켜 제1 송신 신호를 생성하는 제1 선처리부, 그리고 제1 송신 신호 및 제1 송신 신호에 공액 연산을 수행하여 얻은 제2 송신 신호를 복수의 송신 안테나를 통하여 전송하는 제2 선처리부를 포함한다. 본 발명에 의하면 낮은 연산 복잡도와 적은 양의 피드백 정보를 가지면서도 다중 입출력 시스템의 성능을 향상시킬 수 있다.
다중 입출력 시스템, MIMO, 선처리 행렬, 채널 상태 정보, 피드백

Description

다중 입출력 시스템의 선처리 장치 및 방법{PRECODING APPARATUS AND METHOD FOR MIMO SYSTEM}
본 발명은 다중 입출력 시스템의 선처리 장치 및 방법에 관한 것이다.
최근 무선 통신 환경에서 음성 서비스를 비롯한 다양한 멀티미디어 서비스를 제공하고, 고품질 및 고속의 데이터 전송을 지원하기 위해 많은 연구가 이루어지고 있다. 이러한 연구의 일환으로 공간 영역의 채널을 이용하는 다중 입출력(Multiple-Input Multiple-Output, MIMO) 기술에 대한 연구가 활발히 진행되고 있다. 다중 입출력 기술은 송수신 양단에 다중 안테나를 사용함으로써 한정된 주파수 자원 내에서 채널 용량을 증대하여 높은 데이터 전송률을 제공할 수 있다. 다중 입출력 기술은 채널 상태 정보의 피드백 여부에 따라 개루프 다중 입출력(Open Loop MIMO) 기술과 폐루프 다중 입출력(Closed Loop MIMO) 기술로 구분할 수 있다.
신호가 여러 경로를 통해 산란되는 채널 환경에서 전송 다이버시티(diversity) 이득을 얻기 위해 개루프 다중 입출력 기술에서는 심벌 외에 리던던시(redundancy) 심벌을 함께 송신함으로써 신뢰성 있는 전송이 가능한 시공간 블록 부호(Space-Time Block Codes, STBC)를 이용한다. 반면, 폐루프 다중 입출력 기술에서는 피드백되는 채널 상태 정보를 이용하여 채널에 적응적인 신호 처리를 함으로써 높은 시스템 용량 및 고속의 전송 속도를 얻을 수 있다.
다중 입출력 기술은 다이버시티 이득을 얻기 위한 시공간 블록 부호 기술과 데이터 전송량을 향상시키는 공간 다중화(Spatial Multiplexing, SM) 기술로 구분할 수 있다. 시공간 블록 부호 기술은 단위 시간당 전송되는 데이터 심벌의 개수는 줄이는 대신 리던던시 심벌을 추가하여 다이버시티 이득을 얻을 수 있고, 공간 다중화 기술은 안테나당 다른 데이터 심벌을 전송함으로써 데이터 전송량을 향상시킬 수 있다. 송신 안테나가 두 개인 환경에서는 직교 시공간 블록 부호인 알라무티 부호(Alamouti code)를 사용함으로써 최대 다이버시티 이득과 최대 데이터 전송량을 얻을 수 있다. 반면, 송신 안테나가 세 개 이상인 환경에서는 최대 다이버시티 이득과 최대 데이터 전송량을 동시에 얻을 수 없으며, 이를 얻기 위해서는 채널 환경을 적응적으로 이용할 수 있도록 수신 장치에서 송신 장치로 채널 정보를 전송하는 피드백 기술이 사용된다.
본 발명이 해결하고자 하는 과제는 낮은 연산 복잡도와 적은 양의 피드백 정보를 가지면서도 성능을 향상시킬 수 있는 다중 입출력 시스템의 선처리 장치 및 방법을 제공하는 것이다.
이러한 기술적 과제를 해결하기 위한 본 발명의 실시예에 따른 선처리 장치는 수신 장치로부터 수신한 채널 상태 정보를 이용하여 선처리 행렬
Figure 112009002384178-pat00001
를 계산하는 피드백 처리부, 상기 피드백 처리부로부터의 상기 선처리 행렬
Figure 112009002384178-pat00002
를 이용하여 심벌
Figure 112009002384178-pat00003
을 위상 회전시켜 제1 송신 신호
Figure 112009002384178-pat00004
를 생성하는 제1 선처리부, 그리고 상기 제1 선처리부로부터의 상기 제1 송신 신호
Figure 112009002384178-pat00005
를 복수의 송신 안테나를 통하여 전송하고, 상기 제1 송신 신호
Figure 112009002384178-pat00006
에 공액 연산을 수행하여 얻은 제2 송신 신호를 상기 복수의 송신 안테나를 통하여 전송하는 제2 선처리부를 포함한다.
상기 제1 송신 신호
Figure 112009002384178-pat00007
의 수효는 상기 심벌
Figure 112009002384178-pat00008
의 수효의 두 배이다.
상기 제1 송신 신호
Figure 112009002384178-pat00009
는 수학식
Figure 112009002384178-pat00010
에 의하여 산출되고, 상기
Figure 112009002384178-pat00011
는 상기 채널 상태 정보로부터 결정되며, 상기
Figure 112009002384178-pat00012
은 크기가 n이다.
상기 채널 상태 정보는 한 개의 비트 정보를 포함하며, 상기 한 개의 비트 정보에 따라 미리 정해져 있는 두 값 중 어느 하나가 상기
Figure 112009002384178-pat00013
의 값으로 결정될 수 있다.
상기 미리 정해져 있는 두 값은
Figure 112009002384178-pat00014
의 범위 내에 존재하며, 상기 미리 정해져 있는 두 값은 서로 부호가 반대이고 동일한 절대값을 가질 수 있 다.
상기 위상
Figure 112009002384178-pat00015
의 값은 유효 채널 행렬
Figure 112009002384178-pat00016
와 상기 선처리 행렬
Figure 112009002384178-pat00017
의 곱행렬
Figure 112009002384178-pat00018
의 프로비니어스 놈(Frobenius norm)을 최대화하도록 결정될 수 있다.
상기 제1 송신 신호
Figure 112009002384178-pat00019
에 대하여 상기 제2 송신 신호는
Figure 112009002384178-pat00020
로 계산될 수 있다.
본 발명의 다른 실시예에 따른 다중 입출력 시스템의 수신 장치는, 복수의 송신 안테나를 포함하는 송신 장치로부터 전송된 제1 송신 신호 및 상기 제1 송신 신호에 대하여 공액 연산 처리된 제2 송신 신호를 차례로 수신하는 적어도 하나의 수신 안테나, 상기 수신 안테나에서 수신한 신호에 대하여 심벌 단위로 최대 우도 복호화하는 복호부, 그리고 상기 수신 안테나에서 수신한 신호로부터 채널 상태 정보를 추출하여 상기 송신 장치로 전송하는 피드백 정보 생성부를 포함하며, 상기 송신 장치는 상기 채널 상태 정보를 이용하여 선처리 행렬을 계산하고 상기 선처리 행렬을 이용하여 상기 송신 장치가 전송하려는 심벌을 위상 회전시켜 상기 제1 송신 신호를 생성한다.
상기 채널 상태 정보는 위상
Figure 112009002384178-pat00021
의 값을 포함하고, 상기 선처리 행렬
Figure 112009002384178-pat00022
는 수학식
Figure 112009002384178-pat00023
으로 산출되며(상기
Figure 112009002384178-pat00024
은 크기가 n인 단위 행렬), 상기 위상
Figure 112009002384178-pat00025
의 값은 유효 채널 행렬
Figure 112009002384178-pat00026
와 상기 선처리 행렬
Figure 112009002384178-pat00027
의 곱행렬
Figure 112009002384178-pat00028
의 프로 비니어스 놈(Frobenius norm)을 최대화하도록 결정될 수 있다.
상기 채널 상태 정보는 한 개의 비트 정보를 포함하고, 상기 선처리 행렬
Figure 112009002384178-pat00029
는 수학식
Figure 112009002384178-pat00030
으로 산출되며(상기
Figure 112009002384178-pat00031
은 크기가 n인 단위 행렬), 상기 한 개의 비트 정보에 따라 미리 정해져 있는 두 값 중 어느 하나가 상기
Figure 112009002384178-pat00032
의 값으로 결정될 수 있다.
본 발명의 다른 실시예에 따른 다중 입출력 시스템의 선처리 방법은, 수신 장치로부터 수신한 채널 상태 정보를 이용하여 선처리 행렬
Figure 112009002384178-pat00033
를 계산하는 단계, 상기 선처리 행렬
Figure 112009002384178-pat00034
를 이용하여 심벌
Figure 112009002384178-pat00035
을 위상 회전시켜 제1 송신 신호
Figure 112009002384178-pat00036
를 생성하는 단계, 상기 제1 송신 신호
Figure 112009002384178-pat00037
를 복수의 송신 안테나를 통하여 전송하는 단계, 그리고 상기 제1 송신 신호
Figure 112009002384178-pat00038
에 공액 연산을 수행하여 얻은 제2 송신 신호를 상기 복수의 송신 안테나를 통하여 전송하는 단계를 포함한다.
이와 같이 본 발명에 의하면 낮은 연산 복잡도와 적은 양의 피드백 정보를 가지면서도 심벌 단위의 최대 우도 복호화가 가능하며, 최대 다이버시티 이득과 최대 데이터 전송량을 얻을 수 있는 등 다중 입출력 시스템의 성능을 향상시킬 수 있다.
그러면 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다.
이하 보통 문자는 스칼라를, 볼드체 소문자는 벡터를, 볼드체 대문자는 행렬을 나타내는 것으로 한다. 그리고 복소 변수에 대하여는 변수 상단에 바(bar)를 붙여 표현하고,
Figure 112009002384178-pat00039
는 복소 변수
Figure 112009002384178-pat00040
의 실수부를,
Figure 112009002384178-pat00041
는 전치(transpose)를,
Figure 112009002384178-pat00042
는 공액 복소수(complex conjugate)를 나타내는 것으로 한다.
먼저, 도 1을 참고하여 본 발명의 실시예에 따른 다중 입출력 시스템의 선처리 장치가 포함되어 있는 송신 장치에 대하여 상세하게 설명한다.
도 1은 본 발명의 실시예에 따른 다중 입출력 시스템의 송신 장치를 설명하기 위한 블록도이다.
본 발명의 실시예에 따른 송신 장치는 차례로 연결되어 있는 비트 변환부(110), 두 개의 매핑부(120, 125), 제1 선처리부(130), 제2 선처리부(140) 및 네 개의 송신 안테나(151, 152, 153, 154)와 제1 선처리부(130)에 연결되어 있는 피드백 처리부(160)를 포함한다. 본 발명의 실시예에 따른 선처리 장치는 좁은 의미로 제1 및 제2 선처리부(130, 140)와 피드백 처리부(160)를 포함하지만 넓은 의미로 비트 변환부(110) 및 매핑부(120, 125)를 더 포함할 수 있다. 한편, 네 개의 송신 안테나(151, 152, 153, 154)와 두 개의 매핑부(120, 125)가 존재하는 것으로 도 1에 도시하였으나, 본 발명은 이에 한정되지 않고 실시예에 따라 송신 안테나의 수 효는 증가할 수 있으며, 이에 따라 매핑부의 수효도 증가할 수 있다. 여기서 송신 안테나의 수효는 매핑부의 수효의 두 배가 되도록 구현된다.
비트 변환부(110)는 직렬로 입력되는 비트 스트림(bit stream)을 매핑부(120, 125)의 수효에 따라 복수의 병렬 스트림으로 변환하여 해당 매핑부(120, 125)에 제공한다. 각 병렬 스트림은 직렬 비트 스트림을 매핑부(120, 125)의 변조 레벨(modulation level)에 대응하는 일정 비트수만큼씩 잘라서 생성된다. 여기서 변조 레벨은 매핑부(120, 125)에서 이용되는 변조 방식에 따라 결정된다.
매핑부(120, 125)는 직교 진폭 변조(Quadrature Amplitude Modulation, QAM) 방식을 이용하여 비트 변환부(110)로부터 제공받은 병렬 비트 스트림을 복소수 형태의 데이터 심벌로 변환한다. 매핑부(120, 125)는 변조 레벨에 따라 16-직교 진폭 변조 방식을 이용하면 비트 스트림을 4비트 단위로 하여 데이터 심벌로 변환하고, 4-직교 진폭 변조 방식을 이용하면 비트 스트림을 2비트 단위로 하여 데이터 심벌로 변환할 수 있다. 물론 매핑부(120, 125)는 직교 진폭 변조 방식이 아니라 직교 위상 편이 변조(Quadrature Phase Shift Keying, QPSK) 등의 다른 변조 방식을 이용할 수도 있다. 매핑부(120)는 데이터 심벌
Figure 112009002384178-pat00043
를 생성하고, 매핑부(125)는 데이터 심벌
Figure 112009002384178-pat00044
를 생성한다.
제1 선처리부(130)는 매핑부(120, 125)로부터 제공받은 데이터 심벌
Figure 112009002384178-pat00045
Figure 112009002384178-pat00046
와 선처리 행렬을 곱하여 제1 송신 신호
Figure 112009002384178-pat00047
,
Figure 112009002384178-pat00048
,
Figure 112009002384178-pat00049
Figure 112009002384178-pat00050
를 생성한다. 제1 선처리부(130)는 데이터 심벌
Figure 112009002384178-pat00051
Figure 112009002384178-pat00052
을 위상 회전시켜 채널을 직교화하고 채널 을 통합하는 절차를 통해 수신 장치(도시하지 않음)에서 복호화를 간단하게 수행할 수 있도록 하며 최대 부호화 이득을 얻을 수 있도록 한다.
제2 선처리부(140)는 제1 송신 신호
Figure 112009002384178-pat00053
,
Figure 112009002384178-pat00054
,
Figure 112009002384178-pat00055
Figure 112009002384178-pat00056
와 제1 송신 신호
Figure 112009002384178-pat00057
,
Figure 112009002384178-pat00058
,
Figure 112009002384178-pat00059
Figure 112009002384178-pat00060
에 적절한 연산을 수행하여 얻은 제2 송신 신호를 차례로 송신 안테나(151, 152, 153, 154)를 통하여 전송한다.
피드백 처리부(160)는 수신 장치로부터 수신한 채널 상태 정보(Channel State Information, CSI)를 이용하여 선처리 행렬을 계산하고 이를 제1 선처리부(130)에 제공한다.
본 발명의 실시예에 따른 다중 입출력 시스템의 수신 장치는 적어도 하나의 수신 안테나(도시하지 않음), 복호부(도시하지 않음) 및 피드백 정보 생성부를 포함한다. 수신 장치는 송신 장치와 달리 하나의 수신 안테나만 있어도 동작하는 데 있어서 문제되지 않는다. 수신 안테나는 송신 장치의 송신 안테나(151, 152, 153, 154)로부터 신호를 수신한다. 복호부는 전송 받은 신호에 대하여 적절한 신호 처리 과정을 거쳐 송신 장치가 전송하려는 심벌을 추출해낸다. 피드백 정보 생성부는 송신 장치로부터 전송받은 신호에 기초하여 채널 환경을 측정하고 이로부터 채널 상태 정보를 추출하며 이를 송신 장치의 피드백 처리부(160)로 전송한다.
그러면 본 발명에 따라 선처리가 적용된 다중 입출력 시스템의 신호 처리에 대하여 보다 상세하게 설명한다. 이하
Figure 112009002384178-pat00061
는 송신 안테나의 수효를,
Figure 112009002384178-pat00062
은 수신 안테나의 수효를 나타내며, 앞서 설명한 것처럼 송신 안테나의 수효는 4(
Figure 112009002384178-pat00063
) 로 가정한다. 그러면 두 개의 알라무티 부호(Alamouti codes)가 시공간 블록 부호(Space-Time Block Codes, STBC) 시스템에 적용되고, 각 블록(block)은 두 개의 송신 안테나에 대응된다.
Figure 112009002384178-pat00064
Figure 112009002384178-pat00065
부호 워드 행렬(codeword matrix)
Figure 112009002384178-pat00066
는 [수학식 1]과 같이 표현되며, (i, j)의 원소는 i 번째 시간에 j 번째 송신 안테나로부터 전송되는 신호를 나타내고,
Figure 112009002384178-pat00067
는 시공간 블록 부호의 블록 크기(block size)를 나타낸다.
Figure 112009002384178-pat00068
(i+1) 번째 시간에 수신된 신호에 공액 연산을 적용하면,
Figure 112009002384178-pat00069
Figure 112009002384178-pat00070
유효 채널 행렬(effective channel matrix)
Figure 112009002384178-pat00071
는 [수학식 2]와 같이 표현된다.
Figure 112009002384178-pat00072
여기서
Figure 112009002384178-pat00073
Figure 112009002384178-pat00074
로 정의되며,
Figure 112009002384178-pat00075
는 j 번째 송신 안테나로부터 i 번째 수신 안테나까지의 경로 이득(path gain)을 나타낸다. 그리고
Figure 112009002384178-pat00076
Figure 112009002384178-pat00077
는 각각 유효 채널 행렬
Figure 112009002384178-pat00078
의 첫 번째 및 두 번째 열벡터(column vector)와 세 번째 및 네 번째 열벡터로 이루어지는 행렬을 나타낸다.
[수학식 1]의 부호(code)에 기초한 본 발명의 다중 입출력 시스템은 [수학식 3]과 같이 모델링될 수 있다.
Figure 112009002384178-pat00079
Figure 112009002384178-pat00080
는 수신 장치가 수신하는 신호이며,
Figure 112009002384178-pat00081
은 크기
Figure 112009002384178-pat00082
인 잡음 복소 열벡터(noise complex column vector)를 나타내고,
Figure 112009002384178-pat00083
는 송신 장치가 전송하려는 복소 송신 신호 벡터이며
Figure 112009002384178-pat00084
를 나타낸다.
여기서 4차원의 제1 송신 신호 벡터
Figure 112009002384178-pat00085
는 [수학식 4]와 같이 데이터 심벌 벡터
Figure 112009002384178-pat00086
와 선처리 행렬
Figure 112009002384178-pat00087
를 곱하여 계산되며, 데이터 심벌 벡터
Figure 112009002384178-pat00088
Figure 112009002384178-pat00089
를 나타낸다. 즉, 제1 선처리부(130)는 [수학식 4]에 따라 제1 송신 신호 벡터
Figure 112009002384178-pat00090
를 구하여 제2 선처리부(140)에 전달하고, 제2 선처리부(140)는 제1 송신 신호 벡터
Figure 112009002384178-pat00091
를 송신 안테나(151, 152, 153, 154)를 통하여 전송하고, 이어 제1 송신 신호 벡터
Figure 112009002384178-pat00092
에 공액 연산, 마이너스 연산 및 공간적으로 위치를 바꾸는 연산을 수행하여 얻은 제2 송신 신호([수학식 1]에서
Figure 112009002384178-pat00093
의 두 번째 행)를 송신 안테나(151, 152, 153, 154)를 통하여 전송한다.
Figure 112009002384178-pat00094
여기서
Figure 112009002384178-pat00095
는 크기 n인 단위 행렬(identity matrix)을 나타내고,
Figure 112009002384178-pat00096
는 위상(phase)을 나타낸다.
[수학식 3]과 [수학식 4]로부터 수신 신호
Figure 112009002384178-pat00097
는 [수학식 5]와 같이 나타낼 수 있다.
Figure 112009002384178-pat00098
여기서 행렬
Figure 112009002384178-pat00099
는 [수학식 6]과 같이 나타낼 수 있다.
Figure 112009002384178-pat00100
[수학식 6]에서 행렬
Figure 112009002384178-pat00101
의 마지막 표현에 의하면 위상
Figure 112009002384178-pat00102
와는 무관하게 새로운 알라무티 부호를 얻을 수 있음을 알 수 있다.
위상
Figure 112009002384178-pat00103
는 부호 이득(coding gain)을 향상시키는 데 이용되며, 위상
Figure 112009002384178-pat00104
의 관점에서 보면 전체적인 시스템 성능은 행렬
Figure 112009002384178-pat00105
의 프로비니어스 놈(Frobenius norm)에 달려있다. 따라서 시스템 성능을 향상시키기 위해서는 행렬
Figure 112009002384178-pat00106
의 프로비니어스 놈을 최대화하는 것이 필요하며, 행렬
Figure 112009002384178-pat00107
의 프로비니어스 놈은 [수학식 7]과 같이 정의된다.
Figure 112009002384178-pat00108
여기서
Figure 112009002384178-pat00109
은 행렬의 트레이스(trace)를 나타내며,
Figure 112009002384178-pat00110
는 행렬의 복소 공액 전치(complex conjugate transpose)를 나타낸다.
행렬
Figure 112009002384178-pat00111
의 프로비니어스 놈을 최대화하는 위상
Figure 112009002384178-pat00112
를 계산하기 위해, 위상
Figure 112009002384178-pat00113
에 대하여 [수학식 7]을 미분(differentiation)하면
Figure 112009002384178-pat00114
의 1차 및 2차 도함수(derivative)는 [수학식 8]과 같다.
Figure 112009002384178-pat00115
여기서
Figure 112009002384178-pat00116
Figure 112009002384178-pat00117
을 나타내며,
Figure 112009002384178-pat00118
Figure 112009002384178-pat00119
를 나타낸다.
Figure 112009002384178-pat00120
는 0이고
Figure 112009002384178-pat00121
는 0보다 작은 조건을 이용하여 [수학식 8]을 풀어보면, 최적의 위상
Figure 112009002384178-pat00122
는 [수학식 9]와 같이 산출된다.
Figure 112009002384178-pat00123
따라서 최적의 위상
Figure 112009002384178-pat00124
를 행렬
Figure 112009002384178-pat00125
에 적용할 때, 행렬
Figure 112009002384178-pat00126
의 프로비니어스 놈은 최대화된다. 한편 위상
Figure 112009002384178-pat00127
Figure 112009002384178-pat00128
로 하여(
Figure 112009002384178-pat00129
) 행렬
Figure 112009002384178-pat00130
에 적용하면 행렬
Figure 112009002384178-pat00131
의 프로비니어스 놈은 최소화된다. [수학식 9]의 결과로부터, 두 개의 알라무티 부호를 단지 하나의 위상값
Figure 112009002384178-pat00132
가 적용된 행렬
Figure 112009002384178-pat00133
에 의해 프로비니어스 놈을 최대화하는 하나의 알라무티 부호로 결합하는 것이 가능함을 알 수 있다.
실수 값 형태(real-valued representation)를 이용하면 복소 직교 부 호(complex orthogonal codes)의 I-채널(in-phase) 및 Q-채널(quadrature) 성분 각각에 대하여 간단한 최대 우도 복호(simple maximum likelihood decoding)가 적용될 수 있다. [수학식 3]의 시스템 모델을 실수 값 형태로 표현하면 [수학식 10]과 같이 나타낼 수 있다.
Figure 112009002384178-pat00134
여기서
Figure 112009002384178-pat00135
는 복소 변수의 I-채널 성분을,
Figure 112009002384178-pat00136
는 복소 변수의 Q-채널 성분을 나타내며, 행렬
Figure 112009002384178-pat00137
는 행렬
Figure 112009002384178-pat00138
의 실수 값 형태를 나타내고 [수학식 11]과 같다.
Figure 112009002384178-pat00139
여기서
Figure 112009002384178-pat00140
는 행렬
Figure 112009002384178-pat00141
의 i 번째 열벡터를 나타낸다.
행렬
Figure 112009002384178-pat00142
의 모든 열은 서로 직교하기 때문에, 간단한 최대 우도 복호를 통해 데이터 심벌 벡터
Figure 112009002384178-pat00143
를 [수학식 12]와 같이 추정할 수 있으며, 데이터 심벌 벡터
Figure 112009002384178-pat00144
Figure 112009002384178-pat00145
를 나타낸다.
Figure 112009002384178-pat00146
여기서
Figure 112009002384178-pat00147
Figure 112009002384178-pat00148
를 나타내며,
Figure 112009002384178-pat00149
는 심벌당 비트 수 를 나타내고,
Figure 112009002384178-pat00150
Figure 112009002384178-pat00151
을 나타낸다. 그리고 [수학식 12]와 같이 간단한 최대 우도 복호를 통해 데이터 심벌 벡터
Figure 112009002384178-pat00152
를 추정하는 것은 위상
Figure 112009002384178-pat00153
의 값에 관계없이 수행되는 것을 알 수 있다.
지금까지 설명한 본 발명에 따른 선처리가 적용된 다중 입출력 시스템은 복호 지연(decoding delay) 관점에서 장점을 가지고 있다. 수신 장치의 복호 과정은 하나의 블록 내의 모든 심벌이 전송되기 전에는 수행될 수 없기 때문에, 긴 블록 크기
Figure 112009002384178-pat00154
는 긴 복호 지연을 가져온다. 따라서 실제 환경에서는 블록 크기
Figure 112009002384178-pat00155
가 짧은 것이 더 합리적이다. 블록 크기
Figure 112009002384178-pat00156
가 4인 다른 폐루프 준 직교 시공간 블록 부호(Quasi Orthogonal-STBC, QO-STBC) 방법(이하, Q0-STBC 방법이라 함)과는 달리, 본 발명에 따른 선처리가 적용된 다중 입출력 시스템은 블록 크기
Figure 112009002384178-pat00157
가 2이기 때문에 복호 지연이 짧은 장점이 있다.
그러면, 제한된 피드백 시스템에서 피드백되는 위상의 양자화 효과(quantization effect)에 대해 설명한다. 시뮬레이션 결과로부터 위상
Figure 112009002384178-pat00158
Figure 112009002384178-pat00159
의 범위에서 균등 분포(uniform distribution)를 가진다는 것을 알 수 있다. 따라서, 피드백되는 정보를 1비트로 하기 위해, 양자화된 위상
Figure 112009002384178-pat00160
의 값은 위상
Figure 112009002384178-pat00161
의 값이 0보다 같거나 크면
Figure 112009002384178-pat00162
로 선택하고, 위상
Figure 112009002384178-pat00163
의 값이 0보다 작으면
Figure 112009002384178-pat00164
로 선택할 수 있다. 물론,
Figure 112009002384178-pat00165
Figure 112009002384178-pat00166
대신에 상기 범위 내에 존재하며 서로 부호(sign)가 반대이고 동일한 절대값을 가지는 두 값을 양자화된 위상
Figure 112009002384178-pat00167
의 값으 로 이용할 수도 있다.
양자화된 위상
Figure 112009002384178-pat00168
의 값은 위상
Figure 112009002384178-pat00169
의 부호에 따라 선택되기 때문에, 1비트 피드백 정보를 결정하기 위해 [수학식 13]과 같은 간단한 선택 메트릭(selection metric)을 얻을 수 있다. [수학식 9]로부터, 위상
Figure 112009002384178-pat00170
의 부호는 편각(argument)
Figure 112009002384178-pat00171
의 부호와 동일함을 알 수 있다. 편각의 분자(numerator)
Figure 112009002384178-pat00172
는 항상 양수이기 때문에, 위상
Figure 112009002384178-pat00173
의 부호는
Figure 112009002384178-pat00174
의 부호에 따라 결정된다. 따라서 피드백되는 정보를 1비트로 하기 위해, 양자화된 위상
Figure 112009002384178-pat00175
의 값은 [수학식 13]과 같이 간단하게 선택할 수 있다.
Figure 112009002384178-pat00176
송신 장치의 피드백 처리부(160)는 수신 장치로부터 채널 상태 정보로서 위상
Figure 112009002384178-pat00177
의 값을 수신하고 이 값을 이용하여 [수학식 4]에 따라 선처리 행렬
Figure 112009002384178-pat00178
를 계산하고, 이를 제1 선처리부(130)에 제공한다. 한편 위상
Figure 112009002384178-pat00179
의 값 대신 한 개 비트 정보를 이용하여 선처리 행렬
Figure 112009002384178-pat00180
를 계산할 수도 있다. [수학식 13]에서
Figure 112009002384178-pat00181
의 부호에 따라 양자화된 위상
Figure 112009002384178-pat00182
의 값이 결정되기 때문에, 수신 장치는 송신 장치로 위상
Figure 112009002384178-pat00183
의 값을 피드백하는 대신에 한 개의 비트 정보를 피드백하고, 피드백 처리 부(160)는 해당 비트 정보에 따라
Figure 112009002384178-pat00184
의 범위 내에서 위상
Figure 112009002384178-pat00185
의 값을 결정하고, 이를 이용하여 선처리 행렬
Figure 112009002384178-pat00186
를 계산하면 된다. 예를 들어, 비트 정보가 '1'이면 위상
Figure 112009002384178-pat00187
의 값으로
Figure 112009002384178-pat00188
를 결정하고, 비트 정보가 '0'이면 위상
Figure 112009002384178-pat00189
의 값으로
Figure 112009002384178-pat00190
를 결정할 수 있다.
이와 달리 피드백 처리부(160)는 채널 상태 정보로서 채널 행렬 자체를 수신하고 이를 이용하여 연산 처리를 수행함으로써 선처리 행렬
Figure 112009002384178-pat00191
를 계산하고, 이를 제1 선처리부(130)에 제공할 수도 있으며, 수신 장치로부터 채널 행렬과는 직접 관련이 없는 데이터 스트림을 받아 이로부터 채널 행렬을 추출하고 채널 행렬을 이용하여 연산 처리를 수행함으로써 선처리 행렬
Figure 112009002384178-pat00192
를 계산할 수도 있다.
이와 같이 수신 장치에서 측정한 채널 환경을 바탕으로 최적의 위상 피드백 정보를 산출하여 송신 장치로 전송하고, 송신 장치에서는 이 피드백 정보를 바탕으로 선처리 행렬
Figure 112009002384178-pat00193
를 구하여 채널을 직교화하도록 피드백된 위상만큼 심벌을 회전시키고 채널 일부를 다른 채널과 통합함으로써 알라무티 코드의 효과를 가져올 수 있으며 이와 동시에 수신 안테나가 1개일 경우에도 잘 동작하도록 할 수 있다. 또한 수신 장치에서는 제1 및 제2 선처리부(130, 140)에 의해 재구성된 채널을 통해 전송된 전송 심벌들을 심벌 단위로 최대 우도 복호하여 복호화를 단순화할 수 있고 동시에 최대 다이버시티 이득과 최대 전송량을 가져올 수 있게 되며, 수신 장치도 간단하게 구현할 수 있다.
본 발명에 따른 선처리가 적용된 다중 입출력 시스템은 하나의 위상과 1비트 피드백 정보를 적용하면서도 간단한 최대 우도 복호가 가능하다. 반면에, QO-STBC 방법에서는 유효 채널의 열 사이의 직교성을 획득하기 위해 위상
Figure 112009002384178-pat00194
의 값이 피드백되어야 한다. 그러나 위상
Figure 112009002384178-pat00195
의 값을 비트 레졸루션(bit resolution) 단위로 양자화하여 송신 장치로 피드백하는 실제 환경에서는 피드백 정보량이 제한되어 있기 때문에, 양자화된 위상
Figure 112009002384178-pat00196
의 값으로는 채널을 완벽하게 직교화할 수 없는 문제가 있다. 따라서 QO-STBC 방법에서는 피드백되는 정보를 1비트로 하면 직교성을 획득하지 못하게 되고, 조인트 최대 우도 복호(joint ML decoding) 방법을 이용하여야 한다. 그러나 조인트 최대 우도 복호 방법은 높은 복잡도를 가지기 때문에, QO-STBC 방법에서 피드백되는 정보를 1비트로 하기 위해서는 차선책으로 MMSE(Minimum Mean Square Error) 선형 등화기(linear equalizer)가 수신 장치에 적용되어야 한다.
그러면 준 정적 평탄 페이딩 채널(quasi-static flat fading channels) 환경에서 본 발명에 따른 선처리가 적용된 다중 입출력 시스템의 성능을 시뮬레이션한 결과에 대하여 도 2 및 도 3을 참고하여 설명한다.
도 2는 하나의 위상을 피드백하는 경우 본 발명의 실시예에 따른 시스템과 QO-STBC 방법이 적용된 시스템의 성능을 비교하기 위한 그래프이고, 도 3은 1비트 정보를 피드백하는 경우 본 발명의 실시예에 따른 시스템과 QO-STBC 방법이 적용된 시스템의 성능을 비교하기 위한 그래프이다.
도 2에 도시한 그래프는 하나의 위상
Figure 112009002384178-pat00197
를 피드백하는 시스템의 성능을 나타내는 그래프로서 가로축은 신호대 잡음비(Signal-to-Noise Ratio, SNR)이고, 세로축은 비트 에러율(Bit Error Rate, BER)이다. 4-직교 진폭 변조 방식을 사용하고 송신 안테나의 수효는 4(
Figure 112009002384178-pat00198
)이며 수신 안테나의 수효는 1(
Figure 112009002384178-pat00199
)인 경우, 개루프 QO-STBC 방법이 적용된 시스템은 곡선 ①과 같은 성능을 가지고, 폐루프 QO-STBC 방법이 적용된 시스템은 곡선 ②와 같은 성능을 가지며, 본 발명에 따른 선처리가 적용된 다중 입출력 시스템은 곡선 ③과 같은 성능을 가진다. 따라서 본 발명에 의하면 비트 에러율이
Figure 112009002384178-pat00200
일 때 신호대 잡음비는 폐루프 QO-STBC 방법에 비하여 대략 2dB 개선됨을 알 수 있다.
도 3에 도시한 그래프는 위상으로 1비트 정보를 피드백하는 시스템의 성능을 나타내는 그래프로서 가로축은 신호대 잡음비이고, 세로축은 비트 에러율이다. 16-직교 진폭 변조 방식을 사용하고 송신 안테나의 수효는 4(
Figure 112009002384178-pat00201
)이며 수신 안테나의 수효는 1(
Figure 112009002384178-pat00202
)인 경우, 개루프 QO-STBC 방법이 적용된 시스템은 곡선 ①과 같은 성능을 가지고, 폐루프 QO-STBC 방법이 적용된 시스템은 곡선 ②와 같은 성능을 가지며, 본 발명에 따른 선처리가 적용된 다중 입출력 시스템은 곡선 ③과 같은 성능을 가진다. 따라서 본 발명에 의하면 비트 에러율이
Figure 112009002384178-pat00203
일 때 신호대 잡음비는 폐루프 QO-STBC 방법에 비하여 1.5dB 개선됨을 알 수 있다.
시뮬레이션 결과, 피드백 정보량이 제한되는 현실적인 환경에서 최적의 위상 피드백 정보를 필요로 하는 기법(폐루프 QO-STBC 방법)에 비하여 본 발명의 선처리 가 적용된 다중 입출력 시스템은 1비트의 피드백 정보만으로도 양자화 오류로 인한 성능 열화가 적다는 것을 알 수 있다.
그러면, 도 4를 참고하여 본 발명의 실시예에 따른 다중 입출력 시스템의 선처리 방법에 대해 설명한다.
도 4는 본 발명의 실시예에 따른 다중 입출력 시스템의 선처리 방법을 설명하기 위한 흐름도이다.
먼저 본 발명의 실시예에 따른 송신 장치는 직렬로 입력되는 비트 스트림을 변조 레벨에 기초하여 복수의 병렬 비트 스트림으로 변환한다(S510). 그런 후 송신 장치는 직교 진폭 변조 방식을 이용하여 병렬 비트 스트림을 복소수 형태의 데이터 심벌로 변환하여(S520) 데이터 심벌
Figure 112009002384178-pat00204
Figure 112009002384178-pat00205
를 생성한다. 물론 송신 장치는 직교 진폭 변조 방식이 아니라 직교 위상 편이 변조 등의 다른 변조 방식을 이용할 수도 있다.
송신 장치는 수신 장치로부터 전송받은 채널 상태 정보를 이용하여 선처리 행렬
Figure 112009002384178-pat00206
를 계산한다(S530). 채널 상태 정보는 위상
Figure 112009002384178-pat00207
의 값이거나 위상
Figure 112009002384178-pat00208
의 값을 대신하는 한 개의 비트 정보일 수 있다.
다음으로 송신 장치는 선처리 행렬
Figure 112009002384178-pat00209
과 데이터 심벌
Figure 112009002384178-pat00210
Figure 112009002384178-pat00211
를 곱하여 제1 송신 신호
Figure 112009002384178-pat00212
,
Figure 112009002384178-pat00213
,
Figure 112009002384178-pat00214
Figure 112009002384178-pat00215
를 생성한다(S540). 그리고 송신 장치는 제1 송신 신호
Figure 112009002384178-pat00216
,
Figure 112009002384178-pat00217
,
Figure 112009002384178-pat00218
Figure 112009002384178-pat00219
에 공액 연산, 마이너스 연산 및 공간적으로 위치를 바꾸는 연산을 수행하여 제2 송신 신호를 계산한다(S550).
그런 후 송신 장치는 최종적으로 연산 처리된 제1 및 제2 송신 신호를 송신 안테나(151, 152, 153, 154)를 통해 차례로 전송한다(S560). 그러면 수신 장치는 수신한 신호를 복호화하여 비트 스트림으로 변환하는 등 적절한 동작을 수행하고, 채널 환경을 측정하여 채널 행렬에 기초한 채널 상태 정보를 생성하고 이를 송신 장치로 전송한다.
설명의 편의를 위하여 단계(S520) 이후에 선처리 행렬
Figure 112009002384178-pat00220
이 계산되는 것으로 도 4에 도시하였지만 단계(S530)는 단계(S510) 및 단계(S520)와 별도로 수행될 수 있으며 단계(S540) 이전에 수행되면 된다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
도 1은 본 발명의 실시예에 따른 다중 입출력 시스템의 송신 장치를 설명하기 위한 블록도이다.
도 2는 하나의 위상을 피드백하는 경우 본 발명의 실시예에 따른 시스템과 QO-STBC 방법이 적용된 시스템의 성능을 비교하기 위한 그래프이다.
도 3은 1비트 정보를 피드백하는 경우 본 발명의 실시예에 따른 시스템과 QO-STBC 방법이 적용된 시스템의 성능을 비교하기 위한 그래프이다.
도 4는 본 발명의 실시예에 따른 다중 입출력 시스템의 선처리 방법을 설명하기 위한 흐름도이다.
<도면의 주요 부분에 대한 부호의 설명>
110: 비트 변환부, 120, 125: 매핑부,
130: 제1 선처리부, 140: 제2 선처리부,
151, 152, 153, 154: 송신 안테나, 160: 피드백 처리부

Claims (19)

  1. 수신 장치로부터 수신한 채널 상태 정보를 이용하여 선처리 행렬
    Figure 112009002384178-pat00221
    를 계산하는 피드백 처리부,
    상기 피드백 처리부로부터의 상기 선처리 행렬
    Figure 112009002384178-pat00222
    를 이용하여 심벌
    Figure 112009002384178-pat00223
    을 위상 회전시켜 제1 송신 신호
    Figure 112009002384178-pat00224
    를 생성하는 제1 선처리부, 그리고
    상기 제1 선처리부로부터의 상기 제1 송신 신호
    Figure 112009002384178-pat00225
    를 복수의 송신 안테나를 통하여 전송하고, 상기 제1 송신 신호
    Figure 112009002384178-pat00226
    에 공액 연산을 수행하여 얻은 제2 송신 신호를 상기 복수의 송신 안테나를 통하여 전송하는 제2 선처리부
    를 포함하는 선처리 장치.
  2. 제1항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00227
    의 수효는 상기 심벌
    Figure 112009002384178-pat00228
    의 수효의 두 배인 선처리 장치.
  3. 제1항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00229
    는 수학식
    Figure 112009002384178-pat00230
    에 의하여 산 출되고, 상기
    Figure 112009002384178-pat00231
    는 상기 채널 상태 정보로부터 결정되며, 상기
    Figure 112009002384178-pat00232
    은 크기가 n인 단위 행렬인 선처리 장치.
  4. 제3항에서,
    상기 채널 상태 정보는 한 개의 비트 정보를 포함하며, 상기 한 개의 비트 정보에 따라 미리 정해져 있는 두 값 중 어느 하나가 상기
    Figure 112009002384178-pat00233
    의 값으로 결정되는 선처리 장치.
  5. 제4항에서,
    상기 미리 정해져 있는 두 값은
    Figure 112009002384178-pat00234
    의 범위 내에 존재하며, 상기 미리 정해져 있는 두 값은 서로 부호가 반대이고 동일한 절대값을 가지는 선처리 장치.
  6. 제3항에서,
    상기 위상
    Figure 112009002384178-pat00235
    의 값은 유효 채널 행렬
    Figure 112009002384178-pat00236
    와 상기 선처리 행렬
    Figure 112009002384178-pat00237
    의 곱행렬
    Figure 112009002384178-pat00238
    의 프로비니어스 놈(Frobenius norm)을 최대화하도록 결정되는 선처리 장치.
  7. 제1항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00239
    에 대하여 상기 제2 송신 신호는
    Figure 112009002384178-pat00240
    로 계산되는 선처리 장치.
  8. 복수의 송신 안테나를 포함하는 송신 장치로부터 전송된 제1 송신 신호 및 상기 제1 송신 신호에 대하여 공액 연산 처리된 제2 송신 신호를 차례로 수신하는 적어도 하나의 수신 안테나,
    상기 수신 안테나에서 수신한 신호에 대하여 심벌 단위로 최대 우도 복호화하는 복호부, 그리고
    상기 수신 안테나에서 수신한 신호로부터 채널 상태 정보를 추출하여 상기 송신 장치로 전송하는 피드백 정보 생성부
    를 포함하며,
    상기 송신 장치는 상기 채널 상태 정보를 이용하여 선처리 행렬을 계산하고 상기 선처리 행렬을 이용하여 상기 송신 장치가 전송하려는 심벌을 위상 회전시켜 상기 제1 송신 신호를 생성하는
    수신 장치.
  9. 제8항에서,
    상기 채널 상태 정보는 위상
    Figure 112009002384178-pat00241
    의 값을 포함하고, 상기 선처리 행렬
    Figure 112009002384178-pat00242
    는 수학식
    Figure 112009002384178-pat00243
    으로 산출되며(상기
    Figure 112009002384178-pat00244
    은 크기가 n인 단위 행렬), 상기 위상
    Figure 112009002384178-pat00245
    의 값은 유효 채널 행렬
    Figure 112009002384178-pat00246
    와 상기 선처리 행렬
    Figure 112009002384178-pat00247
    의 곱행렬
    Figure 112009002384178-pat00248
    의 프로비니어스 놈(Frobenius norm)을 최대화하도록 결정되는 수신 장치.
  10. 제8항에서,
    상기 채널 상태 정보는 한 개의 비트 정보를 포함하고, 상기 선처리 행렬
    Figure 112009002384178-pat00249
    는 수학식
    Figure 112009002384178-pat00250
    으로 산출되며(상기
    Figure 112009002384178-pat00251
    은 크기가 n인 단위 행렬), 상기 한 개의 비트 정보에 따라 미리 정해져 있는 두 값 중 어느 하나가 상기
    Figure 112009002384178-pat00252
    의 값으로 결정되는 수신 장치.
  11. 제10항에서,
    상기 미리 정해져 있는 두 값은
    Figure 112009002384178-pat00253
    의 범위 내에 존재하며, 상기 미리 정해져 있는 두 값은 서로 부호가 반대이고 동일한 절대값을 가지는 수신 장치.
  12. 제8항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00254
    에 대하여 상기 제2 송신 신호는
    Figure 112009002384178-pat00255
    인 수신 장치.
  13. 수신 장치로부터 수신한 채널 상태 정보를 이용하여 선처리 행렬
    Figure 112009002384178-pat00256
    를 계산하는 단계,
    상기 선처리 행렬
    Figure 112009002384178-pat00257
    를 이용하여 심벌
    Figure 112009002384178-pat00258
    을 위상 회전시켜 제1 송신 신호
    Figure 112009002384178-pat00259
    를 생성하는 단계,
    상기 제1 송신 신호
    Figure 112009002384178-pat00260
    를 복수의 송신 안테나를 통하여 전송하는 단계, 그리고
    상기 제1 송신 신호
    Figure 112009002384178-pat00261
    에 공액 연산을 수행하여 얻은 제2 송신 신호를 상기 복수의 송신 안테나를 통하여 전송하는 단계
    를 포함하는 선처리 방법.
  14. 제13항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00262
    의 수효는 상기 심벌
    Figure 112009002384178-pat00263
    의 수효의 두 배인 선처리 방법.
  15. 제13항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00264
    는 수학식
    Figure 112009002384178-pat00265
    에 의하여 산출되고, 상기
    Figure 112009002384178-pat00266
    는 상기 채널 상태 정보로부터 결정되며, 상기
    Figure 112009002384178-pat00267
    은 크기가 n인 단위 행렬인 선처리 방법.
  16. 제15항에서,
    상기 채널 상태 정보는 한 개의 비트 정보를 포함하며, 상기 한 개의 비트 정보에 따라 미리 정해져 있는 두 값 중 어느 하나가 상기
    Figure 112009002384178-pat00268
    의 값으로 결정되는 선처리 방법.
  17. 제16항에서,
    상기 미리 정해져 있는 두 값은
    Figure 112009002384178-pat00269
    의 범위 내에 존재하며, 상기 미리 정해져 있는 두 값은 서로 부호가 반대이고 동일한 절대값을 가지는 선처리 방법.
  18. 제15항에서,
    상기 위상
    Figure 112009002384178-pat00270
    의 값은 유효 채널 행렬
    Figure 112009002384178-pat00271
    와 상기 선처리 행렬
    Figure 112009002384178-pat00272
    의 곱행렬
    Figure 112009002384178-pat00273
    의 프로비니어스 놈(Frobenius norm)을 최대화하도록 결정되는 선처리 방법.
  19. 제13항에서,
    상기 제1 송신 신호
    Figure 112009002384178-pat00274
    에 대하여 상기 제2 송신 신호는
    Figure 112009002384178-pat00275
    로 계산되는 선처리 방법.
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