KR100754948B1 - 직교 주파수 분할 다중화 신호의 동기화 장치 - Google Patents

직교 주파수 분할 다중화 신호의 동기화 장치 Download PDF

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Abstract

본 발명은 직교 주파수 분할 다중화 신호의 동기화 장치에 관한 것으로, 특히 OFDM 신호의 검출 여부에 따라 OFDM 수신기에서의 주파수 오프셋의 보정 및 심볼 타이밍을 추정하도록 한 직교 주파수 분할 다중화 신호의 동기화 장치에 관한 것이다.
또한, OFDM 신호를 디지털 신호로 변환하는 ADC, 상기 ADC에서 출력되는 OFDM 신호의 주파수 오프셋을 보정하는 주파수 오프셋 보정부 및 상기 주파수 오프셋 보정부에서 출력되는 OFDM 신호에서 보호구간 영역을 제거하는 보호구간 제거부를 포함하여 이루어진 OFDM 수신기에 있어서, 상기 ADC로부터 입력되는 OFDM 신호에 대해 자기 상관을 수행하여 그에 상응하는 신호를 출력하는 자기 상관부; 상기 자기 상관부로부터 입력되는 신호를 소정의 시간 동안 지연시킨 후 출력하는 신호 지연부; 상기 자기 상관부로부터 입력되는 신호의 주파수 오프셋을 추정하여, 상기OFDM 신호의 주파수 오프셋을 보정하는 보정 신호를 상기 주파수 오프셋 보정부로 출력하는 주파수 오프셋 추정부; 상기 자기 상관부로부터 입력되는 신호와 신호 지연부로부터 입력되는 신호에 의거하여 상기 보호구간 영역의 제거 시점을 알리는 제어 신호를 상기 보호구간 제거부로 출력하는 심볼 타이밍 추정부 및 상기 자기 상관부로부터 입력되는 신호와 상기 신호 지연부로부터 입력되는 신호에 의거하여 상기 주파수 오프셋 추정부와 상기 심볼 타이밍 추정부가 액티브 모드 또는 슬립 모드로 동작하도록 제어하는 OFDM 신호 검출부를 포함하여 이루어진 것을 특징으로 한다.
OFDM, 프리엠블, 오프셋, 타이밍, CP, 보호구간, 동기화

Description

직교 주파수 분할 다중화 신호의 동기화 장치{apparatus for synchronizing of OFDM signal}
도 1은 직교 주파수 분할 다중화 신호의 프레임 구조를 개략적으로 보인 예시도,
도 2는 본 발명의 일 실시예에 따른 직교 주파수 분할 다중화 신호의 동기화 장치를 사용한 OFDM 수신기의 전기적인 블록 구성도,
도 3a 내지 도 3c는 도 2에서 보인 직교 주파수 분할 다중화 신호의 동기화 장치의 내부 구성도이다.
*** 도면의 주요 부분에 대한 부호의 설명 ***
100: OFDM 동기화 장치 110: 자기 상관부
111: 지연기 113: 공액 변환부
115: 곱셈기 117: 이동 평균기
120: 신호 지연부 130: 주파수 오프셋 추정부
140: OFDM 신호 검출부 141: 곱셈기
143: 비교기 145: 카운터
147: OFDM신호 판단부 150: 심볼 타이밍 추정부
151: 차분기 153: 절대값 계산기
155: CP 시작점 판단부 200: 주파수 변환부
300: ADC 400: 주파수 오프셋 보정부
500: CP 제거부 600: FFT
700: 등화기
본 발명은 직교 주파수 분할 다중화 신호의 동기화 장치에 관한 것으로, 특히 OFDM 신호의 검출 여부에 따라 OFDM 수신기에서의 주파수 오프셋의 보정 및 심볼 타이밍을 추정하도록 한 직교 주파수 분할 다중화 신호의 동기화 장치에 관한 것이다.
일반적으로, 직교 주파수 분할 다중화(Orthogonal Frequency Division Multiplexing; OFDM) 변조 방식은 다중 반송파를 사용하여 높은 전송률을 가지며, 단일 반송파 방식에 비해 주파수의 선택적인 페이딩과 시간 영역의 충격 잡음에 강하다. 좁은 반송파 간격 내에서 수신 신호는 같은 크기로 왜곡되므로 비교적 간단한 채널 등화기만으로 다중 경로의 영향을 보상할 수 있다. 이러한 장점들로 인해 직교 주파수 분할 다중화 방식은 무선 LAN 규격인 IEEE 802.11a에 채택되었다.
한편, 직교 주파수 분할 다중화 변조 방식은 각각의 직교성을 가지는 반송파에 데이터를 병렬로 전송하는 방식이므로 단일 반송파 전송방식에 비해 주파수 오프셋에 민감하다. 주파수 오프셋이 존재하면 각 반송파 간의 직교성이 유지되지 못하고 반송파 간의 간섭이 일어나 신호의 왜곡이 발생한다. 따라서, 직교 주파수 분할 다중화 변조 방식을 이용한 무선 LAN 시스템은 주파수 오프셋에 의한 영향을 보상해야 한다. 또한, 무선 LAN 시스템은 랜덤 액세스 네트워크이므로 입력되는 신호의 시작을 정확히 알지 못한다. 패킷 방식의 통신에서는 패킷의 시작점을 찾는 것 이 그 시스템의 성능을 크게 좌우하기 때문에 신호 검출과 심볼 타이밍 동기는 매우 중요하다.
따라서, 주파수 오프셋을 추정하기 위한 주파수 오프셋 추정부와 직교 주파수 분할 다중화 신호의 시작점을 결정하기 위한 심볼 타이밍 복원부를 구비함으로써, 입력되는 직교 주파수 분할 다중화 신호의 주파수 오프셋을 보정하고 심볼 타이밍을 추정하도록 된 직교 주파수 분할 다중화 수신기가 등록특허 제510861호에 제안된 바 있다.
그러나, 이러한 직교 주파수 분할 다중화 수신기에 따르면, 주파수 오프셋 추정부와 심볼 타이밍 복원부가 직교 주파수 분할 다중화 신호의 입력 유무에 상관없이 항상 액티브 모드(active mode)로 구동되어 불필요하게 많은 전력이 소모되는 문제점이 있었다. 더 나아가, 한시적으로 직교 주파수 분할 다중화 신호 조건이 성립되는 잡음 신호의 입력에도 주파수 오프셋 추정부와 심볼 타이밍 복원부가 반응하게 됨으로써 직교 주파수 분할 다중화 수신기가 전반적으로 오작동하게 되는 문제점이 있었다.
본 발명은 전술한 문제점을 해결하기 위하여 안출된 것으로서, 직교 주파수 분할 다중화 신호의 입력 여부를 판단하기 위한 직교 주파수 분할 다중화 신호 검출부를 구비함으로써, 직교 주파수 분할 다중화 신호가 입력되는 경우에 한해 직교 주파수 분할 다중화 수신기의 구동 상태를 액티브 모드로 전환하도록 한 주파수 분할 다중화 신호의 동기화 장치를 제공하는데 그 목적이 있다.
전술한 목적을 달성하기 위해 본 발명의 직교 주파수 분할 다중화 신호의 동기화 장치는 OFDM 신호를 디지털 신호로 변환하는 ADC, 상기 ADC에서 출력되는 OFDM 신호의 주파수 오프셋을 보정하는 주파수 오프셋 보정부 및 상기 주파수 오프셋 보정부에서 출력되는 OFDM 신호에서 보호구간 영역을 제거하는 보호구간 제거부를 포함하여 이루어진 OFDM 수신기에 있어서, 상기 ADC로부터 입력되는 OFDM 신호에 대해 자기 상관을 수행하여 그에 상응하는 신호를 출력하는 자기 상관부; 상기 자기 상관부로부터 입력되는 신호를 소정의 시간 동안 지연시킨 후 출력하는 신호 지연부; 상기 자기 상관부로부터 입력되는 신호의 주파수 오프셋을 추정하여, 상기OFDM 신호의 주파수 오프셋을 보정하는 보정 신호를 상기 주파수 오프셋 보정부로 출력하는 주파수 오프셋 추정부; 상기 자기 상관부로부터 입력되는 신호와 신호 지연부로부터 입력되는 신호에 의거하여 상기 보호구간 영역의 제거 시점을 알리는 제어 신호를 상기 보호구간 제거부로 출력하는 심볼 타이밍 추정부 및 상기 자기 상관부로부터 입력되는 신호와 상기 신호 지연부로부터 입력되는 신호에 의거하여 상기 주파수 오프셋 추정부와 상기 심볼 타이밍 추정부가 액티브 모드 또는 슬립 모드로 동작하도록 제어하는 OFDM 신호 검출부를 포함하여 이루어진 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치를 제공한다.
이하, 본 발명의 실시예에 따라 직교 주파수 분할 다중화 신호의 동기화 장치에 대해 상세하게 설명하기에 앞서, 도 1을 참조하여 직교 주파수 분할 다중화(이하 OFDM) 신호의 프레임 구조를 개략적으로 살펴보기로 한다.
도 1에 도시된 바와 같이, 패킷 형태로 송/수신되는 OFDM 신호의 프레임 구조는 신호 검출, AGC(automatic gain control), 다이버시티, 대략적 주파수 동기 및 샘플링 타이밍 동기에 이용되는 9개의 짧은 프리엠블(preamble)과; 채널 등화(channel equalization)와 미세 주파수 동기에 이용되는 2개의 긴 프리엠블과; 유효 데이터 심볼인 다수의 페이로드(payload)로 구성된다. 또한, 긴 프리엠블 및 각 페이로드의 시작점에는 보호구간(Cyclic Prefix; CP)(이하 CP)이 형성된다.
도 2는 본 발명의 일 실시예에 따른 직교 주파수 분할 다중화 신호의 동기화 장치를 사용한 OFDM 수신기의 전기적인 블록 구성도이다.
도 2에 도시된 바와 같이, OFDM 수신기의 전기적인 블록 구성은 입력되는 OFDM 신호의 주파수 대역을 기저 대역대로 변환하여 출력하는 주파수 변환부(200); 기저 대역대로 변환된 OFDM 신호를 디지털 신호로 변환하여 출력하는 ADC(300); ADC(300)로부터 입력되는 OFDM 신호를 처리하여 OFDM신호의 주파수 오프셋 및 심볼 타이밍의 추정을 수행하는 OFDM 동기화 장치(100); ADC(300)로부터 입력되는 OFDM 신호에 OFDM 동기화 장치(100)에서 출력되는 신호를 곱하여 OFDM 신호의 주파수 오프셋을 보정하는 주파수 오프셋 보정부(400); OFDM 동기화 장치(100)로부터 입력되는 제어신호에 의거하여 주파수 오프셋 보정부(400)로부터 입력되는 OFDM 신호의 CP를 삭제하는 CP 제거부(500); CP 제거부(500)로부터 입력되는 OFDM 신호를 고속 푸리에 변환하는 FFT(Fast Fourier Transform)(600) 및 등화기(equalizer)(700)를 포함하여 이루어진다.
전술한 구성에서, OFDM 동기화 장치(100)의 구성은 미리 정해진 자기상관 (autocorrelation) 알고리즘에 의거하여 ADC(300)로부터 입력되는 OFDM 신호를 처리하며, 그에 상응하는 신호를 출력하는 자기 상관부(110); 자기 상관부(110)로부터 입력되는 신호를 소정의 시간 동안 지연시킨 후 출력하는 신호 지연부(120); 자기 상관부(110)로부터 입력되는 신호의 주파수 오프셋을 추정하여, 주파수 오프셋 보정부(400)로 입력되는 OFDM신호의 주파수 오프셋을 보정하는 보정 신호를 주파수 오프셋 보정부(400)로 출력하는 주파수 오프셋 추정부(130); 자기 상관부(110)로부터 입력되는 신호와 신호 지연부(120)로부터 입력되는 신호에 의거하여 그에 상응하는 제어신호를 CP 제거부(500)로 출력하는 심볼 타이밍 추정부(150) 및 자기 상관부(110)로부터 입력되는 신호와 신호 지연부(120)로부터 입력되는 신호에 신호에 의거하여 주파수 오프셋 추정부(130)와 심볼 타이밍 추정부(150)를 엑티브 또는 슬립모드로 동작하도록 제어하는 OFDM 신호 검출부(140)를 포함하여 이루어진다.
이외에도, 도 2에 도시하지는 않지만 OFDM 수신기의 각 부의 구동 전원을 공급하는 전원부가 구비됨은 주지된 사실이다.
한편, 도 3a 내지 도 3c는 도 2에서 보인 OFDM 동기화 장치의 세부적인 내부 구성도이다.
도 3a에 도시된 바와 같이, 자기 상관부(110)의 구성은 ADC(300)로부터 입력되는 OFDM 신호를 소정의 시간 동안 지연시킨 후 출력하는 지연기(111); 지연기(111)로부터 입력되는 OFDM 신호를 공액 변환(conjugation)하는 공액 변환부(113); ADC(300)로부터 입력되는 OFDM 신호와 공액 변환부(113)를 통해 공액 변환된 OFDM 신호를 곱하여 자기 상관을 수행하는 곱셈기(115) 및 곱셈기(115)로부터 입력되는 신호를 이동 평균하는 이동 평균기(117)를 포함하여 이루어진다.
전술한 바와 같이, 자기 상관부(110)의 동작은 수학식 1로 표현된다.
Figure 112006008926117-pat00001
여기서,
Figure 112006008926117-pat00002
는 ADC(300)에서 출력되는 OFDM 신호를 나타내며,
Figure 112006008926117-pat00003
은 지연기(111)에서 출력되는 OFDM 신호를 나타내며,
Figure 112006008926117-pat00004
은 이동 평균기(117)에서 출력되는 신호를 나타낸다. 한편, 수학식 1에서 표시된
Figure 112006008926117-pat00005
은 미리 정해진 상수로써, 각각의 짧은 프리엠블이 16개의 OFDM 신호로 이루어진 점에 기인한다.
다음, 도 3b에 도시된 바와 같이, 심볼 타이밍 추정부(150)의 구성은 자기 상관부(110)로부터 입력되는 신호(
Figure 112006008926117-pat00006
)와 신호 지연부(120)로부터 입력되는 신호(
Figure 112006008926117-pat00007
)의 전력 차이를 구하여 그에 상응하는 신호(
Figure 112006008926117-pat00008
)를 출력하는 차분기(151); 차분기(151)로부터 입력되는 신호(
Figure 112006008926117-pat00009
)의 절대값을 계산하여 그에 상응하는 신호(
Figure 112006008926117-pat00010
)를 출력하는 절대값 계산기(153); 절대값 계산기(153)로부터 순차적으로 입력되는 신호(
Figure 112006008926117-pat00011
)에 의거하여 CP 제거 시점을 판단하는 심볼 시작점 판단부(155)를 포함하여 이루어진다.
전술한 구성에서, 심볼 시작점 판단부(155)는 수학식 2에 의거하여 그 동작을 수행하게 된다.
Figure 112006008926117-pat00012
Figure 112006008926117-pat00013
즉, 수학식 2에 명시한 바와 같이, 심볼 시작점 판단부(155)는 절대값 계산기(153)로부터 입력되는 신호의 크기가 순차적으로 작은 값을 가지는 조건을 만족하면서 첫 번째로 입력된 신호(
Figure 112006008926117-pat00014
)가 미리 정해진 값(
Figure 112006008926117-pat00015
)보다 큰 경우에는 CP 제거부(500)에서 출력되는 OFDM 신호가 짧은 프리엠블의 마지막 시점으로 판단하게 된다. 따라서, 심볼 시작점 판단부(155)는 이후에 입력되는 OFDM 신호의 일정 구간 즉, 긴 프리엠블의 CP 구간을 제거하도록 CP 제거부(500)를 제어하게 된다. 이에 따라 CP 제거부(500)는 CP 구간이 제거된 긴 프리엠블을 FFT(600)로 출력하게 되고, 이후 입력되는 각각의 페이로드 또한, 그 시작점에 위치한 CP 구간을 자동적으로 제거하고 FFT(600)로 출력하게 된다.
다음, 도 3c에 도시된 바와 같이, OFDM 신호 검출부(140)의 구성은 곱셈기(141); 비교기(143); 카운터(145) 및 OFDM 신호 판단부(147)를 포함하여 이루어지는바, 곱셈기(141)는 수학식 3으로 표현되며, 비교기(143)는 수학식 4에 의거하여 동작을 수행하게 된다.
Figure 112006008926117-pat00016
Figure 112006008926117-pat00017
즉, 수학식 3에 명시한 바와 같이 곱셈기(141)는 신호 지연부(120)로부터 입력되는 신호(
Figure 112006008926117-pat00018
)에 미리 정해진 값(
Figure 112006008926117-pat00019
)을 곱하여 그에 상응하는 신호(
Figure 112006008926117-pat00020
)를 출력한다.
또한, 비교기(143)는 곱셈기(141)로부터 입력되는 신호(
Figure 112006008926117-pat00021
)와 자기 상관부(110)로부터 입력되는 신호(
Figure 112006008926117-pat00022
)의 크기를 비교하여 수학식 4에 명시한 바와 같이, 신호(
Figure 112006008926117-pat00023
)가 신호(
Figure 112006008926117-pat00024
)보다 큰 경우에는 카운터(145)의 내부 카운터 값을 '1'씩 증가시키도록 제어신호를 출력하며, 반면 신호(
Figure 112006008926117-pat00025
)가 신호(
Figure 112006008926117-pat00026
)보다 작은 경우에는 카운터(145)의 내부 카운터 값이 '0'으로 초기화되도록 그에 상응하는 다른 제어신호를 출력한다. 한편, OFDM 신호 판단부(147)는 카운터(145)의 내부 카운터 값이 미리 정해진 특정 값(K)보다 큰 경우에는 주파수 오프셋 추정부(130) 및 심볼 타이밍 추정부(150)가 엑티브 모드로 동작하도록 제어신호를 출력하고, 반면 카운터(145)의 내부 카운터 값이 미리 정해진 특정값보다 작은 경우에는 주파수 오프셋 추정부(130) 및 심볼 타이밍 추정부(150)의 구동 상태를 슬 립(sleep) 모드로 전환시킨다.
본 발명의 직교 주파수 분할 다중화 신호의 동기화 장치는 전술한 실시 예에 국한되지 않고 본 발명의 기술 사상이 허용하는 범위에서 다양하게 변형하여 실시할 수가 있다.
이상에서 설명한 바와 같은 본 발명의 직교 주파수 분할 다중화 신호의 동기화 장치에 따르면, OFDM 신호를 검출하도록 된 OFDM 신호 검출부를 구비하여 OFDM 신호 입력 여부에 따라 오프셋 추정부 및 심볼 타이밍 추정부의 구동을 액티브/슬립 모드로 전환함으로써, 오프셋 추정부 및 심볼 타이밍 추정부의 구동에 사용되는 전력의 효율성을 기할 수 있는 효과가 있다.
더 나아가, OFDM 수신기로 입력되는 신호가 OFDM 신호인지 여부를 판단하도록 된 카운터 및 OFDM 신호 판단부를 구비함으로써, 한시적으로 OFDM 신호의 조건을 만족하는 잡음 신호 즉,
Figure 112006008926117-pat00027
값보다 큰 잡음 신호가 입력되더라도 카운터의 내부 카운터 값이 미리 정해진 특정값(K) 이상인 경우에 한해서만 오프셋 추정부 및 심볼 타이밍 추정부를 구동하게 하는바, 이를 통해 잡음 신호에 대한 OFDM 수신기의 오작동을 방지하는 다른 효과가 있다.

Claims (8)

  1. OFDM 신호를 디지털 신호로 변환하는 ADC, 상기 ADC에서 출력되는 OFDM 신호의 주파수 오프셋을 보정하는 주파수 오프셋 보정부 및 상기 주파수 오프셋 보정부에서 출력되는 OFDM 신호에서 보호구간 영역을 제거하는 보호구간 제거부를 포함하여 이루어진 OFDM 수신기에 있어서,
    상기 ADC로부터 입력되는 OFDM 신호에 대해 자기 상관을 수행하여 그에 상응하는 신호를 출력하는 자기 상관부;
    상기 자기 상관부로부터 입력되는 신호를 소정의 시간 동안 지연시킨 후 출력하는 신호 지연부;
    상기 자기 상관부로부터 입력되는 신호의 주파수 오프셋을 추정하여, 상기OFDM 신호의 주파수 오프셋을 보정하는 보정 신호를 상기 주파수 오프셋 보정부로 출력하는 주파수 오프셋 추정부;
    상기 자기 상관부로부터 입력되는 신호와 상기 신호 지연부로부터 입력되는 신호의 전력 차이를 구하여 그에 상응하는 신호를 출력하는 차분기; 상기 차분기로부터 입력되는 신호의 절대값을 계산하여 그에 상응하는 신호를 출력하는 절대값 계산기 및 상기 절대값 계산기로부터 입력되는 신호에 의거하여 상기 보호구간 영역의 제거 시점을 판단하는 심볼 시작점 판단부를 포함하여 이루어져서, 상기 자기 상관부로부터 입력되는 신호와 신호 지연부로부터 입력되는 신호에 의거하여 상기 보호구간 영역의 제거 시점을 알리는 제어 신호를 상기 보호구간 제거부로 출력하는 심볼 타이밍 추정부 및
    상기 자기 상관부로부터 입력되는 신호와 상기 신호 지연부로부터 입력되는 신호에 의거하여 상기 주파수 오프셋 추정부와 상기 심볼 타이밍 추정부가 액티브 모드 또는 슬립 모드로 동작하도록 제어하는 OFDM 신호 검출부를 포함하여 이루어진 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
  2. 제 1항에 있어서,
    상기 자기 상관부는
    상기 ADC로부터 입력되는 OFDM 신호를 소정의 시간 동안 지연시킨 후 출력하는 지연기;
    상기 지연기로부터 입력되는 OFDM 신호를 공액 변환하는 공액 변환부;
    상기 ADC로부터 입력되는 OFDM 신호와 상기 공액 변환부로부터 입력되는 OFDM 신호를 곱하는 곱셈기 및
    상기 곱셈기로부터 입력되는 신호를 이동 평균하는 이동 평균기를 포함하여 이루어진 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
  3. 제 2항에 있어서,
    상기 자기 상관부에서 출력되는 신호는 수학식
    Figure 112006008926117-pat00028
    (여기서,
    Figure 112006008926117-pat00029
    는 상기 ADC로부터 입력되는 신호이며,
    Figure 112006008926117-pat00030
    는 상기 지연기에서 출력되는 신호이며,
    Figure 112006008926117-pat00031
    는 상기 이동 평균기에서 출력되는 신호임.) 에 의해 구해지는 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
  4. 제 3항에 있어서,
    상기 신호 지연부에서 출력되는 신호는
    Figure 112006008926117-pat00032
    인 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
  5. 삭제
  6. 제 4항에 있어서,
    상기 심볼 시작점 판단부는 수학식
    Figure 112007026746590-pat00033
    과 수학식
    Figure 112007026746590-pat00034
    (여기서,
    Figure 112007026746590-pat00035
    은 상기 절대값 계산기로부터 입력되는 신호의 크기이며,
    Figure 112007026746590-pat00036
    은 상기
    Figure 112007026746590-pat00037
    의 다음 신호의 크기이며,
    Figure 112007026746590-pat00038
    은 상기
    Figure 112007026746590-pat00039
    의 다음 신호의 크기이며,
    Figure 112007026746590-pat00040
    는 미리 정해진 값임.) 의 조건이 만족되는 경우에는 상기 보호구간 영역의 제거 시점을 알리는 제어 신호를 상기 보호구간 제거부로 출력하는 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
  7. 제 4항 및 제 6항 중 어느 한 항에 있어서,
    상기 OFDM 신호 검출부는
    상기 신호 지연부로부터 입력되는 신호(
    Figure 112007026746590-pat00041
    )에 미리 정해진 값을 곱하여 그에 상응하는 신호(
    Figure 112007026746590-pat00042
    )를 출력하는 곱셈기;
    상기 자기 상관부로부터 입력되는 신호(
    Figure 112007026746590-pat00043
    )와 상기 신호(
    Figure 112007026746590-pat00044
    )의 크기를 비교하는 비교기;
    상기 신호(
    Figure 112007026746590-pat00045
    )가 상기 신호(
    Figure 112007026746590-pat00046
    )의 크기보다 큰 경우에는 내부 카운터 값을 '1'씩 증가시키며, 반면 상기 신호(
    Figure 112007026746590-pat00047
    )가 상기 신호(
    Figure 112007026746590-pat00048
    )의 크기보다 작은 경우에는 상기 내부 카운터 값을 '0'으로 초기화시키는 카운터 및
    상기 내부 카운터 값이 '0'인 경우에는 상기 주파수 오프셋 추정부와 상기 심볼 타이밍 추정부의 동작 모드를 슬립 모드로 전환하는 OFDM 신호 판단부를 포함하여 이루어진 직교 주파수 분할 다중화 신호의 동기화 장치.
  8. 제 7항에 있어서,
    상기 OFDM 신호 판단부는 상기 내부 카운터 값이 미리 정해진 특정 값보다 작은 경우에는 상기 주파수 오프셋 추정부와 상기 심볼 타이밍 추정부의 동작 모드를 슬립 모드로 전환하는 것을 특징으로 하는 직교 주파수 분할 다중화 신호의 동기화 장치.
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