KR100733635B1 - 판독헤드 보호회로 및 방법 - Google Patents

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Abstract

하드디스크 드라이브 시스템(100)의 판독헤드(18)를 보호하는 회로(80) 및 방법(84). 커패시터(C1)는 Vbias 모드 동안 더미헤드(Rdummy)에 제어가능하게 접속되어, Ibias 모드로 복귀시 커패시터(C1)는 낮고 예측가능한 전압을 가져, 판독헤드(18)가 손상되지 않게 보호한다. 회로(80)는 서보 뱅크 기입(SBW) 시퀀스 동안 커패시터(C1)를 언제 더미헤드(Rdummy)에 접속할지를 결정하는 논리(82) 및 알고리즘(84)을 포함한다.
판독헤드 보호, 하드디스크 드라이브 시스템, 서보 뱅크 기입 시퀀스

Description

판독헤드 보호회로 및 방법 {READ HEAD PROTECTION CIRCUIT AND METHOD}
도 1은 종래기술의 디스크 드라이브 대용량 기억시스템의 구성을 도시한 도면.
도 2는 판독헤드를 전류 Ibias로 바이어스하기 위해 사용된 전형적인 종래기술의 회로를 개략적으로 표현한 도면.
도 3은 판독헤드를 전압 Vbias 회로와 Ibias 회로로 교대로 바이어스하는 택일적인 종래기술의 방법을 개략적으로 표현한 도면.
도 4는, 판독헤드가 사용중이 아닐 때, Vbias 모드 동안 커패시터(C1)에 선택적으로 접속된 더미헤드(Rdummy)를 구비한 본 발명의 바람직한 실시예를 도시한 개략도.
도 5는 도 4에 도시된 회로의 타이밍도.
도 6은 본 발명의 알고리즘의 흐름도.
도 7은 하드디스크 드라이브 시스템에서 구현된 본 발명의 블록도.
* 도면의 주요부분에 대한 부호의 설명 *
18 : 판독헤드 20 : 기입헤드
28 : SSD 채널 30 : 제어회로
32 : 호스트 52 : Ibias 회로
62 : Vbias 회로 80 : 판독헤드 보호회로
82 : 논리회로 84 : 알로리즘
100 : 하드디스크 드라이브 시스템 102 : 프리앰프
본 발명은 일반적으로 정보기억분야에 관한 것이며, 특히 하드디스크 드라이브의 판독헤드를 보호하는 회로 및 방법에 관한 것이다.
하드디스크 드라이브는 전형적으로 회전 디스크 또는 플래터(platter)와 같은 자기 기억매체, 스핀들 모터, 판독/기입 헤드, 액추에이터, 프리앰프(pre-amplifier), 판독채널, 기입채널, 서보회로, 및 하드디스크 드라이브의 동작을 제어하고 하드디스크 드라이브를 호스트 시스템 또는 버스에 적절히 인터페이스하는 제어회로를 포함하는 대용량 기억장치이다. 도 1은 종래의 디스크 드라이브 대용량 기억시스템(10)의 일례를 도시한다. 디스크 드라이브 시스템(10)은 판독 및 기입동작 동안 호스트(32)와 인터페이스하고 데이터를 교환한다. 디스크 드라이브 시스템(10)은 회전가능한 베이스(14) 상에 탑재된 다수의 회전 플래터(12)를 포함한다. 플래터(12)는 자기 플래터 상에 자기 전이로 표현된 데이터를 기억하는 데 사용되는데, 각 플래터(12)는 프리앰프(26)와 데이터를 송수신하는 판독/기입 헤드(18/20)에 접속가능하다. 프리앰프(26)는 판독채널 및 기입채널를 포함하는 SSD (synchronously sampled data) 채널과 제어회로(30)에 접속된다. SSD 채널(28) 및 제어회로(30)는, 플래터(12)로부터 판독하고 또한 플래터로 기입하는 데이터를 처리하고, 디스크 드라이브 대용량 기억 시스템(10)의 다양한 동작을 제어하기 위해 사용된다. 호스트(32)는 제어회로(30)와 디지털 데이터를 교환한다.
판독헤드(18)와 기입헤드(20)에 의해 자기 플래터(12)의 각 측으로부터 데이터가 검색되고 저장된다. 판독헤드는 전류가 통과할 때 플래터(12)로부터 데이터를 판독하고 기입하도록 적용된 MR 헤드(magneto-resistive head)를 포함한다. 판독/기입헤드(18/20)는 디스크/헤드 어셈블리(10)의 판독/기입헤드(18/20)와 SSD 채널(28) 사이의 인터페이스로서 역할하는 프리앰프(26)에 접속된다. 프리앰프(26)는 필요한만큼 파형 데이터신호에 증폭을 제공한다. 플래터(12) 표면은 도시된 바와 같이 섹션으로 분할되어 포맷되고, 데이터 기억 웨지(wedge) 또는 섹션(22)은 대부분의 플래터 표면영역을 포함하고 그 사이에 위치된 더 작은 서보 웨지(24)는 위치정보를 저장한다. 하드디스크 드라이브 시스템(10)의 정상동작 동안의 특정 시간간격에서, 기입헤드(20)가 위치 데이터를 모든 플래터 서보웨지(24)에 동시에 기입하는 동안에 SBW(Servo Bank Write) 시퀀스라 불리는 시퀀스가 수행된다.
종래기술의 하드디스크 드라이브 설계에서의 문제점은 판독헤드(18)의 과도한 민감도이다. 기입헤드(20)를 이용하여 데이터를 플래터(12)에 기입할 때, 다량의 전류, 예컨대 40mA가 기입헤드(20)를 통해 흘러, 기입헤드(20)와 근접한 판독헤드(18)로 다시 접속될 수 있어, 판독헤드(18)가 손상되거나 파괴될 가능성이 있다. 기입 시퀀스 동안의 손상을 방지하기 위하여, 대부분의 종래기술의 설계는 판독헤드(18)에 바이어스를 인가한다. 판독헤드(18)가 손상될 위험성은 SBW 시퀀스 동안에 특히 높은데, 그 이유는, 모든 판독헤드(18)가 동시에 온 상태이고 따라서 바이어스 전류가 판독헤드들(18) 사이에서 동등하게 분할되어, 결과적으로 각 판독헤드(18)에 인가된 바이어스 전류가 프리앰프(26)에 접속된 판독헤드(18)의 수에 의존하게 되기 때문이다. 이 관계는 수학식 1로 특징된다.
Figure 112001014956314-pat00001
여기서 Ibiastotal은 프리앰프(26)로부터 모든 헤드(18/20)에 인가된 총 바이어스 전류이며, Ibhead는 하나의 판독헤드(18) 상의 바이어스 전류이고, N은 하드디스크 드라이브 시스템(10)에서의 헤드 수로서, 도 1에 도시된 시스템(10)에서는 N은 3이다. 따라서, SBW 모드로 전이할 때, 판독헤드(18) 상의 바이어스 전류는 판독모드에서의 Ibiastotal로부터 SBW 모드에서의 Ibiastotal/N으로 감소할 수 있다. 감소된 바이어스 전류는 판독헤드(18)를 보호하기에 불충분할 수 있어, 헤드(18)에 손상을 가져올 수 있다.
필요한 것은 하드디스크 드라이브 SBW 시퀀스 동안에 판독헤드(18)를 보호하는 회로 및 방법이다.
본 발명은 SBW 시퀀스 동안 디스크 드라이브의 판독헤드를 보호하는 회로 및 방법으로서의 기술적 장점을 달성한다. 프리앰프의 피드백 루프 커패시터는 Vbias 모드 동안 별개의 더미 헤드에 제어가능하게 접속되어, Ibias 모드로 복귀할 때 커패시터 전압은 예측가능하고 판독헤드의 전압보다 더 낮다.
본 발명은, 판독헤드에 선택적으로 접속가능한 전압 바이어스 회로, 판독헤드에 선택적으로 접속가능한 커패시터, 및 커패시터에 선택적으로 접속가능한 더미헤드를 포함하는 하드디스크 드라이브의 판독헤드를 보호하는 회로를 포함한다. 더미헤드는 내부 저항을 포함할 수도 있다. 손상 레벨의 전류가 판독헤드에 접속되는 것을 방지하기 위하여 전압 바이어스 회로가 판독헤드에 접속될 때 커패시터는 더미헤드에 제어가능하게 그리고 반응적으로 접속된다.
본 발명은 데이터를 기억하는 복수의 플래터와 이 데이터를 검색하기 위한 플래터 각각에 대한 판독헤드를 구비한 하드디스크 드라이브 기억 시스템을 위한 프리앰프를 포함한다. 프리앰프는 판독헤드에 접속가능한 전압 바이어스 회로, 판독헤드에 접속가능한 커패시터, 및 커패시터에 접속가능한 더미헤드를 구비한 판독헤드 보호회로를 포함한다. 커패시터는 전압 바이어스 회로가 판독헤드에 접속될 때 더미헤드에 제어가능하게 접속된다.
본 발명의 방법은 하드디스크 드라이브 기억 시스템의 판독헤드를 보호하는 방법을 포함하는데, 이 시스템은 전압 바이어스 회로, 판독헤드에 접속가능한 커패시터, 및 커패시터에 선택적으로 접속가능한 더미헤드를 구비한 프리앰프 회로를 포함한다. 이 방법은, 손상 레벨의 전류가 판독헤드에 접속되는 것을 방지하기 위하여 전압 바이어스 회로가 판독헤드에 접속될 때 더미헤드를 통해 커패시터 전압을 제어가능하게 방전함으로써 판독헤드를 보호한다.
본 발명의 장점은, 모든 기입헤드(20)가 사용중일 때 서보 뱅크 기입(SBW) 시퀀스 동안 하드디스크 드라이브 시스템의 판독헤드(18)를 보호하는 것을 포함한다. 이 보호회로 및 방법은 SBW 시퀀스 동안 판독헤드가 손상되지 않게 보호하는 용이하게 실현가능하며 신뢰성있는 해결책이다. 바람직하게는, 더미헤드 저항은, 종래기술에서와 같이 커패시터를 부동하게 두는 대신에 커패시터를 소정의 전압으로 방전한다. 전압은 예측가능하고 기억 시스템이 종래기술에 비해 더 오랜 시간동안 Vbias 모드에 남아 있게 한다. 몇몇 회로에서는, 본 발명은 커패시터를 Vbias 회로의 더미헤드에 접속하는 추가의 스위치를 필요로 할 뿐이다.
본 발명의 상기 특징은 첨부한 도면을 참조하여 아래의 설명으로부터 더 명확히 이해될 것이다.
상이한 도면에서 대응하는 부재번호와 기호는 다른 언급이 없으면 대응하는 요소를 나타낸다.
도 2는 종래기술의 제어회로(50)의 개략도로서, 도 1의 프리앰프(26)의 부분을 포함하며, 하드디스크 드라이브 시스템(10)의 판독헤드(18)에 스위치(S1)를 통해 접속된 전류 바이어스 Ibias 회로(52)를 구비한다. 트랜지스터(Q1)는 전류제한 저항(R1)에 의해 전원(Vss)에 접속된 NPN 바이폴라 트랜지스터를 포함할 수 있다. 트랜지스터(Q1)는 이득단 (A1, A2)을 통과하는 신호를 제어하여 출력전압을 SSD 채널(28)에 제공한다. Ibias 모드동안, 스위치(S1)가 닫혀, Ibias 회로(52)를 C1, 및 트랜지스터(Q1)를 통해 저항(Rhead)으로 표현된 판독헤드(18)에 접속한다. 다른 판독헤드는 도시되지 않았지만 디스크 드라이브 시스템(10)의 각 플래터(12)에 대해 회로(50)에서 유사하게 구성될 수도 있다. Ibias 모드에서, 기입헤드(20)가 사용중인 동안 판독헤드(18)를 보호하기 위해 적은 양의 전류가 저항 (Rhead)을 통해 흐른다.
프리앰프(26)는 판독헤드들 사이의 간섭을 방지하기 위해 다중화된 방식으로 한번에 하나씩 판독헤드(18)에 전류를 공급하는 단일 전류원(도시되지 않음)을 포함한다. 그러나, Ibias 모드에서 SBW 시퀀스 동안, Ibias 회로(52)는 정상동작모드에서처럼 한번에 오직 하나의 판독헤드(18)에 접속되기 보다는 모든 판독헤드(18)에 동시에 접속된다. 따라서, SBW 시퀀스 동안, Ibias 회로(52) 단일 전류원은 모든 판독헤드(18) 사이에서 공유된다. 플래터(12)의 수가 하드디스크 드라이브 시스템(10)에서 증가함에 따라 문제가 악화된다. 예를 들면, 플래터가 두개인 시스템에서, Ibias 전류는 각 판독헤드(18)에 대해 절반으로 된다. 플래터가 네개인 시스템에서는, Ibias 전류는 단일 헤드 Ibias 모드에 비해 각 판독헤드(18)에 대해 25%이다. 도 2의 Ibias 회로에서의 문제점은, SBW 시퀀스 동안, 둘 이상의 플래터(12)에 대해, Ibias 회로(52) 전류는 SBW 시퀀스 동안 판독헤드(18)가 손상되지 않게 보호하기에 충분하지 않을 수도 있다는 점이다. 예를 들면, Ibias 회로(52)가 5mA를 공급한다면, 이 전류는 하나의 판독헤드(18)를 보호하기에 적절할 수 있지만, 플래터가 두개인 시스템에 대해서는 SBW 시퀀스 동안 5mA 전류가 분할되어 각 판독헤드(18)를 통해 2.5mA 전류가 흐르게 되므로, 이 전류는 적절한 보호가 되지 않을 수 있다. 또한 보호회로(50)는 바이어스 전류량이 가변하고 디스크 드라이브 시스템(10)에서 플래터(12)의 수에 의존하므로 불리하다. 이상적으로는, 바이어스 전류가 디스크 드라이브에서의 헤드(18)의 수에 무관하여서, 판독모드에서 SBW 모드로 전이할 때 단일 헤드상의 바이어스 전류가 일정하게 유지되어, 판독헤드(18)를 손상시키는 것을 방지하는 것일 것이다.
기입헤드(20)가 사용중일 때 판독헤드(18)를 바이어스하는 또다른 종래 방법 및 회로가 도 3의 회로(60)에 도시되어 있다. 전압 바이어스 Vbias 회로(62)는 기입헤드(20)가 사용중일 때 판독헤드(18)를 보호하기 위해 스위치 (S2, S4)를 통해 판독헤드(18)에 접속된다. Vbias는 직렬포트 레지스터 (도시되지 않음)에 의해 시동시 시스템 설계자에 의해 설정될 수도 있다. Vbias 회로(62)는 시스템(10)에서의 플래터(12)의 수에 상관없이 판독헤드(18)에 동일한 양의 바이어스 전압을 제공한다.
전형적인 시스템 아키텍처에서 프리앰프(26)는 Ibias 회로에 적합한 피드백 루프를 필요로 하도록 설계된다. Vbias 회로(62)를 활성시키기 전에, Ibias 회로(52) 는 턴오프되어야 하는데 이는 스위치(S1)를 개방시킴으로써 달성된다. 이것은, Vbias 모드 동안 피드백 루프 커패시터(C1)가 부동하게 하여, 커패시터(C1) 상의 전압 (Vc) 의 양을 예측불가능하게 하므로 회로(60)에서 문제를 일으킨다. 스위치(S1)가 다시 닫혀, C1 상의 전압(Vc)이 판독헤드(18)에 접속되면, 전압(Vc)은 고전압으로 드리프트할 수 있어, 판독헤드(18)를 손상시킨다. 특히, SBW 시퀀스는 매우 길어서, 누설전류가 커패시터(C1) 상에 판독헤드(18)를 손상시킬 수 있는 과도한 전하를 형성하기에 충분한 시간을 허용할 수 있다.
도 4는 본 발명의 최선 태양의 전형적인 실시예를 도시한 회로(80)의 개략도이다. Vbias 회로(62) 및 Ibias 회로(52)는 교대로 하드디스크 드라이브 시스템의 판독헤드(18)에 접속된다. 저항(Rdummy)으로 표현된 더미헤드는 Vbias 회로(62)가 판독헤드(18)에 접속되지 않을 때 커패시터(C1)에 제어가능하게 반응적으로 접속되어, 커패시터 전압(Vc)이 Vbias 회로(62) 보다 더 낮은 소정의 전압으로 소산되는 것을 보장한다. 그후 예컨대 판독헤드(18)가 SBW 시퀀스 동안 Vbias 회로(62)로 스위칭될 때, 더미 저항 (Rdummy)이 커패시터 (C1)를 사전에 방전시키므로 전압(Vc)은 헤드(18)를 손상시키기에 충분하지 않을 것이다. 논리회로(82)는 SBW 보호 알고리즘(84)을 포함하는데, 논리회로(82)는 스위치 (S1, S2, S3, S4, S5 , S6)에 접속되어 이들을 제 어한다. 본 발명에 따르면, 시스템이 SBW 시퀀스에 있을 때, 스위치(S6)가 반응적으로 닫혀, 트랜지스터(QD)를 통해 더미헤드(Rdummy)를 커패시터(C1)에 접속하고 시스템이 스위칭되어 SBW 시퀀스를 벗어날 때 전압(Vc)이 Rhead0 및 Rhead1 으로 도시된 판독헤드 (및 2개 초과의 플래터를 갖는 시스템에 대한 다른 헤드들, 도시되지 않음) 상의 전압보다 더 낮은 전압레벨에 있음을 보장한다.
바람직하게는, 더미헤드(Rdummy)는 프리앰프회로(102)(도 7)에 상주하고, 예컨대 프리앰프(102)는 더미헤드(Rdummy)를 포함하는 별개의 집적회로를 포함할 수 있다. 더미헤드(Rdummy)는 최저 판독헤드(18) 저항의 10-30%와 동일한 저항을 포함하는 것이 바람직하다. 예를 들면, 디스크 드라이브 시스템의 판독헤드(18)의 저항이 30 내지 80 오옴이면, 더미헤드는 10 내지 14 오옴의 저항값을 갖는 저항(Rdummy)을 포함하는 것이 바람직하다. 저항(Rdummy)의 저항값은 판독헤드(18)의 저항값보다 낮으므로, 트랜지스터(QD)를 통해 저항(Rdummy)을 커패시터(C1)에 접속하면, 전압(Vc)이 판독헤드 전압보다 낮아, 판독헤드(18)가 다시 스위칭되어 각각의 트랜지스터를 통해 커패시터(C1)에 접속될 때 헤드 손상 방지가 보장된다. Vbias 회로(62)는 하드 드라이브 시스템의 다양한 시퀀스 또는 모드에서 판독헤드(18)를 바이어스하도록 Ibias 회로(52)와 교대로 판독헤드(18)에 접속될 수도 있다. 커패시터(C1)는 판독헤 드(18)가 손상되는 것을 방지하기 위하여 SBW 시퀀스 동안 더미저항(Rdummy)을 통해 방전된다.
이 신규 회로(80)는 커패시터(C1)에 걸리는 전압(Vc)을 예측할 수 있게 하므로 이 회로가 SBW 시퀀스 후에 전압(Vc)의 회복을 위해 최적화될 수 있는 장점이 있다. 예를 들면, SBW 동안 0.3V의 전압(Vc)을 생성할 더미저항(Rdummy)이 사용되고 판독헤드(18)가 0.5V 이면, 요구되는 전압회복은 0.2V이다. 이 회복전압은 하드디스크 드라이브 시스템(100) (도 7)의 설계에서 유용한 회복시간 정보를 결정하는 데 유용하다.
도 5는 4개의 헤드를 갖는 하드디스크 드라이브 시스템(100)(도 7)의 제 1 헤드(Rhead0)(도 4)에 대한 타이밍도이다. 직렬포트 헤드 선택신호(SPT_HS)는 선택된 헤드를 나타내는데, 예컨대 이진수 000은 제 1 헤드를 선택하고, 이진수 101은 4개의 모든 헤드를 선택한다. 처음에, 디스크 드라이브 시스템(100)은 시각 t0에서 정규의 판독모드이다. 신호(RDZ_WRT)는 논리 로우(low)일 때의 판독모드와 논리 하이(high)일 때의 기입모드를 나타낸다. 서보신호(SRV_SEQZ)는 서보 뱅크 기입(SBW) 시퀀스가 개시될 것임을 나타내기 위해 시각 t1에서 로우로 스위칭된다. 신호(Ibias 및 Vbias)는 예컨대 스위치(S1, S2, S3)를 통해 도 4의 제 1 헤드(Rhead0)에 대해 각각 Ibias 및 Vbias 모드를 선택한다.
시각 t1에서 신호(Vbias)가 하이로 이동함으로써 Vbias 모드는 판독헤드(R head0) 를 위해 활성되고, 더미저항(Rdummy)은 신호(DMZ)에 의해 표시되고 더미 헤드저항(Rdummy)을 제어하는 커패시터(C1)에 접속된다. 반응시, 내부 헤드선택신호(INT_HS)는 시각 t1에서 이진수 101의 무효 헤드상태를 나타낸다. 신호(INT_HS)는 직렬포트 헤드선택신호(SPT_HS)에 대응하여 시각 t2에서 상태를 변화시킨다. 회로는 현재 SBW 모드임을 내부적으로 결정한다. 종래기술의 회로에서는, 커패시터(C1)는 시각 t1에서 부동할 것이다. 그러나, 본 발명에 따르면, 직렬포트 레지스터신호(SPT_HS)는 스위치(S6) 및 트랜지스터(QD)를 통해 더미헤드(Rdummy )에 접속됨으로써 커패시터(C1)가 부동하는 것을 방지하도록 디코딩된다. 신호(SPT_HS)가 시각 t3에서 반전할 때, 신호(INT_HS)가 반응한다. 더미헤드(Rdummy)는 SRV_SEQZ 가 하이로 이동하여 SBW 모드가 종료하고 Vbias가 스위치 오프되는 시각 t4에서 신호(DMZ)로 도시된 커패시터(C1)와 접속이 단절된다.
도 6은 본 발명에 따른 알고리즘(84)을 도시한다. SBW 시퀀스가 시작될 때 (단계 86), Vbias 모드가 선택된다(단계 88). 커패시터(C1)는 회로가 SBW 모드를 빠져나와 Ibias 모드로 되돌아갈 때까지 더미헤드(Rdummy)에 접속되고(단계 90), 이때 커패시터(C1)는 더미헤드(Rdummy)와 접속이 단절되고 (단계 92) 선택된 판독헤드(18)에 접속된다.
도 7은 알고리즘(84)에 따라 기능하는 보호회로(80)를 구비한 본 발명의 프리앰프(102)를 포함하는 하드디스크 드라이브 시스템(100)을 도시한다. 프리앰프(102)는 단일의 집적회로칩을 포함하는 것이 바람직하고, 디스크 드라이브 시스템(100)의 하나 이상의 아암(16) 상에 위치될 수도 있다.
본 발명이 예시한 실시예를 참조하여 설명되었지만, 이 설명은 한정하는 의미로 제한하려는 것이 아니다. 상기 설명을 참조하면, 본 발명의 다른 실시예뿐만 아니라 설명된 실시예와 조합한 다양한 변경이 당업자에게 명백할 것이다. 따라서, 첨부된 청구범위는 이러한 임의의 변경 또는 실시예를 포함하는 것으로 의도되었다.
본 발명의 신규한 보호회로 및 방법은 모든 기입헤드(20)가 사용중일 때 서보뱅크기입(SBW) 시퀀스 동안 하드디스크 드라이브 시스템의 판독헤드(18)를 보호함으로써 기술적 장점을 달성한다. 여기 설명된 보호회로 및 방법은 SBW 시퀀스 동안 판독헤드(18)가 손상되지 않게 보호하는 용이하게 실현가능하며 신뢰성있는 방법을 제공한다. 더미헤드 저항(Rdummy)은, 종래기술에서와 같이 커패시터(C1)를 부동상태로 두기 보다는 커패시터(C1)가 방전되는 전압(Vc)을 제어한다. 전압(Vc)은 예측가능하고 종래기술에 비해 더 긴 시간동안 Vbias가 인가될 수 있도록 설정된다.

Claims (20)

  1. 하드 디스크 드라이브의 판독헤드 보호회로에 있어서,
    상기 판독헤드에 접속가능한 전압 바이어스 회로;
    상기 판독헤드에 접속가능한 커패시터; 및
    상기 커패시터에 접속가능한 더미헤드를 포함하며,
    상기 커패시터는 상기 전압 바이어스 회로가 상기 판독헤드에 접속될 때 상기 더미헤드에 접속되는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  2. 제 1 항에 있어서,
    상기 더미헤드는 상기 커패시터 양단에 걸린 전압을 낮추는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  3. 제 2 항에 있어서,
    상기 판독헤드 및 상기 커패시터에 접속가능한 전류 바이어스 회로를 더 포함하는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  4. 제 2 항에 있어서,
    상기 하드디스크 드라이브는 기입헤드를 포함하고, 상기 기입헤드 및 상기 판독헤드는 교대로 선택가능하며, 상기 더미헤드는 상기 기입헤드가 선택될 때 상기 커패시터 양단에 걸린 전압을 상기 판독헤드의 전압보다 더 낮은 전압으로 낮추는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  5. 제 3 항에 있어서,
    상기 더미헤드를 상기 커패시터에 제어가능하게 접속하는 논리회로; 및
    상기 논리회로를 제어하는 알고리즘을 더 포함하는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  6. 제 1 항에 있어서,
    상기 하드디스크 드라이브는 기억매체로부터 판독하고 상기 기억매체로 기입하는 복수의 판독 및 기입헤드를 포함하고, 서보뱅크기입(SBW) 시퀀스 동안, 상기 모든 기입헤드가 동시에 상기 기억매체에 기입하고, 상기 더미헤드는 상기 SBW 시퀀스 동안 상기 커패시터에 접속되는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  7. 제 1 항에 있어서,
    상기 더미헤드는 상기 판독헤드의 저항값보다 작은 저항값을 갖는 저항을 포함하는 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  8. 제 7 항에 있어서,
    상기 더미헤드 저항값은 상기 판독헤드 저항값보다 10-30% 더 작은 것을 특징으로 하는 하드디스크 드라이브의 판독헤드 보호회로.
  9. 데이터를 기억하는 복수의 플래터 및 상기 데이터를 검색하기 위하여 상기 각 플래터에 대한 판독헤드를 구비한 하드디스크 드라이브 기억 시스템용 프리앰프에 있어서,
    상기 판독헤드에 접속가능한 전압 바이어스 회로, 상기 판독헤드에 접속가능한 커패시터, 및 상기 커패시터에 접속가능한 더미헤드를 구비하고, 상기 커패시터는 상기 전압 바이어스 회로가 상기 판독헤드에 접속될 때 상기 더미헤드에 접속되는 판독헤드 보호회로를 포함하는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  10. 제 9 항에 있어서,
    상기 더미헤드는 상기 커패시터 양단에 걸린 전압을 낮추는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  11. 제 10 항에 있어서,
    상기 판독헤드 보호회로는 상기 판독헤드 및 상기 커패시터에 접속가능한 전류 바이어스 회로를 더 포함하는 것을 특징으로 하는 하드디스크 드라이브 기억 시 스템용 프리앰프.
  12. 제 10 항에 있어서,
    상기 하드디스크 드라이브는 기입헤드를 포함하고, 상기 기입헤드 및 상기 판독헤드는 교대로 선택가능하며, 상기 더미헤드는 상기 기입헤드가 선택될 때 상기 커패시터 양단에 걸린 상기 전압을 상기 판독헤드의 전압보다 낮은 전압으로 낮추는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  13. 제 11 항에 있어서,
    상기 판독헤드 보호회로는,
    상기 더미헤드를 상기 커패시터에 접속하는 것을 제어하는 논리회로; 및
    상기 논리회로를 제어하는 알고리즘을 더 포함하는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  14. 제 9 항에 있어서,
    상기 하드디스크 드라이브는 상기 플래터에 데이터를 기입하도록 채용된 복수의 기입헤드를 포함하고, 서보뱅크기입(SBW) 시퀀스 동안, 상기 모든 기입헤드가 동시에 상기 플래터에 기입하고, 상기 프리앰프 더미헤드는 상기 SBW 시퀀스 동안 상기 커패시터에 접속되는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  15. 제 9 항에 있어서,
    상기 더미헤드는 상기 판독헤드의 저항값보다 작은 저항값을 갖는 저항을 포함하는 것을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  16. 제 15 항에 있어서,
    상기 더미헤드 저항값은 상기 판독헤드 저항값보다 10-30% 더 작은 값임을 특징으로 하는 하드디스크 드라이브 기억 시스템용 프리앰프.
  17. 전압 바이어스 회로, 판독헤드에 접속가능한 커패시터, 및 상기 커패시터에 접속가능한 더미헤드를 구비한 프리앰프회로를 포함하는 하드디스크 드라이브 기억 시스템의 판독헤드 보호방법에 있어서,
    상기 전압 바이어스 회로가 상기 판독헤드에 접속될 때 상기 더미헤드를 통해 상기 커패시터를 방전하는 단계를 포함하는 것을 특징으로 하는 판독헤드 보호방법.
  18. 제 17 항에 있어서,
    상기 방전단계는 상기 판독헤드의 저항값보다 작은 저항값을 갖는 저항을 통해 상기 커패시터를 방전하는 단계를 포함하는 것을 특징으로 하는 판독헤드 보호방법.
  19. 제 18 항에 있어서,
    상기 하드디스크 드라이브는 기입헤드를 포함하고, 상기 기입헤드 및 상기 판독헤드는 교대로 선택가능하고,
    상기 기입헤드가 선택될 때, 상기 커패시터 전압이 상기 판독헤드의 전압보다 더 낮도록 상기 커패시터를 방전하는 단계를 더 포함하는 것을 특징으로 하는 판독회로 보호방법.
  20. 제 19 항에 있어서,
    상기 디스크 드라이브 시스템은 복수의 상기 판독 및 기입헤드를 포함하고, 상기 모든 기입헤드는 서보뱅크기입(SBW) 시퀀스 동안 복수의 플래터에 동시에 기입하도록 채용되며, 상기 방전단계는 상기 SBW 시퀀스 동안 수행되는 것을 특징으로 하는 판독회로 보호방법.
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