KR100669584B1 - 프로그램가능 필터, 장치 및 방법 - Google Patents

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Abstract

프로그램가능 필터는 무한 임펄스 응답 필터를 구현하여, 필터를 사용하는 송수신기가 하나 이상의 통신 표준에 따라서 한 이상의 모드에서 동작하도록 프로그래밍될 수 있다. 프로그램가능 무한 임펄스 응답 필터는 송수신기의 하나 이상의 아날로그 필터를 교체하여, 바람직한 필터 응답이 기저대역 프로세서에 의해서 프로그래밍될 수 있게 한다. 무한 임펄스 응답 필터의 지연 기능은 피드백 및 다중화를 이용하여 구현될 수 있다.

Description

프로그램가능 필터, 장치 및 방법{PROGRAMMABLE FILTER}
무선 주파수 시스템은 하나 이상의 통신 표준에 맞추어 설계되고 있다. 종래에는, 2개 이상의 통신 표준에 맞추어 동작할 수 있는 디바이스를 제공하기 위해서, 그 디바이스는 각각의 표준을 위한 2개 이상의 개별 무선 및 지원 하드웨어를 구비하도록 설계되었다. 2개 이상의 개별 라디오 및 지원 하드웨어를 사용하여, 디바이스가 단일 표준에 맞춘 디바이스보다 더 많은 애플리케이션에서 사용되게 하고 있으나, 다수의 라디오 및 지원 하드웨어를 구비하면 그 디바이스는 더 크고 고가이며, 비교적 많은 집적 회로를 구비하게 된다. 하나 이상의 통신 표준에 맞춘 디바이스는, 무선 및 지원 하드웨어 내의 회로 중 일부가 하나 이상의 희망 통신 표준에 맞추어지도록 프로그래밍될 수 있는 경우에, 무선 및 지원 하드웨어에서 리던던시를 이용할 수 있다.
본 발명에 관한 주제는 명세서의 결론 부분에서 구체적으로 지적되고 명백하게 청구된다. 그러나, 구성 및 동작 방법 모두에 관한 본 발명은, 그 목적, 특징 및 이점과 함께, 첨부한 도면과 함께 다음의 상세한 설명을 참조하면 가장 잘 이해 될 것이다.
도 1은 본 발명의 일 실시예에 따라서 프로그램가능 필터를 사용할 수 있는 송수신기 회로의 블록도,
도 2는 본 발명의 일 실시예에 따라서 도 1의 송수신기에서 사용될 수 있는 2차 프로그램가능 필터의 블록도,
도 3은 본 발명의 일 실시예에 따라서 도 1의 송수신기에서 사용될 수 있는 일반 차수 프로그램가능 필터의 블록도이다.
예시의 간단성 및 명료성을 위하여, 도면에 예시된 소자는 실측으로 도시되어 있지 않다. 예를 들어, 일부 소자의 치수는 명료성을 위하여 다른 소자에 비해 확대되어 있다. 또한, 적절하게 고려하여, 참조 부호는 도면에서 반복되어 대응하거나 유사한 소자를 나타내고 있다.
다음의 상세한 설명에서는, 다수의 특정 세목이 본 발명의 완전한 이해를 제공하기 위해서 제공된다. 그러나, 당업자라면, 본 발명이 이러한 특정 세목없이 실현될 수 있음을 이해할 것이다. 다른 경우, 공지 방법, 절차, 구성 요소 및 회로는 본 발명을 불명료하게 하지 않기 위해서 상세히 설명되지 않는다.
다음의 상세한 설명 중 일부분은 컴퓨터 메모리 내의 데이터 비트 또는 이진 디지털 신호에 대한 알고리즘 및 심볼 표현에 관하여 제시된다. 이들 알고리즘 설명 및 표현은 데이터 처리 분야의 당업자에 의해 이용되어 다른 분야의 당업자에게 작업의 실질성을 전달하게 하는 기술이 될 수 있다.
본 명세서에 일반적으로 알고리즘은 희망 결과를 가져오는 자기 일관성 시퀀스(self-consistent sequence)의 작용 또는 동작으로 간주된다. 이들은 물리량의 물리적 조작을 포함한다. 대체로, 이들 양은 저장, 전송, 조합, 비교 및 이와 달리 조작될 수 있는 전기적 또는 자기적 신호의 형태를 취하고 있으나, 반드시 그러한 것은 아니다. 대체로 통용되는 것이기 때문에 이들 신호를 비트, 값, 소자, 심볼, 문자, 용어, 수 등이라고 지칭하는 것은 때때로 편리하다. 그러나, 이러한 용어 및 유사한 용어 모두가 적절한 물리량과 연관되며 단지 이러한 물리량에 적용된 편리한 라벨일 뿐이라는 점을 이해해야 한다.
이와 달리 다음의 논의로부터 명백하기 때문에 구체적으로 진술하지 않은 경우, 명세서 전체에서 "프로세싱", "연산(computing)", "계산(calculating)", "판별" 등과 같은 용어는, 컴퓨팅 시스템의 레지스터 및/또는 메모리 내의 물리적(예를 들어, 전자적) 양으로서 표현되는 데이터를 컴퓨팅 시스템의 메모리, 레지스터 또는 그러한 정보 저장, 전송 또는 디스플레이 디바이스 내의 물리적인 양으로 유사하게 표현되는 다른 데이터로 조작 및/또는 변환하는 컴퓨터나 컴퓨팅 시스템, 또는 유사한 전자 장치의 액션 및/또는 프로세스를 지칭한다.
본 발명의 실시예는 동작을 수행하는 장치를 포함한다. 이 장치는 희망 목적을 위해 특별히 구성될 수 있으며, 또는 저장된 프로그램에 의해서 선택적으로 활성화되거나 재구성되는 범용 컴퓨팅 디바이스를 포함할 수도 있다. 이러한 프로그램은, 플로피 디스크, 광 디스크, CD-ROM, 자기광 디스크, 판독 전용 메모리(ROM), 랜덤 액세스 메모리(RAM), 전기적 프로그램 가능 판독 전용 메모리(EPROM), 전기적 소거가능 및 프로그램가능 판독 전용 메모리(EEPROM), 자기적 또는 광학적 카드와 같은 임의의 유형의 디스크, 또는 전자 인스트럭션을 저장하는 데 적합한 기타 유형의 임의의 매체와 같은 저장 매체 상에 저장될 수 있으나 이러한 것으로 제한되지는 않으며, 컴퓨팅 디바이스를 위하여 시스템 버스에 연결될 수 있다.
본 명세서에서 제시된 프로세스 및 디스플레이는 본질적으로 임의의 특정 컴퓨팅 디바이스 또는 기타 장치에 관련되지 않는다. 각종 범용 시스템은 본 명세서의 설명에 따라서 프로그램을 이용하여 사용될 수 있으며, 또는 더욱 특화된 장치를 구성하여 희망하는 방법을 실행하는 것이 더욱 편리할 수도 있다. 이러한 다양한 시스템에 대한 바람직한 구조는 하기의 설명으로부터 분명해질 것이다. 또한, 본 발명의 실시예는 임의의 특정 프로그래밍 언어를 참조하여 설명되지 않는다. 다양한 프로그래밍 언어가 본 명세서에서 설명한 바와 같은 본 발명의 설명을 구현하는 데 사용될 수도 있다.
다음의 설명 및 청구범위에서는, 용어 "결합된(coupled)" 및 "접속된(connected)"이 그 파생어와 함께 사용된다. 이들 용어는 서로에 대한 동의어로서 의도된 것이 아니다. 오히려, 특정 실시예에서, "접속된"이라는 용어는 2개 이상의 소자가 서로에게 직접적인 물리적 또는 전기적 접촉 상태임을 나타내는 데 사용된다. "연결된"이라는 용어는 2개 이상의 소자가 직접적인 물리적 또는 전기적 접촉 상태임을 의미한다. 그러나, "연결된"이라는 용어는 또한 2개 이상의 소자가 서로에게 직접적인 접촉상태는 아니지만, 여전히 협력하거나 서로 상호 작용한다는 것을 의미할 수도 있다.
본 발명의 실시예는 다양한 애플리케이션에서 사용된다. 본 발명이 이러한 관점으로 제한되는 것은 아니지만, 본 명세서에서 개시한 회로는 무선 시스템의 송신기 및 수신기에서와 같은 많은 장치에서 사용될 수도 있다. 본 발명의 범주 내에 포함되는 것으로 의도된 무선 시스템은, 단지 예로서, 셀룰러 무선전화 통신 시스템, 위성 통신 시스템, 쌍방향 무선 통신 시스템, 단방향 호출, 쌍방향 호출, 개인 통신 시스템(PCS), 무선 랜(WLAN) 통신 시스템, 개인휴대정보단말(PDA) 등을 포함한다.
본 발명의 범주 내에 있는 것으로 의도된 무선 또는 셀룰러 무선전화 통신 시스템의 유형은, 코드 분할 다중 접속(CDMA) 셀룰러 무선전화 통신 시스템, 범유럽 이동통신(GSM) 셀룰러 무선전화 시스템, 북아메리카 디지털 셀룰러(NADC) 셀룰러 무선전화 시스템, 시간 분할 다중 접속(TDMA) 시스템, 확장된 TDMA(E-TDMA) 셀룰러 무선전화 시스템, 광대역 CDMA(WCDMA)와 같은 제 3 세대(3G) 시스템, CDMA-2000, 무선 랜(WLAN), 무선 광역 통신망(WWAN) 등을 포함하지만, 이러한 것으로 제한되지는 않으며, 본 발명의 범주가 이러한 관점으로 제한되는 것도 아니다.
도 1을 참조하여, 본 발명의 실시예에 따른 송수신기의 블록도가 논의된다. 송수신기(100)는 휴대용 셀룰러 전화 수신기, 예를 들어 GSM, WLAN 또는 WCDMA 디바이스와 같은 통신 디바이스에서 사용되지만, 본 발명의 범주가 이러한 관점으로 제한되지는 않는다. 송수신기(100)는 송수신기(100)의 송신기 경로(144) 및 수신기 경로(146)를 조합하는 듀플렉서에 연결된 하나 이상의 안테나(110)를 포함한다. 듀플렉서(112)는 송신기 경로(144) 및 수신기 경로(146)가 공통 안테나 또는 안테나들(110)을 공유하게 하는 임피던스 매칭 회로를 포함한다. 수신기 경로(146)에서, 듀플렉서(112)는 저잡음 증폭기(LNA)(114)에 연결되어, 안테나(110)에서 수신된 무선 주파수(RF) 신호를 증폭하며, 이 증폭기(114)는 복조기(116)와 로컬 발진기(118)를 연결하여 수신된 RF 신호를 중간 주파수(IF) 신호로 변환한다. 로컬 발진기(118)는 가변되어, 수신기 경로(146)를 수신된 RF 신호의 희망 반송파 주파수로 튜닝한다. 표면 탄성파(SAW) 필터와 같은 IF 필터(120)는 희망 중간 주파수 범위(120)를 혼합기(116)의 출력으로부터 선택하는 데 사용된다. IF 필터(120)의 출력은 직교 발진기(126)에 연결되어 IF 신호를 동위상(I) 및 직교(Q) 성분이나 낮은 중간 주파수(LIF) 신호로 변환하는 복조기(122, 124)를 포함하는 복조기 단을 통과한다. 필터(128, 132)는 각각 복조기(122, 124)의 출력으로부터 희망하지 않는 주파수 성분을 필터링하는 데 사용된다. I 및 Q 또는 LIF 신호는 아날로그/디지털 변환기(130, 134)를 통해서 전송되어 기저대역 프로세서(136)에 의해 수신 및 처리된다. 이 기저 대역 프로세서(136)는 디지털 신호 프로세서(DSP)이며, 또는 디지털 신호 프로세서 또는 그 소자로서의 서브블록과 같은 디지털 신호 프로세서를 포함할 수도 있으나, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다.
송신기 경로(144)에서, 기저대역 프로세서(136)는 기저대역 신호를 디지털/아날로그 변환기(DAC)(138)에 제공하며, 이 변환기(DAC)(138)는 송신을 위해 변조될 신호를 변조기(140)에 제공한다. 변조기의 출력은 출력 신호를 듀플렉서(112) 및 무선 주파수 송신용 안테나(110)로 제공하는 전력 증폭기(PA)(142)를 통과하지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 본 발명의 일 실시예에서, 필터(128, 132)는 본 발명에 따른 프로그램가능 필터, 예를 들어 도 2 및 도 3에 도시한 프로그램가능 필터에 의해서 구현되며, 필터의 필터 응답은 송수신기(100)의 바람직한 동작 모드에 따라서 기저대역 프로세서(136)에 의해 제어되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다.
도 2를 참조하여, 본 발명의 일 실시예에 따른 2차 프로그램가능 필터의 블록도가 논의된다. 도 2의 필터(200)는 도 1에 도시한 송수신기(100)에서 사용되어, 예를 들어, 하나 이상의 주파수에서 동작할 수 있거나 하나 이상의 무선 통신 표준(예를 들어, GSM, WLAN 또는 WCDMA)에 맞추어 동작할 수 있는 다중 모드 무선용 프로그램 가능 필터를 제공하지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 필터(202)는 필터(128, 132)의 필터링 기능을 제공하는 데 사용되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 필터(200)는 일반적으로 아날로그 필터에서 사용되는 아날로그 성분 대신에 적분기 및 구성 가능한 아날로그 승산기를 사용하여 대응 아날로그 필터의 기능을 제공할 수 있는 프로그램가능 필터 또는 컨볼버(convolver)가 될 수도 있다. 필터(200)는, 일 실시예에서 비트 및 탭의 수를 최소화하여 바람직한 필터링을 달성하고, 필터를 구현하는 데 사용되는 구성 요소의 양을 최소화하는 무한 임펄스 응답(infinite impulse response: IIR) 토폴로지를 나타낼 수도 있으나, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다.
필터(200)는 반-알리아싱(anti-aliasing)을 제공하는 데 사용되는 저역 통과 필터(202)의 입력에서 시간 기반 신호 x(t)를 수신한다. 이후, 필터링된 신호는 승수 b(t mod 2T)에 의해 승산되는데, 이 승수 b는 기저대역 프로세서(136)에 의해 제공되고, 디지털/아날로그 변환기(DAC)를 사용하여 아날로그 값으로 변환된다. 출력된 승수는 적분기(214)로 적분되고, 합산 소자(214)에서 승산기(224)의 출력과 합산된다. 필터(128, 132)의 출력은, 승수 값이 대응 DAC를 거쳐서 기저대역 프로세서(136)에 의해 제공되는 승산기(234)를 이용하여 승수 값 b((t-T) mod 2T)로 승산된다. 여기서, T는 샘플링 주기, 2T는 b(t)의 임펄스 응답 시간 간격, t는 시간 인덱스이다. 승산기(234)의 출력은 적분기(236)를 통과하여, 합산 소자(238)에서 승산기(230)의 출력과 합산된다. 합산 소자의 출력은, 이산 시간 샘플 신호를 0차 유지(zero order hold: ZOH) 샘플 및 유지 회로(220, 242)로 제공하는 샘플러(218, 238)로 샘플링된다.
0차 유지 회로(220)의 출력은 y(n=0)로 표현되며, 승산기(230) 내로 제공되어 기저대역 프로세서(136)에 의해 제공되는 일정값(a1)(228)으로 승산된다. 승산기(230)의 출력은 합산 소자(238)에 제공된다. 유사하게, 0차 유지 회로(242)의 출력은 y(n=1)로 표현되며, 승산기(224) 내로 제공되어 기저대역 프로세서(136)에 의해 제공되는 일정값(a0)(226)으로 승산된다. 승산기(224)의 출력은 합산 소자(216)에 제공된다. 출력 y(n=0) 및 y(n=1)는 멀티플렉서(222)를 거쳐서 조합되어, 아날로그/디지털 변환기(ADC)(130 또는 134)로 제공된 후 기저대역 프로세서(136)에 전송된다.
필터(200)의 각 브랜치(244, 246)는 필터(200)의 응답을 위한 컨볼루션 연산자의 출력의 절반을 나타내고, 이에 따라 브랜치(244, 246)의 샘플링은 이산 도메인에 필터링된 신호를 나타낸다. 이 필터링된 신호는 샘플링된 아날로그 전단으로서 기저대역 프로세서에 포워드되거나, 또는 이와 달리 연속 아날로그 전단으로서 연속 신호로 재구성되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 도 2에 도시한 바와 같이, 무한 임펄스 응답(IIR) 프로그램가능 필터를 구현하는 데 사용된 지연은, 실질적인 지연 소자를 사용하기보다는, 신호 y(n=0) 및 y(n=1)의 피드백을 사용하고 멀티플렉서(223)를 거쳐서 다중화함으로써 달성되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 이러한 장치는 DAC의 개수를 감소시켜서, 희망 필터 동작을 발생시키는 승수 값(212, 232)을 제공한다. 다중모드 송수신기에서, 필터(200)는, 선택적으로는 실시간으로, 재구성될 수 있고, 이 필터(200) 내에서 기저대역 프로세서(136)는, 사용자 입력 또는 기저대역 프로세서(136) 상에서 실행되는 프로그램을 거쳐서 재구성화가 제어되는 경우에, 필터(200)에 제공된 값, 예를 들어 승수 값(212, 232, 226, 228)을 변화시킴으로써 필터(200)의 응답을 재구성할 수 있으나, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다.
도 3을 참조하여, 본 발명의 일 실시예에 따른 일반 차수 프로그램가능 필터의 블록도가 논의된다. 필터(300)는 필터(200)의 일반 차수의 구현예를 나타냄으로써 도 2의 2차 필터(200)와는 상당히 유사하다. N차 필터의 경우, 일반 차수 필터(300)는 브랜치(366, 368) 내지 N번째 브랜치(총 N개의 브랜치를 갖는 경우)를 구비하고 있으나, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 연속 시간 신호 x(t)는 반-알리아싱을 위하여 저역 통과 필터(302)를 통과한다. 필터(302)의 출력은 N개의 DAC, 즉 DA1(312), DAC2(336) 내지 N번째 DAC(352)의 출력으로 승산되어, 기저대역 프로세서(136)로부터 수신된 DAC에 대한 입력을 기초로 대응하는 승산기(310, 332) 내지 N번째 승산기(350)에 b((t-1·T) mod NT) 내지 b((t-NT) mod NT)를 제공한다. 상기 수학식에서, T는 샘플링 속도를 나타내고, mod는 모듈로(modulo) 수학 연산을 표시하며, m은 N차 필터(300)의 브랜치 개수를 나타내고, t는 실행 시간이다. 승산기(310, 332, 350)의 출력은 적분기(314, 334, 354)에 의해 적분되어 합산 소자(316, 338, 356)에 제공되며, 합산 소자(316, 338, 356)의 출력은 브랜치에서 N개의 합산 소자인 N번째 합산 소자(318, 340, 358)와 조합된다. 합산 소자(318, 340, 358)의 출력은, 공식 i·N·T+m·T에 의해서 각각의 브랜치마다 계산된 샘플링 시간에 샘플러(320, 342 내지 360)를 거쳐서 샘플링되며, 여기서 i는 1 내지 무한대의 실행 인덱스이며, 인덱스 m은 브랜치 번호에 대응한다. 브랜치는 시간 T와는 별개의 시간 인스턴스에서 샘플링되며, 여기서 T는 샘플링 간격이다. 샘플링된 신호는 0차 유지 샘플 및 유지 회로(322, 344) 내지 시간 N*T마다 샘플링된 신호를 유지하는 N번째 0차 유지 회로(364)로 전달되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. 필터(300)의 N개의 브랜치는, 이산 도메인 출력 y(n=1), y(n=m) 내지 N번째 출력 y(n=N)를 멀티플렉서(222)로 제공하고, 이 멀티플렉서(222)는 출력을 아날로그/디지털 변환기(130, 134)로 제공하며, 이 변환기(130, 134)는 출력을 기저대역 프로세서(136)로 제공하지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다. N개의 이산 시간 출력은 도 3에 도시한 바와 같은 다양한 합산 소자로 귀환되고, 일정한 값(370, 372, 374, 376, 378, 380)으로 승산되며, 승산기(382, 384, 836, 388, 390, 392)를 거쳐서 승산되지만, 본 발명의 범주는 이러한 사항으로 제한되지는 않는다.
본 발명이 소정의 상세한 사항으로 설명되고 있으나, 당업자라면 본 발명의 사상 및 범주로부터 벗어나지 않고서 그 소자를 변경할 수 있다. 본 발명의 프로그램가능 필터 등과, 많은 부대적인 이점이 전술한 상세한 설명에 의해서 이해되며, 그 구성 요소의 형식, 구조 및 장치는 본 발명의 사상 및 범주로부터 벗어나지 않거나, 실질적인 모든 이점을 희생하지 않고서 변경될 수 있음이 명백하다. 본 명세서에서 전술한 형식은 단지 설명상의 실시예일 뿐이며, 실질적인 변화를 제공하지 않는다. 이러한 변화를 포괄 및 포함하는 것이 청구범위의 의도이다.

Claims (28)

  1. 적어도 2개의 컨볼버(convolver) 브랜치 - 상기 브랜치는, 입력 신호를 승산 값으로 승산하기 위한 승산기와, 상기 승산기의 출력을 필터링하기 위한 필터와, 상기 저역 통과 필터의 출력을 수신하여 샘플링된 출력을 제공하는 샘플러 및 유지 회로를 포함함 - 와,
    상기 적어도 2개의 컨볼버 브랜치의 상기 샘플링된 출력들을 조합하는 멀티플렉서를 포함하되,
    상기 적어도 2개의 컨볼버 브랜치 중 하나의 브랜치의 상기 샘플링된 출력은 다른 브랜치의 상기 샘플러의 입력에 추가하는
    장치.
  2. 제 1 항에 있어서,
    상기 승산 값은 기저대역 프로세서에 의해 제공되어 바람직한 필터 응답을 제공하는
    장치.
  3. 제 1 항에 있어서,
    상기 다른 브랜치의 상기 샘플러의 상기 입력에 제공된 상기 샘플링된 출력은 일정한 값으로 승산되는
    장치.
  4. 제 1 항에 있어서,
    상기 다른 브랜치의 상기 샘플러의 상기 입력에 제공된 상기 샘플링된 출력은 일정한 값으로 승산되고,
    상기 일정한 값은 기저대역 프로세서에 의해서 제공되는
    장치.
  5. 제 1 항에 있어서,
    상기 승산 값은 기저대역 프로세서에 의해서 제공되어, 바람직한 동작 모드에 따라서 프로그램가능 필터 응답을 제공하는
    장치.
  6. 제 1 항에 있어서,
    상기 적어도 2개의 컨볼버 브랜치는 N개의 컨볼버 브랜치를 포함하고,
    상기 N개의 컨볼버 브랜치의 상기 샘플링된 출력은 상기 다른 브랜치의 상기 샘플러의 상기 입력에 피드백되는
    장치.
  7. 제 1 항에 있어서,
    상기 필터는 적분기를 포함하는
    장치.
  8. 적어도 2개의 컨볼버 브랜치를 통해서 입력된 신호를 승산기 값으로 승산하는 단계와,
    상기 승산된 입력 신호를 적분하여, 상기 적어도 2개의 컨볼버 브랜치에 적분 신호를 제공하는 단계와,
    상기 적분 신호를 샘플링하여 샘플링된 출력을 제공하는 단계와,
    상기 샘플링된 출력을 조합하는 단계와,
    상기 적어도 2개의 컨볼버 브랜치 중 하나의 브랜치의 상기 샘플링된 출력의 중 하나를 다른 브랜치에서의 상기 샘플링 단계에 추가하는 단계를 포함하는
    방법.
  9. 제 8 항에 있어서,
    상기 승산 값을 선택하여 바람직한 필터 응답을 제공하는 단계를 더 포함하는
    방법.
  10. 제 8 항에 있어서,
    상기 샘플링된 출력을 일정한 값으로 승산하는 단계를 더 포함하는
    방법.
  11. 제 8 항에 있어서,
    상기 샘플링된 출력을 일정한 값으로 승산하여 바람직한 필터 응답을 제공하는 단계를 더 포함하는
    방법.
  12. 제 8 항에 있어서,
    상기 조합 단계는 상기 샘플링된 출력을 다중화하는 단계를 포함하는
    방법.
  13. 제 8 항에 있어서,
    제 1 필터 모드에 따라서 상기 적어도 2개의 컨볼버 브랜치에서 제 1 승산 값 세트를 선택하는 단계와,
    제 2 필터 모드에 따라서 제 2 승산 값 세트를 선택하는 단계를 더 포함하는
    방법.
  14. 제 8 항에 있어서,
    상기 승산 단계는 N개의 컨볼버 브랜치를 통해서 입력된 신호를 승산하는 단계를 포함하고,
    상기 추가 단계는 상기 N개의 컨볼버 브랜치의 상기 샘플링된 출력을 상기 다른 N개의 컨볼버 브랜치의 상기 샘플링 단계에 추가하는 단계를 포함하는
    방법.
  15. 인스트럭션을 저장하는 기계 판독가능 저장 매체를 포함하는 물품으로서,
    적어도 2개의 컨볼버 브랜치를 통해서 입력된 신호를 승산 값으로 승산하는 과정과,
    상기 승산된 입력 신호를 적분하여, 집적 신호를 상기 적어도 2개의 컨볼버 브랜치에 제공하는 과정과,
    상기 집적 신호를 샘플링하여 샘플링된 출력을 제공하는 과정과,
    상기 샘플링된 출력을 조합하는 과정과,
    상기 적어도 2개의 컨볼버 브랜치 중의 하나의 브랜치의 상기 샘플링된 출력 중 하나를 다른 브랜치에서 상기 샘플링에 추가하는 과정에 의해서 필터 응답을 생성하는
    물품.
  16. 제 15 항에 있어서,
    상기 인스트럭션은 바람직한 필터 응답을 제공하기 위한 승산 값을 선택하는 과정을 더 포함하는
    물품.
  17. 제 15 항에 있어서,
    상기 인스트럭션은 또한 상기 샘플링된 출력을 일정한 값으로 승산하는 과정을 더 포함하는
    물품.
  18. 제 15 항에 있어서,
    상기 인스트럭션은 상기 샘플링된 출력을 일정한 값으로 승산하여, 바람직한 필터 응답을 제공하는 과정을 더 포함하는
    물품.
  19. 제 15 항에 있어서,
    상기 인스트럭션은 상기 조합 과정에서 상기 샘플링된 출력을 다중화하는 과정을 더 포함하는
    물품.
  20. 제 15 항에 있어서,
    상기 인스트럭션은 제 1 필터 모드에 따라서 제 1 승산 값 집합을 상기 적어도 2개의 컨볼버 브랜치에서 선택하는 과정과,
    제 2 필터 모드에 따라서 제 2 승산 값 집합을 선택하는 과정을 더 포함하는
    물품.
  21. 제 15 항에 있어서,
    상기 인스트럭션은 상기 승산 과정에서 N개의 컨볼버 브랜치를 통한 상기 입력 신호를 다른 N개의 컨볼버 브랜치의 상기 샘플링 과정에 추가하는 과정을 더 포함하는
    물품.
  22. 기저대역 프로세서와,
    상기 기저대역 프로세서에 연결된 송수신기와,
    상기 송수신기에 연결된 마이크로스트립 안테나를 포함하되,
    상기 송수신기는 프로그램가능 필터를 포함하며,
    상기 필터는,
    적어도 2개의 컨볼버(convolver) 브랜치 - 상기 브랜치는, 입력 신호를 승산 값으로 승산하기 위한 승산기와, 상기 승산기의 출력을 필터링하기 위한 필터와, 상기 저역 통과 필터의 출력을 수신하여 샘플링된 출력을 제공하는 샘플러 및 유지 회로를 포함함 - 와,
    상기 적어도 2개의 컨볼버 브랜치의 상기 샘플링된 출력들을 조합하는 멀티플렉서를 포함하되,
    상기 적어도 2개의 컨볼버 브랜치 중 하나의 브랜치의 상기 샘플링된 출력은 다른 브랜치의 상기 샘플러의 입력에 추가하는
    장치.
  23. 제 22 항에 있어서,
    상가 승산 값은 상기 기저대역 프로세서에 의해서 제공되는 상기 필터의 바람직한 필터 응답을 제공하는
    장치.
  24. 제 22 항에 있어서,
    상기 다른 브랜치의 상기 샘플러의 입력에 제공되는 상기 샘플링된 출력은 일정한 값으로 승산되는
    장치.
  25. 제 22 항에 있어서,
    상기 다른 브랜치의 상기 샘플러의 입력에 제공되는 상기 샘플링된 출력은 일정한 값으로 승산되고,
    상기 일정한 값은 상기 기저대역 프로세서에 의해서 제공되는
    장치.
  26. 제 22 항에 있어서,
    상기 승산 값은 상기 기저대역 프로세서에 의해 제공되어, 바람직한 동작 모드에 따라서 상기 필터 응답의 프로그램가능 필터를 제공하는
    장치.
  27. 제 22 항에 있어서,
    상기 적어도 2개의 컨볼버 브랜치는 N개의 컨볼버 브랜치를 포함하고,
    상기 N개의 컨볼버 브랜치의 상기 샘플링된 출력은 상기 다른 브랜치의 상기 샘플러의 입력에 추가되는
    장치.
  28. 제 22 항에 있어서,
    상기 필터는 적분기를 포함하는
    장치.
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