KR100667236B1 - 플라즈마 디스플레이 패널 및 그 구동방법 - Google Patents

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Abstract

본 발명은 소거 기간에서 인가되는 펄스의 인가시점을 개선함으로써, 방전된 셀 내의 벽전하 소거 효율 및 패널 구동의 안정성을 높이는 플라즈마 디스플레이 패널 및 그의 구동 방법에 관한 것이다. 본 발명은, 리셋 기간, 어드레스 기간, 서스테인 기간 및 소거 기간에 어드레스 전극, 스캔 전극 및 서스테인 전극에 소정의 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 소정의 개수의 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 소거 기간에서 상기 서스테인 전극에 공급되는 소거 전압이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 한다. 상기 소거 기간에서 상기 서스테인 전극에 소거 전압이 공급되는 기간 내에 상기 어드레스 전극에 소정의 펄스폭을 갖는 구형파 전압을 인가한다. 상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 개시되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 상승 기울기를 갖는 일정시간 이내이고, 상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 종료되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 공급전압을 유지시키는 일정시간 이내이다.
플라즈마, 패널, 소거, 기간, 펄스, 스캔, 기울기, 구형파, 서스테인

Description

플라즈마 디스플레이 패널 및 그 구동방법{Plasma Display Panel and Driving Method Thereof}
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 도시한 도면.
도 2는 플라즈마 디스플레이 패널과 구동모듈의 결합관계를 나타낸 도면.
도 3은 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도면.
도 4는 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도면.
도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도면.
도 6은 본 발명에 따른 도 5의 소거기간을 상세히 나타낸 도면.
도 7은 본 발명의 실시예에 따라 구동하는 플라즈마 디스플레이 패널의 컨트롤러의 구성을 개략적으로 나타낸 블럭도.
<도면의 주요 부분에 대한 부호의 설명>
20 : 데이터 드라이버 IC 21 : 스캔 드라이버 IC
23 : 서스테인 보드 90 : 패널
X : 스캔 전극 Y : 서스테인 전극
Z : 어드레스 전극
본 발명은 플라즈마 디스플레이 패널(Plasma Display Panel)에 관한 것으로, 보다 상세하게는 소거 기간에서 인가되는 펄스의 인가시점을 개선함으로써, 방전된 셀 내의 벽전하 소거 효율 및 패널 구동의 안정성을 높이는 플라즈마 디스플레이 패널 및 그의 구동 방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 전면기판과 후면기판 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.
도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면기판(100) 및 배면을 이루는 후면 글라스(111) 상에 전술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극 (113)이 배열된 후면기판(110)이 일정거리를 사이에 두고 평행하게 결합된다.
전면기판(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO 물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 스캔 전극(102) 및 서스테인 전극(103)이 쌍을 이뤄 포함된다. 스캔 전극(102) 및 서스테인 전극(103)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체층(104)에 의해 덮혀지고, 상부 유전체층(104) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.
후면기판(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면기판(110)의 상측면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 하부 유전체층(115)이 형성된다.
이러한 구조의 플라즈마 디스플레이 패널은 방전셀이 매트릭스(Matrix) 구조로 복수개가 형성되고, 방전셀에 소정의 펄스를 공급하기 위한 구동회로를 포함하는 구동모듈이 부착되어 구동된다. 이러한 플라즈마 디스플레이 패널과 구동모듈의 결합관계를 살펴보면 도 2와 같다.
도 2는 플라즈마 디스플레이 패널과 구동모듈의 결합관계를 나타낸 도면이 다.
도 2에 도시된 바와 같이, 구동모듈은 예컨대, 데이터 드라이버 IC(Integrated Circuit)(20), 스캔 드라이버 IC(21), 서스테인 보드(23)를 포함하여 구성된다. 플라즈마 디스플레이 패널(22)은 외부로부터 영상신호를 입력받아 소정의 신호 처리 과정을 거쳐 데이터 드라이버 IC(20)로부터 출력된 데이터 펄스를 입력받고, 스캔 드라이버 IC(21)로부터 출력된 스캔 펄스 및 서스테인 펄스를 입력받고, 서스테인 보드(23)로부터 출력된 서스테인 펄스를 입력받는다. 데이터 펄스, 스캔 펄스, 서스테인 펄스 등을 입력받은 플라즈마 디스플레이 패널(22)에 포함된 다수의 셀 중에서 스캔 펄스에 의해 선택된 셀에 방전이 발생하고, 방전이 발생한 셀은 소정의 휘도로 발광한다. 여기서 데이터 드라이버 IC(20)은 FPC(Flexible Printed Circuit)(미도시)와 같은 연결체를 통해 각 어드레스 전극(X1~Xn)에 소정의 데이터 펄스를 출력한다.
이와 같은 플라즈마 디스플레이 패널에서 화상 계조를 구현하는 방법은 다음 도 3과 같다.
도 3은 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.
도 3에 도시된 바와 같이, 종래 플라즈마 디스플레이 패널의 화상 계조(Gray Level) 표현 방법은 한 프레임을 발광횟수가 다른 여러 서브필드로 나누고, 각 서브필드는 다시 모든 셀들을 초기화시키기 위한 리셋 기간(RPD), 방전될 셀을 선택 하기 위한 어드레스 기간(APD) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(SPD)으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다. 방전될 셀을 선택하기 위한 어드레스방전은 어드레스 전극과 스캔 전극인 투명전극 사이의 전압차에 의해 일어난다. 서스테인 기간은 각 서브필드에서 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가된다. 이와 같이 각 서브필드에서 서스테인 기간이 달라지게 되므로 각 서브필드의 서스테인 기간 즉, 서스테인 방전 횟수를 조절하여 화상의 계조를 표현하게 된다. 이러한 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 살펴보면 다음 도 4와 같다.
도 4는 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도면이다.
도 4에 도시된 바와 같이, 플라즈마 디스플레이 패널은 모든 셀들을 초기화시키기 위한 리셋 기간, 방전할 셀을 선택하기 위한 어드레스 기간, 선택된 셀의 방전을 유지시키기 위한 서스테인 기간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 기간으로 나뉘어 구동된다.
리셋 기간에 있어서, 셋업 기간에는 모든 스캔 전극들에 상승 램프파형 (Ramp-up)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 방전에 의해 어드레스 전극과 서스테인 전극 상에는 정극성 벽전하가 쌓이게 되며, 스캔 전극 상에는 부극성의 벽전하가 쌓이게 된다.
셋다운 기간에는 상승 램프파형이 공급된 후, 상승 램프파형의 피크전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 스캔 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스 기간에는 부극성 스캔 펄스가 스캔 전극들에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스 전극에 정극성의 데이터 펄스가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 리셋 기간에 생성된 벽 전압이 더해지면서 데이터 펄스가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인 전극에는 셋다운 기간과 어드레스 기간 동안에 스캔 전극과의 전압차를 줄여 스캔 전극과의 오방전이 일어나지 않도록 정극성 전압(Vz)이 공급된다.
서스테인 기간에는 스캔 전극과 서스테인 전극들에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테 인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.
서스테인 방전이 완료된 후, 소거 기간에서는 펄스폭과 전압레벨이 작은 소거 램프파형(Ramp-ers)의 전압이 서스테인 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시키게 된다.
그러나, 이와 같은 종래의 플라즈마 디스플레이 패널 및 그 구동방법은, 펄스폭과 전압레벨이 작은 소거 램프파형(Ramp-ers)의 전압에 의하여 방전된 셀 내의 벽전하 소거 효율이 저하되고, 플라즈마 디스플레이 패널의 구동효율을 저감시키는 문제점이 있었다.
이러한 문제점을 해결하기 위해 본 발명은, 소거 기간에서 인가되는 펄스의 인가시점을 개선함으로써, 방전된 셀 내의 벽전하 소거 효율 및 패널 구동의 안정성을 높이는 플라즈마 디스플레이 패널 및 그의 구동 방법을 제공하는데 그 목적이 있다.
이러한 목적을 이루기 위한 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법은, 리셋 기간, 어드레스 기간, 서스테인 기간 및 소거 기간에 어드레스 전극, 스캔 전극 및 서스테인 전극에 소정의 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 소정의 개수의 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 소거 기간에서 상기 서스테인 전극에 공급되는 소거 전압이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 하는 것을 특징으로 한다.
상기 소거 기간에서 상기 서스테인 전극에 소거 전압이 공급되는 기간 내에 상기 어드레스 전극에 소정의 펄스폭을 갖는 전압을 인가한다. 상기 어드레스 전극에 공급되는 전압은 구형파인 것이 바람직하다.
상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 개시되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 상승 기울기를 갖는 일정시간 이내이고, 상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 종료되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 공급전압을 유지시키는 일정시간 이내인 것이 더욱 바람직하다.
또한, 본 발명에 따른 플라즈마 디스플레이 패널은, 리셋 기간, 어드레스 기간, 서스테인 기간 및 소거 기간에 어드레스 전극, 스캔 전극 및 서스테인 전극에 소정의 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 소정의 개수의 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널에 있어서, 상기 소거 기간에서 상기 서스테인 전극에 공급되는 소거 전압이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 하는 것을 특징으로 한다.
이하 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 패널 및 그의 구동방법의 실시예들을 상세히 설명한다.
도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법에 따른 구동 파형을 나타낸 도면이고, 도 6은 본 발명에 따른 도 5의 소거기간을 상세히 나타낸 도면이다.
도시된 바와 같이 본 발명은, 리셋 기간, 어드레스 기간, 서스테인 기간 및 소거 기간에 어드레스 전극(X), 스캔 전극(Y) 및 서스테인 전극(Z)에 소정의 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 소정의 개수의 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 소거 기간에서 상기 서스테인 전극(Z)에 공급되는 소거 전압(Ramp-ers)이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 한다.
즉, 도 6에 도시된 바와 같이, 상기 서스테인 전극(Z)에 공급되는 소거 전압(Ramp-ers)의 상승 기울기는 T1 + T2 = 2㎲ 시간동안 진행되고, 이후 이 공급전압이 소정의 펄스폭을 같도록 일정시간 예로서, T3 + T4 시간 만큼 유지되어, 상기 서스테인 전극(Z)에 공급되는 소거 전압(Ramp-ers)의 전체 시간은 T1 + T2 + T3 + T4 =15㎲ 동안 공급전압을 유지시키도록 한다.
또한, 상기 소거 기간에서 상기 서스테인 전극(Z)에 소거 전압(Ramp-ers)이 공급되는 기간내에 상기 어드레스 전극(X)에 소정의 펄스폭을 갖는 전압을 인가하되, 상기 어드레스 전극(X)에 공급되는 전압은 도 6에 도시된 바와 같은 구형파인 것이 바람직하다.
아울러, 상기 소거 기간에서 상기 어드레스 전극(X)의 공급 전압이 개시되는 시점은, 상기 서스테인 전극(Z)에 공급되는 소거 전압(Ramp-ers)이 상승 기울기를 갖는 일정시간 이내이고, 상기 소거 기간에서 상기 어드레스 전극(X)의 공급 전압이 종료되는 시점은, 상기 서스테인 전극(Z)에 공급되는 소거 전압(Ramp-ers)이 공급전압을 유지시키는 일정시간 이내인 것이 바람직하다.
즉, 상기 어드레스 전극(X)의 공급 전압이 개시되는 시점은, 1.5㎲ < T1 < 2㎲ 이내 이고, 상기 어드레스 전극(X)의 공급 전압이 종료되는 시점은, T1 + T2 + T3 = 15㎲ (T4 = 0) 이내인 것이 바람직하다.
도 7은 본 발명의 실시예에 따라 구동하는 플라즈마 디스플레이 패널의 컨트롤러의 구성을 개략적으로 나타낸 블럭도이다.
도시된 바와 같이 본 발명은, 플라즈마 디스플레이 패널의 회로 모듈은 컨트롤 보드(Control Board), 데이터 보드, 스캔 보드, 서스테인 보드 등을 포함하여 구성된다. 특히, 컨트롤 보드는 나머지 보드의 동작을 제어하는 핵심적인 기능을 수행하는 데, 감마(Gamma) 처리, 게인(Gain) 처리, 오차 확산 처리, APL(Averae Picture Level) 계산, 서브필드 매핑(SFM : Sub-Field Mapping) 처리, 데이터 보드, 스캔 보드 및 서스테인 보드의 동작 타이밍 처리 등의 다양한 기능을 수행한다.
컨트롤러(1300)는 컨트롤 보드에 탑재되는 부품으로 신호 처리기(1310), 메모리 컨트롤러(1320), 데이터 정렬기(1330), 이피롬(EPROM : Erasable Pro-grammable ROM)(1340), 타이밍 컨트롤러(1350) 등을 포함하여 구성된다.
신호 처리기(1310)는 DVS 신호, DHS 신호, DEN 신호, R, G, B 신호 등을 수신하여 게인 처리, 서브필드 매핑 처리, 오차 확산 처리, 역감마 보정 처리, APL 계산 등을 기능을 수행한다.
메모리 컨트롤러(1320)는 신호 처리기(1310)로부터 입력되는 각종 신호를 저장하였다가 타이밍 컨트롤러(1350)의 제어에 의해 신호를 처리한다.
데이터 정렬기(1330)는 메모리 컨트롤러(1320)로부터 수신한 각종 데이터 펄스를 정렬하고, 타이밍 컨트롤러(1350)로부터 입력받은 제어 신호에 따라 데이터 보드(1360)으로 정렬된 데이터 펄스를 인가한다.
이피롬(1340)은 스캔 테이블, 서브필드 매핑 테이블, 타이밍 테이블, APL 테이블, 각종 파라미터(Parameter) 등을 저장하고 있다. 따라서 신호 처리기(1310) 및 타이밍 컨트롤러(1350)는 이피롬(1340)에 저장된 각종 테이블을 이용하여 원하는 동작을 수행한다.
한편, 본 발명의 실시예에 따르면 이피롬(1340)에 저장된 타이밍 테이블에 데이터 보드(1360)에 탑재된 데이터 드라이버 IC(미도시)로 인가하는 하나 이상의 데이터 펄스에 대한 데이터 펄스 타이밍 테이블과, 스캔 드라이버 IC(미도시)로 스캔 펄스에 대한 스캔 펄스 타이밍 테이블이 포함되어 있다. 이피롬(1340)에 저장된 데이터 펄스 타이밍 테이블에는 두 개 이상의 전극군에 포함된 어드레스 전극에 대한 데이터 펄스 인가 시점과 스캔 전극에 대한 스캔 펄스 인가 시점에 대한 정보가 저장되어 있다. 즉, 이러한 소정의 타이밍 테이블로 인해 소거 기간에서 상기 서스테인 전극에 공급되는 소거 전압이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 한다.
상기 소거 기간에서 상기 서스테인 전극에 소거 전압이 공급되는 기간내에 상기 어드레스 전극에 소정의 펄스폭을 갖는 전압을 인가한다. 상기 어드레스 전극에 공급되는 전압은 구형파인 것이 바람직하다.
상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 개시되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 상승 기울기를 갖는 일정시간 이내이고, 상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 종료되는 시점은, 상기 서스테인 전극에 공급되는 소거 전압이 공급전압을 유지시키는 일정시간 이내인 것이 더욱 바람직하다.
한편, 도 7에서는 데이터 펄스 타이밍 테이블을 포함한 각종 테이블이 저장되는 저장 매체로서 이피롬(1340)을 예로 들어 설명하고 있지만, 저장 매체가 이에 한정되는 것은 결코 아니며 이이피롬(EEPROM), 플래쉬롬(Falsh ROM) 등과 같은 롬 타입 저장 매체도 가능하다.
타이밍 컨트롤러(1350)는 이피롬(1340)에 저장된 데이터 펄스 타이밍 테이블 및 스캔 펄스 타이밍 테이블에 기록된 정보를 읽어 들여 스캔 펄스 및 데이터 펄스의 인가를 위한 제어 신호를 생성하고, 생성된 제어 신호를 데이터 정렬기(1330)로 인가한다. 데이터 정렬기(1330)는 타이밍 컨트롤러(1350)로부터 수신한 제어 신호에 따라 정렬된 데이터를 인가하기 위한 데이터 펄스를 생성하여 데이터 보드(1360)로 인가한다.
따라서 데이터 보드(1360)에 탑재된 데이터 드라이버 IC(미도시)는 수신한 데이터 펄스의 수신 순서에 따라 데이터 펄스를 해당 어드레스 전극으로 전달한다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서 상세히 설명한 바와 같이, 본 발명의 플라즈마 디스플레이 패널 및 그의 구동 방법에 의하면, 소거 기간에서 인가되는 펄스의 인가시점을 개선함으로써, 방전된 셀 내의 벽전하 소거 효율 및 패널 구동의 안정성을 높이게 되는 효과가 있다.

Claims (10)

  1. 삭제
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  6. 리셋 기간, 어드레스 기간, 서스테인 기간 및 소거 기간에 어드레스 전극, 스캔 전극 및 서스테인 전극에 소정의 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 소정의 개수의 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널에 있어서,
    상기 소거 기간에서 상기 서스테인 전극에 공급되는 소거 전압이 일정시간의 상승 기울기를 갖은 후, 소정의 펄스폭을 같도록 일정시간동안 공급전압을 유지시키도록 하며,
    상기 소거 기간에서 상기 서스테인 전극에 소거 전압이 공급되는 기간 내에 상기 어드레스 전극에 소정의 펄스폭을 갖는 전압이 인가되고 있는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 삭제
  8. 제 6 항에 있어서,
    상기 어드레스 전극에 공급되는 전압은 구형파인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  9. 제 6 항에 있어서,
    상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 개시되는 시점은,
    상기 서스테인 전극에 공급되는 소거 전압이 상승 기울기를 갖는 일정시간 이내인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  10. 제 6 항에 있어서,
    상기 소거 기간에서 상기 어드레스 전극의 공급 전압이 종료되는 시점은,
    상기 서스테인 전극에 공급되는 소거 전압이 공급전압을 유지시키는 일정시간 이내인 것을 특징으로 하는 플라즈마 디스플레이 패널.
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