KR100550997B1 - 플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치 - Google Patents

플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치 Download PDF

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Abstract

본 발명에 따른 플라즈마 표시 패널 구동 방법은 유지 기간에서, 제1 전극 및 제2 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가한다. 이 때, 제1 전극에 시간적으로 마지막에 인가되는 유지 방전 펄스의 폭이, 상기 제1 전극에 인가되는 나머지 유지방전 펄스의 폭보다 짧고, 제1 전극에 전기적으로 연결된 인덕터와 상기 용량성 부하의 공진을 이용하지 않고 상기 제1 전극에 상기 마지막 유지방전 펄스를 인가한다. 이렇게 하면, 다음 서브필드에서의 어드레스 방전 지연을 단축시킬 수 있는 효과가 있다.
PDP, 전극, 공진, 주사 전압, 어드레스, 방전, 전력 회수 회로

Description

플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치{DRIVING METHOD OF PLASMA DISPLAY PANEL AND PLASMA DISPLAY DEVICE}
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형도이다.
도 3은 본 발명의 실시 예에 따른 유지방전 구동 회로를 나타내는 도면이다.
도 4는 도 2의 구동 파형에서 유지 전극에 인가되는 마지막 유지방전 펄스를 생성하기 위한 도 3의 구동 회로에서의 전류 경로를 나타내는 도면이다.
본 발명은 플라즈마 표시 패널(plasma display panel, PDP)의 구동 방법에 관한 것이다.
교류형 플라즈마 표시 패널에는 그 한쪽 면에 서로 평행인 주사 전극 및 유지 전극이 형성되고 다른 쪽 면에 이들 전극과 직교하는 방향으로 어드레스 전극이 형성된다. 그리고 유지 전극은 각 주사 전극에 대응해서 형성되며, 그 일단이 서로 공통으로 연결되어 있다.
플라즈마 표시 패널의 구동 방법에 따르면, 각 서브필드는 리셋 기간(reset period), 어드레스 기간(address period) 및 유지 기간(sustain period)으로 이루어진다.
리셋 기간은 이전의 유지방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업(setup) 하는 역할을 한다. 어드레스 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다. 그리고 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지방전을 수행하는 기간이다.
한편, 어드레스 기간에서는 주사 전극(Y)과 어드레스 전극에 각각 주사 펄스 및 어드레스 펄스를 인가하여 주사 전극(Y)과 어드레스 전극(A) 사이에서 어드레스 방전을 일으켜 켜질 셀을 선택한다.
그런데, 일반적으로 두 전극 사이에 전압을 인가하여 수행되는 방전은 전압이 인가된 시점보다 시간적으로 지연되어 방전이 발생하게 된다. 특히, 앞서 설명한 어드레스 방전은 일정한 주사 펄스와 어드레스 펄스의 폭 내에서 방전이 수행되어야 하므로 방전 지연 시간이 주사 펄스와 어드레스 펄스의 폭보다 길어지면 방전이 일어나지 않는 문제점이 발생하게 된다.
본 발명이 이루고자 하는 기술적 과제는 어드레스 방전 지연 시간을 단축시켜 안정적인 어드레스 방전을 일으킬 수 있는 플라즈마 표시 패널의 구동 방법을 제공하고자 하는 것이다.
본 발명의 한 특징에 따르면, 복수의 제1 전극 및 복수의 제2 전극을 포함하며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널에서 한 프레임을 복수의 서브필드로 나누어 구동하는 방법이 제공된다. 이 구동 방법은, 적어도 하나의 서브필드의 유지 기간에서, 상기 제1 전극 및 상기 제2 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가하는 단계를 포함하며, 상기 제1 전극에 시간적으로 마지막에 인가되는 유지 방전 펄스의 폭이, 상기 제1 전극에 인가되는 나머지 유지방전 펄스의 폭보다 짧고, 상기 제1 전극에 전기적으로 연결된 인덕터와 상기 용량성 부하의 공진을 이용하지 않고 상기 제1 전극에 상기 마지막 유지방전 펄스를 인가한다. 이 때, 유지 기간에서 마지막 유지방전 펄스는 상기 제2 전극에 인가될 수 있으며, 상기 제1 전극은 유지 전극이고, 상기 제2 전극은 주사 전극일 수 있다.
그리고 이 구동 방법은, 상기 유지 기간과 이어지는 리셋 기간에서는 직전 서브필드에서 유지 방전이 일어난 방전 셀에 대해서 초기화를 수행할 수 있다. 이 때, 상기 유지 기간과 이어지는 리셋 기간에서, 상기 제2 전극에 마지막 유지방전 펄스의 높은 전압이 인가된 상태에서 상기 제2 전극의 전압을 제1 전압까지 점진적으로 감소시키는 단계를 포함한다.
본 발명의 다른 한 특징에 따르면, 복수의 주사 전극 및 복수의 유지 전극을 포함하며, 상기 주사 전극과 상기 유지 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널, 그리고 상기 플라즈마 표시 패널에서 한 프레임을 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지는 복수의 서브필드로 나누고, 상기 주사 전극 및 유지 전극에 구동 전압을 인가하는 구동 회로를 포함하는 플라즈마 표시 장치가 제공된다. 이 때, 상기 구동 회로는, 상기 복수의 서브필드 중 제1 서브필드의 유지 기간에서, 상기 주사 전극 및 상기 유지 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가하고, 상기 유지 전극에 인가되는 복수의 유지방전 펄스를 복수의 그룹으로 나눌 때 시간적으로 마지막으로 인가되는 유지방전 펄스를 포함하는 그룹의 유지방전 펄스는, 상기 유지 전극에 전기적으로 연결된 인덕터와 상기 용량성 부하의 공진을 통하지 않고 인가되고, 다른 그룹의 유지방전 펄스의 폭보다 짧은 폭을 가진다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
이제 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
먼저, 본 발명의 실시 예에 따른 플라즈마 표시 장치의 개략적인 구조에 대해서 도 1을 참조하여 자세하게 설명한다.
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 1에 나타낸 바와 같이, 본 발명의 실시 예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 구동부(300), 유지전극 구동부(400) 및 주사전극 구동부(500)를 포함한다.
플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(A1∼Am), 그리고 행 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)을 포함한다. X 전극(X1∼Xn)은 각 Y 전극(Y1∼Yn)에 대응해서 형성되며, 일반적으로 그 일단이 서로 공통으로 연결되어 있다. 그리고 플라즈마 표시 패널(100)은 유지 및 주사 전극(X1∼Xn, Y1∼Yn)이 배열된 기판(도시하지 않음)과 어드레스 전극(A1∼Am)이 배열된 기판(도시하지 않음)으로 이루어진다. 두 기판은 주사 전극(Y1∼Yn)과 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn)과 어드레스 전극(A1∼Am)이 각각 직교하도록 방전 공간을 사이에 두고 대향하여 배치된다. 이때, 어드레스 전극(A1∼Am)과 유지 및 주사 전극(X1∼Xn, Y1∼Yn)의 교차부에 있는 방전 공간이 방전 셀을 형성한다. 이러한 플라즈마 표시 패널(100)의 구조는 일 예이며, 아래에서 설명하는 구동 파형이 적용될 수 있는 다른 구조의 패널도 본 발명에 적용될 수 있다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스구동 제어 신호, 유지 전극(X) 구동 제어신호 및 주사 전극(Y) 구동 제어신호를 출력한다. 그리고 제어부(200)는 한 프레임을 복수의 서브필드로 분할하여 구동하며, 각 서브필드는 시간적인 동작 변화로 표현하면 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다.
어드레스 구동부(300)는 제어부(200)로부터 어드레스구동 제어신호를 수신하 여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
유지전극 구동부(400)는 제어부(200)로부터 유지전극(X)구동 제어신호를 수신하여 유지 전극(X)에 구동 전압을 인가한다.
주사전극 구동부(500)는 제어부(200)로부터 주사전극(Y)구동 제어신호를 수신하여 주사 전극(Y)에 구동 전압을 인가한다.
아래에서는 도 2를 참조하여 각 서브필드에서 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)에 인가되는 구동 파형에 대하여 설명한다. 그리고 아래에서는 하나의 어드레스 전극, 유지 전극 및 주사 전극에 의해 형성되는 방전 셀을 기준으로 설명한다. 그리고 아래에서 언급되는 벽 전하란 각 전극에 가깝게 방전 셀의 벽(예를 들어, 유전체층)에 형성되어 전극에 축적되는 전하를 말한다. 이러한 벽 전하는 실제로 전극 자체에 접촉되지는 않지만, 여기서는 벽 전하가 전극에 "형성됨", "축적됨" 또는 "쌓임"과 같이 설명된다. 또한 벽 전압은 벽 전하에 의해서 방전 셀의 벽에 형성되는 전위차를 말한다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형도이다. 도 2에서는 복수의 서브필드 중 두 개의 서브필드만을 도시하였으며, 각각 제1 서브필드 및 제2 서브필드로 표현하였다. 그리고 제1 서브필드의 리셋 기간이 상승 기간과 하강 기간으로 이루어지는 것으로 도시하였고, 제2 서브필드의 리셋 기간이 하강 기간으로 이루어지는 것으로 도시하였다. 즉, 제1 서브필드의 리셋 기간에서는 모든 방전 셀을 초기화하며, 제2 서브필드의 리셋 기간에서는 제1 서브필드에서 유지 방전이 일어난 방전 셀에 대해서 초기화를 수행한다. 여기서, 제1 서브필드의 리셋 기간을 메인 리셋 기간으로 표현할 수 있으며, 제2 서브필드의 리셋 기간을 보조 리셋 기간으로 표현할 수 있다.
도 2에 나타낸 바와 같이, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지며, 리셋 기간은 상승 기간 및 하강 기간을 포함한다.
제1 서브필드의 리셋 기간의 상승 기간에서는 유지 전극(X)을 0V로 유지한 상태에서 주사 전극(Y)에 Vs 전압에서 Vset 전압까지 증가시킨다. 그러면, 주사 전극(Y)으로부터 어드레스 전극(A) 및 유지 전극(X)으로 각각 미약한 리셋 방전이 일어나면서, Y 전극에 (-)의 벽 전하가 형성되고 어드레스 전극(A) 및 유지 전극(X)에 (+)의 벽 전하가 형성된다.
그리고 제1 서브필드의 리셋 기간의 하강 기간에서는 유지 전극(X)을 Ve 전압으로 유지시킨 상태에서 주사 전극(Y)에 Vs 전압에서 Vnf 전압까지 감소시킨다. 그러면, 주사 전극(Y)의 전압이 감소하는 중에 주사 전극(Y)과 유지 전극(X) 사이 및 주사 전극(Y)과 어드레스 전극(A) 사이에서 미약한 리셋 방전이 일어나면서, Y 전극에 형성된 (-) 벽 전하와 X 전극 및 A 전극에 형성된 (+) 벽 전하가 소거된다.
다음, 제1 서브필드의 어드레스 기간에서 켜질 셀을 선택하기 위해 주사 전극(Y)과 어드레스 전극(A)에 각각 VscL 전압을 가지는 주사 펄스 및 Va 전압을 가지는 어드레스 펄스를 인가한다. 그리고 선택되지 않는 주사 전극(Y)은 VscL 전압보다 높은 VscH 전압으로 바이어스하고, 켜지지 않을 셀의 어드레스 전극에는 기준 전압을 인가한다. 그러면, 어드레스 전압(Va)과 주사 전압(VscL)의 차이 및 어드레 스 전극(A) 및 주사 전극(Y)에 형성된 벽 전하에 의한 벽 전압에 의해 어드레스 방전이 일어난다. 그 결과 주사 전극(Y)에는 (+)의 벽 전하가 형성되고 유지 전극(X)에는 (-) 벽 전하가 형성된다. 또한 어드레스 전극(A)에도 (-) 벽 전하가 형성된다.
이어서, 제1 서브필드의 유지 기간에서는 주사 전극(Y)과 유지 전극(X)에 차례로 Vs 전압의 유지 방전 펄스를 인가한다. 이 때, 유지방전 펄스는 주사 전극(Y)과 유지 전극(X)의 전압차가 교대로 Vs 전압 및 -Vs 전압이 되도록 하는 펄스이다. 그러면, 어드레스 기간에서 어드레스 방전에 의해 주사 전극(Y)과 유지 전극(X) 사이에 벽 전압이 형성되어 있으면, 벽 전압과 Vs 전압에 의해 주사 전극(Y)과 유지 전극(X)에서 방전이 일어난다. 이후, 주사 전극(Y)에 Vs 전압의 유지방전 펄스를 인가하는 과정과 유지 전극(X)에 Vs 전압의 유지방전 펄스를 인가하는 과정을 해당 서브필드가 표시하는 가중치에 대응하는 횟수만큼 반복한다. 이 때, 각 서브필드의 유지 기간에서의 마지막 유지 방전 펄스는 주사 전극(Y)에 인가된다.
본 발명의 실시 예에 따르면, 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 다른 유지방전 펄스의 폭보다 좁은 세폭으로 한다. 예를 들어, 주사 전극(Y)과 유지 전극(X)에 인가되는 유지방전 펄스의 폭이
Figure 112004039068611-pat00001
인 경우에, 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을
Figure 112004039068611-pat00002
정도로 할 수 있다.
또한, 유지 전극에는 전력 회수 회로를 통하지 않고, 즉 인덕터와의 공진을 통하여 전압을 변경하지 않고 마지막 유지방전 펄스를 인가한다. 일반적으로 주사 전극(Y)과 유지 전극(X) 사이의 방전 공간은 용량성 부하(이하, 패널 커패시터라 함)로 작용하기 때문에 패널에는 커패시턴스가 존재하게 된다. 따라서, 유지방전을 위한 파형을 인가하기 위해서는 유지방전을 위한 전력 이외에 무효 전력이 필요하므로 무효 전력을 회수하여 재사용하는 전력 회수 회로가 사용된다. 전력 회수 회로는 용량성 부하와 인턱터의 공진을 이용하여 무효 전력을 회수하여 재사용하는 방법으로, 이러한 전력 회수 회로로서 L.F.Weber에 의해 제안된 회로(미국특허 제4,866,349호 및 제5,081,400호)가 있다.
이와 같이 하여 제1 서브필드의 유지 기간이 종료되면, 제2 서브필드가 시작된다. 그리고 제2 서브필드의 리셋 기간은 하강 기간으로만 이루어지며, 제2 서브필드의 리셋 기간에서는 제1 서브필드의 유지 기간에서 Vs 전압의 유지방전 펄스가 주사 전극(Y)에 인가된 상태에서 주사 전극(Y)의 전압을 Vnf 전압까지 점진적으로 감소시킨다.
이 때, 제1 서브필드의 유지 기간에서 유지방전이 일어난 경우에는 주사 전극(Y)에 (-) 벽 전하, 유지 전극(X)과 어드레스 전극(A)에 (+) 벽 전하가 형성되어 있으므로, 주사 전극(Y)의 전압이 점진적으로 감소하는 중에 셀에 형성된 벽 전압과 함께 방전 개시 전압을 넘게 되면 제1 서브필드의 리셋 기간의 하강 기간에서와 같이 약 방전이 일어난다. 그리고 주사 전극(Y)의 최종 전압(Vnf)이 제1 서브필드의 하강 기간의 최종 전압(Vnf)과 동일하므로, 제2 서브필드의 하강 기간 종료 후의 셀의 벽 전하 상태는 제1 서브필드의 하강 기간 종료 후의 벽 전하 상태와 실질적으로 동일해진다.
그리고 제1 서브필드의 유지 기간에서 유지방전이 일어나지 않은 경우에는 어드레스 기간에서도 어드레스 방전이 일어나지 않았으므로, 셀의 벽 전하 상태는 제1 서브필드의 하강 기간 종료 후의 상태를 그대로 유지한다. 제1 서브필드의 하강 기간 종료 후에 셀에 형성된 벽 전압은 인가 전압과 함께 방전 개시 전압 근처로 형성되어 있으므로, 주사 전극(Y)의 전압이 Vnf 전압까지 감소하는 경우에는 방전이 일어나지 않는다. 따라서, 제2 서브필드의 리셋 기간에서 방전이 일어나지 않으므로 제1 서브필드의 리셋 기간에서 설정된 벽 전하 상태를 그대로 유지한다.
이와 같이, 리셋 기간이 하강 기간으로 이루어진 서브필드는 직전 서브필드에서 유지방전이 있는 경우에는 리셋 방전이 일어나고 유지방전이 없는 경우에는 리셋 방전이 일어나지 않는다.
그리고 제2 서브필드의 어드레스 기간 및 유지 기간은 제1 서브필드와 동일하며, 단, 제2 서브필드의 유지 기간에서 주사 전극(Y) 및 유지 전극(X)에 제2 서브필드가 표시하고자 하는 가중치에 대응하여 인가되는 유지방전 펄스의 수가 다르다는 점에서 차이가 있다. 이 때에도 제1 서브필드에서와 마찬가지로 제2 서브필드 이후의 서브필드가 하강 기간으로만 이루어진 경우에는 유지 전극(X)에 인가되는 마지막 유지방전 펄스를 전력 회수 회로를 통하지 않고 세폭으로 인가한다.
아래에서는 유지 기간에서 유지 전극(X)에는 전력 회수 회로를 통하지 않고 세폭으로 마지막 유지 방전 펄스를 인가하는 이유에 대해서 상세하게 설명한다.
앞서 설명한 것처럼, 두 전극 사이에 전압을 인가하여 수행되는 방전은 전압이 인가된 시점보다 시간적으로 지연되어 방전이 발생하게 된다. 특히, 어드레스 방전은 주사 펄스와 어드레스 펄스의 폭 내에서 방전이 수행되어야 하므로, 어드레스 방전은 방전 지연 시간에 큰 영향을 받는다. 이러한 어드레스 방전은 리셋 기간 종료 후 방전 공간에 형성된 벽 전하에 의한 벽 전압에 의하여 결정되므로, 어드레스 방전 지연은 리셋 기간 종료 후의 벽 전하 상태에 영향을 받게 된다. 또한 리셋 기간 종료 후의 벽 전하 상태는 직전 서브필드의 마지막 유지 방전 이후의 벽 전하 상태에 따라 결정되므로, 어드레스 방전 지연이 직전 서브필드의 벽 전하 상태에 영향을 받는다는 것을 알 수 있다.
그리고 전극의 전압이 완만하게 변하는 경우에는 유지 전극(X)과 주사 전극(Y) 사이의 간극 부근에서만 방전이 일어나서 간극 부근에만 전하가 형성되지만, 유지 방전과 같이 강한 방전이 일어나는 경우에는 방전이 유지 전극(X)과 주사 전극(Y)의 간극에서 내부로 확산되어 전극 전체에 전하가 형성될 수 있다. 이와 같이 유지 방전에 의해 전하가 형성된 후 보조 리셋을 수행하는 경우에 전극 내부에 형성된 전하가 소거되지 않고 많은 전하가 남을 수 있다. 이와 같이 많은 전하가 남아 있으면 이후 어드레스 기간과 유지 기간에서의 방전 시에 과도한 방전이 일어날 수 있다.
따라서, 본 발명의 실시 예처럼 제1 서브필드(메인 리셋)의 유지 기간에서 유지 전극에 인가되는 마지막 유지방전 펄스의 폭을 세폭으로 하면, 일반적인 유지 방전과 달리 소규모의 강한 방전이 일어나서 주사 전극(Y)과 유지 전극(X)에 벽 전하가 형성되지 않기 때문에 벽 전하의 양을 줄일 수 있게 된다. 또한, 유지 기간에서 유지 전극에 인가되는 세폭 펄스를 전력 회수 회로를 통하지 않고 인가하게 되 면, 강한 방전으로 인해 간극 부근 외에 전극 내부에 형성된 전하까지 소거할 수 있게 된다. 이처럼 벽 전하가 많이 소거됨에 따라 이후 주사 전극(Y)에 마지막 유지방전 펄스가 인가되어 방전이 일어나게 되어도 그 방전의 세기가 약화되기 때문에 벽 전하가 과도하게 형성되지 않는다. 따라서 제2 서브필드의 리셋 기간에서 벽 전하를 충분히 제어할 수 있게 되어 어드레스 기간에서 어드레스 방전 지연을 단축시킬 수 있을 뿐만 아니라 과도한 방전을 방지할 수 있다.
아래에서는 본 발명의 실시 예처럼 유지전극(X)에 마지막으로 인가되는 유지방전 펄스를 생성하기 위한 유지방전 구동 회로에 대해서 도 3을 참고로 하여 상세하게 설명한다.
도 3은 본 발명의 실시 예에 따른 유지방전 구동 회로를 나타내는 도면이다. 도 3에서 사용되는 스위칭 소자는 n채널 트랜지스터로 도시하였으며, 바디 다이오드를 가지는 전계 효과 트랜지스터(FET)로 이루어질 수 있으며, 동일 또는 유사한 기능을 하는 다른 스위칭 소자로 이루어질 수 있다. 그리고 도 3에서는 편의상 유지 전극(X)과 주사 전극(Y)에 의해 형성되는 용량성 성분을 패널 커패시터(Cp)로 도시하였다.
도 3에 나타낸 바와 같이, 본 발명의 실시 예에 따른 유지방전 구동 회로는 전력 회수 회로(410) 및 유지 전압 공급부(420)를 포함한다.
전력 회수 회로(410)는 스위칭 소자(Xr, Xf), 인덕터(L), 다이오드(D1, D2) 및 커패시터(C1)를 포함한다. 커패시터(C1)에는 Vs/2 전압이 충전되어 있다. 스위 칭 소자(Xr)의 드레인과 스위칭 소자(Xf)의 소스 사이에 전력회수용 커패시터(C1)가 전기적으로 연결되며, 스위칭 소자(Xr, Xf)에 각각 다이오드(D1, D2)가 직렬로 연결된다. 그리고 다이오드(D1, D2) 간 접점과 유지 전압 구동부(420)의 스위칭 소자(Xs, Xg) 간 접점 사이에 인덕터(L)의 일단이 전기적으로 연결되며, 인덕터(L)의 타단에는 유지 전극(X)이 직렬로 연결된다. 다이오드(D1)는 스위칭 소자(Xr)가 바디 다이오드를 가질 경우 패널 커패시터(Cp)의 전압을 증가시키는 상승 경로를 설정하기 위한 것이다. 그리고 다이오드(D2)는 스위칭 소자(Xf)가 바디 다이오드를 가질 경우 패널 커패시터(Cp)의 전압을 하강시키는 하강 경로를 설정하기 위한 것이다. 이 때, 스위칭 소자(Xr, Xf)가 바디 다이오드를 가지지 않는다면 다이오드(D1, D2)가 제거될 수도 있다. 이와 같이 연결된 전력 회수 회로(410)는 패널 커패시터(Cp)의 전압(즉, 유지 전극의 전압)을 Vs 전압으로 충전시키거나 접지 전압으로 방전시키는 역할을 한다.
그리고 전력 회수 회로(410)에서 인덕터(L), 다이오드(D1) 및 스위칭 소자(Xr) 사이의 연결 순서는 바뀔 수 있으며, 마찬가지로 인덕터(L), 다이오드(D2) 및 스위칭 소자(Xf) 사이의 연결 순서도 바뀔 수 있다.
유지 전압 공급부(420)는 전력 회수 회로(410)와 패널 커패시터(Cp)사이의 유지 전극 사이에 연결되며, 두 개의 스위칭 소자(Xa, Xg)를 포함한다. 스위칭 소자(Xa)는 유지방전 펄스 전압(Vs)을 공급하는 전원과 패널 커패시터(Cp)의 유지 전극 사이에 연결되어 있으며, 스위칭 소자(Xg)는 접지 전압을 공급하는 전원과 패널 커패시터(Cp)의 유지 전극 사이에 연결되어 있다. 이 스위칭 소자(Xa, Xg)는 패널 커패시터(Cp)(즉, 유지 전극)에 Vs 전압과 접지 전압을 각각 공급한다.
다음, 도 4를 참고로 하여 본 발명의 실시 예에 따른 구동 파형에서 유지 전극의 마지막 유지방전 펄스를 생성하기 위한 유지방전 구동 회로의 동작에 대해서 설명한다.
도 4는 본 발명의 실시 예에 따른 도 2의 구동 파형에서 유지 전극에 인가되는 마지막 유지방전 펄스를 생성하기 위한 도 3의 구동 회로에서의 전류 경로를 나타내는 도면이다.
먼저, 전력 회수 회로(410)를 사용하여 유지 전극(X)에 유지방전 펄스를 인가하는 방법에 대해서 설명한다.
스위칭 소자(Xg)가 턴온되어 패널 커패시터(Cp)에 0V가 인가된 상태에서, 스위칭 소자(Xg)가 턴오프되고 스위칭 소자(Xr)가 턴온된다. 그러면, 커패시터(C1), 스위칭 소자(Xr), 다이오드(D1), 인덕터(L) 및 패널 커패시터(Cp)의 경로에서 LC 공진이 형성되어 유지 전극(X)의 전압이 Vs 전압 근처까지 증가한다. 다음, 스위칭 소자(Xs)가 턴온되고 스위칭 소자가(Xr)가 턴오프되어 유지 전극(X)에 Vs 전압이 인가된다.
다음, 스위칭 소자(Xs)가 턴오프되고 스위칭 소자(Xf)가 턴온된다. 그러면, 패널 커패시터(Cp), 인덕터(L), 다이오드(D2), 스위칭 소자(Xf) 및 커패시터(C1)의 경로에서 LC 공진이 형성되어 패널 커패시터(Cp)의 전압이 0V 전압 근처까지 감소 한다. 다음, 스위칭 소자(Xg)가 턴온되고 스위칭 소자(Xf)가 턴오프되어 유지 전극(X)에 0V 전압이 인가된다.
그리고 이러한 동작이 반복되어 유지 전극(X)에 0V 전압과 Vs 전압을 교대로 가지는 유지방전 펄스가 전력 회수 회로(410)를 이용하여 인가될 수 있다.
다음, 유지 전극(X)에 전력 회수 회로를 통하지 않고 마지막 유지방전 펄스를 세폭으로 인가하는 방법에 대해서 설명한다.
마지막 유지방전 펄스가 인가되기 전에 스위칭 소자(Xg)가 턴온되어 0V 전압이 유지 전극(X)에 인가된 상태에서, 스위칭 소자(Xg)를 턴오프하는 동시에 스위칭 소자(Xs)를 턴온한다. 즉, 전력 회수 회로(410)를 사용하는 것과는 달리 스위칭 소자(Xr)를 턴온하지 않는다. 그러면, 도 4에 나타낸 바와 같이, 전원(Vs), 스위칭 소자(Xs) 및 패널 커패시터(Cp)의 경로(M1)로 패널 커패시터(Cp), 즉 유지 전극(X)에 Vs 전압이 인가된다.
그리고 스위칭 소자(Xs)가 턴온되어 Vs 전압이 유지 전극(X)에 인가되어 있는 상태에서, 스위칭 소자(Xs)를 턴오프하는 동시에 스위칭 소자(Xg)를 턴온한다. 즉, 전력 회수 회로(410)를 사용하는 것과는 달리 스위칭 소자(Xf)를 턴온하지 않는다. 그러면 도 4에 나타낸 바와 같이 패널 커패시터(Cp), 스위칭 소자 및 전원(0V)의 경로(M2)로 패널 커패시터(Cp), 즉 유지 전극(X)에 0V 전압이 인가된다.
이 때, 스위칭 소자(Xs)가 턴온된 후 턴오프될 때까지의 시간을 전력 회수 회로(410)를 사용하는 것보다 짧게 함으로써 세폭의 유지방전 펄스를 유지 전극(X)에 인가할 수 있다.
그리고 본 발명의 실시 예에서는 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 세폭으로 하고, 전력 회수 회로를 통하지 않고 마지막 유지방전 펄스를 인가하였으나, 이와 다르게 유지 전극(X)에 인가되는 복수의 유지방전 펄스를 복수의 그룹으로 나누고 시간적으로 마지막으로 인가되는 유지방전 펄스를 포함하는 그룹의 유지방전 펄스를 세폭으로 하고, 이 그룹의 유지방전 펄스를 전력 회수 회로를 통하지 않고 인가할 수도 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
본 발명에 의하면, 메인 리셋을 가지는 서브필드의 유지 기간에서 유지 전극에 인가되는 마지막 유지방전 펄스를 전력 회수 회로를 통하지 않고 세폭으로 인가하여 이후 보조 리셋을 가지는 서브필드의 리셋 기간 및 어드레스 기간에서의 안정된 동작을 위한 벽 전하를 형성함으로써 어드레스 방전 지연을 단축시킬 수 있을 뿐만 아니라 과도한 방전을 방지할 수 있다.

Claims (8)

  1. 복수의 제1 전극 및 복수의 제2 전극을 포함하며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널에서 한 프레임을 복수의 서브필드로 나누어 구동하는 방법에 있어서,
    적어도 하나의 서브필드의 유지 기간에서,
    상기 제1 전극 및 상기 제2 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가하는 단계를 포함하며,
    상기 제1 전극에 시간적으로 마지막에 인가되는 유지 방전 펄스의 폭이, 상기 제1 전극에 인가되는 나머지 유지방전 펄스의 폭보다 짧고,
    상기 제1 전극에 전기적으로 연결된 인덕터와 상기 용량성 부하의 공진을 이용하지 않고 상기 제1 전극에 상기 마지막 유지방전 펄스를 인가하는 플라즈마 표시 패널의 구동 방법.
  2. 제 1항에 있어서,
    유지 기간에서 마지막 유지방전 펄스는 상기 제2 전극에 인가되는 플라즈마 표시 패널의 구동 방법.
  3. 제 2항에 있어서,
    상기 제1 전극은 유지 전극이고, 상기 제2 전극은 주사 전극인 플라즈마 표 시 패널의 구동 방법.
  4. 제 1항 또는 제 3항 중 어느 한 항에 있어서,
    상기 유지 기간과 이어지는 리셋 기간에서는 직전 서브필드에서 유지 방전이 일어난 방전 셀에 대해서 초기화를 수행하는 플라즈마 표시 패널의 구동 방법.
  5. 제 4항에 있어서,
    상기 유지 기간과 이어지는 리셋 기간에서,
    상기 제2 전극에 마지막 유지방전 펄스의 높은 전압이 인가된 상태에서 상기 제2 전극의 전압을 제1 전압까지 점진적으로 감소시키는 단계
    를 포함하는 플라즈마 표시 패널의 구동 방법.
  6. 복수의 주사 전극 및 복수의 유지 전극을 포함하며, 상기 주사 전극과 상기 유지 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널, 그리고
    상기 플라즈마 표시 패널에서 한 프레임을 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지는 복수의 서브필드로 나누고, 상기 주사 전극 및 유지 전극에 구동 전압을 인가하는 구동 회로를 포함하며,
    상기 구동 회로는,
    상기 복수의 서브필드 중 제1 서브필드의 유지 기간에서,
    상기 주사 전극 및 상기 유지 전극에 유지방전을 위한 유지방전 펄스를 교대 로 인가하고,
    상기 유지 전극에 인가되는 복수의 유지방전 펄스를 복수의 그룹으로 나눌 때 시간적으로 마지막으로 인가되는 유지방전 펄스를 포함하는 그룹의 유지방전 펄스는, 상기 유지 전극에 전기적으로 연결된 인덕터와 상기 용량성 부하의 공진을 통하지 않고 인가되고, 다른 그룹의 유지방전 펄스의 폭보다 짧은 폭을 가지는 플라즈마 표시 장치.
  7. 제 6항에 있어서,
    각 서브필드의 유지 기간에서 마지막 유지방전 펄스는 상기 주사 전극에 인가되는 플라즈마 표시 장치.
  8. 제 6항 또는 제 7항에 있어서,
    상기 유지 기간과 이어지는 제2 서브필드의 리셋 기간에서는 상기 제1 서브필드의 유지 기간에서 유지 방전이 일어난 방전 셀에 대해서 초기화를 수행하는 플라즈마 표시 장치.
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