KR100287416B1 - Asynchronous Transmission Mode Cell Structure Conversion Method in Demand Dense Optical Subscriber Transmitter - Google Patents

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Abstract

본 발명은 수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법에 관한 것으로서, 수요밀집형 광가입자 전송장치에서 처리되는 27 워드의 표준 구조 ATM 셀을 소정의 타 구조를 갖는 ATM 셀로 변환해 주기 위한 것이다.The present invention relates to a method for converting an asynchronous transmission mode cell structure in a demand dense optical subscriber transmitter, wherein a 27 word standard structure ATM cell processed in a demand dense optical subscriber transmitter is converted into an ATM cell having a predetermined other structure. It is to do it.

이러한 본 발명은 표준 구조의 소정 ATM 셀에 대하여, 모든 워드의 상위 바이트와 하위 바이트 위치를 서로 바꾸어 소정의 역표준 ATM 셀을 만드는 단계, 역표준 ATM 셀의 시작점(SOC:Start Of Cell)으로부터 카운트하여, 1번째 워드 내지 27번째 워드를 각각 구분하는 단계, 구분된 워드 중 4번째 워드로부터 27번째 워드까지의 각각의 워드에 대하여, 해당 워드의 하위 바이트를 현재 워드 번호보다 1만큼 적은 워드의 상위 바이트로 옮긴 후, 해당 워드의 상위 바이트를 해당 워드의 하위 바이트로 옮기는 단계, 및 27번째 워드의 상위 바이트를 임의의 값으로 세팅하는 단계로 이루어진다.The present invention provides a predetermined ATM cell by swapping the position of the upper byte and the lower byte of every word with respect to a predetermined ATM cell having a standard structure, and counting from a start of cell (SOC) of the reverse standard ATM cell. Distinguishing the first word to the 27th word, and for each word from the fourth word to the 27th word among the divided words, the lower byte of the word is higher than the word having the number less than one by the current word number. After transferring to a byte, transferring the upper byte of the word to the lower byte of the word, and setting the upper byte of the 27th word to an arbitrary value.

Description

수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법(A method of changing a structure of Asynchronous Transfer Mode cells for Fiber Loop Carrier-Curb systems)A method of changing a structure of Asynchronous Transfer Mode cells for Fiber Loop Carrier-Curb systems

본 발명은 수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법에 관한 것으로서, 특히 수요 밀집형 광가입자 전송장치(Fiber Loop Carrier-Curb System: 이하 FLC-C 시스템이라 한다.)에 사용되는 비동기 전송 모드 셀(ATM 셀) 처리용 장치들이 서로 다른 ATM 셀 포맷을 사용하고 있는 경우, 이 장치들 사이에서 ATM 셀의 구조를 변환시켜주는 방법에 관한 것이다.The present invention relates to a method for converting an asynchronous transmission mode cell structure in a demand dense optical subscriber transmitter, and particularly used in a demand dense optical subscriber transmitter (hereinafter referred to as a Fiber Loop Carrier-Curb System). The present invention relates to a method for converting an ATM cell structure between devices for processing asynchronous transfer mode cells (ATM cells) using different ATM cell formats.

도 1은 FLC-C 시스템(100)의 구성도로서, 홈-쇼핑, 게임, 영화 등 각종의 서비스를 제공하는 서비스 제공자들은 ATM 교환기(10)를 경유하고, 호스트 디지털 터미널(110:Host Digital Terminal)과 광 종단 장치(120:Optical Network Unit)를 통하여 광가입자들에게 서비스를 제공한다.FIG. 1 is a block diagram of a FLC-C system 100, and service providers providing various services such as home shopping, games, movies, etc. are provided via a host digital terminal 110 through an ATM switch 10. And optical termination unit (120: Optical Network Unit) to provide services to optical subscribers.

이 때, HDT(110)는 전화국에 설치되는 장치로서, DS1 및 DS1E 신호와 광대역 교환망측에서 전달되는 ATM 기반의 광대역 신호를 접속하여, 동기식 디지털 계위로 통합-다중화한 후, 대국 장치인 ONU(120)로 광전송하는 기능 및 그 역기능을 수행한다. 또한, ONU(120)는 아파트 단지와 같은 주거 밀집 지역의 분배소에 설치되어, HDT(110)에서 수신한 광신호로부터 각 가입자 신호를 서비스에 따라 분리하여 각 가입자에게 제공하는 기능과 그 역기능을 수행하는 장치이다.At this time, the HDT 110 is a device installed in the telephone station, connects the DS1 and DS1E signals with the ATM-based broadband signals transmitted from the broadband switching network side, integrates and multiplexes them into the synchronous digital hierarchy, and then uses the ONU (international apparatus). 120) and the reverse function. In addition, the ONU 120 is installed in a distribution center of a dense residential area such as an apartment complex, and separates each subscriber signal from the optical signal received from the HDT 110 according to a service and provides each subscriber with its reverse function. Device to perform.

이러한 FLC-C 시스템(100)은 FTTC(Fiber To The Curb) 방식의 서비스 전송 플랫폼으로서, 가입자들에게 전화 및 비디오 서비스를 제공하기 위하여, HDT(110)에서 ONU(120) 까지는 광선로를 통해 서비스에 관련된 데이터를 전송하며, ONU(120)에서 각각의 가입자들까지는 기존의 전화선을 이용하여 표준의 전화서비스와 디지털 서비스를 전달한다.The FLC-C system 100 is a FTTC (Fiber To The Curb) service transmission platform. In order to provide telephone and video services to subscribers, the HDT 110 to the ONU 120 are connected to a service through an optical path. It transmits related data, and each subscriber from ONU 120 delivers standard telephone service and digital service using existing telephone line.

한편, ONU(120)에는 HDT(110)로부터 전송되는 622.08Mbps의 전송률을 갖는 STM-4급 광신호를 수신하여, ATM 셀 단위의 신호로 만들어 ATM 셀 버스(123)로 출력함으로서, 비디오 채널 유니트(122)와 같은 소정 가입자 접속장치를 통하여 해당 가입자들과 접속하도록 해주며, ATM 셀 버스(123)로부터 ATM 셀 단위의 신호들을 입력받아 STM-4급 광신호로 만들어 HDT(110)로 보내주는 기능을 수행하는 클럭 및 광 송수신 유니트(121:Clock and Optical Transceiver Unit)가 사용된다.Meanwhile, the ONU 120 receives an STM-4 class optical signal having a transmission rate of 622.08 Mbps transmitted from the HDT 110, converts the optical signal into an ATM cell bus 123, and outputs the signal to the ATM cell bus 123. It is connected to the corresponding subscribers through a predetermined subscriber access device, such as 122, receives the signals of the ATM cell unit from the ATM cell bus 123 to make the STM-4 class optical signal to HDT (110) A clock and optical transceiver unit 121 that performs a function is used.

이 때, 클럭 및 광 송수신 유니트(121:COTU)에는 이러한 기능을 수행하기 위하여 HDT(110)로부터 수신한 광신호로부터 ATM 셀 단위의 신호들을 추출하는 ATM 처리부(도시되지 않음), 및 ATM 처리부로부터 출력되는 ATM 셀 신호들을 4개의 셀 버스 스위칭 요소 중 어느 하나로 보내주기 위하여 역다중화 하는 역다중화부(도시되지 않음)가 사용된다.At this time, the clock and optical transmitting / receiving unit 121 (COTU) includes an ATM processor (not shown) for extracting signals of an ATM cell unit from the optical signal received from the HDT 110 to perform such a function, and from the ATM processor. A demultiplexer (not shown) is used to demultiplex the output ATM cell signals to any one of the four cell bus switching elements.

그러나, 이러한 ATM 처리부와 역다중화부는 해당 기능을 수행하는 상용칩을 이용하여 구현하는 경우가 대부분이어서, 사용하는 ATM 셀의 구조가 서로 다를 수 있다. 즉, ATM 처리부는 표준 구조의 ATM 셀을 사용하지만, 역다중화부는 표준 ATM 셀과는 구조가 다른 ATM 셀을 사용한다. 그러므로, 이런 경우 ATM 처리부에서 출력되는 ATM 셀을 역다중화부에서 사용하는 구조의 ATM 셀로 변환시켜 줄 필요가 있다.However, since the ATM processor and the demultiplexer are often implemented using a commercial chip that performs a corresponding function, the structure of an ATM cell may be different. That is, the ATM processor uses an ATM cell of a standard structure, but the demultiplexer uses an ATM cell having a different structure from that of the standard ATM cell. Therefore, in this case, it is necessary to convert the ATM cell output from the ATM processor into an ATM cell of a structure used by the demultiplexer.

이에 본 발명은 상기와 같은 필요성에 부응하기 위하여 안출된 것으로서, 표준 구조의 ATM 셀을 상기 역다중화부가 사용하는 ATM 셀 구조로 변환시켜 주는 방법, 즉 수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법을 제공하는데 그 목적이 있다.Accordingly, the present invention has been made to meet the above needs, and a method for converting an ATM cell of a standard structure into an ATM cell structure used by the demultiplexer, that is, an asynchronous transmission mode in a demand dense optical subscriber transmission device. The purpose is to provide a cell structure conversion method.

상기와 같은 목적을 달성하기 위하여, 본 발명에 따른 수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법은 표준 구조의 소정 ATM 셀에 대하여, 모든 워드의 상위 바이트와 하위 바이트 위치를 서로 바꾸어 소정의 역표준 ATM 셀을 만드는 단계; 상기 역표준 ATM 셀의 시작점(SOC:Start Of Cell)으로부터 카운트하여, 1번째 워드 내지 27번째 워드를 각각 구분하는 단계; 상기 구분된 워드 중 4번째 워드로부터 27번째 워드까지의 각각의 워드에 대하여, 해당 워드의 하위 바이트를 현재 워드 번호보다 1만큼 적은 워드의 상위 바이트로 옮긴 후, 해당 워드의 상위 바이트를 해당 워드의 하위 바이트로 옮기는 단계; 및 27번째 워드의 상위 바이트를 임의의 값으로 세팅하는 단계를 포함하여 구성하는 것을 특징으로 한다.In order to achieve the above object, the asynchronous transmission mode cell structure conversion method in the demand-density optical subscriber transmission device according to the present invention, the position of the upper byte and the lower byte of each word with respect to a predetermined ATM cell of the standard structure Switching to create a predetermined counterstandard ATM cell; Counting from a Start Of Cell (SOC) of the inverse standard ATM cell to distinguish each of the first word to the 27th word; For each word from the fourth word to the 27th word among the classified words, the lower byte of the word is moved to the upper byte of the word by one less than the current word number, and the upper byte of the word is Moving to lower byte; And setting the upper byte of the 27th word to an arbitrary value.

도 1은 FLC-C 시스템의 구성도,1 is a configuration diagram of an FLC-C system;

도 2는 표준 ATM 셀의 구조도,2 is a structural diagram of a standard ATM cell;

도 3은 ATM 셀 역다중화 칩에서 사용되는 ATM 셀의 구조도,3 is a structural diagram of an ATM cell used in an ATM cell demultiplexing chip;

도 4는 상위 바이트와 하위 바이트 위치가 서로 바뀐 표준 ATM 셀의 구조도,4 is a structural diagram of a standard ATM cell in which high byte and low byte positions are interchanged;

도 5는 본 발명에 따른 방법의 흐름도이다.5 is a flow chart of a method according to the invention.

* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings

10: ATM 교환기 100: FLC-C 시스템10: ATM exchange 100: FLC-C system

110: 호스트 디지털 터미널(HDT) 120: 광 종단장치(ONU)110: host digital terminal (HDT) 120: optical termination (ONU)

121: 클럭 및 광 송수신 장치 122: ATM 셀 버스121: clock and optical transceiver 122: ATM cell bus

123: 비디오 채널 유니트(VCU) 200: 표준 ATM 셀123: video channel unit (VCU) 200: standard ATM cell

이하, 첨부된 도면을 참조하여 본 발명을 상세히 설명하기로 한다.Hereinafter, with reference to the accompanying drawings will be described in detail the present invention.

도 2는 표준 ATM 셀(200)의 구조도로서 총 27 워드(word:2 바이트)로 이루어진다.2 is a structural diagram of a standard ATM cell 200, which consists of a total of 27 words (word: 2 bytes).

이 때, 제 1 워드의 상위 바이트(Header1)는 4 비트의 일반 흐름 제어(GFC:Generic Flow Control)와 4 비트의 가상 경로 식별자(VPI:Virtual Path Identifier)로 이루어지고, 하위 바이트(Header2)는 4 비트의 가상 경로 식별자(VPI)와 4 비트의 가상 채널 식별자(VCI:Virtual Channel Identifier)로 이루어진다.In this case, the upper byte (Header1) of the first word is composed of 4 bits of Generic Flow Control (GFC) and 4 bits of Virtual Path Identifier (VPI), and the lower byte (Header2) is It consists of a 4-bit Virtual Path Identifier (VPI) and a 4-bit Virtual Channel Identifier (VCI).

또한, 제 2 워드의 상위 12 비트(Header3 과 Header4의 상위 4비트)는 가상 채널 식별자(VCI)이고, 하위 바이트(Header4)의 하위 4비트는 3 비트의 유료부하형태(PT:Payload Type)와 1 비트의 셀포기순위(CLP:Cell Loss Priority)로 이루어지며, 제 3 워드의 상위 바이트(UDF1)는 헤더오류제어(HEC:Header Error Control) 정보이고, 하위 바이트(UDF2)는 헤더검사순서(HCS:Header Check Sequence) 정보이다.In addition, the upper 12 bits of the second word (upper 4 bits of Header3 and Header4) are virtual channel identifiers (VCI), and the lower 4 bits of the lower byte (Header4) are 3 bits of payload type (PT) and payload type. 1 bit of cell loss priority (CLP: Cell Loss Priority), the upper byte (UDF1) of the third word is header error control (HEC: Header Error Control) information, the lower byte (UDF2) is the header check order ( HCS: Header Check Sequence (HCS) information.

그리고, 제 4 워드로부터 제 27 워드까지의 나머지 24 워드 구간에는 제 1 유료부하 바이트(Payload1)로부터 제 48 유료부하 바이트(Payload48)까지 총 48 바이트의 유료부하(Payload)가 순서대로 채워진다.In the remaining 24 word sections from the fourth word to the 27th word, a total of 48 bytes of payloads from the first payload byte Payload1 to the 48th payload byte Payload48 are sequentially filled.

한편, 도 3은 역다중화 칩에서 사용하는 ATM 셀(300)의 구조도로서, 표준 ATM 셀(200)과 비교해 보면, 제 1 워드와 제 2 워드의 상위 바이트와 하위 바이트가 서로 바뀌어서 위치하여 있으며, 제 3 워드의 상위 바이트가 제 1 유료부하 바이트(Payload1)이고, 하위 바이트에는 표준 ATM 셀(200)의 제 3 워드의 상위 바이트(UDF1)가 위치한다.3 is a structural diagram of the ATM cell 300 used in the demultiplexing chip. Compared to the standard ATM cell 200, the upper byte and the lower byte of the first word and the second word are interchanged with each other. The upper byte of the third word is the first payload byte Payload1, and the upper byte UDF1 of the third word of the standard ATM cell 200 is located in the lower byte.

그리고, 제 4 워드로부터 제 26 워드까지 제 2 유료부하(Payload2) 내지 제 47 유료부하(Payload47)가 각각 어긋나게 위치하고 있으며, 마지막 제 48 바이트의 상위 바이트에는 표준 ATM 셀(200)의 제 3 워드의 하위 바이트(UDF2)가 위치하고, 하위 바이트에는 제 48 유료부하 바이트(Payload48)가 위치한다.The second payloads Payload2 to the 47th payloads 47 are shifted from the fourth word to the 26th word, and the upper byte of the last 48 bytes of the third word of the standard ATM cell 200 is located. The lower byte UDF2 is located and the 48 th payload byte Payload48 is located at the lower byte.

그러므로, ATM 처리부에서 출력되는 표준 ATM 셀(200)은 역다중화 칩에서 처리되기 전에 도 3에 보인 구조의 ATM 셀(300)로 변환되어야 한다.Therefore, the standard ATM cell 200 output from the ATM processor must be converted into the ATM cell 300 of the structure shown in FIG. 3 before being processed by the demultiplexing chip.

도 4는 본 발명에 따른 방법의 순서도이다.4 is a flow chart of a method according to the invention.

먼저, ATM 셀 처리부에서 출력되는 표준 구조의 ATM 셀(200)을 입력받아(S410), 각 워드의 상위 바이트와 하위 바이트의 위치를 서로 바꾼다(S420). 그러면 도 5와 같은 구조의 ATM 셀(500)이 되며, 이 ATM 셀(500)을 역표준 ATM 셀이라 하기로 한다.First, the ATM cell 200 having a standard structure output from the ATM cell processor is input (S410), and the positions of the upper byte and the lower byte of each word are interchanged (S420). This results in an ATM cell 500 having the structure as shown in FIG. 5, which will be referred to as an inverse standard ATM cell.

이제, 역표준 ATM 셀(500)을 시작점(SOC:Start Of Cell)으로부터 카운트하여 제 1 워드 내지 제 27 워드를 각각 구분한다(S430).In step S430, the inverse standard ATM cell 500 is counted from a start point of a cell (SOC) to distinguish the first to twenty-seventh words (S430).

그리고, 소정의 기억소자(예: D 플립플롭)를 사용하여, 역표준 ATM 셀(500)의 제 4 워드에서부터 시작하여 제 27 워드까지 해당 워드의 하위 바이트를 현재 워드 번호보다 1만큼 적은 워드의 상위 바이트로 옮긴 후, 해당 워드의 상위 바이트를 해당 워드의 하위 바이트로 옮기는 과정을 반복한다(S440).Then, using a predetermined memory element (eg, a D flip-flop), the lower byte of the word starting from the fourth word of the inverse standard ATM cell 500 and up to the twenty-seventh word is one word less than the current word number. After moving to the upper byte, the process of moving the upper byte of the word to the lower byte of the word is repeated (S440).

한 예로서 제 4 워드에 대한 처리를 설명하자면, 제 4 워드의 하위 바이트(Payload1)를 제 3 워드의 상위 바이트 위치로 이동시킨 후, 제 4 워드의 상위 바이트(Payload2)를 제 4 워드의 하위 바이트 위치로 이동시키는 것이다.As an example, the processing for the fourth word will be described. After moving the lower byte Payload1 of the fourth word to the upper byte position of the third word, the upper byte Payload2 of the fourth word is lower than the fourth word. To move to the byte position.

마지막으로 제 27 워드의 상위 바이트는 임의의 값으로 세팅한다(S450). 이 바이트는 역다중화 칩에서의 역다중화 과정에서 폐기되는 정보이므로 임의의 값으로 세팅할 수가 있다.Finally, the upper byte of the 27th word is set to an arbitrary value (S450). This byte is discarded during demultiplexing in the demultiplexing chip and can be set to any value.

이상에서 설명한 바와 같이 본 발명을 사용하면, 표준 구조의 ATM 셀(200)을 도 3에 보인 구조의 ATM 셀(300)로 쉽게 변환할 수 있으므로, FLC-C 시스템(100)에서 ATM 셀 단위의 인터페이스를 원활하게 수행할 수 있는 효과가 있다.As described above, the present invention can easily convert the ATM cell 200 having the standard structure into the ATM cell 300 having the structure shown in FIG. This has the effect of smoothly performing the interface.

Claims (1)

소정 수요밀집형 광가입자 전송장치에서 처리되는 27 워드의 표준 ATM 셀을 소정의 타 구조를 갖는 ATM 셀로 변환하는 방법에 있어서,A method for converting a 27-word standard ATM cell processed by a predetermined demand density optical subscriber transmission device into an ATM cell having a predetermined other structure, 상기 표준 ATM 셀에 대하여, 모든 워드의 상위 바이트와 하위 바이트 위치를 서로 바꾸어 소정의 역표준 ATM 셀을 만드는 단계;For the standard ATM cell, swapping the high byte and low byte positions of every word to create a predetermined inverse standard ATM cell; 상기 역표준 ATM 셀을 시작점(SOC:Start Of Cell)으로부터 카운트하여, 1번째 워드 내지 27번째 워드를 각각 구분하는 단계;Counting the inverse standard ATM cells from a start point of a cell (SOC) to distinguish first to twenty-seventh words; 상기 구분된 워드 중 4번째 워드로부터 27번째 워드까지의 각각의 워드에 대하여, 해당 워드의 하위 바이트를 현재 워드 번호보다 1만큼 적은 워드의 상위 바이트로 옮긴 후, 해당 워드의 상위 바이트를 해당 워드의 하위 바이트로 옮기는 단계; 및For each word from the fourth word to the 27th word among the classified words, the lower byte of the word is moved to the upper byte of the word by one less than the current word number, and the upper byte of the word is Moving to lower byte; And 27번째 워드의 상위 바이트를 임의의 값으로 세팅하는 단계를 포함하여 구성하는 것을 특징으로 하는 수요밀집형 광가입자 전송장치에서의 비동기 전송 모드 셀 구조 변환방법.And setting the upper byte of the 27th word to an arbitrary value.
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