KR100255812B1 - Restoration method for atm cell - Google Patents

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Abstract

PURPOSE: A method for restoring an ATM cell structure is provided to restore a deformed structure of an ATM cell into a standard structure in order to easily carry out the next ATM cell processing. CONSTITUTION: A user sets up the current word number 'n' as '27'(S411). The user moves a higher-level byte of the nth word to a lower-level byte of the nth word(S412). The user moves a lower-level byte of the (n-1)th word to the higher-level byte of the nth word(S413). The user checks the current word number(n)(S414). If the current word number 'n' is not '4', the user decreases 'n' by '1'(S415). In case that the 'n' is '4', the user fills all the bits of a lower-level byte of the third word with a logic value '0'(S420) and finalizes the ATM cell restoration procedures(S430).

Description

ATM셀 구조 복구방법(Method of recovering ATM cell structure)Method of recovering ATM cell structure

본 발명은 변형된 구조의 ATM 셀을 표준구조의 ATM 셀로 복구시켜 주는 ATM 셀 구조 복구방법에 관한 것으로서, 특히 수요 밀집형 광 가입자 전송장치(Fiber Loop Carrier-Curb System:이하 FLC-C 시스템이라 한다.)에 사용되며, ATM 셀 기반의 전기적 디지털 신호를 입력받아 다중화하고, 통신상태의 점검을 위한 각종 처리를 한 후, 전기적 신호를 광 신호로 변환시켜 광 케이블을 통하여 전송하는 장치인 광 송수신 장치(Optical Transmit/Receive Unit:이하 OTRU라 한다.)에 있어서, 다중화기에 의하여 다중화된 ATM 셀 기반의 신호가 표준 ATM 셀 구조와 다르게 되는 경우, 표준 구조로 다시 변환시켜 주는 ATM 셀 구조 복구방법에 관한 것이다.The present invention relates to a method for recovering an ATM cell structure for recovering an ATM cell of a modified structure into an ATM cell of a standard structure, and in particular, a demand dense optical subscriber carrier (Fiber Loop Carrier-Curb System: hereinafter referred to as a FLC-C system). It is used for.) And is an optical transceiver device that transmits multiple signals by receiving ATM cell-based electrical digital signals, converts electrical signals into optical signals and transmits them through optical cables (Optical Transmit / Receive Unit: OTRU), when the ATM cell-based signal multiplexed by the multiplexer is different from the standard ATM cell structure, the ATM cell structure recovery method for converting back to the standard structure will be.

종래에는 OTRU의 다중화기에 의하여 다중화된 디지털 신호가 변형된 구조의 ATM 셀을 가지고 있었으므로, 다중화기와 연결되는 장치의 설계가 불편한 문제점이 있었다.Conventionally, since the digital signal multiplexed by the multiplexer of the OTRU has an ATM cell of a modified structure, the design of a device connected to the multiplexer is inconvenient.

이에 본 발명은 상기와 같은 문제점을 해결하기 위하여 안출된 것으로서, ATM 셀의 구조가 표준구조와 달라져 있는 경우, 다음 단계의 ATM 셀 처리가 용이하게 하기 위하여, 변형된 구조의 ATM 셀을 표준구조의 ATM 셀로 복구시켜 주는 방법을 제공하는데 그 목적이 있다.Accordingly, the present invention has been made to solve the above problems, when the structure of the ATM cell is different from the standard structure, in order to facilitate the processing of the ATM cell of the next step, the modified ATM cell of the standard structure Its purpose is to provide a method for recovering an ATM cell.

상기와 같은 목적을 달성하기 위하여, 본 발명에 따른 ATM 셀 구조 복구방법은 ATM 셀의 3번째 워드의 하위 바이트로부터, 27번째 워드의 상위 바이트 까지의 바이트를 모두 한 바이트씩 하향으로 이동시키는 단계; 및 ATM 셀의 3번째 워드의 하위 바이트를 모두 논리값 '0'으로 채우는 단계를 포함하는 것을 특징으로 한다.In order to achieve the above object, the ATM cell structure recovery method according to the present invention comprises the steps of moving all the bytes from the lower byte of the third word of the ATM cell to the upper byte of the 27th word downward by one byte; And filling all of the lower bytes of the third word of the ATM cell with the logical value '0'.

도 1은 FLC-C 시스템의 구성도,1 is a configuration diagram of an FLC-C system;

도 2는 OTRU의 구조도,2 is a structural diagram of an OTRU;

도 3은 표준 ATM 셀의 구조도,3 is a structural diagram of a standard ATM cell;

도 4는 ATM 셀 구조 복구동작도이다.4 is a diagram illustrating an ATM cell structure recovery operation.

도 1은 FLC-C 시스템의 구성도로서, 홈 쇼핑, 게임, 영화 등 각종의 서비스를 제공하는 서비스 제공자들(130)은 ATM 교환기(100)와 FLC-C 시스템(200)을 통해서, 이 서비스들을 요구하는 광 가입자들(140)과 서로 연결된다.FIG. 1 is a schematic diagram of a FLC-C system. The service providers 130 that provide various services such as home shopping, games, and movies are provided through the ATM switch 100 and the FLC-C system 200. Are connected to each other with optical subscribers 140 requiring them.

FLC-C 시스템(200)은 전화국에 설치되어, PSTN(110)과 접속되는 DS1(E) 신호와 광대역 교환망측에서 전달되는 ATM에 기반을 둔 광대역 신호를 접속하고, 동기식 디지털 계위로 통합, 다중화한 후, 대국 장치인 ONU(220)로 광전송하는 기능 및 그 역기능을 수행하는 장치인 HDT(210) 및 아파트 단지와 같은 주거 밀집 지역의 분배소에 설치되어, HDT(210)에서 수신한 광 신호에서 각 가입자 신호를 서비스에 따라 분리하여 가입자에게 제공하는 기능과 그 역기능을 수행하는 장치인 ONU(220)로 구성되는 FTTC(Fiber To The Curb) 방식의 서비스 전송 플랫폼이다. FLC-C 시스템(200)은 HDT(210)에서 ONU(220) 까지는 광 선로(230)를 통해 서비스에 관련된 데이터를 전송하며, ONU(220)에서 각각의 가입자들(140)까지는 기존의 전화선(150)을 통해 표준의 전화서비스와 디지털 서비스를 전송한다.The FLC-C system 200 is installed in the telephone company, connects the DS1 (E) signal connected to the PSTN 110 and the broadband signal based on the ATM delivered from the broadband switching network, and integrates and multiplexes the synchronous digital hierarchy. Then, the optical signal received from the HDT 210 is installed in the distribution center of the dense area, such as the HDT 210 and the apartment complex that performs the optical transmission to the ONU 220 and the reverse function of the power device Is a FTTC (Fiber To The Curb) type service transmission platform consisting of ONU 220, which is a device that separates each subscriber signal according to a service and provides the subscriber with the function and performs the reverse function. The FLC-C system 200 transmits data related to the service from the HDT 210 to the ONU 220 through the optical path 230, and the existing telephone line from the ONU 220 to each subscriber 140. 150, standard telephone and digital services are transmitted.

HDT(210)는 ATM 교환기(100)로부터 155.52 Mbps의 전송률을 갖는 4개의 STM-1(Synchronous Transport Module-1) 신호를 수신하여, STM-1 신호에 포함되어 있는 오버헤드를 처리하고, ATM 셀을 추출하는 ATRU(211), ATM 셀의 전송통로인 셀 버스(213), HDT(210)와 ONU(220) 사이의 접속을 담당하는 OTRU(212) 등으로 구성되며, PSTN(110)으로부터 DS1, DS1E 신호를 접속하고, ATM 교환기(100)로부터 디지털 영상서비스를 접속하는데, 디지털 영상 서비스 신호 접속은 ATM을 기반으로 하는 STM-1에 의해 이루어지고, ONU(220)로의 전송시에 ATM 셀은 해당 STM-4에 재배치 및 다중화된다.The HDT 210 receives four STM-1 (Synchronous Transport Module-1) signals having a transfer rate of 155.52 Mbps from the ATM switch 100, processes the overhead included in the STM-1 signal, and provides an ATM cell. ATRU 211 for extracting the data, a cell bus 213 that is a transmission path of ATM cells, an OTRU 212 that is in charge of the connection between the HDT 210 and the ONU 220, and the like. The DS1E signal is connected and the digital video service is connected from the ATM switch 100. The digital video service signal connection is made by the STM-1 based on the ATM, and the ATM cell is transmitted at the time of transmission to the ONU 220. It is relocated and multiplexed to the STM-4.

ONU(220)는 HDT(210)에서 수신한 STM-4 광 신호로부터, 각 가입자 신호를 서비스에 따라 분리하여 가입자들(140)에게 제공하는 동작과 그 역동작을 수행하며, EMS(120:Element Management System)는 운용자 터미널로서, TMN(Telecommunication Management System) 방식에 따라 고장, 과금, 구성, 성능 및 보안관리 등의 기능을 수행하는 장치이다.The ONU 220 separates the subscriber signal from the STM-4 optical signal received from the HDT 210 according to the service and provides the subscribers 140 with the service 140 and the reverse operation. A management system is an operator terminal, and is a device that performs functions such as failure, charging, configuration, performance, and security management according to a TMN (Telecommunication Management System) method.

도 2는 본 발명에 따른 OTRU(212)의 구성도로서, 셀 버스 스위칭을 사용하여 OTRU(212) 와 ATM 셀 버스(213)를 접속시키는 동작을 수행하며, 총 8개의 셀 버스 스위칭부(311)로 구성되는 셀 버스 접속부(310), 셀 버스 접속부(310)로부터 전송되는 155.52Mbps의 UTOPIA(Universal Test and Operations PHY Interface for ATM) 레벨1 신호 4개를 4:1로 다중화하여 622.08Mbps의 UTOPIA 레벨2 신호로서 ATM/UNI부(340)로 전송하는 다중화기와 주소 지정부(330)가 ATM/UNI부(340)로부터 전송되는 UTOPIA 레벨2 신호 가운데서 ATM 셀의 가상 경로 식별자(VPI) 값을 통하여 포트의 주소를 정하면, 해당 UTOPIA 레벨1 신호 4개중 하나의 신호가 주소가 정해진 포트로 전송됨으로서 역 다중화하는 역 다중화기로 구성되는 2개의 다중/역다중화부(320), 다중/역다중화부(320)의 역 다중화기에 포트 주소를 지정하여, 해당하는 ATM 셀들을 전송하도록 제어하는 장치로서, ATM/UNI부(340)로부터 UTOPIA 레벨2 신호 셀들의 VPI를 번역하여 역 다중화기의 포트 주소를 지정해주는 주소 지정부(330), 클럭 처리부(350)로부터 8비트 데이터 버스를 통하여 전송된 STM-4c급 신호를 16비트 데이터 버스를 통하여 UTOPIA 레벨2 신호로 변환하여, ATM 셀 레벨로 데이터를 주소 지정부(330)로 전송하는 2개의 ATM/UNI부(340), 클럭 공급부(301)로부터 공급되는 19.44Mhz의 클럭을 이용하여, 77.76Mhz의 클럭을 생성하여 ATM/UNI부(340) 내의 주요 클럭을 공급하는 클럭 합성부(351)와 병렬신호와 직렬신호간의 변환을 행하는 병렬/직렬 신호변환부(352) 및 수신된 신호로부터 원래의 클럭을 복원시키는 클럭 복원부(353)로 이루어지는 2개의 클럭 처리부(350), 광 송신시에는 전/광 변환을 행하고 광 수신시에는 광/전 변환을 행하는 광 송수신부(360), 셀 버스 접속부(310)는 25.92Mhz의 클럭전송률을 가지며, 다중/역다중화부(320)의 역 다중화기는 25Mhz의 클럭전송률을 가지므로, 이 두 장치가 서로 올바로 데이터를 주고 받을 수 있게 해주는 장치인 FIFO(First Input First Output)부(370), 프로세서간 직렬 통신을 수행하는 IPC 통신부(381), MC68302 16 비트 마이크로 프로세서(382), 해당 OTRU(212)의 동작 프로그램을 영구 저장하고 있는 ROM(383) 및 OTRU(212)가 동작하기 시작하면, ROM에 있는 동작 프로그램을 옮겨와서 프로그램이 수행되는 RAM(384)으로 구성되어, 각 소자(Device)들의 제어, 경보, 감시, 관리기능을 수행하는 마이크로 프로세서부(380) 및 OTRU(212)에 전원을 공급하거나 전원의 장애를 검출하는 동작을 하는 전원 및 전원장애 검출부(390)로 구성된다.2 is a configuration diagram of the OTRU 212 according to the present invention, and performs an operation of connecting the OTRU 212 and the ATM cell bus 213 using cell bus switching, and total eight cell bus switching units 311. UTOPIA of 622.08 Mbps by multiplexing four 155.52 Mbps Universal Test and Operations PHY Interface for ATM (UTOPIA) Level 1 signals transmitted from the cell bus connection 310 and the cell bus connection 310 to 4: 1 The multiplexer that transmits the level 2 signal to the ATM / UNI unit 340 and the virtual path identifier (VPI) value of the ATM cell among the UTOPIA level 2 signals transmitted from the ATM / UNI unit 340. Once the port is addressed, two multiplexing / demultiplexing units 320 and multiplexing / demultiplexing units 320 constituted by a demultiplexer for demultiplexing by transmitting one of four UTOPIA level 1 signals to an addressed port are provided. Port number to the demultiplexer, corresponding ATM cell Apparatus for controlling the transmission of the signals, the addressing unit 330 for translating the VPI of the UTOPIA level 2 signal cells from the ATM / UNI unit 340 to designate the port address of the demultiplexer, and 8 bits from the clock processing unit 350. Two ATM / UNI units 340 for converting the STM-4c-class signals transmitted through the data bus into UTOPIA level 2 signals through the 16-bit data bus and transmitting the data to the addressing unit 330 at the ATM cell level. By using a clock of 19.44Mhz supplied from the clock supply unit 301, a clock of 77.76Mhz is generated and the clock synthesizing unit 351, which supplies the main clock in the ATM / UNI unit 340, between the parallel signal and the serial signal. Two clock processing units 350 comprising a parallel / serial signal converting unit 352 for converting and a clock recovering unit 353 for restoring the original clock from the received signal. Optical transmission that performs optical conversion before reception The bride 360 and the cell bus connection 310 have a clock rate of 25.92Mhz, and the demultiplexer of the multiplexer / demultiplexer 320 has a clock rate of 25Mhz so that these two devices can correctly exchange data with each other. FIFO (First Input First Output) unit 370, which enables the inter-processor serial communication, the MC68302 16-bit microprocessor 382, the OTRU 212 operating program permanently stored When the ROM 383 and the OTRU 212 start to operate, the RAM 384 is configured to move an operation program in the ROM and to execute the program, thereby controlling, alarming, monitoring, and managing each device. A microprocessor unit 380 that performs a function and a power source and a power failure detection unit 390 that operate to supply power to the OTRU 212 or detect a failure of the power source.

도 3은 표준 ATM 셀의 구조도로서 총 27개의 워드(16 비트)의 크기를 가지며, 1번째 워드로부터 3번째 워드는 데이터 전송의 정상성을 점검하기 위하여 사용되는 오버헤드이며, 나머지 워드들은 유료부하 데이터이다.3 is a structural diagram of a standard ATM cell, which has a total size of 27 words (16 bits), and the third to third words are overheads used to check the normality of data transmission, and the remaining words are payload. Data.

그러나 도 2의 다중/역다중화부(320)에 포함되어 있는 다중화기가 셀 버스 접속부(310)로부터 입력되는 155.52Mhz의 UTOPIA(Universal Test & Operations PHY Interface for ATM) 레벨1 데이터 신호 4개를 하나로 다중화하여, 16비트의 데이터 버스를 통해 ATM/UNI부(340)로 전송할 때, ATM 구조가 변화게 된다. 즉 ATM 표준 구조는 3번 워드의 하위 바이트(510)에 HCS(Header Check Sequence)가 위치하고 27번 워드의 하위 바이트(520)에는 유료부하가 위치하여야 하지만, 이 HCS 바이트가 27번 워드의 하위 바이트(520)에 위치하게 된다.However, the multiplexer included in the multiplexer / demultiplexer 320 of FIG. 2 multiplexes four 155.52Mhz UTOPIA (Universal Test & Operations PHY Interface for ATM) level 1 data signals inputted from the cell bus connector 310 into one. Thus, when transmitting to the ATM / UNI unit 340 through a 16-bit data bus, the ATM structure changes. That is, in the ATM standard structure, the HCS (Header Check Sequence) is located in the lower byte 510 of word 3 and the payload is located in the lower byte 520 of word 27, but this HCS byte is the lower byte of word 27. It is located at 520.

도 4는 변경된 ATM 셀 구조의 복구동작에 관한 흐름도로서, 위치가 바뀌어진 바이트들을 제위치로 이동시키는 바이트 이동 과정(S410) 및 HCS 바이트를 채워 넣는 HCS 삽입 단계(단계 S420)로 이루어 진다.4 is a flowchart illustrating a recovery operation of the modified ATM cell structure, and includes a byte shifting process (S410) for moving the changed bytes to an in-place position and an HCS insertion step (step S420) for filling HCS bytes.

바이트 이동 과정(S410)은 먼저 이동에 관계할 현재의 워드번호(n)를 27로 설정하는 단계(단계 S411), n번째 워드의 상위 바이트를 n번째 워드의 하위 바이트로 이동시키는 단계(단계 S412), n-1번째 워드의 하위 바이트를 n번째 워드의 상위 바이트로 이동시키는 단계(단계 S413), 현재의 워드번호 n을 검사하는 단계(단계 S414) 및 단계 S414에서의 판단 결과 n이 4가 아니라면, n을 1만큼 감소시키고, 다시 단계 S412로 진행하는 단계(단계 S415)로 이루어진다.In the byte shifting process S410, first, setting the current word number n to be related to the shift to 27 (step S411), and shifting the upper byte of the nth word to the lower byte of the nth word (step S412). ), shifting the lower byte of the n-1th word to the upper byte of the nth word (step S413), checking the current word number n (step S414), and determining the result n in step S414 by 4 If not, it decreases n by 1 and proceeds to step S412 again (step S415).

만일 상기의 단계 S414의 검사 결과 n이 4라면, 3번째 워드의 하위 바이트의 모든 비트를 논리값 "0"으로 채우는 HCS 삽입 단계(단계 S420)로 진행하고, ATM 셀 복구 과정을 종료(단계 S430)하는데, HCS 삽입 단계(단계 S420)에서, 3번째 워드의 하위 바이트의 모든 비트를 논리값 "0"으로 채우는 이유는, HCS는 헤더 에러를 검사하는 정보를 담고 있는 비트들로서, 정상인 경우에는 "0"이기 때문이다.If the check result n in step S414 is 4, the process proceeds to the HCS insertion step (step S420) of filling all bits of the lower byte of the third word with the logic value "0", and ends the ATM cell recovery process (step S430). In the HCS insertion step (step S420), the reason for filling all bits of the lower byte of the third word with the logical value "0" is that the HCS bits contain information for checking a header error. 0 ".

본 발명에 따른 방법을 사용하면, ATM 셀에 기반을 둔 신호를 처리하는 과정에서, ATM 셀의 구조가 변경되었을 때, ATM 셀의 표준구조로 복구시켜 줄 수 있으므로, 이후의 ATM 셀 처리가 용이해지는 효과가 있다.Using the method according to the present invention, when the ATM cell structure is changed in the process of processing the signal based on the ATM cell, it is possible to restore to the standard structure of the ATM cell, so that subsequent ATM cell processing is easy. There is a repelling effect.

Claims (1)

ATM 셀의 3번째 워드의 하위 바이트로부터, 27번째 워드의 상위 바이트 까지의 바이트를 모두 한 바이트씩 하향으로 이동시키는 단계; 및Moving all bytes from the lower byte of the third word of the ATM cell to the upper byte of the 27th word downward by one byte; And ATM 셀의 3번째 워드의 하위 바이트를 모두 논리값 '0'으로 채우는 단계를 포함하는 것을 특징으로 하는 ATM 셀 구조 복구방법.And filling all lower bytes of the third word of the ATM cell with a logical value of '0'.
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