KR100244850B1 - 과전류 제어장치 - Google Patents

과전류 제어장치 Download PDF

Info

Publication number
KR100244850B1
KR100244850B1 KR1019970007643A KR19970007643A KR100244850B1 KR 100244850 B1 KR100244850 B1 KR 100244850B1 KR 1019970007643 A KR1019970007643 A KR 1019970007643A KR 19970007643 A KR19970007643 A KR 19970007643A KR 100244850 B1 KR100244850 B1 KR 100244850B1
Authority
KR
South Korea
Prior art keywords
overcurrent
control
transistor
voltage
switch element
Prior art date
Application number
KR1019970007643A
Other languages
English (en)
Other versions
KR19980072706A (ko
Inventor
배석철
이원오
Original Assignee
김충환
한국전자주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 김충환, 한국전자주식회사 filed Critical 김충환
Priority to KR1019970007643A priority Critical patent/KR100244850B1/ko
Publication of KR19980072706A publication Critical patent/KR19980072706A/ko
Application granted granted Critical
Publication of KR100244850B1 publication Critical patent/KR100244850B1/ko

Links

Images

Classifications

    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
    • H02H3/08—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection responsive to excess current
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
    • H02H3/02—Details
    • H02H3/025—Disconnection after limiting, e.g. when limiting is not sufficient or for facilitating disconnection
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H7/00—Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions
    • H02H7/20—Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions for electronic equipment
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H9/00—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection
    • H02H9/02—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection responsive to excess current
    • H02H9/025—Current limitation using field effect transistors

Landscapes

  • Electronic Switches (AREA)
  • Power Conversion In General (AREA)

Abstract

본 발명은 과전류 제어 방법 및 장치에 관한 것으로, 특히 과전류를 제어하여 반도체 소자를 보호하기 위한 기능을 갖는 과전류 제어장치에 관한 것이다.
본 발명에 따른 과전류 제어 장치는 제어라인으로부터의 제어신호에 따라 부하의 전류 통로를 선택적으로 절환하는 제어용 스위치 소자와, 제어용 스위치 소자에 인가되는 과전류를 검출하는 과전류 검출수단과, 제어용 스위치 소자가 턴-온되는 기간에 과전류가 검출되게끔 상기 제어용 스위치 소자의 절환상태를 검출하는 검출수단과, 제어용 스위치 소자에 공급되는 과전류에 따라 제어라인인상의 제어신호를 기저전압원 쪽으로 바이패스하는 과전류 제어수단을 구비한다.
본 발명에 따른 과전류 제어장치는 부하에 접속되어 부하의 전류 통로를 절환 하는 반도체 스위치 소자에 유입되는 과전류에 따라 과전류 제어 수단을 선택적으로 구동시킴으로써 과전류를 제한 할 수 있다.

Description

과전류 제어장치.
제 1 도는 본 발명의 실시 예에 따른 과전류 제어장치의 회로도.
제 2 도는 본 발명의 다른 실시 예에 따른 과전류 제어장치의 회로도.
제 3도는 본 발명의 또 다른 실시 예에 따른 과전류 제어장치의 회로도.
* 도면의 주요부분에 대한 부호의 설명
20 : 과전류 제어부 30 : 검출부
50 : 대용한 검출부
Q1내지 Q3: 제 1내지 제 3트랜지스터 R1내지 R4: 저항
Dn: n개의 다이오드
본 발명은 부하의 전류통로와 전류량을 제어하기 위해 제어용 스위치 소자를 가지는 전력제어장치에 관한 것으로, 제어용 스위치 소자를 과전류로부터 보호하는 과전류 제어장치에 관한 것이다.
통상적으로, 인버터(Inbertor), 컨버터(Converter) 및 모터(Motor)구동회로와 같은 전력제어장치는 제어용 스위치 소자를 고용하여 부하의 전류 통로와 그 전류량을 제어한다. 이 제어용 스위치 소자로는 우수한 전류구동능력과 빠른 스위칭 속도를 가지는 반도체 스위치 소자들이 주로 사용된다. 이들 반도체 스위치 소자들에는 바이폴라 트랜지스터(Bipolar Transistor), 및 전계효과 트랜지스터(Field Effect Transistor) 및 절연 게이트 바이폴라 트랜지스터(Insulated Gate Bipolar Transistor ; 이하 ＆quot;IGBT＆quot;라 함) 등이 있으나, 이들 중 IGBT가 가장 뛰어나 보편적으로 사용된다.
한편, 모터구동회로 및 인버터와 같은 전력 제어 장치는 유도성 부하를 포함하여 종종 제어회로의 오작동 또는 부하의 파괴로 인한 단락으로 과전류를 발생시킨다. 이 경우, 과전류는 부하의 전류통로를 절환하는 반도체 스위치 소자의 온도를 급격하게 상승시킴과 아울러 그 반도체 스위치 소자에 스트레스를 가함으로써 급기야는 반도체 스위치 소자를 파괴시킨다.
따라서, 본 발명의 목적은 과전류로부터 스위치 소자를 보호할 수 있는 과전류 제어장치를 제공함에 있다.
상술한 목적을 달성하기 위하여, 본 발명에 따른 과전류 제어 장치는 제어라인으로부터 제어신호에 따라 부하의 전류 통로를 선택적으로 절환하는 제어용 스위치 소자와, 제어용 스위치 소자에 인가되는 과전류를 검출하는 과전류 검출수단과, 제어용 스위치 소자가 턴-온되는 기간에 과전류가 검출되게끔 상기 제어용 스위치 소자의 절환상태를 검출하는 검출수단과, 제어용 스위치 소자에 공급되는 과전류에 따라 제어라인상의 제어신호를 기저전압원 쪽으로 바이패스하는 과전류 제어수단을 구비한다.
본 발명의 상기 목적 외에 다른 목적 및 이점들은 첨부 도면을 참조한 본 발명의 실시 예들에 대한 상세한 설명을 통하여 명백하게 드러나게 될 것이다.
이하 본 발명의 실시 예들을 첨부한 제1도 내지 제3도를 참조하여 상세히 설명하기로 한다.
제 1 도는 본 발명의 실시 예에 따른 반도체 소자의 과전류 제어장치의 회로를 도시한 것이다.
제 1 도에 있어서, 과전류 제어장치는 부하와 접속되어 부하의 전류 통로를 선택적으로 절환 하는 반도체 스위치 소자로 사용된 제1 트랜지스터(Q1)와, 제1 트랜지스터(Q1)에 접속되어 제 1 트랜지스터(Q1)의 동작여부를 검출하는 검출부(30) 및 검출부(30)와 제 1트랜지스터(Q1)에 공통으로 접속되어 과전류가 발생하는 경우 과전류를 제한하는 과전류 제어부(20)를 구비한 본 발명의 과전류 제어 장치가 도시되어 있다.
부하의 전류 통로를 절환 하기 위한 반도체 스위치 소자는 바이폴라 트랜지스터의 전류 구동 능력과 전계 효과 트랜지스터의 빠른 스위칭 특성을 동시에 갖는 절연 게이트 바이폴라 트랜지스터 (IGBT)를 사용한다. 검출부(30)는 제1 트랜지스터(Q1)의 컬렉터 전압을 분압하는 분압 저항기(R2,R3)와 분전압 신호의 전압으로 턴-온(Turn-on)/턴-오프(Turn-off)되는 제 2트랜지스터(Q2)를 추가로 구비한다. 제1 트랜지스터(Q1)는 제 5노드(10) 및 기저 전압원(GND) 사이에 접속된 분압 저항기(R2,R3)와 제2 노드(4)를 경유하여 컬렉터 전류를 제한하는 저항(R1) 및 기저 전압원(GND)에 접속된다. 또한 제1 트랜지스터(Q1)는 제2 노드(4)와 제5 노드(10)를 경유하여 부하와 접속되고 제1 노드(2)를 경유하여 제3 트랜지스터(Q3)와 접속된다. 제2 트랜지스터(Q2)는 제3 노드(6)를 경유하여 컬렉터 전류 제한 저항(R1) 및 제3 트랜지스터(Q3)의 게이트와 공통 접속되고 제4 노드(8)을 경유하여 분압 저항기(R2,R3)와 접속된다.
그리고 제2 트랜지스터(Q2)는 기저 전압원(GND)에 접속된다. 제3 트랜지스터(Q3)는 제1 노드(2)를 경유하여 제1 트랜지스터(Q1)의 게이트 저항(R4)에 접속됨과 아울러 기저 전압원(GND)과 제3 노드(6) 사이에 접속된다.
제1 트랜지스터(Q1)는 자신의 게이트에 기저 전압(0V)이 인가될 경우 턴-오프(Turn-off)된다. 이 경우 제1 트랜지스터(Q1)의 컬렉터 전압은 제5 노드(10)을 통하여 부하와 접속된 분압 저항기(R2,R3) 양단에 인가된 전원 전압원(Vcc)과 같고 분압 저항기(R2,R3)의 저항 값의 비율에 따라 분압 된다. 분압된 분전압 신호는 제1 트랜지스터(Q1)의 턴-오프 상태 신호로써 제4 노드(8)를 경유하여 제2 트랜지스터(Q2)의 베이스에 인가된다. 이 때 분압 저항기(R2,R3)의 비율은 제1 트랜지스터(Q1)가 턴-오프 상태일 때 제2 트랜지스터(Q2)가 턴-온 될 수 있도록 적정한 비율로 예컨대 1:10 R2=50㏀, R3=500㏀으로 설정된다. 제2 트랜지스터(Q2)는 제4 노드(8)로부터 0.7V 이상의 분전압 신호가 자신의 베이스에 인가되어 턴-온됨으로써 제3 노드(6)를 기저 전압원(GND)에 접속시켜 제2 노드(4)로부터의 저항(R1)과 제 3노드(6)를 경유하여 제3 트랜지스터(Q3)의 게이트에 인가될 전압이 기저 전압원(GND)으로 바이패스 되도록 한다. 이 결과 제3 트랜지스터(Q3)는 자신의 게이트 문턱 전압(6V) 이하의 전압이 자신의 게이트에 인가되어 턴-오프됨으로써 제1 노드(2)와 기저 전압원(GND) 사이의 전송 통로를 차단시킨다.
따라서, 제1 트랜지스터(Q1)의 턴-오프 상태에 분압 저항기(R2,R3)에 의한 0.7V 이상의 분전압이 제2 트랜지스터(Q2)의 베이스에 인가되어 제2 트랜지스터(Q2)가 턴-온 되도록 한다. 턴-온된 제2 트랜지스터(Q2)에 의해 제3 트랜지스터(Q3)는 턴-오프 되어 과전류 제어부(20)가 구동되지 않는다.
이와는 달리, 부하의 전류 통로를 절환 하기 위해 사용된 제1 트랜지스터(Q1)가 자신의 게이트에 턴-온 전압(통상 15V정도)이 인가되면 턴-온되어 제2노드(4)를 기저 전압원(GND)에 접속시켜 제1 트랜지스터(Q1)의 콜렉터 전압은 콜렉터-에미터간 포화 전압(3~5V)이 된다. 이 전압은 제5 노드(10)를 경유하여 부하와 접속된 분압 저항기(R2,R3) 양단에 인가된다. 분압된 분전압 신호는 0.7V 이하의 전압으로 제4 노드(8)를 경유하여 제2 트랜지스터(Q2)의 베이스에 인가된다. 이로 인하여 제2 트랜지스터(Q2)는 턴-오프 되어 제3 노드(6)와 기저 전압원(GND) 사이의 신호 전송 통로가 차단된다. 턴-오프된 제2 트랜지스터(Q2)의 컬렉터 상의 전류는 차단되고 제3 노드(6)를 경유한 저항(R1)에서는 전압 강하가 발생하지 않는다. 이 때, 제3 노드(6)를 경유한 제2 트랜지스터(Q2)의 컬렉터 전압과 제3 트랜지스터(Q3)의 게이트 전압은 제1 트랜지스터(Q1)의 컬렉터-에미터간 포화 전압(3~5V)으로 등전위 된다. 이 전압은 제3 트랜지스터(Q3)의 턴-온 조건인 게이트 문턱 전압(6V) 이하이므로 제3 트랜지스터(Q3)는 턴-오프 되어 제1 노드(2)와 기저 전압원(GND) 사이의 신호 전송 통로가 차단된다. 결과적으로 정상 전류가 흐르는 경우, 제1 트랜지스터(Q1)가 턴-온 상태를 유지하면 제2 트랜지스터(Q2)는 턴-오프 되고 제3 트랜지스터(Q3)의 게이트에 걸리는 전압은 제1 트랜지스터(Q1)의 컬렉터-에미터간 포화 전압으로 인가된다. 이 전압은 게이트 문턱 전압(6V) 이하이므로 제1 트랜지스터(Q1)가 턴-오프 되어 과전류 제어부(20)는 구동되지 않는다. 이를 위하여, 분압 저항기(R2,R3)는 제1 트랜지스터(Q1)의 턴-오프 상태에 제4 노드(8)를 경유한 분전압 신호로 제2 트랜지스터(Q2)의 베이스 전압이 0.7V 이상을 유지하도록 하고, 제1 트랜지스터(Q1)의 턴-온 상태에 0.7V 이하의 전압을 유지하도록 한다. 또한, 제2 트랜지스터(Q2)는 분압 저항기(R2,R3)에 의한 분전압 신호로써 자신의 베이스 전압으로 인가받아 제3 노드(6)와 기저 전압원(GND)을 선택적으로 절환하는 절환 스위칭 기능을 갖는 NPN 바이폴라 트랜지스터를 사용한다.
한편, 제1 트랜지스터(Q1)가 턴-온된 상태에서 부하의 단락 등으로 인한 전류가 증가하여 제한 전류 이상의 과전류가 제1 트랜지스터(Q1)의 컬렉터에 인가되면 컬렉터 전압이 증가하게 된다. 이 전압은 컬렉터 저항(R1) 및 제3 노드(6)를 경유하여 제3 트랜지스터(Q3)의 게이트에 인가된다. 제3 트랜지스터(Q3)는 게이트 문턱 전압(6V) 이상의 전압이 자신의 게이트에 인가되어 턴-온 된다. 제3 트랜지스터(Q3)의 턴-온으로 제1 노드(2)를 기저 전압원에 접속시켜 제1노드(2)를 경유하여 게이트 저항(R4)에 의한 게이트 신호원의 전압 강하로 인한 분압 전압을 기저 전압원(GND)으로 바이패스 시킨다. 따라서 제1 트랜지스터(Q1)의 게이트에 인가되는 전압이 감소함에 따라 컬렉터에 유입되는 과전류가 제한됨으로써 과전류를 제어하게 된다.
이를 위하여 제3 트랜지스터(Q3)는 자신의 게이트에 인가되는 전압에 따라 제1 노드(2)와 기저 전압원(GND) 사이의 접속을 선택적으로 절환하는 절환 기능을 갖는 n-channel 전계 효과 트랜지스터가 사용된다.
제1 트랜지스터(Q1)에 인가되는 과전류는 크기에 따라 무시할 수 있을 정도일 수도 있고, 특정 크기의 과전류 이상을 제어할 필요가 있을 수 있다. 제한하려는 과전류의 크기는 제3 트랜지스터(Q3)의 게이트 문턱 전압과 제1 트랜지스터(Q1)의 컬렉터-에미터간 포화 전압에 의해 결정된다.
제한하려는 과전류의 크기에 따라 제3 트랜지스터(Q3)의 게이트 문턱 전압을 임의로 조정할 필요가 있는 경우, 과전류 제어부(20)의 절환 스위칭 기능을 갖는 제3 트랜지스터(Q3)의 소스단에 n개의 다이오드 (Dn)를 직렬 접속하여 게이트 문턱 전압을 조정함으로써 선택적으로 과전류 제어부(20)를 구동시킬 수 있다.
결과적으로, 제3 트랜지스터(Q3)는 컬렉터 저항(R1)과 함께 제1 트랜지스터(Q1)가 턴-온되는 기간에 제1 트랜지스터(Q1)의 컬렉터에 공급되는 과전류를 검출하고, 제1 트랜지스터(Q1)의 게이트에 인가되는 전압을 기저전압원(GND)으로 바이패스시켜 검출된 과전류를 제한하게 된다.
제 2도에는 임의의 과전류 크기 이상을 제어하는 수단을 구바한 과전류 제어 장치가 도시되어 있다.
과전류 제어부(20)는 게이트 문턱 전압을 임의로 조정하기 위한 n개의 다이오드(Dn)를 추가로 구비한다.
제1 트랜지스터(Q1)는 자신의 게이트에 턴온전압(통상 15V정도)이 인가되면 턴-온되어 제2 노드(4)를 기저 전압원(GND)에 접속시켜 제2 노드(4)와 기저 전압원(GND)의 양단 전압은 컬렉터-에미터간 포화 전압이 되고, 이 전압은 제5 노드(10)를 경유해 분압 저항기(R2, R3)에 의해 분압 되어 진다. 분압된 분전압 신호는 제4 노드(8)를 경유해 제2 트랜지스터(Q2)의 베이스에 0.7V 이하의 전압이 인가되어 제2 트랜지스터(Q2)는 턴-오프 된다. 이에 따라 제3 노드(6)와 기저 전압원(GND)간의 전송 통신로는 차단되고, 제2 노드(4)와 제3 노드(6)사이에 접속된 저항(R1)양단간 전압과 제3 트랜지스터(Q3)의 게이트 전압 및 제2 트랜지스터(Q2)의 컬렉터 전압은 제1 트랜지스터(Q1)의 컬렉터-에미터간 포화 전압(3~5V)으로 등전위 된다. 제1 트랜지스터(Q1)에 제한 값 이상의 과전류가 인가되는 경우, 제1 트랜지스터(Q1)의 컬렉터 전압은 증가하고 이 전압은 컬렉터 저항(R1) 및 제3 노드(6)를 경유하여 제3 트랜지스터(Q3)의 게이트에 인가된다. 이 전압이 제3 트랜지스터(Q3)의 게이트 문턱 전압 이상(6V)이 되면 제3 트랜지스터(Q3)는 턴-온되어 제2 노드(4)와 기저 전압원(GND)을 접속한다. 이 결과 제2 노드(4)를 경유하여 게이트 저항(R4)에 의한 게이트 신호원의 분전압을 기저 전압원(GND)으로 바이패스 한다. 이 때 제3 트랜지스터(Q3)의 게이트 문턱 전압을 임의로 조정하여 제한하려는 과전류에 대하여 제3 트랜지스터가 턴-온됨으로써 제한하려는 과전류 량을 적절히 조절할 수 있다.
이를 위하여 과전류 제어부(20)는 낮은 게이트 문턱 전압 특성을 갖는 제3 트랜지스터(Q3)와 제3 트랜지스터(Q3)의 소스에 직렬 접속된 n개의 다이오드(Dn)를 추가로 구비한다. 5.5V의 게이트 문턱 전압 특성을 갖는 제3 트랜지스터(Q3)가 사용된다면, 비교적 낮은 과전류에 제3 트랜지스터(Q3)는 턴-온되어 제1 트랜지스터(Q1)에 유입되는 비교적 낮은 과전류를 제한할 수 있다. 또는 n개의 다이오드(Dn)를 이용하여 5.5V의 게이트 문턱 전압 특성을 갖는 제3 트랜지스터(Q3)의 소스에 n개의 다이오드(Dn)를 직렬 접속하여 게이트 문턱 전압을 5.5+(0.6*n)V로 임의로 조정함으로써 임의의 과전류를 제어할 수 있다. 2개의 다이오드를 제3 트랜지스터(Q3)의 소스에 직렬 접속한다면 게이트 문턱 전압은 6.7V로 조정되고, 그에 대응한 과전류를 제한할 수 있다. 또한 4개의 다이오드를 제3 트랜지스터(Q3)의 소스에 직렬 접속한다면 게이트 문턱 전압은 7.9V가 된다.
한편, 과전류 제어 장치는 검출부의 소자를 변경하여도 같은 과전류 제어 효과를 갖는다.
제 3도를 참조하면 제2 트랜지스터(Q2)를 절연 게이트형 전계 효과 트랜지스터로 대용한 검출부를 구비한 과전류 제어장치가 도시되어 있다.
검출부(30)는 제1 트랜지스터(Q1)의 턴-온/턴-오프 상태에 따라 이를 검출하여 과전류가 발생하는 경우에 과전류 제어부(20)를 구동시킴으로써 제1 트랜지스터(Q1)에 유입되는 과전류를 제한한다.
이를 위하여 검출부(30)는 분압 저항기(R2, R3)와 n-channel 전계 효과 트랜지스터(50)를 추가로 구비한다.
점선 내의 부분은 NPN바이폴라 트랜지스터를 n-channel 전계 효과 트랜지스터로 대용한 부분을 나타낸다.
제1 트랜지스터(Q1)의 게이트에 턴온전압(통상 15V정도)이 인가되어 턴-온되면 제2 노드(4)를 기저 전압원(GND)에 접속시켜 자신의 컬렉터 전압은 컬렉터-에미터간 포화 전압이 된다. 이 전압은 제2 노드(4)와 제5 노드(10)를 경유하여 분압 저항기(R2, R3)에 인가되고, 분압 저항기 (R2, R3)에 의한 분전압 신호는 제1 트랜지스터(Q1)의 턴-온 신호로써 제4 노드(8)를 경유하여 제2 트랜지스터(Q2)의 게이트에 인가된다. 이 전압은 게이트 문턱 전압(6V) 보다 낮으므로 제2 트랜지스터(Q2)는 턴-오프된다. 제3 노드(6)를 경유해서 제3 트랜지스터(Q3)의 게이트에 인가되는 전압은 제2 노드(4)와 컬렉터 전류 제한 저항(R1)을 경유한 제1 트랜지스터(Q1)의 컬렉터-에미터간 포화 전압(3~5V)으로 제3 트랜지스터(Q3)의 게이트 문턱 전압(6V)보다 낮아 제3 트랜지스터(Q3)는 턴-오프된다. 이때 부하의 단락 등으로 인한 과전류가 제1 트랜지스터(Q1)의 컬렉터에 인가 되면 컬렉터-에미터간 포화 전압이 증가해서 제3 트랜지스터(Q3)의 게이트 문턱 전압(6V)에 가까워진다. 이 전압은 제3 노드(6)를 경유해서 제3 트랜지스터(Q3)에 인가되고 제3 트랜지스터(Q3)는 턴-온된다. 이 결과 제1 노드(2)와 기저 전압원을 접속시켜 제1 노드(2)를 경유해서 게이트 저항(R4)에 의한 게이트 신호의 전압 강하분이 기저 전압원(GND)으로 바이패스 하도록 한다. 따라서 제1 트랜지스터 게이트에 인가되는 전압의 감소로 컬렉터에 유입되는 과전류가 제한된다.
이를 위하여, 분압 저항기(R2, R3)는 제1 트랜지스터(Q1)의 턴-온 상태에 제4 노드(8)를 경유한 분압 신호가 제2 트랜지스터(Q2)의 게이트 문턱 전압(6V)이하의 전압을 유지하도록 하고, 제1 트랜지스터(Q1)의 턴-오프 상태에 제4 노드(8)를 경유한 분압 신호가 제2 트랜지스터(Q2)의 게이트 문턱 전압(6V) 이상의 전압을 유지하도록 저항 비를 적절하게 설정하여야 한다.
결과적으로, 제3 트랜지스터(Q3)는 컬렉터 저항(R1) 및 n개의 다이오드들(Dn)과 함께 제1 트랜지스터(Q1)가 턴-온되는 기간에 제1 트랜지스터(Q1)의 컬렉터에 공급되는 과전류를 검출하고, 제1 트랜지스터(Q1)의 게이트에 인가되는 전압을 기저전압원(GND)으로 바이패스시켜 검출된 과전류를 제한하게 된다.
상술한 바와 같이, 본 발명의 실시 예에 따른 과전류 제어방법 및 장치는 부하에 접속되어 부하의 전류 통로를 절환 하는 반도체 스위치 소자에 유입되는 과전류에 따라 과전류 제어 수단을 선택적으로 구동시킴으로써 과전류를 제한 할 수 있다.
본 발명에 따른 과전류 제어 방법 및 장치는 부하에 접속되어 부하의 전류 통로를 선택적으로 절환하는 반도체 스위치 소자에 인가되는 과전류를 제어하여 제품의 안정성과 신뢰도를 향상시키는 이점을 제공한다.
본 발명의 실시 예로써 제1도 내지 제3도를 들어 설명하였으나 당업자라면 본 발명의 기술 사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의하여 정하여져야만 한다.

Claims (6)

  1. 제어라인으로부터의 제어신호에 따라 부하의 전류 통로를 선택적으로 절환하는 제어용 스위치 소자와,
    상기 제어용 스위치 소자에 과전류가 인가되는 가를 검출하는 제1 검출수단과,
    상기 제어용 스위치 소자에 절환상태를 검출하여 상기 제어용 스위치 소자가 턴-온되는 기간에 상기 제1 검출수단이 상기 과전류 검출동작을 수행하게끔 하는 제2 검출수단과,
    상기 제1 검출수단의 출력신호에 응답하여 상기 제어라인상의 제어신호를 기저전압원 쪽으로 바이패스하는 과전류 제어수단을 구비한 것을 특징으로 하는 과전류 제어장치.
  2. 제 1 항에 있어서,
    상기 제어용 스위치 소자는 상기 제어라인에 접속된 게이트, 상기 부하에 접속된 컬렉터 및 상기 기저전압원에 접속된 에미터를 가지는 인슐레이티드 게이트 바이폴라 트랜지스터인 것을 특징으로 하는 과전류 제어장치.
  3. 제 2 항에 있어서,
    상기 제2 검출수단은 상기 인슐레이티드 게이트 바이폴라 트랜지스터의 컬렉터와 상기 기저전압원 사이에 접속되어 상기 제어용 스위치 소자의 절환상태를 검출하는 분압 저항기와,
    상기 분압저항기와 상기 제어용 스위치소자 사이에 접속되어 상기 분압저항기의 출력신호에 응답하여 상기 과전류 제어수단을 구동시키는 절환 스위칭 수단을 추가로 구비하고,
    상기 분압 저항기의 분압비는 상기 제어용 스위치 소자가 턴-온 상태를 유지하는 기간에 상기 출력신호가 상기 절환 스위칭 수단의 문턱전압 이하를 유지하도록 함과 아울러 상기 제어용 스위치 소자가 턴-오프 상태를 유지하는 기간에 상기 출력신호가 상기 절환 스위칭 수단의 문턱전압 이상을 유지하도록 분압비가 설정되는 것을 특징으로 하는 과전류 제어 장치.
  4. 제 2 항 또는 제 3 항에 있어서,
    상기 절환 스위칭 수단은 상기 분압저항기의 출력라인에 접속된 베이스, 상기 인슐레이티드 게이트 바이폴라 트랜지스터의 컬렉터 및 상기 과전류 제어수단의 제어단자에 공통으로 접속된 컬렉터 및 상기 기저전압원에 접속된 에미터를 가지는 바이폴라 트랜지스터와,
    상기 분압저항기의 출력라인에 접속된 게이트, 상기 인슐레이티드 게이트 바이폴라 트랜지스터의 컬렉터 및 상기 과전류 제어수단의 제어수단에 공통으로 접속된 드레인 및 상기 기저전압원에 접속된 소오스를 가지는 전계효과 트랜지스터 중 어느 하나로 된 것을 특징으로 하는 과전류 제어 장치.
  5. 제 3 항에 있어서,
    상기 과전류 제어 수단은 상기 인슐레이티드 게이트 바이폴라 트랜지스터의 컬렉터와 상기 절환 스위칭 수단의 출력단자에 공통으로 접속된 게이트, 상기 제어라인에 접속된 드레인 및 상기 기저전압원에 접속된 소오스를 가지는 전계 효과 트랜지스터와,
    상기 전계 효과 트랜지스터의 소오스와 기저전압원 사이에 접속되어 상기 제어용 스위치 소자를 경유하는 전류량에 대한 임계값을 조정하기 위한 전압 조정 수단을 추가로 구비하는 것을 특징으로 하는 과전류 제어 장치.
  6. 제 5 항에 있어서,
    상기 전압 조정 수단은 직렬 접속된 적어도 둘 이상의 다이오드들을 구비한 것을 특징으로 하는 과전류 제어 장치.
KR1019970007643A 1997-03-07 1997-03-07 과전류 제어장치 KR100244850B1 (ko)

Priority Applications (1)

Application Number Priority Date Filing Date Title
KR1019970007643A KR100244850B1 (ko) 1997-03-07 1997-03-07 과전류 제어장치

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1019970007643A KR100244850B1 (ko) 1997-03-07 1997-03-07 과전류 제어장치

Publications (2)

Publication Number Publication Date
KR19980072706A KR19980072706A (ko) 1998-11-05
KR100244850B1 true KR100244850B1 (ko) 2000-02-15

Family

ID=19499026

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019970007643A KR100244850B1 (ko) 1997-03-07 1997-03-07 과전류 제어장치

Country Status (1)

Country Link
KR (1) KR100244850B1 (ko)

Also Published As

Publication number Publication date
KR19980072706A (ko) 1998-11-05

Similar Documents

Publication Publication Date Title
US5091664A (en) Insulated gate bipolar transistor circuit with overcurrent protection
US5563759A (en) Protected three-pin mosgated power switch with separate input reset signal level
US4429339A (en) AC Transistor switch with overcurrent protection
EP0585926B1 (en) Insulated gate semiconductor device
US7443645B2 (en) Overcurrent detecting device
US4949213A (en) Drive circuit for use with voltage-drive semiconductor device
EP0631390B1 (en) A power semiconductor circuit
US6275093B1 (en) IGBT gate drive circuit with short circuit protection
EP0814564A1 (en) Electronic switching circuit with reduction of switching transients
US4954917A (en) Power transistor drive circuit with improved short circuit protection
CN109599845B (zh) 一种保护电路、上桥驱动芯片及ipm模块
US4590395A (en) FET-bipolar drive circuit
KR970005567B1 (ko) 단락 보호 회로
US4547686A (en) Hybrid power semiconductor switch
US20180145668A1 (en) Voltage clamping circuit
US5173848A (en) Motor controller with bi-modal turnoff circuits
JPH05218836A (ja) 絶縁ゲート素子の駆動回路
USRE34107E (en) Power transistor drive circuit with improved short circuit protection
KR100244850B1 (ko) 과전류 제어장치
US5453900A (en) Protective circuit for a power MOSFET that drives an inductive load
US5027020A (en) Zero voltage switching AC relay circuit
US4324989A (en) Solid-state relay
US5315165A (en) Output circuit for outputting control signal to controlled apparatus
JP3139276B2 (ja) 電力用半導体素子の過負荷保護回路
US6940319B2 (en) Device for controlling high and low levels of a voltage-controlled power switch

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20121031

Year of fee payment: 14

FPAY Annual fee payment

Payment date: 20131016

Year of fee payment: 15

LAPS Lapse due to unpaid annual fee