JPS64900U - - Google Patents

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JPS64900U
JPS64900U JP9235687U JP9235687U JPS64900U JP S64900 U JPS64900 U JP S64900U JP 9235687 U JP9235687 U JP 9235687U JP 9235687 U JP9235687 U JP 9235687U JP S64900 U JPS64900 U JP S64900U
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JP
Japan
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switch
capacitor
amplifier
paths
arithmetic unit
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JP9235687U
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Description

【図面の簡単な説明】
第1図は本考案に係るトラツクホールド回路の
一実施例を示す構成図、第2図、第4図、第6図
はスイツチの具体的構成を示す構成図、第3図は
本考案の他の実施例を示す構成図、第5図は従来
のトラツクホールド回路の構成を示す構成図であ
る。 1,3,4,12,18……増幅器、2,7,
8,13,16,17……スイツチ、5,6……
ホールドコンデンサ、10,11……コンデンサ
、14,15……バツフア。

Claims (1)

    【実用新案登録請求の範囲】
  1. ホールドすべき入力信号が入力される増幅器と
    、この増幅器の出力を2つの経路に選択して出力
    する第1のスイツチと、前記2つの経路の各々に
    接続された第1および第2のホールドコンデンサ
    と、前記第1のスイツチと連動して動作される第
    2のスイツチと、この第2のスイツチによつて選
    択され、所定の電位を有する2つの経路のそれぞ
    れに接続された第1および第2のコンデンサと、
    前記第1のホールドコンデンサおよび前記第1の
    コンデンサに保持された電圧を減算する第1の演
    算器と、前記第2のホールドコンデンサと前記第
    2のコンデンサに保持された電圧を減算する第2
    の演算器と、前記第1のスイツチと連動して動作
    され、前記第1または第2の演算器のうち前記第
    1のスイツチによつて選択されている側の経路に
    ある演算器の出力を前記増幅器に帰還することを
    特徴とするトラツクホールド回路。
JP9235687U 1987-06-16 1987-06-16 Pending JPS64900U (ja)

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JP9235687U JPS64900U (ja) 1987-06-16 1987-06-16

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JP9235687U JPS64900U (ja) 1987-06-16 1987-06-16

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JPS64900U true JPS64900U (ja) 1989-01-05

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ID=30953991

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57203296A (en) * 1981-06-09 1982-12-13 Toko Inc Sample holding circuit

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57203296A (en) * 1981-06-09 1982-12-13 Toko Inc Sample holding circuit

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