JPS6417474U - - Google Patents

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JPS6417474U
JPS6417474U JP11240787U JP11240787U JPS6417474U JP S6417474 U JPS6417474 U JP S6417474U JP 11240787 U JP11240787 U JP 11240787U JP 11240787 U JP11240787 U JP 11240787U JP S6417474 U JPS6417474 U JP S6417474U
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printed circuit
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  • Tests Of Electronic Circuits (AREA)
  • Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)

Description

【図面の簡単な説明】
第1図は本考案の原理説明図、第2図は本考案
による一実施例の説明図で、aは側面図、bはフ
ランジの斜視図、c1はピンの斜視図、c2,c
3は平面図、第3図は従来の側面図を示す。 図において、1はプレート、2はプローブピン
、3は被試験プリント基板、4は電子部品、5は
ガイドポスト、6はフランジ、7はピン、3Aは
フツトプリント、3Bは基準穴、4Aはリード端
子を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 プローブピン2が配列されたプレート1と、電
    子部品4が実装された被試験プリント基板3とを
    備え、該プレート1に該被試験プリント基板3を
    重ね合わせることで該電子部品4のリード端子4
    Aが該被試験プリント基板3のフツトプリント3
    Aに固着された箇所に該プローブピン2を当接さ
    せるフイクチヤの構造において、 前記プレート1に係止されるフランジ6と、該
    フランジ6に着脱され、前記被試験プリント基板
    3に設けられた基準穴3Bに挿脱されるピン7と
    より成るガイドポスト5が具備されて成ることを
    特徴とするフイクチヤの構造。
JP11240787U 1987-07-22 1987-07-22 Expired - Lifetime JPH0537260Y2 (ja)

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JP11240787U JPH0537260Y2 (ja) 1987-07-22 1987-07-22

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Publication Number Publication Date
JPS6417474U true JPS6417474U (ja) 1989-01-27
JPH0537260Y2 JPH0537260Y2 (ja) 1993-09-21

Family

ID=31351317

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JP11240787U Expired - Lifetime JPH0537260Y2 (ja) 1987-07-22 1987-07-22

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JPH0537260Y2 (ja) 1993-09-21

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