JPS6417474U - - Google Patents

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JPS6417474U
JPS6417474U JP11240787U JP11240787U JPS6417474U JP S6417474 U JPS6417474 U JP S6417474U JP 11240787 U JP11240787 U JP 11240787U JP 11240787 U JP11240787 U JP 11240787U JP S6417474 U JPS6417474 U JP S6417474U
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printed circuit
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JP11240787U
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  • Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)
  • Tests Of Electronic Circuits (AREA)

Description

【図面の簡単な説明】
第１図は本考案の原理説明図、第２図は本考案
による一実施例の説明図で、ａは側面図、ｂはフ
ランジの斜視図、ｃ１はピンの斜視図、ｃ２，ｃ
３は平面図、第３図は従来の側面図を示す。 図において、１はプレート、２はプローブピン
、３は被試験プリント基板、４は電子部品、５は
ガイドポスト、６はフランジ、７はピン、３Ａは
フツトプリント、３Ｂは基準穴、４Ａはリード端
子を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 プローブピン２が配列されたプレート１と、電
    子部品４が実装された被試験プリント基板３とを
    備え、該プレート１に該被試験プリント基板３を
    重ね合わせることで該電子部品４のリード端子４
    Ａが該被試験プリント基板３のフツトプリント３
    Ａに固着された箇所に該プローブピン２を当接さ
    せるフイクチヤの構造において、 前記プレート１に係止されるフランジ６と、該
    フランジ６に着脱され、前記被試験プリント基板
    ３に設けられた基準穴３Ｂに挿脱されるピン７と
    より成るガイドポスト５が具備されて成ることを
    特徴とするフイクチヤの構造。
JP11240787U 1987-07-22 1987-07-22 Expired - Lifetime JPH0537260Y2 (ja)

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JP11240787U JPH0537260Y2 (ja) 1987-07-22 1987-07-22

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Publication Number Publication Date
JPS6417474U true JPS6417474U (ja) 1989-01-27
JPH0537260Y2 JPH0537260Y2 (ja) 1993-09-21

Family

ID=31351317

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JP11240787U Expired - Lifetime JPH0537260Y2 (ja) 1987-07-22 1987-07-22

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JPH0537260Y2 (ja) 1993-09-21

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