JPS6361829B2 - - Google Patents

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JPS6361829B2
JPS6361829B2 JP54161131A JP16113179A JPS6361829B2 JP S6361829 B2 JPS6361829 B2 JP S6361829B2 JP 54161131 A JP54161131 A JP 54161131A JP 16113179 A JP16113179 A JP 16113179A JP S6361829 B2 JPS6361829 B2 JP S6361829B2
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circuit
signal
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clock signal
video signal
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/14Picture signal circuitry for video frequency region

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Studio Circuits (AREA)
  • Television Signal Processing For Recording (AREA)
  • Closed-Circuit Television Systems (AREA)
  • Transforming Electric Information Into Light Information (AREA)

Description

【発明の詳細な説明】 本発明はテレビ映像信号等のアナログ信号から
画像の輪郭のみをテレビ受像機、感熱記録紙に記
録して表示する際に用いられる画像輪郭検出装置
に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an image contour detection device used for recording and displaying only the contour of an image from an analog signal such as a television video signal on a television receiver or thermal recording paper.

テレビ映像信号等のアナログ信号を2値の濃淡
をもつ感熱記録紙等に記録してハードコピーを得
る場合のブロツク図を第1図に、その波形図を第
2図に示す。第1図の入力端子1に第2図aに示
すような映像信号を入力し、スライス回路2で第
2図aのイのレベルでスライスして2値の信号
(デイジタル信号)第2図bを得る。前記スライ
スした信号を記憶コントロール回路3のコントロ
ールにより、記憶回路4に記憶し、さらに感熱記
録装置のようなプリンター5に記録した場合、そ
の表示は第2図bのハの部分を黒とした場合ロの
部分は白となり記録されない。
FIG. 1 shows a block diagram of a case in which a hard copy is obtained by recording an analog signal such as a television video signal on heat-sensitive recording paper having binary shading, and FIG. 2 shows its waveform diagram. A video signal as shown in Figure 2a is input to the input terminal 1 in Figure 1, and the slice circuit 2 slices it at the level A in Figure 2a to generate a binary signal (digital signal) Figure 2b get. When the sliced signal is stored in the memory circuit 4 under the control of the memory control circuit 3 and further recorded on a printer 5 such as a thermosensitive recording device, the display will be as shown in FIG. The part marked "b" will be white and will not be recorded.

このように映像信号をスライスしたのみで記憶
回路に蓄えて、ハードコピーを得たのみでは画像
の変化状態がわからない欠点がある。また映像信
号を2値に変換する際のスライスレベルの変動、
あるいは映像信号のレベルの変動により常にスラ
イスレベルを調整する必要がある。また感熱記録
を使用する場合は、記録部が多くなると熱により
ヘツドの寿命が短くなる欠点がある。
If the video signal is simply sliced and stored in a storage circuit to obtain a hard copy, there is a drawback that changes in the image cannot be determined. Also, fluctuations in slice level when converting video signals to binary,
Alternatively, it is necessary to constantly adjust the slice level due to fluctuations in the level of the video signal. Further, when using thermal recording, there is a drawback that the life of the head is shortened due to heat as the number of recording sections increases.

本発明は上記欠点を除去しようとするものであ
り、以下本発明の一実施例について図面を参照し
て説明する。
The present invention aims to eliminate the above-mentioned drawbacks, and one embodiment of the present invention will be described below with reference to the drawings.

第3図において10は映像信号入力端子、11
は微分回路、12は波形整形回路、13は波形変
換回路、14は同期信号入力端子、15はクロツ
ク発生回路、16は入力処理回路、17は記憶回
路、18は出力信号処理回路、19は輪郭補正回
路、20は制御回路、21は感熱記録装置、ニ,
ホ,A,Bは各ブロツクの出力である。
In FIG. 3, 10 is a video signal input terminal, 11
12 is a differential circuit, 12 is a waveform shaping circuit, 13 is a waveform conversion circuit, 14 is a synchronization signal input terminal, 15 is a clock generation circuit, 16 is an input processing circuit, 17 is a storage circuit, 18 is an output signal processing circuit, and 19 is a contour a correction circuit; 20 a control circuit; 21 a thermosensitive recording device;
E, A, and B are the outputs of each block.

次に各ブロツクの動作を、第4図〜第6図の波
形図を参照して説明する。映像信号入力端子10
には第4図aに示す映像信号が入力しており、微
分回路11で前記映像信号を微分して第4図bに
示すように映像信号の変化点でそれぞれ正方向の
パルス、負方向のパルスを発生している。前記負
方向及び正方向のパルスは波形整形回路12によ
つて端子14より入力した同期信号により同期信
号部分が除去され、パルスの極性を反転させる極
性反転回路と極性を反転したパルスと反転しない
パルスとの論理和をとるOR回路等とで構成され
る公知の極性をそろえる回路により正方向のみの
デイジタル信号に変換される。この信号を波形変
換回路13に加え、前記第4図cに示すパルスの
立上りによりトリガをかけて第4図dに示すよう
に正方向のパルスを作り、そのパルス幅を、第5
図aに示すように、記録回路制御用のクロツク信
号(第5図b)の1周期分より大きい一定値以上
にしている。このように輪郭部分の信号のパルス
幅を広げているのは、この輪郭部分の信号を第5
図bのクロツク信号を用いて記憶回路17に記録
する際に、クロツク信号によつて輪郭部分の信号
を確実にラツチして記録することができるように
するためである。微分したのみの信号はパルス幅
が狭いため、そのままクロツク信号を用いて記録
しようとしてもクロツク信号によるラツチのタイ
ミングとうまく合わないことが多く、記録できな
いケースが多くなるが、このようにクロツク信号
の1周期分以上にパルス幅を広げておくと、確実
にラツチすることができ、正確に記録することが
できる。第5図aは第4図dのある任意のデータ
期間の1部の時間軸を引き伸ばして記したもので
ある。クロツク発生回路15はテレビの水平同期
信号に同期した第5図bに示すクロツク信号を発
生しており、入力処理回路16で第5図aに示す
データを第5図bに示すクロツク信号でラツチし
て、第5図cに示すようにクロツク信号と同期さ
せている。制御回路20はクロツク発生回路15
で発生している記録制御用のクロツク信号をもと
に、第5図dに示すメモリ記録用クロツク信号ニ
と、メモリ再生用クロツク信号ホ第5図eに示す
記録動作と再生動作の切替えを行う信号B、およ
び第6図aのクロツク信号を8分の1分周したス
トローブ信号Aをそれぞれ作成して出力してい
る。なお第5図a,b,cは同じ時間軸で記し、
第5図d,eは第5図a,b,cの時間軸を圧縮
して記したものである。また第6図のaは第5図
dのホの部分を記したものである。
Next, the operation of each block will be explained with reference to the waveform diagrams of FIGS. 4 to 6. Video signal input terminal 10
The video signal shown in FIG. 4a is input to the , and the video signal is differentiated by the differentiating circuit 11, and as shown in FIG. Generating pulses. The synchronizing signal portion of the negative direction and positive direction pulses is removed by a waveform shaping circuit 12 using a synchronizing signal inputted from a terminal 14, and a polarity inverting circuit inverts the polarity of the pulse, and a pulse with inverted polarity and a pulse without inverted polarity are generated. It is converted into a positive-direction-only digital signal by a known polarity matching circuit composed of an OR circuit and the like. This signal is applied to the waveform conversion circuit 13, which is triggered by the rising edge of the pulse shown in FIG. 4c to create a positive pulse as shown in FIG.
As shown in FIG. 5A, the value is set to a constant value greater than one cycle of the recording circuit control clock signal (FIG. 5B). The reason why the pulse width of the signal of the contour part is widened in this way is that the signal of this contour part is
This is to ensure that when recording in the memory circuit 17 using the clock signal shown in FIG. Since the pulse width of the differentiated signal is narrow, even if you try to record it directly using the clock signal, it will often not match the latch timing of the clock signal, and there will be many cases where it will not be possible to record. By widening the pulse width to one cycle or more, it is possible to reliably latch and record accurately. FIG. 5a is an enlarged view of the time axis of a part of an arbitrary data period in FIG. 4d. The clock generation circuit 15 generates the clock signal shown in FIG. 5b synchronized with the horizontal synchronization signal of the television, and the input processing circuit 16 latches the data shown in FIG. 5a with the clock signal shown in FIG. 5b. The clock signal is synchronized with the clock signal as shown in FIG. 5c. The control circuit 20 is a clock generation circuit 15.
Based on the recording control clock signal generated in the memory recording clock signal D shown in FIG. 5d, and the memory reproducing clock signal H shown in FIG. A strobe signal B and a strobe signal A obtained by dividing the frequency of the clock signal shown in FIG. 6a by one-eighth are respectively generated and output. Note that Figure 5 a, b, and c are written on the same time axis,
Figures 5d and 5e are compressed time axes of Figures 5a, b, and c. Further, a in FIG. 6 depicts the portion e in FIG. 5 d.

さて、記憶回路17は、制御回路20の出力で
ある記録タイミング第5図dのニの部分のタイミ
ングで、入力処理回路16からのデータをメモリ
する。一定ビツト記憶した後、第5図dのホの部
分のタイミングで記憶回路17中の記憶された内
容が読み出され、出力信号処理回路18において
前記読み出された信号はシリアル−パラレル変換
される。第6図bに示すその場合のロードパルス
でパラレル出力はクロツクの第6図bの立下り、
および、第5図eの信号がハイレベルの時のみ出
力され、輪郭補正回路19に加わる。輪郭補正回
路19はパラレル入力8ビツト中の隣り合う2ビ
ツトの相関をとり、この2ビツトがどちらもロー
レベル、あるいはどちらもハイレベルの場合は信
号をローレベルにしてプリント画面に出力しない
ようにしている。これは、隣り合う2ビツトが共
に表示すべき1の信号である場合には画面に表示
したり感熱記録紙等に記録したときに表示の線幅
が広がつてしまい、明瞭な輪郭表示ができなくな
つてしまうためで、このような場合にはむしろ明
暗の連続的な変化が生じていることが多いので、
輪郭として表示しない方が良好な表示を実現でき
るからである。感熱記録装置21は前記データの
信号および制御回路20の制御信号によりコント
ロールされてハードコピーが得られる。
Now, the storage circuit 17 stores the data from the input processing circuit 16 at the timing of the recording timing portion d in FIG. 5, which is the output of the control circuit 20. After a certain number of bits have been stored, the stored contents in the storage circuit 17 are read out at the timing of part E in FIG. 5d, and the read signal is serial-parallel converted in the output signal processing circuit 18. . In that case, the load pulse shown in FIG. 6b, the parallel output is the falling edge of the clock in FIG. 6b,
The signal shown in FIG. 5e is output only when it is at a high level and is applied to the contour correction circuit 19. The contour correction circuit 19 correlates two adjacent bits of the 8 bits of parallel input, and if both of these two bits are low level or both high level, the signal is set to low level and is not output to the print screen. ing. This is because if two adjacent bits are both 1 signals that should be displayed, the displayed line width will widen when displayed on a screen or recorded on thermal recording paper, etc., making it impossible to display clear outlines. This is because the light disappears, and in such cases there is often a continuous change in brightness and darkness.
This is because better display can be achieved if the outline is not displayed. The thermosensitive recording device 21 is controlled by the data signal and the control signal from the control circuit 20 to obtain a hard copy.

以上のように本発明によれば画像の変化の状態
を表わすことができ、また、スライスレベルの調
整も不用である。さらに、本発明は、アナログ映
像信号であらわされたテレビ映像の輪郭部分を微
分して検出し、これを一旦記憶回路に記憶し、読
み出してテレビ画面に表示するか感熱記録紙等に
記録する装置において、アナログ映像信号を微分
して得たパルスを整形して、記憶回路用のクロツ
ク信号の1周期分の幅以上のパルスにしてから記
録回路の入力処理回路に供給するようにしたの
で、アナログ映像信号を微分して得られた輪郭信
号のパルス幅が狭いものであるために記録回路の
クロツク信号でラツチしたときにサンプリングで
きず記録ミスが多くなるという場合でも、クロツ
ク信号の1周期分以上の幅に予め整形して広げて
おくことによりかかる不都合を解消して、輪郭信
号を確実にクロツク信号でサンプリングして記録
することができるという作用効果を奏する。
As described above, according to the present invention, it is possible to represent the state of change in an image, and there is no need to adjust the slice level. Furthermore, the present invention provides an apparatus that differentiates and detects the outline of a television image represented by an analog video signal, temporarily stores this in a memory circuit, reads it out, and displays it on a television screen or records it on thermal recording paper or the like. In this method, the pulse obtained by differentiating the analog video signal is shaped into a pulse with a width equal to or larger than one period of the clock signal for the storage circuit, and then supplied to the input processing circuit of the recording circuit. Even if the pulse width of the contour signal obtained by differentiating the video signal is narrow and it cannot be sampled when latched by the clock signal of the recording circuit, resulting in many recording errors, the pulse width of the contour signal obtained by differentiating the video signal is narrow enough to exceed one period of the clock signal. By shaping and widening the contour signal in advance to a width of 100 mm, this inconvenience can be solved and the contour signal can be reliably sampled and recorded using the clock signal.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来の画像輪郭検出装置のブロツク図
線図、第2図a,bは同装置説明のための波形
図、第3図は本発明の一実施例における画像輪郭
検出装置のブロツク線図、第4図a,b,c,
d、第5図a,b,c,d,e、第6図a,bは
同装置説明のための波形図である。 10……映像信号入力端子、11……微分回
路、12……波形整形回路、13……波形変換回
路、14……同期信号入力端子、15……クロツ
ク発生回路、16……入力処理回路、17……記
憶回路、18……出力信号処理回路、19……輪
郭補正回路、20……制御回路、21……感熱記
録装置。
FIG. 1 is a block diagram of a conventional image contour detection device, FIG. 2 a and b are waveform diagrams for explaining the same device, and FIG. 3 is a block diagram of an image contour detection device in an embodiment of the present invention Figure 4 a, b, c,
d, Fig. 5 a, b, c, d, e, and Fig. 6 a, b are waveform diagrams for explaining the device. 10... Video signal input terminal, 11... Differential circuit, 12... Waveform shaping circuit, 13... Waveform conversion circuit, 14... Synchronization signal input terminal, 15... Clock generation circuit, 16... Input processing circuit, 17... Memory circuit, 18... Output signal processing circuit, 19... Outline correction circuit, 20... Control circuit, 21... Thermal recording device.

Claims (1)

【特許請求の範囲】 1 テレビ映像信号等の画像をあらわすアナログ
映像信号をデイジタル信号に変換し、記憶回路に
記憶し読み出してテレビ画面に表示あるいは2値
の濃淡をもつ感熱記録紙等に記録する装置におい
て、前記アナログ映像信号を微分して正方向パル
スと負方向パルスを得る微分回路と、これらパル
スを波形整形、波形変換して一方向のみでかつ前
記記憶回路制御用のクロツク信号の1周期分以上
のパルス幅を有するパルスに統一する波形整形、
波形変換回路と、その出力パルスを記憶する記憶
回路と、前記テレビ画面あるいは前記感熱記録紙
等に表示するための基本的なクロツク信号に同期
させて前記記憶回路から画像の輪郭信号を読み出
し出力する回路とを備えたことを特徴とする画像
輪郭検出装置。 2 読み出し出力する回路は、テレビ画面あるい
は前記感熱記録紙等に表示するための基本的なク
ロツク信号で記憶回路から読み出したシリアルな
パルスをシリアル−パラレル変換し、そのパラレ
ル信号のうちの各ビツト間の相関をとり、前記記
憶回路から連続した2ビツトで続けて同じパルス
が読み出されたときに出力パルスを発生しないよ
うにしたことを特徴とする特許請求の範囲第1項
に記載の画像輪郭検出装置。
[Claims] 1. Converting an analog video signal representing an image such as a television video signal into a digital signal, storing it in a storage circuit, reading it out, and displaying it on a television screen or recording it on thermal recording paper with binary gradation. The device includes a differentiating circuit that differentiates the analog video signal to obtain positive direction pulses and negative direction pulses, and a differential circuit that shapes and converts the waveforms of these pulses in one direction only and one period of the clock signal for controlling the storage circuit. Waveform shaping to unify pulses with a pulse width of minutes or more,
A waveform conversion circuit, a memory circuit that stores the output pulses thereof, and reads and outputs an image contour signal from the memory circuit in synchronization with a basic clock signal for displaying on the television screen or the thermal recording paper, etc. An image contour detection device characterized by comprising a circuit. 2 The readout circuit converts the serial pulses read from the storage circuit into serial-to-parallel format using a basic clock signal for display on a television screen or the thermal recording paper, etc., and converts each bit of the parallel signal between each bit. The image contour according to claim 1, wherein an output pulse is not generated when two consecutive bits of the same pulse are successively read out from the memory circuit. Detection device.
JP16113179A 1979-12-11 1979-12-11 Detector for video profile Granted JPS5683182A (en)

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JPS5683182A JPS5683182A (en) 1981-07-07
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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4966014A (en) * 1972-10-30 1974-06-26
JPS5028314A (en) * 1973-07-13 1975-03-22

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4966014A (en) * 1972-10-30 1974-06-26
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