JPS6354194U - - Google Patents
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- Publication number
- JPS6354194U JPS6354194U JP14776186U JP14776186U JPS6354194U JP S6354194 U JPS6354194 U JP S6354194U JP 14776186 U JP14776186 U JP 14776186U JP 14776186 U JP14776186 U JP 14776186U JP S6354194 U JPS6354194 U JP S6354194U
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- JP
- Japan
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- digit
- display
- suppressed
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
第１図は本考案のデジタル表示制御装置の一実
施例を示したブロツク図、第２図は第１図に示し
た数字表示回路を構成する７セグメントＬＥＤの
構成例を示した概略図、第３図は第１図に示した
装置により表示された数字例を示した図である。 １……数字表示回路、２……デコーダドライバ
回路、３……０サプレス検出回路、４……０サプ
レス最下位桁検出回路、５―１〜５―ｎ……アン
ドゲート、６……負符号表示駆動回路、７……イ
ンタフエース回路。
施例を示したブロツク図、第２図は第１図に示し
た数字表示回路を構成する７セグメントＬＥＤの
構成例を示した概略図、第３図は第１図に示した
装置により表示された数字例を示した図である。 １……数字表示回路、２……デコーダドライバ
回路、３……０サプレス検出回路、４……０サプ
レス最下位桁検出回路、５―１〜５―ｎ……アン
ドゲート、６……負符号表示駆動回路、７……イ
ンタフエース回路。
Claims (1)
- 複数桁の数字を表示可能な表示部と接続され、
入力される２進化１０進数信号をデコードして前
記複数桁のうち対応する桁に数字を表示すると共
に、負符号信号の入力があれば前記表示部に前記
数字と共に負符号を表示する制御を行うデジタル
表示制御装置において、前記２進化１０進数から
０サプレスされる桁を検出する０サプレス検出手
段と、０サプレスされた桁の最下位を検出する符
号表示桁検出手段と、前記負符号信号が入力され
た場合には時前記０サプレスされた桁の最下位に
対応する桁に負符号を表示させる制御を行う符号
表示制御手段とを具備したことを特徴とするデジ
タル表示制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14776186U JPS6354194U (ja) | 1986-09-29 | 1986-09-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14776186U JPS6354194U (ja) | 1986-09-29 | 1986-09-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6354194U true JPS6354194U (ja) | 1988-04-12 |
Family
ID=31061422
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14776186U Pending JPS6354194U (ja) | 1986-09-29 | 1986-09-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6354194U (ja) |
-
1986
- 1986-09-29 JP JP14776186U patent/JPS6354194U/ja active Pending
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