JPS6345917A - Data counting system for operating recording device - Google Patents

Data counting system for operating recording device

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JPS6345917A
JPS6345917A JP61183083A JP18308386A JPS6345917A JP S6345917 A JPS6345917 A JP S6345917A JP 61183083 A JP61183083 A JP 61183083A JP 18308386 A JP18308386 A JP 18308386A JP S6345917 A JPS6345917 A JP S6345917A
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JP
Japan
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count
pulse signal
circuit
dummy pulse
exclusive
Prior art date
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JP61183083A
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Japanese (ja)
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JPH0761006B2 (en
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Tatsuya Furukawa
達也 古川
Shoji Tozawa
祥二 戸澤
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Caterpillar Japan Ltd
Caterpillar Mitsubishi Ltd
Original Assignee
Caterpillar Mitsubishi Ltd
Shin Caterpillar Mitsubishi Ltd
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Publication date
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Abstract

PURPOSE:To read a count accurately through the addition of a simple circuit constitution by inputting a dummy pulse signal together with a pulse signal from a sensor, operating an exclusive OR, outputting it to a clock terminal of the count circuit and subtracting the dummy pulse signal from the count signal number. CONSTITUTION:Exclusive OR circuits 21, 22 take exclusive OR of a pulse signal of sensors S1, S2 inputted respectively and a dummy pulse signal inputted from a dummy pulse generating means 1 and the result is inputted to clock terminals CLK0, CLK1 of the count circuit 14. The write is applied by the count circuit 14 synchronously with the input clock and the count value just before is written in the memory. Simultaneously, a dummy pulse is inputted to the circuits 21, 22 from the decoder 31 by the means 1. Then the number of dummy pulse signals is subject to subtraction processing from the count by the data adjusting means, in this case, by the software, stored in the memory or outputted externally.

Description

【発明の詳細な説明】[Detailed description of the invention] 【産業上の利用分野】[Industrial application field]

この発明は、センサから検出されたパルス信号を入力す
ると共にカウントした信号を入力クロックに同期して出
力するカウント回路を有する稼働記録装置のデータカウ
ントシステムの改良に関する。
The present invention relates to an improvement in a data counting system for an operation recording device having a counting circuit that inputs a pulse signal detected from a sensor and outputs a counted signal in synchronization with an input clock.

【従来の技術】[Conventional technology]

IN置 8253等のカウンタの如く、入力したパルス
信号の力うント値を入力クロックに同期して初期化(書
込)するカウント回路において、稼(@J機械が停止し
た場合には直前に入力された稼働データのカウント値が
初期化(書込)まれず残留してしまい、正しいカウント
数を読み出すことができない。
In a count circuit that initializes (writes) the power count value of an input pulse signal in synchronization with the input clock, such as a counter such as the IN 8253, the count circuit that initializes (writes) the count value of the input pulse signal is The count value of the operation data that has been reset is not initialized (written) and remains, making it impossible to read the correct count number.

【発明が解決しようとする問題点】[Problems to be solved by the invention]

この発明は上記事情に鑑みてなされたもので、稼働機械
が停止した場合でも直前のカウント値を初期化(書込)
して正しいカウント数を読み出すことのできるデータカ
ウントシステムを提供することを課題とする。
This invention was made in view of the above circumstances, and even if the operating machine stops, the previous count value can be initialized (written).
An object of the present invention is to provide a data counting system that can read out correct count numbers.

【問題点を解決するための手段】[Means to solve the problem]

上記課題達成のため、この発明は、第1図の機能ブロッ
ク図に示す如く、 センサSから検出されたパルス信号を入力すると共にカ
ウントした信号数を入力クロックに同期して出力するカ
ウント回路4を有する稼働記録装置5のデータカウント
システムにおいて、(a)、カウント回路4でカウント
値を初期化(書込)する毎にダミーパルス信号を出力す
るダミーパルス発生手段1を設ける、 (b)、センサSからのパルス信号と共に上記ダミーパ
ルス信号を入力し排他的論理和を演算してカウント回路
4のクロック端子に出力する排他的論理和回路2を設け
る、 (C)、カウント回路4でカウントされた信号数からダ
ミーパルス信号分を差し引くデータ調整手段3を設ける
、 という技術手段を講じたものである。
In order to achieve the above object, the present invention includes a counting circuit 4 which inputs the pulse signal detected from the sensor S and outputs the counted number of signals in synchronization with the input clock, as shown in the functional block diagram of FIG. In the data counting system of the operation recording device 5, (a) a dummy pulse generating means 1 is provided which outputs a dummy pulse signal every time a count value is initialized (written) in the counting circuit 4; (b) a sensor. An exclusive OR circuit 2 is provided which inputs the above dummy pulse signal together with the pulse signal from S, calculates an exclusive OR, and outputs the result to the clock terminal of the count circuit 4. (C). A technical measure is taken in which a data adjustment means 3 is provided to subtract the dummy pulse signal from the number of signals.

【作 用】 センサSから検出されたパルス信号がカウント回路4に
入力されてカウントされる。 このカウント値は入力クロフクに同期して初期化され、
メモリ等に書込まれる。 この初期化(書込)と同時にダミーパルス発生手段1か
らダミーパルス信号が出力される。 このダミーパルス信号は、センサSからのパルス信号と
共に排他的論理和回路2に入力されて排他的論理和が取
られてカウント回路4のクロック端子に入力される。 またカウント回路4でカウントされたカウント値からダ
ミーパルス信号分のパルス数が差し引かれて正確なカウ
ント数がメモリに記憶される。 従って、稼働機械が停止した場合等でも、直前の出力信
号と共に出力したダミーパルス信号が排他的論理和回路
を介してカウント回路4に入力されるので、それと同期
して直前のカウント値をメモリに出力することができる
[Operation] The pulse signal detected from the sensor S is input to the counting circuit 4 and counted. This count value is initialized in synchronization with the input clock,
Written to memory, etc. Simultaneously with this initialization (writing), a dummy pulse signal is output from the dummy pulse generating means 1. This dummy pulse signal is input to the exclusive OR circuit 2 together with the pulse signal from the sensor S, the exclusive OR is taken, and the result is input to the clock terminal of the count circuit 4. Further, the number of pulses corresponding to the dummy pulse signal is subtracted from the count value counted by the count circuit 4, and the accurate count number is stored in the memory. Therefore, even if the operating machine stops, the dummy pulse signal output together with the previous output signal is input to the count circuit 4 via the exclusive OR circuit, and the previous count value is stored in the memory in synchronization with this. It can be output.

【実施例】【Example】

以下にこの発明をICカードを用いた車輌用の稼働記録
システムに適用した場合の一実施例を図面に基づいて説
明する。 第1図に示すブロック図は、この実施例のハードウェア
構成を示すもので、8ビツトCPUからなるコントロー
ル部10に、アドレスバス及びデータバスBを介して、
キーボード41とデイスプレィ42とを接続するための
第2インターフエイス(PIO)11と、ICカードの
カードコンタクタ43を接続するための第1インターフ
エース(PIO)12と、シリアル通信用のインターフ
ェース(SIO)13と、車速センサーS1とタコメー
ターS2と接続し車速及びエンジン回転数を測定するた
めのインターフェース14と、稼働記録用ソフトウェア
等のメモリとして用いるFROM15と、バックアップ
メモリやソフトウェア用メモリとして用いるRAM16
と、車載のバッテリでバックアンプされるリアルタイム
クロック17と、シリアル通信用インターフェース(C
TC)18とからなっている。 上記構成中において、車速及びエンジン回転数を測定す
るためのインターフェース14として、IN置8253
のカウント回路(カウンタ)を用いている。 そして上記カウント回路14には第3図に示す如くデコ
ーダ31が接続されており、コントロールs10のダミ
ーパルス発生手段1からの制御信号によって後述の各排
他的論理和回路21.22にダミーパルス信号を出力し
ている。 このカウント回路14では、0.5秒毎にスピードセン
サーS1やデジタルタコメータ(エンジン回転数検出セ
ンサー)S2から入力したパルス信号をカウントし、更
に初期化(メモリーへの書込)を行っている。 即ち、スピードセンサーS1で検出されたパルス信号は
、スピードデーター人力用フォトカプラ5及びアンプ6
を通り第1の排他的論理和回路21の一方に入力される
。 この第1の排他的論理和回路21の他方には、前記ダミ
ーパルス発生手段1に制御されデコーダ31から上記カ
ウント回路14の初期化(書込)する毎に発信されるダ
ミーパルス信号が入力され−〇− る。 また、デジタルタコメータS2から送られたパルス信号
についても、エンジン回転データ入力用のフォトカプラ
7及びアンプ8を通り第2の排他的論理和回路22の一
方に入力される。 この第2の排他的論理和回路22の他方には、前記と同
様にダミーパルス発生手段1に制御されデコーダ31か
ら上記カウント回路14の初期化(書込)する毎に発信
されるダミーパルス信号が入力される。 従って、各排他的論理和回路21.22では、それぞれ
入力されるセンサー5IS2側のパルス信号と、ダミー
パルス発生手段1から入力されるダミーパルス信号とか
ら排他的論理和を取ってカウント回路14のクロック端
子(CLKO,CLKI)に入力する。 この人カクロソクに同期して前述の如くカウント回路1
4で書込動作が行われ、直前のカウント値かメモリへ書
込まれると共に前記ダミーパルス発生手段1によってデ
コーダ31からダミーパルスが各排他的論理和回路21
.22へ入力される。 このような構成からなっているので、車輌が停止して車
速信号等が変化しない場合であっても、クロック信号が
発生することになり計測を行うことができる。 従って、クロック信号がない時はプリセットが行われな
いカウント回路において、直前のカウント値が残留する
ことがなくリアルタイムにカウント値をメモリに書込む
ことができる。 このようにして書込まれるカウント値はダミーパルス信
号の数を含んでいるので、稼働データとして記憶するに
際しては、ダミーパルス信号分の数を減算処理する必要
がある。 そこで、データ調整手段3によって上記処理を行うが、
本実施例では、ソフトウェアによってカウント値からダ
ミーパルス信号分の数を減算処理してメモリ16に記憶
させ或いは外部へ出力する。 更に、この発明においては上記構成を採ったごとによっ
て、ダミーパルス発生手段1から所定数のダミーパルス
を発生させ、カウント数を確認する(入力したダミーパ
ルスの数とカウント回路14で書込んだカウント値とが
一致するか否か判定し7モニタする)ことによって、カ
ウント回路が正常に作動しているか否かのチエツクを行
うこともできる。 面、本実施例におけるカウント回路14では、カードコ
ンタクタへのブザー音の制御をも合わせて行っており、
図中41はブザーへの接続を示している。 この発明の稼働記録装置のデータカウントシステムは、
上記実施例に限定されるものではなく、種々の稼働機械
の稼働データを記録する際に用いることができ、各種セ
ンサーからの入力に対してそれぞれダミーパルスとの排
他的論理和を取ってクロック端子に入力することによっ
て同様の作用効果を奏することができ汎用性に優れる。
An embodiment in which the present invention is applied to a vehicle operation record system using an IC card will be described below with reference to the drawings. The block diagram shown in FIG. 1 shows the hardware configuration of this embodiment, in which a control section 10 consisting of an 8-bit CPU is connected to a
A second interface (PIO) 11 for connecting the keyboard 41 and the display 42, a first interface (PIO) 12 for connecting the card contactor 43 of the IC card, and an interface (SIO) for serial communication. 13, an interface 14 for connecting the vehicle speed sensor S1 and the tachometer S2 to measure the vehicle speed and engine speed, a FROM 15 used as a memory for operation recording software, etc., and a RAM 16 used as a backup memory or a memory for software.
, a real-time clock 17 that is back-amplified by the on-board battery, and a serial communication interface (C
TC) consists of 18. In the above configuration, the IN position 8253 serves as the interface 14 for measuring vehicle speed and engine rotation speed.
A counting circuit (counter) is used. A decoder 31 is connected to the count circuit 14 as shown in FIG. 3, and a dummy pulse signal is sent to each exclusive OR circuit 21 and 22 to be described later by a control signal from the dummy pulse generating means 1 of the control s10. It is outputting. This counting circuit 14 counts pulse signals input from the speed sensor S1 and the digital tachometer (engine speed detection sensor) S2 every 0.5 seconds, and further initializes (writes into memory). That is, the pulse signal detected by the speed sensor S1 is transmitted to the speed data manual photocoupler 5 and the amplifier 6.
The signal is input to one side of the first exclusive OR circuit 21 through the . A dummy pulse signal, which is controlled by the dummy pulse generation means 1 and is transmitted from the decoder 31 every time the count circuit 14 is initialized (written), is input to the other side of the first exclusive OR circuit 21. −〇− ru. Further, the pulse signal sent from the digital tachometer S2 is also input to one of the second exclusive OR circuits 22 through the photocoupler 7 and amplifier 8 for inputting engine rotation data. The other side of the second exclusive OR circuit 22 receives a dummy pulse signal which is controlled by the dummy pulse generating means 1 and transmitted from the decoder 31 every time the count circuit 14 is initialized (written) as described above. is input. Therefore, each exclusive OR circuit 21 and 22 calculates the exclusive OR of the input pulse signal from the sensor 5IS2 side and the dummy pulse signal input from the dummy pulse generating means 1, and calculates the exclusive OR of the input pulse signal from the sensor 5IS2 side and the dummy pulse signal input from the dummy pulse generating means 1. Input to clock terminals (CLKO, CLKI). This person's count circuit 1 is synchronized with Kakurosoku as mentioned above.
4, a write operation is performed, and the immediately preceding count value is written into the memory, and at the same time, the dummy pulse generation means 1 generates a dummy pulse from the decoder 31 to each exclusive OR circuit 21.
.. 22. With this configuration, even when the vehicle is stopped and the vehicle speed signal etc. do not change, the clock signal is generated and measurement can be performed. Therefore, in a count circuit that is not preset when there is no clock signal, the count value can be written in real time to the memory without the previous count value remaining. Since the count value written in this way includes the number of dummy pulse signals, it is necessary to subtract the number of dummy pulse signals when storing it as operation data. Therefore, the above processing is performed by the data adjustment means 3.
In this embodiment, software subtracts the number of dummy pulse signals from the count value and stores it in the memory 16 or outputs it to the outside. Further, in the present invention, by adopting the above configuration, a predetermined number of dummy pulses are generated from the dummy pulse generating means 1, and the count number is confirmed (the number of input dummy pulses and the count written by the count circuit 14). It is also possible to check whether the counting circuit is operating normally by determining whether the values match or not and monitoring 7). On the other hand, the count circuit 14 in this embodiment also controls the buzzer sound to the card contactor.
In the figure, 41 indicates a connection to a buzzer. The data counting system of the operation recording device of this invention includes:
It is not limited to the above embodiments, and can be used to record operating data of various operating machines, and can be used to record inputs from various sensors by exclusive ORing with dummy pulses and outputting them to clock terminals. It is possible to achieve similar effects by inputting the information into the , and is highly versatile.

【発明の効果】【Effect of the invention】

以上、この発明によれば、センサから検出されたパルス
信号を入力すると共にカウントした信号数を入力クロッ
クに同期して出力するカウント回路を用いた場合に、稼
働機械の停止によりセンサーからの入力信号が変化しな
い場合でも簡単な構成の付加によって正確にカウント数
を読み出すことができる。 またカウント回路の作動をチエツクすることもでき有益
である。
As described above, according to the present invention, when using a counting circuit that inputs a pulse signal detected from a sensor and outputs the counted number of signals in synchronization with an input clock, the input signal from the sensor is Even if the value does not change, the count number can be read out accurately by adding a simple configuration. It is also useful to check the operation of the counting circuit.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の機能ブロック図、第2図はこの発明
の実施例に係るICカードを用いた稼(IJデータ記録
システムのハート構成を示すブロック図、第3図はデー
タカウントシステムを示す回路図である。 ■・・・ダミーパルス発生手段 2・・・排他的論理和回路 3・・・データ調整手段 4・・・カウント回路 5・・・フォトカプラ 6・・・アンプ 7・・・フォトカプラ 8・・・アンプ 10・・・コントロール部 14・・・カウント回路 21・・・第1の排他的論理和回路 22・・・第2の排他的論理和回路 31・・・デコーダ Sl・・・スピードセンサー S2・・・デジタルタコメータ
Fig. 1 is a functional block diagram of the present invention, Fig. 2 is a block diagram showing the heart configuration of an IJ data recording system using an IC card according to an embodiment of the invention, and Fig. 3 is a data counting system. It is a circuit diagram. ■...Dummy pulse generation means 2...Exclusive OR circuit 3...Data adjustment means 4...Count circuit 5...Photocoupler 6...Amplifier 7... Photocoupler 8...Amplifier 10...Control unit 14...Count circuit 21...First exclusive OR circuit 22...Second exclusive OR circuit 31...Decoder Sl. ...Speed sensor S2...Digital tachometer

Claims (1)

【特許請求の範囲】[Claims] (1)、センサから検出されたパルス信号を入力すると
共にカウントした信号数を入力クロックに同期して出力
するカウント回路を有する稼働記録装置のデータカウン
トシステムにおいて、 カウント回路がカウントした信号を初期化(書込)する
毎にダミーパルス信号を出力するダミーパルス発生手段
と、 センサからのパルス信号と共に上記ダミーパルス信号を
入力し排他的論理和を演算してカウント回路のクロック
端子に出力する排他的論理和回路と、 カウント回路でカウントされた信号数からダミーパルス
信号分を差し引くデータ調整手段とを有することを特徴
とする稼働記録装置のデータカウントシステム。
(1) In a data counting system of an operation recording device that has a counting circuit that inputs a pulse signal detected from a sensor and outputs the counted number of signals in synchronization with the input clock, the signal counted by the counting circuit is initialized. dummy pulse generating means that outputs a dummy pulse signal every time (write); A data counting system for an operation recording device, comprising an OR circuit and a data adjustment means for subtracting a dummy pulse signal from the number of signals counted by the counting circuit.
JP18308386A 1986-08-04 1986-08-04 Data recording system for operation recorder Expired - Lifetime JPH0761006B2 (en)

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JPS6345917A true JPS6345917A (en) 1988-02-26
JPH0761006B2 JPH0761006B2 (en) 1995-06-28

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ID=16129464

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010161461A (en) * 2009-01-06 2010-07-22 Yamatake Corp Control device
US7898363B2 (en) 2005-09-02 2011-03-01 Sanyo Electric Co., Ltd. Electric element and electric circuit

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7898363B2 (en) 2005-09-02 2011-03-01 Sanyo Electric Co., Ltd. Electric element and electric circuit
JP2010161461A (en) * 2009-01-06 2010-07-22 Yamatake Corp Control device

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JPH0761006B2 (en) 1995-06-28

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