JPS6328267A - コンデンサ・ダイオ−ド電圧逓倍回路 - Google Patents
コンデンサ・ダイオ−ド電圧逓倍回路Info
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- JPS6328267A JPS6328267A JP16923086A JP16923086A JPS6328267A JP S6328267 A JPS6328267 A JP S6328267A JP 16923086 A JP16923086 A JP 16923086A JP 16923086 A JP16923086 A JP 16923086A JP S6328267 A JPS6328267 A JP S6328267A
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- circuit
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- 239000003990 capacitor Substances 0.000 claims abstract description 48
- 239000000284 extract Substances 0.000 claims 1
- 230000001133 acceleration Effects 0.000 abstract 1
- 230000004075 alteration Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 239000000470 constituent Substances 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000001052 transient effect Effects 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
この発明は複数個のコンデンサ及びダイオードの組合わ
せにより交流入力電圧から直流高電圧を得るコンデンサ
・ダイオード電圧逓倍回路に係り、特に交流入力電圧が
矩形波であるときのラッシュ電流の軽減と高効率化に関
する。
せにより交流入力電圧から直流高電圧を得るコンデンサ
・ダイオード電圧逓倍回路に係り、特に交流入力電圧が
矩形波であるときのラッシュ電流の軽減と高効率化に関
する。
（従来の技術）
周知のように、コンデンサ・ダイオード電圧逓倍回路の
代表的な回路としてコツククロフト・ウオルトン型のも
のがある。この電圧逓倍回路は、例えば第３図に逓倍段
数４段のものを示して説明すると、複数個（ここでは４
個）のコンデンサＣ１〜Ｃ４を直列接続した第′１の］
ンデンリ回路と、これと同数のコンデン十ノＣ５〜Ｃ８
を直列接続した第２の］ンデンザ回路を有づる。コンデ
ンサＣ１〜Ｃ４の各出力端ｃ、ｅ、ｇ、ｉはそれぞれダ
イオードＤ２ 、Ｃ４、ＤＯ、Ｃ８を介してコンデンサ
Ｃ５〜Ｃ８の各出力端ｄ、ｆ、ｈ、ｊに接続され、コン
デンサＣ５＝０８の各入力端す。
代表的な回路としてコツククロフト・ウオルトン型のも
のがある。この電圧逓倍回路は、例えば第３図に逓倍段
数４段のものを示して説明すると、複数個（ここでは４
個）のコンデンサＣ１〜Ｃ４を直列接続した第′１の］
ンデンリ回路と、これと同数のコンデン十ノＣ５〜Ｃ８
を直列接続した第２の］ンデンザ回路を有づる。コンデ
ンサＣ１〜Ｃ４の各出力端ｃ、ｅ、ｇ、ｉはそれぞれダ
イオードＤ２ 、Ｃ４、ＤＯ、Ｃ８を介してコンデンサ
Ｃ５〜Ｃ８の各出力端ｄ、ｆ、ｈ、ｊに接続され、コン
デンサＣ５＝０８の各入力端す。
ｄ、ｆ、ｈはそれぞれダイオードｌ）１ 、 （）３
。
。
０５ 、（）７を介してコンデンサ０１〜Ｃ４の各出力
端ｃ、ｅ、ｇ、ｉに接続されている。各ダイオードＤ１
〜Ｄ８はそれぞれ整流の向きが同じになるようにして、
第２のコンデンサ回路の入出力端す、１間に直列接続さ
れＣいる。第１及び第２の］ンデンリー回路の入力端ａ
、ｂ間には矩形波交流電＋１９ Ｐ ｃが接続され、第
２のコンデンサ回路の入力端すは接地され、第２のコン
デンサ回路の入出力端す、１間には負荷抵抗ＲＬが接続
されている。
端ｃ、ｅ、ｇ、ｉに接続されている。各ダイオードＤ１
〜Ｄ８はそれぞれ整流の向きが同じになるようにして、
第２のコンデンサ回路の入出力端す、１間に直列接続さ
れＣいる。第１及び第２の］ンデンリー回路の入力端ａ
、ｂ間には矩形波交流電＋１９ Ｐ ｃが接続され、第
２のコンデンサ回路の入力端すは接地され、第２のコン
デンサ回路の入出力端す、１間には負荷抵抗ＲＬが接続
されている。
つまり、この電圧逓倍回路はダイオードＤ１〜Ｄ８によ
り交流型ＨＰ ｃの出力が反転する毎にコンデンサの充
電経路を変えてＣ，ｉ 、 Ｃ５、Ｃ２。
り交流型ＨＰ ｃの出力が反転する毎にコンデンサの充
電経路を変えてＣ，ｉ 、 Ｃ５、Ｃ２。
・・・の順に充電していくようにしたものである。この
どき各コンデンサの充電量は、交流電源Ｐｃの出力’Ｉ
／Ｉを十Ｅ ［Ｖ］とすると、最終的にＣ１がＥ ［Ｖ
Ｌ ０２〜Ｃ８が２ＥＣＶ］となるので、この回路の出
力電圧は８Ｅ ［Ｖ］となる。つまり、この回路の出力
電圧は交流入力電圧に逓倍段数の２倍を乗じたものとな
る。
どき各コンデンサの充電量は、交流電源Ｐｃの出力’Ｉ
／Ｉを十Ｅ ［Ｖ］とすると、最終的にＣ１がＥ ［Ｖ
Ｌ ０２〜Ｃ８が２ＥＣＶ］となるので、この回路の出
力電圧は８Ｅ ［Ｖ］となる。つまり、この回路の出力
電圧は交流入力電圧に逓倍段数の２倍を乗じたものとな
る。
上記のようなコツククロフト・ウオルトン型電圧５１倍
回路は開発当初（１９３２年）から主として正弦波入力
が用いられてきた。この場合、入力電源系及び各ダイオ
ードに流れる電流は比較的穏やかであるため、問題は少
なかった。ところが、近年になってコンバータ技術が発
達し、コンバータ回路が入力電源に用いられることが圧
則的に多″、、なってきている。この場合、電源出力波
形は一般的に矩形波となる。このように入力電圧が矩形
波で・ある場合、電圧交番の瞬間に各コンデンサ回路、
−過大な電流（ラッシュ電流）が生ずることにな・５ｏ
このことは電源となる］ンバータ回路系にも１１１１々
の問題を発生させる。また、入力電圧の立上がｅ）の過
渡時には電圧交番の瞬間電流が極めて大きくなるのでダ
イオードを破損してしまうこともあり、比較的許容電流
値の大きいダイオードを用いる必要がある。このため従
来では、’ｌ１ｌｉ！系に波形をなまらせる手段を講じ
たり、回路入力端に最も近いダイオードのみ出力電圧に
影響のない程度の抵抗を直列に付加する等の方法によっ
て過大電流を制限している。
回路は開発当初（１９３２年）から主として正弦波入力
が用いられてきた。この場合、入力電源系及び各ダイオ
ードに流れる電流は比較的穏やかであるため、問題は少
なかった。ところが、近年になってコンバータ技術が発
達し、コンバータ回路が入力電源に用いられることが圧
則的に多″、、なってきている。この場合、電源出力波
形は一般的に矩形波となる。このように入力電圧が矩形
波で・ある場合、電圧交番の瞬間に各コンデンサ回路、
−過大な電流（ラッシュ電流）が生ずることにな・５ｏ
このことは電源となる］ンバータ回路系にも１１１１々
の問題を発生させる。また、入力電圧の立上がｅ）の過
渡時には電圧交番の瞬間電流が極めて大きくなるのでダ
イオードを破損してしまうこともあり、比較的許容電流
値の大きいダイオードを用いる必要がある。このため従
来では、’ｌ１ｌｉ！系に波形をなまらせる手段を講じ
たり、回路入力端に最も近いダイオードのみ出力電圧に
影響のない程度の抵抗を直列に付加する等の方法によっ
て過大電流を制限している。
しかしながら、上記のように電源出力波形をなまらせる
手段は電源回路のＩＩ化を招き、さらには効率を低下さ
せる問題が生じる。また、ダイオードを保護するために
ダイオードに抵抗を直列に接続する方法もあるが、抵抗
による損失に対する配慮から数Ω乃〒数十〇の覇囲の低
抵抗が使用されていたが、さして有効な効果が得られな
かった。
手段は電源回路のＩＩ化を招き、さらには効率を低下さ
せる問題が生じる。また、ダイオードを保護するために
ダイオードに抵抗を直列に接続する方法もあるが、抵抗
による損失に対する配慮から数Ω乃〒数十〇の覇囲の低
抵抗が使用されていたが、さして有効な効果が得られな
かった。
（発明が解決しようとする問題点）
この発明は、従来では交流入力が矩形波電圧である場合
、電圧交番時に発生するラッシュ電流に対する有効な手
段がなかったことを考慮してなされたもので、交流入力
が矩形波電圧であっても簡甲な構成でラッシュ電流を充
分低減させることができ、許容電流値の小さなダイオー
ドを使用することができ、しかも高効率なコンデンサ・
ダイオード電圧逓倍回路を提供することを目的とする。
、電圧交番時に発生するラッシュ電流に対する有効な手
段がなかったことを考慮してなされたもので、交流入力
が矩形波電圧であっても簡甲な構成でラッシュ電流を充
分低減させることができ、許容電流値の小さなダイオー
ドを使用することができ、しかも高効率なコンデンサ・
ダイオード電圧逓倍回路を提供することを目的とする。
［発明の構成］
（問題点を解決するための手段）
この発明に係るコンデンサ・ダイオード電圧逓倍回路は
、それぞれ複数個のコンデンサを直列接続してなる第１
及び第２のコンデンサ回路と、この第１及び第２のコン
デンサ回路の互いに対応づる各段のコンデンサ出力端間
にそれぞれ整流方向が同一となるように第１のダイオー
ドを接続すると共に前記第２のコンデンサ回路の各段の
コンデンサ入力端及び該段に対応する前記第１のコン−
〇− デンサ回路の各段のコンデンサ出力端間にそれぞれ前記
第１のダイオードと整流方向が同一になるように第２の
ダイオードを接続し−Ｃなるダイオード直列回路とから
なり、前記第１及び第２のコンデンサ回路の各入力端に
交流電圧を印加して任意のコンデンサ出力端から入力電
圧の逓信電圧を取出すものにおいて、前記ダイオード直
列回路の全てのダイオードに対して直列に抵抗を挿入接
続するようにしたもので、特に前記抵抗を、その抵抗値
と前記各コンデンサの容量との積によって定まる時定数
τが ｒ＝ａｎ” （ｎ＋１ ）ｅｔｒ ／２Ｅｉ但し、ａ
−６×１０′２〜１０×１０−２、ｂ−２〜１０×１０
−２、７〜３．３、ｅ−１／Ｃ−ｆ、Ｉは負荷電流、Ｃ
はコンデンサ容量、ｆは入力電圧周波数、Ｅｉは入力電
圧、ｔｒは入力電圧Ｅｉの立上がり時間、ｎはダイオー
ドの個数の半分、 としたときの１／１０を満足させる抵抗値以−［とする
ことを特徴とするものＣある。
、それぞれ複数個のコンデンサを直列接続してなる第１
及び第２のコンデンサ回路と、この第１及び第２のコン
デンサ回路の互いに対応づる各段のコンデンサ出力端間
にそれぞれ整流方向が同一となるように第１のダイオー
ドを接続すると共に前記第２のコンデンサ回路の各段の
コンデンサ入力端及び該段に対応する前記第１のコン−
〇− デンサ回路の各段のコンデンサ出力端間にそれぞれ前記
第１のダイオードと整流方向が同一になるように第２の
ダイオードを接続し−Ｃなるダイオード直列回路とから
なり、前記第１及び第２のコンデンサ回路の各入力端に
交流電圧を印加して任意のコンデンサ出力端から入力電
圧の逓信電圧を取出すものにおいて、前記ダイオード直
列回路の全てのダイオードに対して直列に抵抗を挿入接
続するようにしたもので、特に前記抵抗を、その抵抗値
と前記各コンデンサの容量との積によって定まる時定数
τが ｒ＝ａｎ” （ｎ＋１ ）ｅｔｒ ／２Ｅｉ但し、ａ
−６×１０′２〜１０×１０−２、ｂ−２〜１０×１０
−２、７〜３．３、ｅ−１／Ｃ−ｆ、Ｉは負荷電流、Ｃ
はコンデンサ容量、ｆは入力電圧周波数、Ｅｉは入力電
圧、ｔｒは入力電圧Ｅｉの立上がり時間、ｎはダイオー
ドの個数の半分、 としたときの１／１０を満足させる抵抗値以−［とする
ことを特徴とするものＣある。
（作用）
上記構成によるコンデンサ・ダイオード電圧逓倍回路は
、ダイオードに直列接続した抵抗により、ダイオードに
流れる電流を極めて小さくすることができ、入力電圧交
番時の過大電流を完全に抑圧することができ、さらには
電源回路の簡素化及び高効率化を図ることができる。
、ダイオードに直列接続した抵抗により、ダイオードに
流れる電流を極めて小さくすることができ、入力電圧交
番時の過大電流を完全に抑圧することができ、さらには
電源回路の簡素化及び高効率化を図ることができる。
（実施例）
以下、第１図及び第２図を参照してこの発明の一実施例
を説明する。但し、第１図において第３図と同一部分に
は同一符号を付して示し、ここでは異なる部分について
のみ）ホベる。
を説明する。但し、第１図において第３図と同一部分に
は同一符号を付して示し、ここでは異なる部分について
のみ）ホベる。
第１図は第３図に示した逓倍段数４段のコツククロフト
・つＡルトン型電圧逓倍回路にこの発明を適用した場合
の構成を示すものである。この回路は、前記ダイオード
０１〜ＤＢの全てに対し、それぞれ抵抗Ｒ１〜Ｒ８（抵
抗値は全て同じ）を直列に挿入接続したものである。
・つＡルトン型電圧逓倍回路にこの発明を適用した場合
の構成を示すものである。この回路は、前記ダイオード
０１〜ＤＢの全てに対し、それぞれ抵抗Ｒ１〜Ｒ８（抵
抗値は全て同じ）を直列に挿入接続したものである。
すなわち、第３図に示した回路の全てのダイオードＤ１
〜Ｄ８に直列に抵抗を接続することは必ずしも出力電圧
の低下を生じせしめず、抵抗値がある程度人きくなると
むしろ出力電圧は増大し、しかも抵抗値によって出力電
圧が変化することが実験によって明らかにされた。
〜Ｄ８に直列に抵抗を接続することは必ずしも出力電圧
の低下を生じせしめず、抵抗値がある程度人きくなると
むしろ出力電圧は増大し、しかも抵抗値によって出力電
圧が変化することが実験によって明らかにされた。
上記実験結果を第２図に示づ。第２図は、コンデンサ０
１〜Ｃ８の容量を０．１［μＦ］、負荷抵抗ＲＬを１０
［ＭΩ］、矩形波交流入力電圧の波高値を１０００ ［
Ｖ］ 、周波数を５０［Ｈｚ］（周期２０ ［ｍｓｌ
＞、立上がり及び立下がり時間を０．２ ［ｍｓ］とし
たときの抵抗Ｒ１〜Ｒ８の抵抗簡変化に対する出力電圧
の変化を示す特性図である。この場合、出力電圧は抵抗
値が１００［Ω］程度から急速に増大し、１．８ ［ｋ
Ω１付近で最大値となる。そして、抵抗値の大きい方の
有効範囲は極めて広く、５０ ［ｋΩ］でも通常の出力
より大きな出力電圧が得られる。
１〜Ｃ８の容量を０．１［μＦ］、負荷抵抗ＲＬを１０
［ＭΩ］、矩形波交流入力電圧の波高値を１０００ ［
Ｖ］ 、周波数を５０［Ｈｚ］（周期２０ ［ｍｓｌ
＞、立上がり及び立下がり時間を０．２ ［ｍｓ］とし
たときの抵抗Ｒ１〜Ｒ８の抵抗簡変化に対する出力電圧
の変化を示す特性図である。この場合、出力電圧は抵抗
値が１００［Ω］程度から急速に増大し、１．８ ［ｋ
Ω１付近で最大値となる。そして、抵抗値の大きい方の
有効範囲は極めて広く、５０ ［ｋΩ］でも通常の出力
より大きな出力電圧が得られる。
さらに実験及び解析を行なった結果、０段コツククロフ
ト・ウオルトン型電圧逓信回路の出ツノ電圧を最大にす
るには次式を満足させればよいことが明らかとなった。
ト・ウオルトン型電圧逓信回路の出ツノ電圧を最大にす
るには次式を満足させればよいことが明らかとなった。
τ＝ａｎｂ （ｎ＋１ ）ｅｔｒ 、／２Ｆｉ但し、τ
は構成コンデンサの容量とダイオードに直列接続される
抵抗値との積で定まる時定数、ａ。
は構成コンデンサの容量とダイオードに直列接続される
抵抗値との積で定まる時定数、ａ。
ｂは実験によって求められた定数で、
ａ＝６Ｘ１０−２〜１０ＸＩＣ１−２、ｂ＝２．７〜３
．３、 ｅ＝Ｉ１０−ｆ（Ｔは負荷電流、Ｃはコンデンサ容量、
ｆは入力電圧周波数）、Ｅｉは入力電圧、ｔｒは入力電
圧Ｅｉの立上がり時間、ｎは逓倍段数でダイオードの個
数の半分である。ｎ、ａ、ｂそれぞれについて実験した
が、いずれの場合も有効範囲は極めて広く、τは１０［
μＳ］から入力Ｎ圧Ｅ１の周期の半分程度までの範囲に
及ぶことが明らかどなった。但しｎが１の場合は電圧上
昇の効果を得られなかった。
．３、 ｅ＝Ｉ１０−ｆ（Ｔは負荷電流、Ｃはコンデンサ容量、
ｆは入力電圧周波数）、Ｅｉは入力電圧、ｔｒは入力電
圧Ｅｉの立上がり時間、ｎは逓倍段数でダイオードの個
数の半分である。ｎ、ａ、ｂそれぞれについて実験した
が、いずれの場合も有効範囲は極めて広く、τは１０［
μＳ］から入力Ｎ圧Ｅ１の周期の半分程度までの範囲に
及ぶことが明らかどなった。但しｎが１の場合は電圧上
昇の効果を得られなかった。
以上のことから、上記のように全てのダイオードに直列
に抵抗を挿入接続したコッククロッｉ〜・ウオルトン型
電圧逓倍回路は、入力電圧交番的の過大電流、つまりラ
ッシュ電流を完全に抑圧することができ、さらには抵抗
値の選択により任意の出力電圧が得られる。そして、ク
イオードに流れる電流が極めて小さくなるので、比較的
安価な許容電流値の小さいダイオードを使用することが
できる。さらに、電源側から見た場合、この電圧逓倍回
路はほぼ純抵抗とみなせるので、電源回路にラッシュ電
流出力防止用の手段を講じる必要がない。このため、電
源回路を簡素化することができ、矩形波をそのまま入力
することができるので極めて高効率となる。そして、従
来Ｊ：り出力電圧が増大するので、負荷電流が一定であ
るとすれば電圧降下が少なくなる。このことは出力イン
ピーダンスが低くなったことを意味する。
に抵抗を挿入接続したコッククロッｉ〜・ウオルトン型
電圧逓倍回路は、入力電圧交番的の過大電流、つまりラ
ッシュ電流を完全に抑圧することができ、さらには抵抗
値の選択により任意の出力電圧が得られる。そして、ク
イオードに流れる電流が極めて小さくなるので、比較的
安価な許容電流値の小さいダイオードを使用することが
できる。さらに、電源側から見た場合、この電圧逓倍回
路はほぼ純抵抗とみなせるので、電源回路にラッシュ電
流出力防止用の手段を講じる必要がない。このため、電
源回路を簡素化することができ、矩形波をそのまま入力
することができるので極めて高効率となる。そして、従
来Ｊ：り出力電圧が増大するので、負荷電流が一定であ
るとすれば電圧降下が少なくなる。このことは出力イン
ピーダンスが低くなったことを意味する。
尚、電源出力が正弦波の場合、出力電圧上昇はほとんど
認められなかったが、出力電圧が同一であってもダイオ
ードに流れるＮ流を大幅に軽減できるという効果は得ら
れる。
認められなかったが、出力電圧が同一であってもダイオ
ードに流れるＮ流を大幅に軽減できるという効果は得ら
れる。
［発明の効果］
以上のようにこの考案によれば、交流入力が矩形波電圧
であっても簡単な構成でラッシュ電流を充分低減させる
ことができ、許容電流値の小さなダイオードを使用する
ことができ、しかも高効率なコンデンサ・ダイオード電
圧逓倍回路を提供することができる。
であっても簡単な構成でラッシュ電流を充分低減させる
ことができ、許容電流値の小さなダイオードを使用する
ことができ、しかも高効率なコンデンサ・ダイオード電
圧逓倍回路を提供することができる。
第１図はこの発明に係るコンデンサ・ダイオード電圧逓
倍回路の一実施例を示す回路構成図、第２図は同実施例
の実験結果を示す特性図、第３図はこの発明が適用可能
なコツククロフト・ウオルトン型電圧逓信回路の構成を
示す回路図である。 Ｐｃ・・・矩形波交流電源、０１〜Ｃ８・・・コンデン
サ、Ｄ１〜Ｄ８・・・ダイオード、ＲＬ・・・負荷抵抗
、Ｒ１−Ｒ８・・・抵抗。
倍回路の一実施例を示す回路構成図、第２図は同実施例
の実験結果を示す特性図、第３図はこの発明が適用可能
なコツククロフト・ウオルトン型電圧逓信回路の構成を
示す回路図である。 Ｐｃ・・・矩形波交流電源、０１〜Ｃ８・・・コンデン
サ、Ｄ１〜Ｄ８・・・ダイオード、ＲＬ・・・負荷抵抗
、Ｒ１−Ｒ８・・・抵抗。
Claims (2)
- （１）それぞれ複数個のコンデンサを直列接続してなる
第１及び第２のコンデンサ回路と、この第１及び第２の
コンデンサ回路の互いに対応する各段のコンデンサ出力
端間にそれぞれ整流方向が同一となるように第１のダイ
オードを接続すると共に前記第２のコンデンサ回路の各
段のコンデンサ入力端及び該段に対応する前記第１のコ
ンデンサ回路の各段のコンデンサ出力端間にそれぞれ前
記第１のダイオードと整流方向が同一になるように第２
のダイオードを接続してなるダイオード直列回路とから
なり、前記第１及び第２のコンデンサ回路の各入力端に
交流電圧を印加して任意のコンデンサ出力端から入力電
圧の逓倍電圧を取出すコンデンサ・ダイオード電圧逓倍
回路において、前記ダイオード直列回路の全てのダイオ
ードに対して直列に抵抗を挿入接続することを特徴とす
るコンデンサ・ダイオード電圧逓倍回路。 - （２）前記抵抗は、その抵抗値と前記各コンデンサの容
量との積によつて定まる時定数τが τ＝ａｎ＾ｂ（ｎ＋１）ｅｔｒ／２Ｅｉ 但し、ａ＝６×１０＾−＾２〜１０×１０＾−＾２、ｂ
＝２．７〜３．３、ｅ＝Ｉ／Ｃ・ｆ、Ｉは負荷電流、Ｃ
はコンデンサ容量、ｆは入力電圧周波数、Ｅｉは入力電
圧、ｔｒは入力電圧Ｅｉの立上がり時間、ｎはダイオー
ドの個数の半分、 としたときの１／１０を満足させる抵抗値以上とするこ
とを特徴とする特許請求の範囲第１項記載のコンデンサ
・ダイオード電圧逓倍回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16923086A JPS6328267A (ja) | 1986-07-18 | 1986-07-18 | コンデンサ・ダイオ−ド電圧逓倍回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16923086A JPS6328267A (ja) | 1986-07-18 | 1986-07-18 | コンデンサ・ダイオ−ド電圧逓倍回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6328267A true JPS6328267A (ja) | 1988-02-05 |
Family
ID=15882639
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16923086A Pending JPS6328267A (ja) | 1986-07-18 | 1986-07-18 | コンデンサ・ダイオ−ド電圧逓倍回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6328267A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007220558A (ja) * | 2006-02-17 | 2007-08-30 | Sumitomo Wiring Syst Ltd | 端子金具および位置決め治具 |
| CN110518816A (zh) * | 2019-08-14 | 2019-11-29 | 三峡大学 | 一种输入端口数可调的模块化高增益整流电路 |
-
1986
- 1986-07-18 JP JP16923086A patent/JPS6328267A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007220558A (ja) * | 2006-02-17 | 2007-08-30 | Sumitomo Wiring Syst Ltd | 端子金具および位置決め治具 |
| CN110518816A (zh) * | 2019-08-14 | 2019-11-29 | 三峡大学 | 一种输入端口数可调的模块化高增益整流电路 |
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