JPS63245007A - Filter circuit - Google Patents
Filter circuitInfo
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、２つ以上の異なった周波ａ特性をもつジャイ
レータ方式のフィルター回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention relates to a gyrator type filter circuit having two or more different frequency a characteristics.
従来の技術
従来のフィルター回路は、第４図に示す様な、２つの差
動アンプ及びコンデンサによるジャイレータ回路によシ
フイルターを構成している。ここでは、トラップ例を示
している。2. Description of the Related Art A conventional filter circuit comprises a gyrator circuit including two differential amplifiers and a capacitor, as shown in FIG. Here is an example of a trap.
以下、第４図に従って説明する。１．２．３はバイアス
を与える電圧源であシ、第１の差動アンプがトランジス
タ１５．１８及び抵抗１７．１８によ）形成され、エミ
ッタ側にトランジスタ２゜及び抵抗２３によシミ流源、
コレクタ側にトランジスタ１０．１１及び抵抗９よシな
るアクティブ負荷がそれぞれ接続されている。又第２の
差動アンプはトランジスタ３２．３３及び抵抗３４．３
５によシ形成され、エミッタ側にトランジスタ２゜及び
抵抗２３によシミ流源、コレクタ側にトランジスタ２８
及び抵抗２７よシなるアクティブ負荷がそれぞれ接続さ
れている。トランジスタ１３゜１９及び抵抗２２、トラ
ンジスタ１４．２１及び抵抗２４、トランジスタ３０．
３６及び抵抗、トランジスタ３１．３８及び抵抗４１は
それぞれ、差動アング入力のエミッタフォロアである。The explanation will be given below according to FIG. 1.2.3 is a voltage source that provides a bias, a first differential amplifier is formed by a transistor 15.18 and a resistor 17.18), and a bias current is formed by a transistor 2° and a resistor 23 on the emitter side. source,
Active loads such as transistors 10 and 11 and a resistor 9 are connected to the collector side, respectively. Also, the second differential amplifier includes transistors 32, 33 and resistors 34, 3.
A transistor 28 is formed on the emitter side and a resistor 23 on the emitter side, and a transistor 28 on the collector side.
and an active load such as a resistor 27 are connected respectively. Transistor 13.19 and resistor 22, transistor 14.21 and resistor 24, transistor 30.
36 and resistor, transistor 31.38 and resistor 41 are emitter followers of the differential input.
そして、第１の差動アンプ出力が第２の差動アンプの入
力に、又、第２の差動アンプの出力が第１の差動アンプ
の入力に接続されるとともに第１゜第２の差動アンプの
出力の一方が各々コンデンサ２５．２６に接続される。The output of the first differential amplifier is connected to the input of the second differential amplifier, and the output of the second differential amplifier is connected to the input of the first differential amplifier. One of the outputs of the differential amplifiers is each connected to a capacitor 25,26.
入力信号４は抵抗１２を介してトランジスタ３１のベー
スに入力され、出力はトランジスタ３１のベースよシ出
される。The input signal 4 is input to the base of the transistor 31 via the resistor 12, and the output is output from the base of the transistor 31.
次に回路動作を説明するため、第６図に等価回路を示す
。この等価回路において、次式が成立する。Next, in order to explain the circuit operation, an equivalent circuit is shown in FIG. In this equivalent circuit, the following equation holds.
（１）式、（２）式よシ、
・・・・・・・・・・・・・・・・・・・・・（３）こ
こで、ＲＡは抵抗３４．３５の抵抗値の和、ＲＢは抵抗
１７．１８の抵抗値の和、Ｃ１はコンデンサ２５の容量
値、Ｃ２はコンデンサ２６の容量値を表わす。According to equations (1) and (2), ・・・・・・・・・・・・・・・・・・・・・(3) Here, RA is the sum of the resistance values of resistors 34.35 , RB represents the sum of the resistance values of the resistors 17 and 18, C1 represents the capacitance value of the capacitor 25, and C2 represents the capacitance value of the capacitor 26.
のときインピーダンスｚｉユは０とな勺、出力電圧が０
となシ、トラップ特性を示す。When the impedance is 0, the output voltage is 0.
Tonashi shows trap characteristics.
この様なジャイレータによるフィルター回路は次の特徴
を持っていることから、半導体集積回路に用いて使用さ
れる。A filter circuit using such a gyrator has the following characteristics and is therefore used in semiconductor integrated circuits.
（１） インダクタンスを用いずにフィルターを形成
出来るため、半導体集積回路内で構成できる。(1) Since the filter can be formed without using inductance, it can be constructed within a semiconductor integrated circuit.
（２）磁気誘導を受けない。(2) Not subject to magnetic induction.
しかしながら、テレビ信号のＰＡＬ方式、ＮＴＳＣ方式
の２方式を重信する受像機に使用するような場合には２
つの異なる周波数のフィルターか必要となるが、この場
合、従来には異なる周波数のフィルターを２組並べ、こ
の２組のフィルターを切替えて使用することにより対応
していた。However, when used in a receiver that relies on two TV signal formats, PAL and NTSC,
This requires filters with two different frequencies, but conventionally this has been handled by arranging two sets of filters with different frequencies and switching between the two sets.
発明が解決しようとする問題点
ところか、このような従来の回路方式においては、ジャ
イレータ回路によるフィルターが複数組必要になシ、回
路構成が複雑となる。Problems to be Solved by the Invention However, in such a conventional circuit system, a plurality of sets of filters using gyrator circuits are required, and the circuit configuration becomes complicated.
反回路素子が非常に多くなるため、集積化が困難となる
。Since the number of anti-circuit elements increases, integration becomes difficult.
本発明はかかる問題に鑑みてなされたもので、簡易な構
成で、異なる周波数特性にすることのできるフィルター
回路を提供することを目的としている。The present invention has been made in view of this problem, and an object of the present invention is to provide a filter circuit that has a simple configuration and can have different frequency characteristics.
問題点を解決するための手段
本発明は、上記問題点を解決するため、ジャイレータに
よるフィルター回路に用いられているコンデンサと並列
にさらにコンデンサを設け、この付加したコンデンサを
トランジスタによシスイツチングして切替えるようにし
たものである。Means for Solving the Problems In order to solve the above problems, the present invention provides an additional capacitor in parallel with the capacitor used in the gyrator filter circuit, and switches this added capacitor by switching it with a transistor. This is how it was done.
作 用
本発明は、上記構成によシ、コンデンサの容量を変化さ
せ、異なった周波数に対応するフィルター回路を得るこ
とが出来る。Function: According to the present invention, with the above-mentioned configuration, a filter circuit corresponding to different frequencies can be obtained by changing the capacitance of the capacitor.
実施例
第１図は本発明のフィルター回路の一実施例を示す回路
図である。Embodiment FIG. 1 is a circuit diagram showing an embodiment of the filter circuit of the present invention.
以下、第１図に従って説明する。１，２．３はバイアス
を与える電圧源、第 の差動アンプがトランジスタ１５
．１６及び抵抗１７．１８によシ形成され、エミッタ側
にトランジスタ２ｏ及び抵抗２３によシミ流源、コレク
タ側にトランジスタ１０．１１及び抵抗９よりなるアク
ティブ負荷がそれぞれ接続されている。又、第２の差動
アンプはトランジスタ３２．３３及び抵抗３４．３５に
より形成され、エミッタ側にトランジスタ２０及び抵抗
２３によシミ流源、コレクタ側にトランジスタ２８及び
抵抗２８及び抵抗２７よシなるアクティブ負荷がそれぞ
れ接続されている。トランジスタ１３．１９及び抵抗２
２、トランジスタ１４゜２１及び抵抗２４．トランジス
タ３０．３６及び抵抗３９、トランジスタ３１．３８及
び抵抗４１はそれぞれ、差動アンプ入力のエミッタフォ
ロアである。そしてＭｌの差動アンプの出力が第２の差
動アンプの入力に、又、第２の差動アンプの出力が第１
の差動アンプの入力にそれぞれ接続されるとともに第１
．第２の差動アンプの出力の一方カ各々コンデンサ２５
．２６に接続される。さらにこの各々の点にコンデンサ
１０１．１０２がそれぞれ接続され、抵抗１０５とトラ
ンジスタ１０３、抵抗１０６とトランジスタ１０４を用
い、スイッチ１０７によシコンデンサ１０１，１０２の
切替を行なっている。又、トランジスタ６．７と抵抗４
２．６．８によシミ流源及びアクティブ負荷のバイアス
を行なっている。The explanation will be given below according to FIG. 1, 2.3 are voltage sources that provide bias, and the second differential amplifier is a transistor 15.
．． 16 and resistors 17 and 18, a current source is connected to the emitter side by a transistor 2o and a resistor 23, and an active load consisting of a transistor 10, 11 and a resistor 9 is connected to the collector side, respectively. Further, the second differential amplifier is formed by transistors 32, 33 and resistors 34, 35, with the transistor 20 and resistor 23 as a stain source on the emitter side, and the transistor 28, resistor 28, and resistor 27 on the collector side. Active loads are connected to each. Transistor 13.19 and resistor 2
2. Transistor 14°21 and resistor 24. Transistor 30.36 and resistor 39, transistor 31.38 and resistor 41 are emitter followers of the differential amplifier input, respectively. Then, the output of the differential amplifier of Ml is input to the second differential amplifier, and the output of the second differential amplifier is input to the first differential amplifier.
are connected to the inputs of the differential amplifiers, respectively, and the first
．． One capacitor 25 for each output of the second differential amplifier
．． 26. Further, capacitors 101 and 102 are connected to each of these points, and the capacitors 101 and 102 are switched by a switch 107 using a resistor 105 and a transistor 103, and a resistor 106 and a transistor 104. Also, transistor 6.7 and resistor 4
2.6.8 is used to bias the stain flow source and active load.
入力信号４は抵抗１２ｔ−介してトランジスタ３１０ベ
ースに入力されるとともにこの点′よシ出力される。Input signal 4 is input to the base of transistor 310 through resistor 12t and output from this point.
次に回路動作を説明するため、第２図に等価回路を示す
。この等価回路においても（１） 、 （２） 、 （
３）式と同等の式が成立するため、スイッチ１ｏ７；＋
％オンの時（すなわち第１図において電源１側に接続さ
れた時）には、
嘔＝Ｈω（Ｃ２＋Ｃ４）ＲＡＲＢ−マ〒９・・・（４）
となシ、スイッチ１０７がオフの時（すなわち第１図に
おいてＧＮＤ側に接続された時）には、Ｚ ＝ｊ（ω
Ｃ２ＲＡＲＢ−；σ−・・・・・・・・・・・・（５１
ｎ１
となる。すなわち、トラップ周波数は、（４）式の場合
（司式の場合
となり、スイッチ１０７の切替えによシ異なった周波数
の・トラップが構成できる。Next, in order to explain the circuit operation, an equivalent circuit is shown in FIG. In this equivalent circuit also (1), (2), (
3) Since a formula equivalent to formula holds true, switch 1o7;+
% When it is on (that is, when connected to the power supply 1 side in Figure 1), ω=Hω(C2+C4)RARB-Ma〒9...(4)
On the other hand, when the switch 107 is off (that is, when it is connected to the GND side in FIG. 1), Z = j (ω
C2RARB-;σ-・・・・・・・・・・・・(51
It becomes n1. That is, the trap frequency is the case of formula (4) (the case of the officiant), and traps of different frequencies can be configured by switching the switch 107.
この構成によシ、スイッチ１０７を切替えた場合のトラ
ップの周波数特性を第３図に示す。FIG. 3 shows the frequency characteristics of the trap when the switch 107 is switched according to this configuration.
本実施例においては、トラップの場合の実施例を示した
が、ジャイレータで構成するパントノくスフイルター、
バイパスフィルター、ローノくスフイルター等のフィル
ターについても同様に適用することができる。In this example, an example in the case of a trap is shown, but a pantone filter consisting of a gyrator,
The same can be applied to filters such as bypass filters and ronokusu filters.
発明の効果
以上のよう釦１本発明によれば、きわめて簡易な回路構
成で、複数の異なる周波数に対応出来るフィルター回路
か構成でき、実用的にきわめて有用である。Effects of the Invention As described above, according to the present invention, a filter circuit that can handle a plurality of different frequencies can be configured with an extremely simple circuit configuration, and is extremely useful in practice.
第１図は本発明の一実施例におけるフィルター回路の回
路図、第２図は第１図に示す回路の等価回路図、第３図
は同フィルター回路の特性図、第４図は従来例のフィル
ター回路の回路図、第６図は第４図に示す回路の等価回
路図である。
１５ 、１６ 、３２ 、３３・・・・・・差動アンプ
のトランジスタ、１了、１８，３４．３６・・・・・・
差動アンプの抵抗、２５．２６・・・・・・コンデンサ
、１０１，１０２・・・コンデンサ、１０３，１０４・
・・・・・切替用のトランジスタ、１０７−・・・・・
切替用スイッチ。
代理人の氏名 弁理士 中 尾 敏 男 ほか１名３４
１図
ｆＯｆ、ｆＯｔ−−−コーＪｆ：７ア
ｆＯ’”’−−−ＫＡ％Ｍ’ｈ’）’Ｊ”１９ｆＯクー
１刀１１スうッテ
第２図Fig. 1 is a circuit diagram of a filter circuit according to an embodiment of the present invention, Fig. 2 is an equivalent circuit diagram of the circuit shown in Fig. 1, Fig. 3 is a characteristic diagram of the same filter circuit, and Fig. 4 is a diagram of a conventional example. A circuit diagram of the filter circuit, FIG. 6 is an equivalent circuit diagram of the circuit shown in FIG. 4. 15, 16, 32, 33... Differential amplifier transistor, 1, 18, 34. 36...
Resistance of differential amplifier, 25.26...Capacitor, 101,102...Capacitor, 103,104...
...Switching transistor, 107-...
Changeover switch. Name of agent: Patent attorney Toshio Nakao and 1 other person34
1 Figure fOf, fOt---Ko Jf: 7AfO'"'---KA%M'h')'J" 19fO Ku 1 Sword 11 Sutte Figure 2
Claims (3)
の差動増幅器を有し、各差動増幅器のエミッタに定電流
源を付加し、第１の差動増幅器の２つの出力を第２の差
動増幅器の２つの入力端子にそれぞれ接続し、第２の差
動増幅器の２つの出力を第１の差動増幅器の２つの入力
端子に接続するとともに、前記第１の差動増幅器の一方
の出力端子及び前記第２の差動増幅器の一方の出力端子
に第１と第２のコンデンサをそれぞれ設け、前記第１、
第２のコンデンサのいずれか一方に並列に第１のトラン
ジスタ及びこの第１のトランジスタに直列に接続された
第３のコンデンサを設け、前記第１のトランジスタをス
イッチングして異なる周波数のフィルターを構成する手
段を設けたことを特徴とするフィルター回路。(1) First and second with active load on the collector side
a constant current source is added to the emitter of each differential amplifier, two outputs of the first differential amplifier are connected to two input terminals of the second differential amplifier, and a constant current source is added to the emitter of each differential amplifier. The two outputs of the second differential amplifier are connected to the two input terminals of the first differential amplifier, and one output terminal of the first differential amplifier and one output of the second differential amplifier are connected. First and second capacitors are provided at the terminals, respectively, and the first and second capacitors are provided at the terminals.
A first transistor is provided in parallel with either one of the second capacitors, and a third capacitor connected in series with the first transistor is provided, and the first transistor is switched to configure a filter with a different frequency. A filter circuit characterized in that a means is provided.
直列に接続された第３のコンデンサを設け、第２のコン
デンサと並列に第２のトランジスタと直列に接続された
第４のコンデンサを設けたことを特徴とする特許請求の
範囲第１項記載のフィルター回路。(2) A third capacitor connected in series with the first transistor is provided in parallel with the first capacitor, and a fourth capacitor is provided in parallel with the second capacitor and connected in series with the second transistor. The filter circuit according to claim 1, characterized in that:
ースに抵抗を設け、抵抗の他方を電源及び接地間でスイ
ッチングするようにしたことを特徴とする特許請求の範
囲第１項又は第２項記載のフィルター回路。(3) A resistor is provided at the base of the first transistor or the second transistor, and the other of the resistors is switched between the power supply and the ground. filter circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7775987A JPS63245007A (en) | 1987-03-31 | 1987-03-31 | Filter circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7775987A JPS63245007A (en) | 1987-03-31 | 1987-03-31 | Filter circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63245007A true JPS63245007A (en) | 1988-10-12 |
Family
ID=13642857
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7775987A Pending JPS63245007A (en) | 1987-03-31 | 1987-03-31 | Filter circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63245007A (en) |
-
1987
- 1987-03-31 JP JP7775987A patent/JPS63245007A/en active Pending
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