JPS63202108A - Current mirror circuit - Google Patents
Current mirror circuitInfo
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- JPS63202108A JPS63202108A JP62033844A JP3384487A JPS63202108A JP S63202108 A JPS63202108 A JP S63202108A JP 62033844 A JP62033844 A JP 62033844A JP 3384487 A JP3384487 A JP 3384487A JP S63202108 A JPS63202108 A JP S63202108A
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は半導体集積回路に用いられるカレントミラー回
路に関するものである。DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention relates to a current mirror circuit used in a semiconductor integrated circuit.
従来の技術
一般に、半導体集積回路に用いられるカレントミラー回
路は、第２図に示すように、ダイオード接続のトランジ
スタ１６のコレクタに入力電流を供給し、このダイオー
ドの両端子間の電位差によって、トランジスタ１７を駆
動し、同トランジスタ１７の電流を、第２のカレントミ
ラ一対のトランジスタ１８．１９を介し、そのトランジ
スタ１９のコレクタからダイオード接続の出力トランジ
スタ２０を通じて出力電流をとり出す回路構成が多く用
いられてきた。2. Description of the Related Art Generally, as shown in FIG. 2, a current mirror circuit used in a semiconductor integrated circuit supplies an input current to the collector of a diode-connected transistor 16. A circuit configuration is often used in which the current of the transistor 17 is passed through a pair of transistors 18 and 19 of a second current mirror, and the output current is extracted from the collector of the transistor 19 through a diode-connected output transistor 20. Ta.
発明が解決しようとする問題点
ところがこのような回路構成では、一般に、トランジス
タ１６およびトランジスタ１７の各コレクタ、エミッタ
間電圧（以下ＶＱＥと記す）と、トランジスタ１８およ
びトランジスタ１９の各ＶＣＢとが等しくないために、
アーリー効果の影響を受けて、入力電流と出力電流の比
、すなわち、ミラー係数が１にならない。また、トラン
ジスタ１７とトランジスタ１９の各ＶＣＥは電源電圧の
変動によっても変化するため、ミラー係数は電源電圧依
存性を持つこととなる。Problems to be Solved by the Invention However, in such a circuit configuration, the collector-to-emitter voltages (hereinafter referred to as VQE) of the transistors 16 and 17 are generally not equal to the VCBs of the transistors 18 and 19. for,
Under the influence of the Early effect, the ratio of input current to output current, that is, the mirror coefficient, does not become 1. Further, since each VCE of the transistor 17 and the transistor 19 changes depending on fluctuations in the power supply voltage, the mirror coefficient has power supply voltage dependence.
本発明は、このような従来の問題を解消し、ミラー係数
を、電源電圧に関係なく、正確に１に保つことができる
カレントミラー回路を提供することを目的とする。SUMMARY OF THE INVENTION An object of the present invention is to provide a current mirror circuit that can solve these conventional problems and keep the mirror coefficient accurately at 1 regardless of the power supply voltage.
問題点を解決するための手段
この目的を達成するために、本発明のカレントミラー回
路は、入力電流が供給される第１カレントミラー回路部
の出力トランジスタのベース、コレクタに、差動増幅回
路の２つの入力端子を各々接続し、前記差動増幅回路の
出力端子を複数の出力端子をもつ第２カレントミラー回
路部の入力端子と接続し、前記第２カレントミラー回路
部の第１出力端子を前記第１カレントミラー回路部の出
力側トランジスタのコレクタと接続し、前記第２カレン
トミラー回路部の第２出力端子を出力ダイオードに接続
し、２の出力ダイオードの両端子間の電圧によって出力
電流をとり出す構成を有している。Means for Solving the Problems In order to achieve this object, the current mirror circuit of the present invention has a differential amplifier circuit that connects the base and collector of the output transistor of the first current mirror circuit section to which the input current is supplied. two input terminals are connected to each other, an output terminal of the differential amplifier circuit is connected to an input terminal of a second current mirror circuit section having a plurality of output terminals, and a first output terminal of the second current mirror circuit section is connected to the output terminal of the differential amplifier circuit. The first current mirror circuit section is connected to the collector of the output side transistor, the second output terminal of the second current mirror circuit section is connected to the output diode, and the output current is determined by the voltage between both terminals of the second output diode. It has a configuration to take it out.
作用
この構成によって第１カレントミ５ラー回路部の出力ト
ランジスタのＶＣＲは、入力電流が供給されるダイオー
ドの両端子間の電位差と等しくなり、第１カレントミラ
ー回路部でのアーリー効果の影響を打ち消すことができ
る。Effect: With this configuration, the VCR of the output transistor of the first current mirror circuit section becomes equal to the potential difference between both terminals of the diode to which the input current is supplied, thereby canceling out the influence of the Early effect in the first current mirror circuit section. Can be done.
また、第２カレントミラー回路部の入力端子に流れる電
流と第１カレントミラー回路部の出力側トランジスタの
コレクタ電流とが等しくなるように差動増幅回路が動作
するため、第１カレントミラー回路部の出力側トランジ
スタおよび第２カレントミラー回路部の出力側トランジ
スタの各コレクタ電流は共に等しい。In addition, since the differential amplifier circuit operates so that the current flowing to the input terminal of the second current mirror circuit section and the collector current of the output side transistor of the first current mirror circuit section are equal, the current flowing through the input terminal of the second current mirror circuit section is The collector currents of the output side transistor and the output side transistor of the second current mirror circuit section are both equal.
さらに、第２カレントミラー回路部の複数の出力端子の
うち、第１出力端子と第２出力端子とが、各々、第１カ
レントミラー回路部の出力トランジスタのコレクタと出
力ダイオードとに接続されることにより、第１カレント
ミラー回路部の出力側トランジスタのＶＣＥと出力ダイ
オードを構成しているトランジスタのｖｃＥとは、電源
電圧が変化しても、常に等しくなる。Furthermore, among the plurality of output terminals of the second current mirror circuit section, the first output terminal and the second output terminal are respectively connected to the collector of the output transistor and the output diode of the first current mirror circuit section. Therefore, the VCE of the output side transistor of the first current mirror circuit section and the vcE of the transistor forming the output diode are always equal even if the power supply voltage changes.
従って第２カレントミラー回路部においてアーリー効果
の打ち消しならびにミラー係数の電源電圧依存性の打ち
消しを併せて達成することがモき、全体としてミラー係
数を電源電圧に関係なく正確に１に保つことができる。Therefore, in the second current mirror circuit section, it is possible to both cancel the Early effect and cancel the dependence of the mirror coefficient on the power supply voltage, and as a whole, it is possible to maintain the mirror coefficient accurately at 1 regardless of the power supply voltage. .
実施例
以下、本発明の一実施例のカレントミラー回路を図面を
参照して説明する。第１図に実施例回路図を示すように
、トランジスタ１．トランジスタ２、抵抗９および抵抗
１０で第１カレントミラー回路部を構成し、ダイオード
の接続のトランジスタ１のコレクタへ入力電流が流入す
る。トランジスタ２のコレクタ、ベースの各端をトラン
ジスタ３、トランジスタ４および抵抗１１で構成された
差動アンプの２つの入力端子に各々接続し、トランジス
タ６．７．８および抵抗１２．１３．１４で構成された
第２カレントミラー回路部の入力端子であるトランジス
タ７のコレクタと前記差動アンプの出力端子であるトラ
ンジスタ４のコレクタとを接続し、前記第２カレントミ
ラー回路部の第１出力端子であるトランジスタ６のコレ
クタと、前記第１カレントミラー回路部の出力端子であ
るトランジスタ２のコレクタとを接続し、前記第２カレ
ントミラー回路部の第２出力端子であるトランジスタ８
のコレクタと、トランジスタ５のコレクタとを接続し、
トランジスタ５は、コレクタ。EXAMPLE Hereinafter, a current mirror circuit according to an example of the present invention will be explained with reference to the drawings. As shown in the circuit diagram of the embodiment in FIG. The transistor 2, the resistor 9, and the resistor 10 constitute a first current mirror circuit section, and an input current flows into the collector of the diode-connected transistor 1. The collector and base terminals of transistor 2 are connected to two input terminals of a differential amplifier composed of transistor 3, transistor 4, and resistor 11, respectively, and composed of transistor 6, 7, 8, and resistor 12, 13, and 14. The collector of the transistor 7, which is the input terminal of the second current mirror circuit section, is connected to the collector of the transistor 4, which is the output terminal of the differential amplifier, and the collector is the first output terminal of the second current mirror circuit section. A transistor 8 is connected between the collector of the transistor 6 and the collector of the transistor 2 which is the output terminal of the first current mirror circuit section, and which is the second output terminal of the second current mirror circuit section.
and the collector of transistor 5 are connected,
Transistor 5 is a collector.
ベースを共通接続し、そのエミッタに抵抗１５を接続し
て、そのベース、エミッタ間電圧によって出力電流をと
り出す構成である。The bases are commonly connected, a resistor 15 is connected to the emitter, and an output current is extracted by the voltage between the base and emitter.
この構成によると、トランジスタ２のｖＣＩｌｌは、差
動アンプによりトランジスタ１のＶＣＥと同じ電圧にな
るため、第１カレントミラー回路部はアーリー効果の影
響を受けなくなる。また差動アンプはトランジスタ６の
コレクタ電流がトランジスタ２のコレクタ電流と等しく
なるように、第２カレントミラー回路部へ入力電流を与
える状態でバランスするため、トランジスタ６のコレク
タ電流は第１カレントミラー回路部の出力電流であるト
ランジスタ２のコレクタ電流と常に等しい。さらにトラ
ンジスタ６とトランジスタ８はベース、エミッタ間電圧
、コレクタ、エミッタ間電圧が共に等しくなるから、そ
のコレクタ電流は常に等しい。従って出力電流であるト
ランジスタ８のコレクタ電流は、トランジスタ２のコレ
クタ電流と等しくなり、結局入力電流と正確に等しい出
力電流が得られる。また、トランジスタ６とトランジス
タ８との各ＶＣＥは、電源電圧が変化しても常に共に等
しい電圧になるため、アーリー効果は打ち消されて、ミ
ラー係数は電源電圧依存性をもたなくなる。According to this configuration, vCIll of transistor 2 becomes the same voltage as VCE of transistor 1 by the differential amplifier, so that the first current mirror circuit section is not affected by the Early effect. In addition, the differential amplifier is balanced by supplying an input current to the second current mirror circuit so that the collector current of transistor 6 is equal to the collector current of transistor 2, so the collector current of transistor 6 is equal to the collector current of transistor 2. It is always equal to the collector current of transistor 2, which is the output current of the section. Further, since transistors 6 and 8 have equal base-emitter voltages and collector-emitter voltages, their collector currents are always equal. Therefore, the output current, the collector current of transistor 8, becomes equal to the collector current of transistor 2, resulting in an output current exactly equal to the input current. Furthermore, since VCE of transistor 6 and transistor 8 are always at the same voltage even if the power supply voltage changes, the Early effect is canceled and the mirror coefficient no longer has power supply voltage dependence.
発明の効果
以上のように、本発明のカレントミラー回路は、第１．
第２の各カレントミラー回路部の入力端子を構成するト
ランジスタと出力端子を構成するトランジスタのＶＣＥ
を著しくすることにより、アーリー効果を打ち消して正
確なミラー係数１を得ることができ、さらに、前述のＶ
ＣＥは、電源電圧が変化しても常に共に著しい電圧にな
るため、ミラー係数の電源電圧に依存性もなく、安定な
カレントミラー回路の実現を容易にするものであり、半
導体集積回路の回路動作精度の向上に太いに貢献でき、
実用上きわめて有効なものである。Effects of the Invention As described above, the current mirror circuit of the present invention has the following advantages:
VCE of the transistors forming the input terminals and the transistors forming the output terminals of each second current mirror circuit section
By making V significant, it is possible to cancel the Early effect and obtain an accurate mirror coefficient of 1. Furthermore, the aforementioned V
CE always remains a significant voltage even when the power supply voltage changes, so there is no dependence of the mirror coefficient on the power supply voltage, making it easy to realize a stable current mirror circuit, and improving the circuit operation of semiconductor integrated circuits. It can greatly contribute to improving accuracy,
This is extremely effective in practice.
第１図は本発明の一実施例におけるカレントミラー回路
の回路図、第２図は従来のカレントミラー回路の回路図
である。
１〜８・・・・・・トランジスタ、９〜１５・・・・・
・抵抗、１６〜２０・・・・・・トランジスタ。FIG. 1 is a circuit diagram of a current mirror circuit according to an embodiment of the present invention, and FIG. 2 is a circuit diagram of a conventional current mirror circuit. 1-8...transistor, 9-15...
・Resistance, 16-20...Transistor.
Claims (1)
ス、コレクタに、差動増幅回路の２つの入力端子を各々
接続し、前記差動増幅回路の出力端子を、複数の出力端
子をもつ第２カレントミラー回路部の入力端子と接続し
、前記第２カレントミラー回路部の第１出力端子を前記
第１カレントミラー回路部の出力側トランジスタのコレ
クタと接続し、前記第２カレントミラー回路部の第２出
力端子を出力ダイオードに接続した構成のカレントミラ
ー回路。Two input terminals of a differential amplifier circuit are connected to the base and collector of the output side transistor of the first current mirror circuit section, respectively, and the output terminal of the differential amplifier circuit is connected to a second current mirror having a plurality of output terminals. a first output terminal of the second current mirror circuit section is connected to an input terminal of the circuit section; a first output terminal of the second current mirror circuit section is connected to a collector of an output side transistor of the first current mirror circuit section; A current mirror circuit with a terminal connected to an output diode.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62033844A JPS63202108A (en) | 1987-02-17 | 1987-02-17 | Current mirror circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62033844A JPS63202108A (en) | 1987-02-17 | 1987-02-17 | Current mirror circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63202108A true JPS63202108A (en) | 1988-08-22 |
Family
ID=12397801
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62033844A Pending JPS63202108A (en) | 1987-02-17 | 1987-02-17 | Current mirror circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63202108A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN112034924A (en) * | 2020-08-10 | 2020-12-04 | 唯捷创芯(天津)电子技术股份有限公司 | Self-adaptive fast response LDO (low dropout regulator) circuit and chip thereof |
-
1987
- 1987-02-17 JP JP62033844A patent/JPS63202108A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN112034924A (en) * | 2020-08-10 | 2020-12-04 | 唯捷创芯(天津)电子技术股份有限公司 | Self-adaptive fast response LDO (low dropout regulator) circuit and chip thereof |
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