JPS63183616U - - Google Patents

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JPS63183616U
JPS63183616U JP1724387U JP1724387U JPS63183616U JP S63183616 U JPS63183616 U JP S63183616U JP 1724387 U JP1724387 U JP 1724387U JP 1724387 U JP1724387 U JP 1724387U JP S63183616 U JPS63183616 U JP S63183616U
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standby
signal
microcomputer
reset
input terminal
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JP1724387U
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【図面の簡単な説明】
第１図は本考案に係るスタンバイ制御回路の実
施例を示す回路図、第２図ａ乃至ｄは第１図にお
けるマイクロコンピユータの処理を示すフローチ
ヤート、第４図は従来のスタンバイ制御回路を示
す回路図、第５図ａ乃至ｅは第４図における各部
電圧波形を示す図、第６図は第４図におけるマイ
クロコンピユータの処理を示すフローチヤートで
ある。 １……マイクロコンピユータ（ＣＰＵ）、２…
…ゲート回路、ＰＩＮ……ポート入力端子、ＰＯ
ＵＴ……ポート出力端子、……リセツ
ト入力端子、……スタンバイ入力端子。
補正 昭６３．６．２９ 図面の簡単な説明を次のように補正する。 明細書第１３頁第１６行「(a)乃至(d)」を以下
の如く訂正する。「は第１図における各部の電圧
波形を示す図、第３図」

Claims (1)

  1. 【実用新案登録請求の範囲】 マイクロコンピユータのポート入力端子にリセ
    ツト信号を入力し、該マイクロコンピユータがリ
    セツト及びスタンバイ処理を行なう以前の所定の
    前処理を行なつた後、リセツト信号とスタンバイ
    信号をリセツト入力端子とスタンバイ入力端子に
    入力するマイクロコンピユータのスタンバイ制御
    回路において、 前記前処理の終了時にマイクロコンピユータの
    ポート出力端子から前処理終了信号を出力し、該
    処理終了信号出力時に前記リセツト信号とスタン
    バイ信号がリセツト入力端子とスタンバイ入力端
    子に入力されるようにゲート回路を設けたことを
    特徴とするマイクロコンピユータのスタンバイ制
    御回路。
JP1724387U 1987-02-10 1987-02-10 Pending JPS63183616U (ja)

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JP1724387U JPS63183616U (ja) 1987-02-10 1987-02-10

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JP1724387U Pending JPS63183616U (ja) 1987-02-10 1987-02-10

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5840639A (ja) * 1981-09-04 1983-03-09 Fujitsu Ten Ltd スタンバイ制御方法
JPS58127262A (ja) * 1982-01-25 1983-07-29 Toshiba Corp マイクロコンピユ−タ

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5840639A (ja) * 1981-09-04 1983-03-09 Fujitsu Ten Ltd スタンバイ制御方法
JPS58127262A (ja) * 1982-01-25 1983-07-29 Toshiba Corp マイクロコンピユ−タ

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