JPS63166073A - Detecting device for sector mark - Google Patents
Detecting device for sector markInfo
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- JPS63166073A JPS63166073A JP31235486A JP31235486A JPS63166073A JP S63166073 A JPS63166073 A JP S63166073A JP 31235486 A JP31235486 A JP 31235486A JP 31235486 A JP31235486 A JP 31235486A JP S63166073 A JPS63166073 A JP S63166073A
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は光デイスク装置等に利用し、セクタの先頭を示
すセクタマークを検出するセクタマーク検出装置に関す
る。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a sector mark detection device that is used in optical disk devices and the like and detects a sector mark indicating the beginning of a sector.
従来の技術
第3図は光デイスク装置に用いる記録円板(ディスク)
を示している。第3図において、1はディスクであり、
このディスク1には螺旋状にトラックが形成されている
。各トラックは複数のセクタ(例えば16セクタ)から
構成される。なお第3図では1トラツクが8セクタで構
成された例を図示している。第3図の黒点2は各セクタ
の先頭に配置されたセクタマークを示している。Conventional technology Figure 3 shows a recording disk (disk) used in an optical disk device.
It shows. In FIG. 3, 1 is a disk;
This disk 1 has tracks formed in a spiral shape. Each track is composed of a plurality of sectors (for example, 16 sectors). Note that FIG. 3 shows an example in which one track is composed of eight sectors. Black dots 2 in FIG. 3 indicate sector marks placed at the beginning of each sector.
第4図は従来のセクタのフォーマットを示しでいる。第
4図において、3はセクタマーク(SM)、4はアドレ
ス等を記録するID部、6はデータ部である。第e図a
はセクタマーク(SM)の−例を示しており、このセク
タマーク(SM)は時間幅Aの0部分、時間幅Bの1
部分、時間幅Cの0部分よりなる。FIG. 4 shows a conventional sector format. In FIG. 4, 3 is a sector mark (SM), 4 is an ID section for recording addresses, etc., and 6 is a data section. Figure e a
shows an example of a sector mark (SM), which is the 0 part of time width A and the 1 part of time width B.
part, consisting of 0 part of time width C.
第6図は第6図aに示すセクタマークを検出するセクタ
マーク検出回路を示している。第6図において、6はデ
ィスク1よりピックアップされた信号が印加される入力
端子、7aは時間幅A検出回路であり、この時間幅A検
出回路7aは、入力端子6に入力された信号の符号変換
点間の時間幅をサンプリングパルス数により検出し、検
出された時間幅が時間幅Aに一致した際に検出パルス(
第6図b)を出力する。同様に7b、7cはそれぞれ時
間幅B、0を検出した際に検出パルス(第6図c、d)
を出力する時間幅B検出回路、時間幅C検出回路である
。8aは時間幅A検出回路7aより出力される検出パル
ス(第6図b)を時間(B+0)シフトするシフト回路
、同様に8bは時間幅B検出回路7bより出力される検
出パルス(第6図C)を時間Cシフトするシフト回路で
ある。9は多数決回路であり、この多数決回路9は、時
間@C検出回路7cより検出パルス(第6図d)が出力
されるタイミングで検出パルスが少なくとも2個以上検
出された際に出力端子10より1を出力する。第6図に
示す例では、時間幅C検出回路7Cより検出パルス(第
6図d)が出力されるタイミングで、シフト回路8a、
8bでシフトされた検出パルス(第e図e、f)及び検
出パルス(第6図d)が入力されるため、多数決回路9
よリセクタマーク検出信号(第6図g)が出力される。FIG. 6 shows a sector mark detection circuit for detecting the sector mark shown in FIG. 6a. In FIG. 6, 6 is an input terminal to which a signal picked up from the disk 1 is applied, and 7a is a time width A detection circuit. The time width between conversion points is detected by the number of sampling pulses, and when the detected time width matches the time width A, the detection pulse (
Figure 6b) is output. Similarly, 7b and 7c are detection pulses when time widths B and 0 are detected, respectively (Fig. 6 c, d).
These are a time width B detection circuit and a time width C detection circuit that output . 8a is a shift circuit that shifts the detection pulse (FIG. 6b) output from the time width A detection circuit 7a by time (B+0); similarly, 8b is a shift circuit that shifts the detection pulse (FIG. 6) output from the time width B detection circuit 7b. This is a shift circuit that shifts C) by a time C. Reference numeral 9 denotes a majority decision circuit, and this majority decision circuit 9 outputs a signal from the output terminal 10 when at least two detection pulses are detected at the timing at which the detection pulse (Fig. 6 d) is output from the time @C detection circuit 7c. Outputs 1. In the example shown in FIG. 6, the shift circuit 8a,
Since the detected pulses (e, f in Figure 6) and the detected pulses (d in Figure 6) shifted at 8b are input, the majority circuit 9
A resector mark detection signal (Fig. 6g) is output.
このように、従来例では、複数の特定の時間幅(A、B
、C)を検出してセクタマークを検出するものであった
。In this way, in the conventional example, a plurality of specific time widths (A, B
, C) to detect sector marks.
発明が解決しようとする問題点
しかしながら、上記従来例では、例えば第4図における
データ部6にセクタマークと同様の時間幅の疑似的なマ
ークが検出された場合にセクタマークと誤検出する問題
があった。Problems to be Solved by the Invention However, in the conventional example described above, for example, when a pseudo mark with the same time width as a sector mark is detected in the data section 6 in FIG. 4, there is a problem that it is mistakenly detected as a sector mark. there were.
本発明は上記従来の問題点を解決するものであり、疑似
的なマークが発生しても誤検出せず、正確にセクタマー
クを検出することができるセクタマーク検出装置を提供
するものである。The present invention solves the above-mentioned conventional problems, and provides a sector mark detection device that can accurately detect sector marks without erroneously detecting them even if pseudo marks are generated.
問題点を解決するための手段
本発明は上記目的を達成するために、セクタマークを検
出するセクタマーク検出回路と、セクタマーク検出時よ
り所定時間毎にウィンド信号を発生させるウィンド信号
発生回路と、ウィンド信号発生時にセクタマーク検出信
号が出力されない場合に疑似マークを発生する疑似マー
ク発生回路とを設けるものである。Means for Solving the Problems In order to achieve the above object, the present invention includes: a sector mark detection circuit that detects sector marks; a window signal generation circuit that generates a window signal at predetermined intervals from the time of sector mark detection; A pseudo mark generation circuit is provided which generates a pseudo mark when a sector mark detection signal is not output when a window signal is generated.
作 用
本発明は上記のような構成であり、セクタマーク間に疑
似的なマークが検出されてもこのマークをセクタマーク
として出力することはないものであるO
実施例
以下に本発明の一実施例について説明する。第1図は本
発明の一実施例を示している。第1図において、11は
第5図に示す従来例と同様のセクタマーク検出回路であ
り、このセクタマーク検出回路11は、セクタマーク検
出信号を出力させるか否かを制御するゲート12に接続
されている。Operation The present invention has the above configuration, and even if a pseudo mark is detected between sector marks, this mark will not be output as a sector mark.An embodiment of the present invention will be described below. Let's discuss an example. FIG. 1 shows an embodiment of the invention. In FIG. 1, 11 is a sector mark detection circuit similar to the conventional example shown in FIG. 5, and this sector mark detection circuit 11 is connected to a gate 12 that controls whether or not to output a sector mark detection signal. ing.
13はセットリセット(SR)フリツプフロツプ(FF
)であり、この5R−FF’13は、セクタマークが検
出された際にセクタマーク検出回路11より出力される
セクタマーク検出信号によってセットされる。14は5
R−FF13がセットされた時点を基準として所定時間
後にパルスを発生するインターバルカウンタ、15は疑
似マーク発生回路であり、この疑似マーク発生回路16
はインターバルカウンタ14よりパルスが出力された際
に疑似マークを発生する。なおこの疑似マーク発生回路
16は、セクタマーク検出回路11より検出信号が出力
された際には、このパルスにより疑似マークの発生が禁
止される。16はインターバルカウンタ14より出力さ
れるパルスに基づき所定の時間幅のウィンド信号を発生
するウィンド信号発生回路である。上記ゲート12はこ
のウィンド信号発生回路16の出力により開成する。1
7は論理和回路(OR回路)である。13 is a set reset (SR) flip-flop (FF
), and this 5R-FF'13 is set by a sector mark detection signal output from the sector mark detection circuit 11 when a sector mark is detected. 14 is 5
An interval counter that generates a pulse after a predetermined time from the point in time when the R-FF 13 is set as a reference, 15 is a pseudo mark generation circuit, and this pseudo mark generation circuit 16
generates a pseudo mark when a pulse is output from the interval counter 14. Note that when the sector mark detection circuit 11 outputs a detection signal, the pseudo mark generation circuit 16 is prohibited from generating a pseudo mark by this pulse. 16 is a window signal generation circuit that generates a window signal of a predetermined time width based on the pulse output from the interval counter 14. The gate 12 is opened by the output of the window signal generating circuit 16. 1
7 is a logical sum circuit (OR circuit).
次に本実施例の動作を第2図とともに説明する。Next, the operation of this embodiment will be explained with reference to FIG.
第2図aはディスクのトラックの一部を直線状に示して
おり、SMはセクタマークを示している。FIG. 2a shows a part of the track of the disk in a straight line, and SM indicates a sector mark.
SMはセクタのデータ部に含まれているセクタマークS
Mと同様の疑似的なマークである(このマークの発生頻
度は非常に低いがディスクの傷等により生じることがあ
る)。第2図において、電源投入時はウィンド信号発生
回路1eは1 を出力しており(第2図d)、ゲート1
2は開状態になつている。ここで、まず0セクタのセク
タマークが検出されると、セクタマーク検出信号(第2
図b)が出力され、このセクタマーク検出信号によって
SR・F’F13はセットされる(第2図C)。SM is the sector mark S included in the data part of the sector.
This is a pseudo mark similar to M (this mark occurs very rarely, but may be caused by scratches on the disc, etc.). In Fig. 2, when the power is turned on, the window signal generating circuit 1e outputs 1 (Fig. 2d), and the gate 1
2 is in the open state. Here, when the sector mark of sector 0 is detected first, the sector mark detection signal (second
(b) in FIG. 2 is output, and SR.F'F13 is set by this sector mark detection signal (FIG. 2C).
5R−FF13がセットされるとインターバルカウンタ
14が計時動作を開始し、所定時間経過時にパルスを発
生する。このパルスによりウィンド信号発生回路16は
ウィンド信号(第2図d)を発生する。このウィンド信
号は次のセクタ(1セクタ)のセクタマーク検出信号が
出力されるタイミングで発生する。このため1セクタの
セクタマークが検出されると、その検出信号(第2図b
)が出力される。この間マーク(SM)が検出されセク
タマーク検出信号を発生するが、このセクタマーク検出
信号発生のタイミングではウィンド信号が発生していな
いため、検出信号はゲート12により阻止され出力され
ない。このように本実施例によれば、疑似的なマーク(
SM’)が検出されても、このマーク(SM)をセクタ
マークとして誤検出することはない。When the 5R-FF 13 is set, the interval counter 14 starts a timing operation and generates a pulse when a predetermined time elapses. This pulse causes the window signal generating circuit 16 to generate a window signal (FIG. 2d). This window signal is generated at the timing when the sector mark detection signal of the next sector (one sector) is output. Therefore, when the sector mark of one sector is detected, the detection signal (Fig. 2b)
) is output. During this time, the mark (SM) is detected and a sector mark detection signal is generated, but since no window signal is generated at the timing of generation of this sector mark detection signal, the detection signal is blocked by the gate 12 and is not output. In this way, according to this embodiment, a pseudo mark (
Even if SM') is detected, this mark (SM) will not be erroneously detected as a sector mark.
発明の効果
本発明によれば、セクタマークに類似したマークをセク
タマークとして誤検出しない利点を有する。Effects of the Invention According to the present invention, there is an advantage that a mark similar to a sector mark is not erroneously detected as a sector mark.
第1図は本発明の一実施例におけるセクタマーク検出装
置のブロック図、第2図は同装置の動作説明図、第3図
は光ディスクの概略説明図、第4図は同党ディスクのセ
クタのフォーマットを示す図、第5図は従来のセクタマ
ーク検出装置のブロック図、第6図は同装置の動作説明
図である。
11・・・セクタマーク検出回路、12・・・ゲート、
13・・・セットリセットフリップフロップ(SR−F
F)、14パ°インターバルカウンタ、15・・・疑似
マーク発生回路、16・・・ウィンド信号発生回路、1
7・・・OR回路。
代理人の氏名 弁理士 中 尾 敏 男 ほか1名第3
図
第4図FIG. 1 is a block diagram of a sector mark detection device according to an embodiment of the present invention, FIG. 2 is an explanatory diagram of the operation of the same device, FIG. 3 is a schematic explanatory diagram of an optical disc, and FIG. FIG. 5 is a block diagram of a conventional sector mark detection device, and FIG. 6 is an explanatory diagram of the operation of the same device. 11... Sector mark detection circuit, 12... Gate,
13...Set-reset flip-flop (SR-F
F), 14° interval counter, 15... pseudo mark generation circuit, 16... window signal generation circuit, 1
7...OR circuit. Name of agent: Patent attorney Toshio Nakao and 1 other person No. 3
Figure 4
Claims (1)
クタマーク検出信号を発生するセクタマーク検出手段と
、上記セクタマーク検出信号の通過を制御するゲートと
、セクタマーク検出時より所定時間毎に上記ゲートを開
成するウインド信号を発生するウインド信号発生手段と
、ウインド信号発生期間にセクタマーク検出信号が出力
されない際に疑似マークを発生する疑似マーク発生手段
とを具備してなるセクタマーク検出装置。sector mark detection means for detecting a sector mark indicating the beginning of a sector on a disk and generating a sector mark detection signal; a gate for controlling passage of the sector mark detection signal; A sector mark detection device comprising: window signal generation means for generating a window signal for opening; and pseudo mark generation means for generating a pseudo mark when a sector mark detection signal is not output during a window signal generation period.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31235486A JPS63166073A (en) | 1986-12-26 | 1986-12-26 | Detecting device for sector mark |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31235486A JPS63166073A (en) | 1986-12-26 | 1986-12-26 | Detecting device for sector mark |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63166073A true JPS63166073A (en) | 1988-07-09 |
Family
ID=18028235
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP31235486A Pending JPS63166073A (en) | 1986-12-26 | 1986-12-26 | Detecting device for sector mark |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63166073A (en) |
-
1986
- 1986-12-26 JP JP31235486A patent/JPS63166073A/en active Pending
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