JPS63163029U - - Google Patents
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- Publication number
- JPS63163029U JPS63163029U JP5623887U JP5623887U JPS63163029U JP S63163029 U JPS63163029 U JP S63163029U JP 5623887 U JP5623887 U JP 5623887U JP 5623887 U JP5623887 U JP 5623887U JP S63163029 U JPS63163029 U JP S63163029U
- Authority
- JP
- Japan
- Prior art keywords
- power supply
- diode
- supply line
- terminal
- backup
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Electronic Switches (AREA)
Description
第1図は本考案に係るリセツト回路のブロツク
図、第2図及び第3図は夫々電源立上り時のリセ
ツト回路の動作を表わすグラフである。 1…主電源入力端子、2…マイクロコンピユー
タ、19…基準電圧発生回路、20…バツクアツ
プ電源、4…コンパレータ。
図、第2図及び第3図は夫々電源立上り時のリセ
ツト回路の動作を表わすグラフである。 1…主電源入力端子、2…マイクロコンピユー
タ、19…基準電圧発生回路、20…バツクアツ
プ電源、4…コンパレータ。
Claims (1)
- 主電源及びバツクアツプ電源20が接続された
電源端子V0とリセツト端子Rとを具えたマイク
ロコンピユータ2のリセツト回路に於いて、前記
主電源は第1ダイオード7を経て前記電源端子V
0へ導かれ、主電源から第1ダイオード7へ至る
第1の電源ラインにはツエナーダイオード6を具
えた基準電圧発生回路19を連結すると共に、第
1ダイオード7から電源端子V0へ至る第2の電
源ラインには第2ダイオード10を介してバツク
アツプ電源20を連結し、基準電圧発生回路19
及びバツクアツプ電源20の各出力は、主電源が
供給されたコンパレータ4の両入力端子へ夫々接
続し、該コンパレータ4はバツクアツプ電源20
の電圧が基準電圧を下回つたときリセツト信号を
発生し、且つ基準電圧を上回つたときリセツト解
除信号を発生し、コンパレータ4の出力端子はリ
セツト信号線を経てマイクロコンピユータ2のリ
セツト端子Rへ接続され、前記第2の電源ライン
とリセツト信号線とは抵抗8を介して連結されて
いることを特徴とするリセツト回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5623887U JPS63163029U (ja) | 1987-04-14 | 1987-04-14 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5623887U JPS63163029U (ja) | 1987-04-14 | 1987-04-14 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63163029U true JPS63163029U (ja) | 1988-10-25 |
Family
ID=30884875
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5623887U Pending JPS63163029U (ja) | 1987-04-14 | 1987-04-14 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63163029U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07202662A (ja) * | 1993-12-28 | 1995-08-04 | Nec Corp | パワーオンリセット回路 |
-
1987
- 1987-04-14 JP JP5623887U patent/JPS63163029U/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07202662A (ja) * | 1993-12-28 | 1995-08-04 | Nec Corp | パワーオンリセット回路 |