JPS63146097A - Phase controller for advertising and decorated lamp - Google Patents
Phase controller for advertising and decorated lampInfo
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- JPS63146097A JPS63146097A JP24845286A JP24845286A JPS63146097A JP S63146097 A JPS63146097 A JP S63146097A JP 24845286 A JP24845286 A JP 24845286A JP 24845286 A JP24845286 A JP 24845286A JP S63146097 A JPS63146097 A JP S63146097A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
本発明は、位相制御を目動的に、且階段状的に行うよう
にした、広告及び装飾灯用位相制御、I Hに関す乙も
のである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to IH, a phase control for advertising and decorative lights, in which phase control is performed objectively and stepwise.
従来、屋外での広告及び装飾灯:ま、ネオン、蛍光灯、
白熱灯等、点滅するもの、又:、マ点汀をAf侵するも
のが主体であって、近年は止溝′よ技術の発達に依って
、自動位相制御装置が容易に裂乍でさるようになり、一
部で使用されている。Conventional outdoor advertising and decorative lights: neon, fluorescent lights,
The main sources are those that flicker, such as incandescent lights, and those that violate the A/F point, and in recent years, due to the development of stop groove technology, automatic phase control devices can easily be torn apart. and is used in some places.
併し、従来の点滅するものや1.舌、汀を持続するもの
は、昔から使用されているから、新軸昧に乏しいし、自
動的に位相制御するものは、!内で、つ使用は別として
1、室外で広告及び装飾灯として使用する場合には、緩
やかに調光するため・′二、人目を引きつけると云う点
で、満足できるものが少いために、現在屋外での広告及
び装飾灯明として:よ、あまり使用されていない。However, conventional flashing ones and 1. The ones that last the tongue and the bottom have been used for a long time, so there are few new developments, and the ones that automatically control the phase are... Apart from being used indoors and outdoors, 1) when used outdoors as advertising and decorative lights, there are currently few that are satisfactory in terms of gradual dimming and 2) eye-catching. As an outdoor advertising and decorative light: Well, it's not used very often.
本発明は、上記欠点を解消するたのに1自動的に、連続
して階段状的に位相制ゴーロを行゛、入、従来・二ない
、変化に富んだ広告及び装飾・汀にし、安lヨで高性能
、互長寿命の装置を提供するもしっである。In order to solve the above-mentioned drawbacks, the present invention has been made to: (1) automatically perform phase-based grounding in a stepwise manner; We are committed to providing high performance, long life equipment.
以下図面を参照して、本発明の実充例を説明する。Embodiments of the present invention will be described below with reference to the drawings.
第1図、二示すものは、従来の手動l:立り呵1装置で
、負荷5と即1佃素子(トライアック、・4を亘列に接
続して、交流電1原ACに接続しである。トランス1の
一次側は、交流電源A Cに接続し、二次側は余波整流
回路2の交流入力に接続しである。電流制講抵抗R1と
ツェナーダイオードZDは直列に接続して、全波整)荒
回路2の直流出力に接続しである。時限抵抗VRTと時
限コンデンサCTは直列に接続して、電流制江艮抵抗R
1とツニナーグイ万一ドZDの接続点P1とマイナス極
P2にそれぞれ接続されている。トリが素子(ユニジセ
ンクノヨントランジスタ、以下UJTと略記する)3の
エミッタEは、時限抵抗VRTと時限コンデンサCTの
接続点P3に接続し、ベースB2はベース抵抗R2を介
して接続点P1に接続し、ベースB1は、パルストラン
スPTの一次側を介してマイナス極P2+−接続し、パ
ルストランスPTの二次側は、制御素子(トライアック
)4のゲートGと端子T1間に接続されている。What is shown in Figures 1 and 2 is a conventional manual stand-up device in which a load 5 and a triac element (triac, 4) are connected in series and connected to an alternating current source AC. The primary side of the transformer 1 is connected to the AC power supply AC, and the secondary side is connected to the AC input of the aftereffect rectifier circuit 2.The current limiting resistor R1 and the Zener diode ZD are connected in series, and the It is connected to the DC output of the wave straightening circuit 2. The time-limiting resistor VRT and the time-limiting capacitor CT are connected in series, and the current limiting resistor R
1 and the connection point P1 of the terminal ZD and the negative pole P2, respectively. The emitter E of the tri-element (uniform transistor, hereinafter abbreviated as UJT) 3 is connected to the connection point P3 between the timer resistor VRT and the timer capacitor CT, and the base B2 is connected to the connection point P1 via the base resistor R2. The base B1 is connected to the negative pole P2+- through the primary side of the pulse transformer PT, and the secondary side of the pulse transformer PT is connected between the gate G of the control element (TRIAC) 4 and the terminal T1. There is.
この回路は、電源が投入されると接続点P1より台形&
が発生し、時定数回路とトリが素子(UJT)3f二洪
袷されるから、トリガ素子(UJT)3は、時限抵抗V
RTと時限コンデンサCTj°二依る時定数で、交流
電源ACに同期して発振し、パルストランスFTで制(
2)素子(トライアック)4を駆動して、負荷5を位相
制御するようになっているから、時匿抵抗VRTの把抗
値7変えることにより、負荷5を任意に調光できるので
ある、第2図、第3図、第4図、第5区1献本発明の実
施例を示すもので、トランス1、全波整流回路2、トリ
ガ素子(UJT)3、制御素子(トライアック)4、負
荷(電球、)5、電流制二艮ξ抗R1、ツェナーダイオ
ードZD、パルストランスPT、ペース抵抗R2等つ配
線は、第1区で示すもつと全く同じであるから、説明を
省略する。When the power is turned on, this circuit connects to the trapezoid &
occurs, and the time constant circuit and the trigger element (UJT) 3f are combined, so the trigger element (UJT) 3 is connected to the time-limited resistor V.
It oscillates in synchronization with the AC power supply, with a time constant depending on RT and the time capacitor CTj°2, and is controlled by the pulse transformer FT (
2) Since the phase of the load 5 is controlled by driving the element (TRIAC) 4, the load 5 can be dimmed arbitrarily by changing the control value 7 of the time storage resistor VRT. Figure 2, Figure 3, Figure 4, Section 5, Section 1. This shows an embodiment of the present invention, which includes a transformer 1, a full-wave rectifier circuit 2, a trigger element (UJT) 3, a control element (TRIAC) 4, and a load ( The wiring for the light bulb, ) 5, current control diode ξ resistor R1, Zener diode ZD, pulse transformer PT, pace resistor R2, etc. is exactly the same as that shown in the first section, so the explanation will be omitted.
次に、第2図に示す本発明の第−実杏ワ′1(1就いて
説明する。第1図に於(する時、;艮抵抗vRTを、R
TO,RTI、RT2、RT3に分害・1し、時□−艮
低抵抗TOは時限コンデンサCTと直列に接続して接続
点P1とP2にそれぞれ接続し、時言艮ξ抗RTOと時
限コンデンサCTの接続片、P3:ま、トリが素子(U
、J T ) 3のエミッタE(:接続し、時り艮抵
抗RTI、RT2、RT3とアナログスイッチASI、
AS2、AS3をそれぞれ直列(:接続した各組を並列
に接続して、一方は接続点P1に、他方は接続声、P3
にそれぞれ接続されている。時で艮抵抗\’RTを分割
する:1当っては、時3艮抵抗RT○、RTI、RT2
、RT3は全部並列接続になっているので、時ミ艮コン
デンサCTかろ見ると、時:″、艮抵抗RT Oi二、
RT ○<RTn 、 RTO>RT *1 RTO
=RT n (n=1〜3 )と如何なる抵抗僅を持っ
た時限抵抗RTnを接続しても、合成抵抗:ま減少する
ことになるOで、時限コンデン−II−CTどの時定数
は変化するから、使用目的に合せて、各時限抵抗RTn
の値を設定すれば良い。Next, the first embodiment of the present invention shown in FIG. 2 will be explained. In FIG.
TO, RTI, RT2, RT3 are divided into 1, and the time □ - 艮 low resistance TO is connected in series with the time capacitor CT and connected to the connection points P1 and P2, respectively, and the time □ - 艮 resistance TO is connected to the connection points P1 and P2, respectively, and the time □ - 艮 resistance TO is CT connection piece, P3: Well, the bird element (U
, J T ) 3 emitters E (: connect the analog switch ASI, with the resistors RTI, RT2, RT3,
AS2 and AS3 are connected in series (: each connected set is connected in parallel, one is connected to the connection point P1, the other is connected to the connection voice, P3
are connected to each. Divide resistance\'RT by time: 1 hit, time 3 resistance RT○, RTI, RT2
, RT3 are all connected in parallel, so if you look at the time capacitor CT, time:'', the time resistance RT Oi2,
RT ○<RTn, RTO>RT *1 RTO
= RT n (n = 1 to 3) and no matter how much resistor RTn is connected, the combined resistance will decrease. , each time-limited resistor RTn according to the purpose of use.
All you have to do is set the value of .
基覚になる時こ艮抵抗RT○の値は、時限抵抗RT○の
みにして、時限コンデンfCTとの時定数で′ヱ相制曳
した?!に、負荷5力ニ電球の場合(ニフィラノ′ント
を予熱して、ラフツユ刀−レソトを防止でさるように説
定する。アブコグスイッチA s 1、AS21..7
S3の各コントロール入力は、ベース抵抗BRI、B
H3、BH3を介してドライバD1、D2、D3にそれ
ぞれ接続されて、゛・る。770グスイツチASI、A
S2、AS 3 :ま、スイッチング素子にバイポーラ
・トランジスタのP−NP型を用いて、ベース電流を充
分に流すようにして、オン、オフのスイッチとして用い
ているっ 6は発振回路で、方形波を発振し、1量波数
は可変抵抗■Rで任意に変えられる。7は=i=投入時
だ、ナにパルスを発生するスタートパルス発生回路っ
8:までウンタ回路で、クロック人力CKは発振回路6
の出力に接続し、クリア入力CLはスタートパルス発生
回路7の出力に接続し、出力Q1、Q2、第3はドライ
バD1、D2、D3の入力C二そnぞr。The value of the resistance RT○ when becoming the basic sense is set to only the timed resistance RT○, and the phase control is carried out by the time constant with the timed capacitor fCT. ! In the case of a 5-power double bulb with a load (preheat the nifilanoant to prevent the light from burning), the Abcog switch A s 1, AS21..7
Each control input of S3 has a base resistor BRI, B
They are connected to drivers D1, D2, and D3 via H3 and BH3, respectively. 770 Guswitch ASI, A
S2, AS 3: Well, a P-NP type bipolar transistor is used as the switching element to allow sufficient base current to flow, and is used as an on/off switch. 6 is an oscillation circuit, which generates a square wave oscillates, and the single wave number can be changed arbitrarily using a variable resistor ■R. 7 is the start pulse generation circuit that generates a pulse when =i=turns on.
8: Counter circuit until clock CK is oscillator circuit 6
The clear input CL is connected to the output of the start pulse generation circuit 7, and the outputs Q1 and Q2 are connected to the outputs of the drivers D1, D2, and D3.
接続されている。ドライバD1、D2、D 3 j’4
共にトランジスタを内蔵し、カクンタ回路8の出力Qn
を増幅できるように回路構成されてい己。整流ダイオー
ドDと平滑コンデンサC:ま直列に番摂し、整、・凡ダ
イオードDの7ノードは接続、占、Pl;二接続し、平
、骨コンデンサCのでイブ:)、”i;ま接總点P2に
接続して、整流ダイで−ドDと二、骨コンデンサCO接
読点よ・つ、定電圧、7)直流DCを得て、発振回路6
、スタートパルス発生回路7、カウンタ回路8、ドライ
バD1、D2、D3に電源を供給する。It is connected. Driver D1, D2, D3 j'4
Both have built-in transistors, and the output Qn of the Kakunta circuit 8
The circuit is configured to amplify the self. The rectifier diode D and the smoothing capacitor C: are connected in series, and the 7 nodes of the diode D are connected. Connect to the connection point P2, connect it to the rectifier die and connect it to the bone capacitor CO contact point, constant voltage, 7) Obtain direct current DC, and connect it to the oscillation circuit 6.
, the start pulse generation circuit 7, the counter circuit 8, and the drivers D1, D2, and D3.
本発明の第一実施例;ま、上述の如く回路構成されてい
るから、電源を投入すると、スタートパルス発生回路7
の出力で、カウンタ回路8の出力はQO:ニセノトされ
、発振回路6は一定1間期でクロックパルスを発振する
から、カウンタ回路8の出力は、QOからスタートして
、Ql、Q2、Q3、QO,Ql・・ ・と出力状態を
1頃次移行するので、これに対応してドライバは、−一
、Dl、D2、D3、−一、Dl・・・と駆動され、ア
ナログスイッチは、−一、ASI、AS2、AS3、−
一、ASI・・・・・と順次制御されて、時限抵抗RT
O1RTI、RT2、RT3と時限コンチン−9−CT
に依る時定数回路を順次切り替えて、時定数を変化させ
て、トリが素子(U 、J T ) 3を発振させ、パ
ルストランスPTを介して制御素子(トライアック)4
を動作させ、負荷(電球)5を自動的j二、連快しで階
段状的に位相制御を行うのである。この状態を、電圧波
形図で示したものが、第6図、第7図、第8図で、カク
ンタ回j!88のカウントモードがアップモードの時は
第6図に示す如くなり、ダウンモードの時は第717に
示す如くなり、ア・ブ・ダウンの反転モードの時は第8
図に示す如くなる。First embodiment of the present invention: Well, since the circuit is configured as described above, when the power is turned on, the start pulse generating circuit 7
, the output of the counter circuit 8 is QO: false note, and the oscillation circuit 6 oscillates a clock pulse at a constant period of one period, so the output of the counter circuit 8 starts from QO, Ql, Q2, Q3, Since the output state changes to QO, Ql, etc. around 1, the driver is driven accordingly to -1, Dl, D2, D3, -1, Dl..., and the analog switch changes to -1, D1, D2, D3, -1, Dl, etc. 1, ASI, AS2, AS3, -
1. The time-limited resistor RT is controlled sequentially as ASI...
O1RTI, RT2, RT3 and timed Contin-9-CT
By sequentially switching the time constant circuit depending on the circuit and changing the time constant, the triac element (U, J
The phase of the load (bulb) 5 is automatically controlled in a stepwise manner in continuous operation. This state is shown in voltage waveform diagrams in Figures 6, 7, and 8. When the count mode of 88 is up mode, it is as shown in FIG.
The result will be as shown in the figure.
次に第3図に示す本発明の第二実施例に就いて説明する
。時限抵抗RT 01と時限コンデンサCTを直列に接
読し、接続、う、P3はトリガ素子(UJT)3のエミ
ッタEに接続し、分割した時限抵抗R’TI、RT2、
RT3、RT4とアナコグスイッチASI’、AS2’
、AS3’、A S 4’、 をそれぞれ直列に接続し
た各組を時限コンデンサC中と並列に接続し、アナログ
スイッチASI’、AS2’、AS3’、A S 4’
、の各コントロール入力は、ベース抵抗BRI、BH3
、BH3、BH3を介して、ドライバD1、I) 2、
D3、D4の各出力にぞセ2ぞれ接続し、ドライバD1
、D2、D3、D4の各入力はカウンタ回路8の出力Q
O1Q1、Q2、Q3にそれぞれ接続されている。アナ
コグスイッチ、A、 S 1’、AS2’、AS3’、
AS 4’、はスイッチング素子にバイポーラ・トラン
ジスタのNPN型を弔いベース電流を充分に流すように
してオン、オフのスイッチとしてイ吏用している。第2
図に示す第一実施例:1於いては、時四艮抵抗RTOの
値を充分大きくして、電源より、時限コンチン−1−C
Tに流入する電荷の量を最小に押さえて置いて、他の時
限抵抗RTI、RT2、RT3を、アナログスイッチA
SI、AS2、AS 3で順次並列に接続することによ
り、合成抵抗を減少させて、流入する電荷の量を順次増
すことにより、時定数を階段状的、二液化させて、位相
制御を行ったのであるが、第3図に示す第二実施例では
、時限抵抗RT○′、の埴を充分小さくして、電Jより
、時限コンデンサCTに流入する電荷の量を最大にして
置いて、他の時限抵抗RTI、RT2、RT3、RT4
を、アブコグスイッチASi’、AS 2’、AS3’
、A S 4’、で順次直列;二接続することにより、
電源より、時限抵抗RT O’、を介して流入する電荷
をでIfスツにバイパスして時Z艮コンデン9CTi二
流入する電荷の量を順次減少させ、時定数を変化させて
、第一実施例と同様に、負荷5を自動的に、連続して階
段状的に位相制御を行うのである。、第−実施例及び第
二実施例では、アナログスイッチASn、ASn’、の
スイッチング素子:ニバイホーラ・トランジスタを用い
た例を説明したが、池にニニボーラ・トランジスタ、S
CR,スイッチングダイオード等を用いることも考えら
れる。Next, a second embodiment of the present invention shown in FIG. 3 will be described. The time resistor RT 01 and the time capacitor CT are connected in series, and the connection P3 is connected to the emitter E of the trigger element (UJT) 3, and the divided time resistors R'TI, RT2,
RT3, RT4 and Anacog switches ASI', AS2'
, AS3', AS 4', connected in series are connected in parallel with the time capacitor C, and analog switches ASI', AS2', AS3', AS 4' are connected in series.
, each control input has a base resistor BRI, BH3
, BH3, via BH3, driver D1, I) 2,
Connect the two outputs to each output of D3 and D4, and connect the driver D1.
, D2, D3, and D4 are the output Q of the counter circuit 8.
Connected to O1Q1, Q2, and Q3, respectively. Anacog switch, A, S1', AS2', AS3',
The AS 4' uses an NPN type bipolar transistor as a switching element to allow a sufficient base current to flow and is used as an on/off switch. Second
In the first embodiment shown in the figure: 1, the value of the timer resistor RTO is made sufficiently large, and the timer resistor RTO is
The other time-limiting resistors RTI, RT2, RT3 are connected to the analog switch A while minimizing the amount of charge flowing into T.
By sequentially connecting SI, AS2, and AS3 in parallel, the combined resistance is decreased and the amount of inflowing charge is increased sequentially to make the time constant step-like and two-component, and phase control is performed. However, in the second embodiment shown in FIG. 3, the time limit resistor RT○' is made sufficiently small to maximize the amount of charge flowing into the time limit capacitor CT from the electric current J. Timed resistors RTI, RT2, RT3, RT4
, Abcog switch ASi', AS2', AS3'
, A S 4', in series; by connecting the two,
By bypassing the charge flowing from the power supply through the time-limiting resistor RTO', the amount of charge flowing into the capacitor 9CTi2 is sequentially decreased and the time constant is changed. Similarly, the load 5 is automatically and continuously phase-controlled in a stepped manner. In the first embodiment and the second embodiment, an example was explained in which the switching elements of the analog switches ASn and ASn' were Nibyholla transistors.
It is also possible to use CR, switching diodes, etc.
次に第4図に示す本発明の第三実施例に就いて説明する
。第三実施例は、第2図に示す第一実施例の時定数回1
烙に於いて、アナコグヌイ、・チAS1、AS2、AS
3が単体で構成されてい己5のを、発光体(発光ダイ
オード)と受光体(ホト・トランジスタ)を組み合せて
、一体化密グしたもので、通称ホト・カプラと呼ばれる
ものに買き換えたもので、時限抵抗RTI、RT2、R
T3、をアナログスイッチA S 11′、A 3 Q
ll、A 33+1、C各ボト・トランジスタと直列に
接続した各組を、時2艮把抗RTOと並列に接続し、ア
ナコグス・イノチA 31″、A S 2”、A 33
′+、の各発光ダイオードのアノードは共通の電流制限
抵抗RLを介して、直流電源のプラス極に接続し、各カ
ソードは、ドライバD1、D2、D3の出力にそれぞれ
接続し、ドライバD1、D2、D3の各入力はカウンタ
回路8の出力Q1、Q2、Q3にそれぞれ接続されてい
るう第三実施例の動作は、カウンタ回路8の出力Qnで
、ドライバDnを順次制御し、各アナログスイッチAS
n代の各発光ダイオード(1流れる電流をオン、オフさ
せて、光を介してホト・トランジスタをオン、オフのス
イッチング動作をさせて、電源より、時限抵抗RTnを
介して、時限コンデンサCTに流入する電荷の量!順次
増減し、時定数を変化させて、第一実施例と同様に、負
荷を自動的に、連続して、階段状的に位相制御を行うの
である。Next, a third embodiment of the present invention shown in FIG. 4 will be described. The third embodiment has the time constant 1 of the first embodiment shown in FIG.
In the heat, Anakogunui, Chi AS1, AS2, AS
I replaced my 5, which was made up of a single element 3, with one that combines a light emitter (light-emitting diode) and a photoreceptor (phototransistor) into a single unit, commonly known as a photocoupler. timed resistor RTI, RT2, R
T3, the analog switch A S 11', A 3 Q
ll, A 33+1, C Each set connected in series with each bottom transistor is connected in parallel with the time 2 resistance RTO, Anacogus Inochi A 31'', A S 2'', A 33
The anode of each light emitting diode '+, is connected to the positive pole of the DC power supply via a common current limiting resistor RL, and the cathode of each light emitting diode is connected to the output of the driver D1, D2, D3, respectively. , D3 are respectively connected to the outputs Q1, Q2, and Q3 of the counter circuit 8.The operation of the third embodiment is such that the output Qn of the counter circuit 8 sequentially controls the driver Dn, and each analog switch AS
The current flowing through each of n generations of light-emitting diodes (1) is turned on and off, and the phototransistor is switched on and off via light, and the current flows from the power supply through the time-limited resistor RTn to the time-limited capacitor CT. By sequentially increasing and decreasing the amount of charge and changing the time constant, the phase of the load is automatically, continuously, and stepwise controlled as in the first embodiment.
次に第5図に示す本発明の、第四実施例(1就いて説明
する。第3図に示す第二実施例の時定数回路に於いて、
アナログスイッチASn’、が単体素子で構成されてい
るものを、発光体(発光ダイオード)と受光体(ホト・
トランジスタ)で構成されたホト・カブラ:1菫き換え
たもので、時i艮抵抗RTI、RT2、RT3、RT4
をアナログスイッチA S 1″、A S 2人 A
S 31′、A S 4+1、の各ぶト・トランジスタ
と直列(=接続した各組を、時限コンデンサCTと並列
;二接続し、アナログスイッチ、NS1″、A82代
入83″、A34代の各発光ダイオードのアノードは、
ドライバD1、D2、D3、D4の各出力にそれぞれ接
続し、カソードは共通の電流制御長抵抗RLを介してマ
イナス極に接続されている。ドライバDI、D2、D3
、D4の各入力は、カウンタ回路8の出力Q○、Ql、
Q2、Q3にそれぞれ接続されている。第四実施例の動
作は、カウンタ回路8の出力Qnで、ドライバQnを順
次制御し各アナログスイッチA Sn″、の各発光ダイ
オードに流れる電流をオン、オンさせて、光を介してホ
ト・トランジスタをオン、オフのスイッチング動作さセ
て、電1原より、時1抵侃RTO′、を介して時限コン
デンサCTに流入する電荷を時限抵抗RTnを介して、
マイナス極にバイパスすることにより、時定数を変化さ
せて、第一実施例と同様に、負荷を自動的に、連続して
、階段状的に、位相制御を行うのである。Next, the fourth embodiment (1) of the present invention shown in FIG. 5 will be explained. In the time constant circuit of the second embodiment shown in FIG.
The analog switch ASn' consists of a single element;
A photocoupler consisting of transistors: 1 and 2.
Analog switch A S 1″, A S 2 people A
S 31', A S 4+1, in series with each pair of transistors (= connected in parallel with the time capacitor CT; two connected, analog switch, NS1'', A82 generation
The anode of each light emitting diode of 83″ and A34 is,
It is connected to each output of the drivers D1, D2, D3, and D4, and its cathode is connected to the negative pole via a common current control long resistor RL. Driver DI, D2, D3
, D4 are the outputs Q○, Ql, of the counter circuit 8.
Connected to Q2 and Q3, respectively. The operation of the fourth embodiment is such that the output Qn of the counter circuit 8 sequentially controls the driver Qn, turns on and on the current flowing through each light emitting diode of each analog switch A Sn'', and connects the phototransistor through light. During the on/off switching operation, the charge flows from the current source into the time capacitor CT through the time resistor RTO' and through the time resistor RTn.
By bypassing to the negative pole, the time constant is changed, and the phase of the load is automatically, continuously, and stepwise controlled as in the first embodiment.
第三伎び第四実施例に於ける、アナグロスイッチA 3
n+1、は、発光体に元光ダイオードを用い、受光体
j二はホト・トランジスタを用いた、ホトカプラを使用
したもので説明したが、他に、発光体にはフノラメント
球、イ・オン球を用い、受光体にはホト・SCR,、ニ
ド・ダイオード、光導電素子のCdS等を用いることも
考えられる。Analog switch A3 in the third and fourth embodiments
n+1 uses an original photodiode as the light emitting body, and the photoreceptor j2 uses a phototransistor or a photocoupler. It is also conceivable to use a photo-SCR, Nido diode, CdS photoconductive element, etc. as the photoreceptor.
実施例は、トソガ素子1ニュニジャソクション・トラン
ジスタ(UJT)を弔いたものを説明したカ、フログラ
マプル・ユニジャンクション・トランジスタ(PtJT
)やPn Pnスイッチング・ダイオード等他のトリが
素子でも、同じ考え方で使用できるので代用しても良い
。The embodiments are explained using a Tosoga element 1 unijunction transistor (UJT), a programmatic pull unijunction transistor (PtJT), and a programmable unijunction transistor (PtJT).
) or Pn Pn switching diodes, etc., can be used in the same way and may be used instead.
実施例は、制御素子にトライアックを用いたが、他のサ
イリスタ、SCR又はSSSを用いても良い。Although the embodiment uses a triac as the control element, other thyristors, SCRs, or SSSs may also be used.
実施例は、電球を用いた抵抗負荷のものを説封したが、
本発明は、時限1氏抗と時−艮コンデンサに依る時限定
数回路を、順次自動的に切り替えて、位相制御を階段状
的に行うようにしたものであるから、イ・オン灯や蛍光
灯等の誘導負荷の位相制御回路にも応用できることは当
然である。The example describes a resistive load using a light bulb, but
The present invention automatically switches a time-limited number circuit based on a time-limited resistor and a time-displacement capacitor in order to perform phase control in a stepwise manner. It goes without saying that the present invention can also be applied to phase control circuits for inductive loads such as lights.
実施例は、複数個のアナグロスイッチの内、動作するも
のを常に一団だけにし、これを順送りにして、時定数を
変化させたのであるが、他;−1動作するアナグロスイ
ッチを、ASI、AS1+AS2、AS1+AS2+A
S3、ASI−1−AS2、・・・・・・と増減して、
時定数を変化させることも考えらnる。In the embodiment, only one group of analog switches is operated at all times, and the time constant is changed by sequentially moving them. , AS1+AS2+A
S3, ASI-1-AS2, etc. increases and decreases,
It is also conceivable to change the time constant.
実施例は、位を目角の変化を四段にしにもの(1就いて
説明したが、用達に応じて段数を増減すると良い。In the embodiment, the change in angle of the eyes is set to 4 steps (although the explanation is based on 1 step, the number of steps may be increased or decreased depending on the purpose).
本発明は、光源の照度変化を、連続的に、且階段状的に
変化させることができると共に、変化するタイミングも
電子的に行うので、早いものから運いものまで任意に調
節できる等、従来にない斬新で変化に富んだ、広告灯及
び装飾灯用位相側・卸装置である。The present invention can change the illuminance of the light source continuously and in a stepwise manner, and also electronically performs the timing of the change, so it can be adjusted arbitrarily from fast to fast. This is a novel and varied phase side/distribution device for advertising lights and decorative lights.
又本発明は、電、原投入時に、カクンタ回路8の出力を
Q○にセットして、時定数が大きいところからスタート
するようにしであるから、制御される位相角も大きいと
ころよりスタートするので、抵抗負荷の場合に、ラッシ
ーカーンントを少くなくすることがでさ、開削素子の破
壊支び劣化を防止できる。In addition, in the present invention, when power is input, the output of the kakunta circuit 8 is set to Q○ so that the time constant starts from a large point, so the controlled phase angle also starts from a large point. In the case of a resistive load, by reducing the lassi currant, it is possible to prevent fracture support and deterioration of the cut-and-cut element.
更に本発明は、従来の点滅するもの(1比べて、電源を
コントロールするので、配線が容易であり、経費も節約
できる等実用的な効果を有するものである。Furthermore, the present invention has practical effects such as easy wiring and cost savings compared to conventional blinking devices (1) because the power source is controlled.
第1区は、従来の基本的な位相制御装置の回路図。第2
図は、本発明の第一実施例を示す回路図。
第3図は、本発明の第二実施例を示す回路図。第4図は
、本発明の第三実施例を示す回路図。第5図は、本発明
の第四実施例を示す回路図。第6図、第7図、第8図は
共に、本発明に依って位相制御された負荷の電圧波形図
。The first section is a circuit diagram of a conventional basic phase control device. Second
The figure is a circuit diagram showing a first embodiment of the present invention. FIG. 3 is a circuit diagram showing a second embodiment of the present invention. FIG. 4 is a circuit diagram showing a third embodiment of the present invention. FIG. 5 is a circuit diagram showing a fourth embodiment of the present invention. 6, 7, and 8 are voltage waveform diagrams of a load whose phase is controlled according to the present invention.
Claims (1)
路に、交流を全波整流し、ツェナーダイオードでクリッ
プした台形波を供給して行う位相制御装置に於いて、複
数個の時限抵抗と複数個のアナログスイッチを、それぞ
れ直列に接続した各組を並列に接続して、一方を時限コ
ンデンサに接続し、他方は電極に接続して時定数回路を
構成し、複数個のアナログスイッチの各コントロール入
力をカウンタ回路の出力で、順順に制御して、時定数回
路を順次切り替え、負荷を自動的に、連続して階段状的
に位相制御するようにしたことを特徴とする広告及び装
飾灯用位相制御装置。In a phase control device that performs full-wave rectification of alternating current and supplies a trapezoidal wave clipped with a Zener diode to a circuit composed of a timed resistor, a timed capacitor, and a trigger element, multiple timed resistors and multiple Each set of analog switches connected in series is connected in parallel, one is connected to a time capacitor, and the other is connected to an electrode to form a time constant circuit, and each control input of multiple analog switches is connected in parallel. Phase control for advertising and decorative lights, characterized in that the output of a counter circuit is used to sequentially control the time constant circuit, and the phase of the load is automatically and continuously controlled in a stepped manner. Device.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15419686 | 1986-07-02 | ||
JP61-154196 | 1986-07-02 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63146097A true JPS63146097A (en) | 1988-06-18 |
Family
ID=15578935
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24845286A Pending JPS63146097A (en) | 1986-07-02 | 1986-10-21 | Phase controller for advertising and decorated lamp |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63146097A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007016436A (en) * | 2005-07-06 | 2007-01-25 | Kajima Corp | Roller blind and airflow system |
-
1986
- 1986-10-21 JP JP24845286A patent/JPS63146097A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007016436A (en) * | 2005-07-06 | 2007-01-25 | Kajima Corp | Roller blind and airflow system |
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