JPS63124091U - - Google Patents
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- Publication number
- JPS63124091U JPS63124091U JP1602987U JP1602987U JPS63124091U JP S63124091 U JPS63124091 U JP S63124091U JP 1602987 U JP1602987 U JP 1602987U JP 1602987 U JP1602987 U JP 1602987U JP S63124091 U JPS63124091 U JP S63124091U
- Authority
- JP
- Japan
- Prior art keywords
- operational amplifier
- input
- converter
- load
- application circuit
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 239000004065 semiconductor Substances 0.000 description 1
Landscapes
- Testing Relating To Insulation (AREA)
- Dc-Dc Converters (AREA)
Description
第１図は本考案の原理図であり、第２図は本考
案の１実施例を示す図であり、第３図ａは高電圧
電源を用いた従来例であり、第３図ｂはＤＣ―Ｄ
Ｃコンバータを用いた従来例である。 図において、１……演算増幅器、２……ＤＣ―
ＤＣコンバータ、３……負荷、２１……発振器、
２２……整流器、２３……半導体スイツチ、３１
……高電圧電源。
案の１実施例を示す図であり、第３図ａは高電圧
電源を用いた従来例であり、第３図ｂはＤＣ―Ｄ
Ｃコンバータを用いた従来例である。 図において、１……演算増幅器、２……ＤＣ―
ＤＣコンバータ、３……負荷、２１……発振器、
２２……整流器、２３……半導体スイツチ、３１
……高電圧電源。
Claims (1)
- 【実用新案登録請求の範囲】 入力電圧ＶｉｎをＤＣ―ＤＣコンバータ２によ
り変換して負荷３に印加する定電圧印加回路にお
いて、 該負荷３に並列に接続した、直列抵抗４ａ，ｂ
の中点を演算増幅器１の反転入力へ接続し、該演
算増幅器１の非反転入力には、前記入力電圧を印
加し、該演算増幅器１の出力を該ＤＣ―ＤＣコン
バータ２の入力に接続したことを特徴とする定電
圧印加回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1602987U JPS63124091U (ja) | 1987-02-05 | 1987-02-05 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1602987U JPS63124091U (ja) | 1987-02-05 | 1987-02-05 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63124091U true JPS63124091U (ja) | 1988-08-12 |
Family
ID=30807515
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1602987U Pending JPS63124091U (ja) | 1987-02-05 | 1987-02-05 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63124091U (ja) |
-
1987
- 1987-02-05 JP JP1602987U patent/JPS63124091U/ja active Pending