JPS63118248U - - Google Patents
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- Publication number
- JPS63118248U JPS63118248U JP754387U JP754387U JPS63118248U JP S63118248 U JPS63118248 U JP S63118248U JP 754387 U JP754387 U JP 754387U JP 754387 U JP754387 U JP 754387U JP S63118248 U JPS63118248 U JP S63118248U
- Authority
- JP
- Japan
- Prior art keywords
- hybrid
- built
- operational amplifier
- input terminal
- utility
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Semiconductor Integrated Circuits (AREA)
- Amplifiers (AREA)
Description
第１図は本考案の説明用回路図、第２図は本考
案の一実施例を示す回路図、第３図は従来の一実
施例を示す回路図である。 １……ＨＩＣ、２……オペアンプ、３……入力
端子、４……可変抵抗、５……ＨＩＣの端子、６
……ダミー用抵抗、７……出力端子、８……次段
回路。
案の一実施例を示す回路図、第３図は従来の一実
施例を示す回路図である。 １……ＨＩＣ、２……オペアンプ、３……入力
端子、４……可変抵抗、５……ＨＩＣの端子、６
……ダミー用抵抗、７……出力端子、８……次段
回路。
Claims (1)
- 演算増幅器を内蔵するハイブリツドＩＣにおい
て演算増幅器の入力端子とハイブリツドＩＣの外
部端子間にダミー用抵抗を内蔵することを特徴と
したハイブリツドＩＣ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP754387U JPS63118248U (ja) | 1987-01-23 | 1987-01-23 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP754387U JPS63118248U (ja) | 1987-01-23 | 1987-01-23 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63118248U true JPS63118248U (ja) | 1988-07-30 |
Family
ID=30791095
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP754387U Pending JPS63118248U (ja) | 1987-01-23 | 1987-01-23 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63118248U (ja) |
-
1987
- 1987-01-23 JP JP754387U patent/JPS63118248U/ja active Pending
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