JPS63100990U - - Google Patents
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- Publication number
- JPS63100990U JPS63100990U JP19488286U JP19488286U JPS63100990U JP S63100990 U JPS63100990 U JP S63100990U JP 19488286 U JP19488286 U JP 19488286U JP 19488286 U JP19488286 U JP 19488286U JP S63100990 U JPS63100990 U JP S63100990U
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- JP
- Japan
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- circuit
- value signal
- voltage
- actual value
- utility
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- Pending
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- 239000003990 capacitor Substances 0.000 claims description 7
- 238000009499 grossing Methods 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Dc-Dc Converters (AREA)
Description
第1図から第3図までが本考案に関するもので
、第1図は本考案によるチヨツパ形DC―DCコ
ンバータ回路の代表的な実施例を示す回路図、第
2図はその主な信号の波形図、第3図は本考案の
異なる実施例の要部を示す回路図である。第4図
は従来技術としての先願にかかるチヨツパ形DC
―DCコンバータ回路の要部を示す回路図、第5
図はその主な信号の波形図である。図において、 1:DC―DCコンバータ、2:電源、3:負
荷、10:チヨツパ回路要素ないしはトランジス
タ、20:平滑回路、21:平滑回路のリアクト
ル、22:平滑回路のキヤパシタ、23:低イン
ピーダンス要素ないしは抵抗、30:比較回路、
40:フリーホイーリングダイオード、41:後
段の平滑回路用リアクトル、42:キヤパシタ、
51,52:実際値信号形成用抵抗、53〜55
:脈動電圧重畳用抵抗、60:出力電圧値設定器
、Ea:実際値信号、Er:実際値信号に重畳さ
れる脈動電圧、Et:目標値信号、IL:リアク
トル電流、Tf:オフ時間、Tn:オン時間、V
c:キヤパシタ電圧、Vi:入力電圧、Vo:出
力電圧、Vs:チヨツパ電圧、である。
、第1図は本考案によるチヨツパ形DC―DCコ
ンバータ回路の代表的な実施例を示す回路図、第
2図はその主な信号の波形図、第3図は本考案の
異なる実施例の要部を示す回路図である。第4図
は従来技術としての先願にかかるチヨツパ形DC
―DCコンバータ回路の要部を示す回路図、第5
図はその主な信号の波形図である。図において、 1:DC―DCコンバータ、2:電源、3:負
荷、10:チヨツパ回路要素ないしはトランジス
タ、20:平滑回路、21:平滑回路のリアクト
ル、22:平滑回路のキヤパシタ、23:低イン
ピーダンス要素ないしは抵抗、30:比較回路、
40:フリーホイーリングダイオード、41:後
段の平滑回路用リアクトル、42:キヤパシタ、
51,52:実際値信号形成用抵抗、53〜55
:脈動電圧重畳用抵抗、60:出力電圧値設定器
、Ea:実際値信号、Er:実際値信号に重畳さ
れる脈動電圧、Et:目標値信号、IL:リアク
トル電流、Tf:オフ時間、Tn:オン時間、V
c:キヤパシタ電圧、Vi:入力電圧、Vo:出
力電圧、Vs:チヨツパ電圧、である。
Claims (1)
- 【実用新案登録請求の範囲】 1 直流入力電圧を断続するチヨツパ回路要素と
、該チヨツパ回路要素の負荷側に接続された逆L
字接続のリアクトルとキヤパシタとからなる平滑
回路と、直流出力電流の実際値信号を目標値信号
と比較する比較回路とを備え、該比較回路の出力
信号によりチヨツパ回路要素を断続させるように
した電圧コンバータ回路において、リアクトルと
キヤパシタとの直列回路としてなる脈動電流路内
に低インピーダンス要素を挿入し、該低インピー
ダンス要素を含む平滑回路内の脈動電圧を前記実
際値信号に重畳して比較回路に与えるようにした
ことを特徴とするチヨツパ形DC―DCコンバー
タ回路。 2 実用新案登録請求の範囲第1項記載の回路に
おいて、低インピーダンス要素が低抵抗値をもつ
抵抗であることを特徴とするチヨツパ形DC―D
Cコンバータ回路。 3 実用新案登録請求の範囲第1項記載の回路に
おいて、低インピーダンス要素がキヤパシタの側
に接続され、リアクトルの負荷側電圧から実際値
信号に重畳されるべき脈動電圧が取られることを
特徴とするチヨツパ形DC―DCコンバータ回路
。 4 実用新案登録請求の範囲第1項記載の回路に
おいて、低インピーダンス要素がリアクトル側に
接続され、キヤパシタと低インピーダンス要素と
の接続点の電圧から実際値信号に重畳されるべき
脈動電圧が取られることを特徴とするチヨツパ形
DC―DCコンバータ回路。 5 実用新案登録請求の範囲第3項または第4項
記載の回路において、リアクトルの電源側電圧か
ら実際値信号にさらに重畳されるべき脈動電圧が
取られることを特徴とするチヨツパ形DC―DC
コンバータ回路。 6 実用新案登録請求の範囲第1項記載の回路に
おいて、脈動電圧が抵抗を介して比較回路の実際
値信号入力に与えられることを特徴とするチヨツ
パ形DC―DCコンバータ回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19488286U JPS63100990U (ja) | 1986-12-18 | 1986-12-18 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19488286U JPS63100990U (ja) | 1986-12-18 | 1986-12-18 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63100990U true JPS63100990U (ja) | 1988-06-30 |
Family
ID=31152265
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19488286U Pending JPS63100990U (ja) | 1986-12-18 | 1986-12-18 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63100990U (ja) |
-
1986
- 1986-12-18 JP JP19488286U patent/JPS63100990U/ja active Pending