JPS6284764U - - Google Patents
Info
- Publication number
- JPS6284764U JPS6284764U JP17501785U JP17501785U JPS6284764U JP S6284764 U JPS6284764 U JP S6284764U JP 17501785 U JP17501785 U JP 17501785U JP 17501785 U JP17501785 U JP 17501785U JP S6284764 U JPS6284764 U JP S6284764U
- Authority
- JP
- Japan
- Prior art keywords
- continuous pulse
- circuit
- pulse
- reference time
- shot multivibrator
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Measuring Phase Differences (AREA)
Description
第１図は本考案の一実施例の回路図、第２図は
第１図のタイミングチヤートである。 １，２……基準時間Ｔのパルスを出力するワン
シヨツトマルチバイブレータ、３，４……遅延回
路、５，６……フリツプフロツプ、７……論理和
回路、８〜１２……信号、Ｔ……基準時間。
第１図のタイミングチヤートである。 １，２……基準時間Ｔのパルスを出力するワン
シヨツトマルチバイブレータ、３，４……遅延回
路、５，６……フリツプフロツプ、７……論理和
回路、８〜１２……信号、Ｔ……基準時間。
Claims (1)
- 第１の連続パルスと第２の連続パルスとの位相
差を予め設定された基準時間Ｔと比較する回路に
おいて、第１の連続パルスを受けて動作する遅延
回路４および基準時間Ｔのパルスを出力するワン
シヨツトマルチバイブレータ１と、第２の連続パ
ルスを受けて動作する遅延回路３および基準時間
Ｔのパルスを出力するワンシヨツトマルチバイブ
レータ２と、前記遅延回路３の出力でワンシヨツ
トマルチバイブレータ１の出力信号をラツチする
フリツプフロツプ５と、前記遅延回路４の出力で
ワンシヨツトマルチバイブレータ２の出力信号を
ラツチするフリツプフロツプ６と、前記フリツプ
フロツプ５と６との出力の論理和回路７とを備え
、前記第１連続パルスと第２連続パルスとの位相
差が前記基準時間Ｔより大きいか小さいかを検出
するように構成したことを特徴とする位相差比較
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17501785U JPS6284764U (ja) | 1985-11-15 | 1985-11-15 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17501785U JPS6284764U (ja) | 1985-11-15 | 1985-11-15 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6284764U true JPS6284764U (ja) | 1987-05-29 |
Family
ID=31113948
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17501785U Pending JPS6284764U (ja) | 1985-11-15 | 1985-11-15 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6284764U (ja) |
-
1985
- 1985-11-15 JP JP17501785U patent/JPS6284764U/ja active Pending