JPS6273616U - - Google Patents

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JPS6273616U
JPS6273616U JP16519085U JP16519085U JPS6273616U JP S6273616 U JPS6273616 U JP S6273616U JP 16519085 U JP16519085 U JP 16519085U JP 16519085 U JP16519085 U JP 16519085U JP S6273616 U JPS6273616 U JP S6273616U
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JP
Japan
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external input
circuit
jack
input signal
signal amplification
Prior art date
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Application number
JP16519085U
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Landscapes

  • Control Of Amplification And Gain Control (AREA)
  • Amplifiers (AREA)

Description

【図面の簡単な説明】
第1図はこの考案の一実施例を示す外部入力信
号増幅回路図、第2図a,bはこの考案の主要な
回路構成図と、他の実施例を示す回路構成図、第
3図はこの考案のさらに他の実施例を示す回路図
、第4図は複数入力におけるミキシングの説明図
である。 図中、J,Jはジヤツク端子、M,M
は(マイクロホン)プラグ、R,R,R
ミキシング抵抗、S,S,Sはジヤツク端
子のスイツチ、OPは演算増幅器、r〜r
フイードバツク回路の抵抗を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数個の外部入力信号をそれぞれジヤツク端子
    で受けて単一の増幅回路により増幅する外部入力
    信号増幅回路において、前記ジヤツク端子にプラ
    グが挿入されたときに開閉するジヤツク接点によ
    り、増幅回路の負帰還回路に挿入されている抵抗
    値を制御して利得を変化するように構成したこと
    を特徴とする外部入力信号増幅回路。
JP16519085U 1985-10-29 1985-10-29 Pending JPS6273616U (ja)

Priority Applications (1)

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JP16519085U JPS6273616U (ja) 1985-10-29 1985-10-29

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JP16519085U JPS6273616U (ja) 1985-10-29 1985-10-29

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Publication Number Publication Date
JPS6273616U true JPS6273616U (ja) 1987-05-12

Family

ID=31094996

Family Applications (1)

Application Number Title Priority Date Filing Date
JP16519085U Pending JPS6273616U (ja) 1985-10-29 1985-10-29

Country Status (1)

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JP (1) JPS6273616U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH024313U (ja) * 1988-06-18 1990-01-11

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH024313U (ja) * 1988-06-18 1990-01-11

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