JPS6255175U - - Google Patents

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JPS6255175U
JPS6255175U JP14657385U JP14657385U JPS6255175U JP S6255175 U JPS6255175 U JP S6255175U JP 14657385 U JP14657385 U JP 14657385U JP 14657385 U JP14657385 U JP 14657385U JP S6255175 U JPS6255175 U JP S6255175U
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JP
Japan
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output
memory
clock oscillator
switch
down counter
Prior art date
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JP14657385U
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  • Testing, Inspecting, Measuring Of Stereoscopic Televisions And Televisions (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第1図は本考案の実施例によりメモリ回路の構
成図、第2図は従来例のメモリ回路の構成図、第
3図は第2図のメモリ回路による波形観測例、第
4図は第1図のメモリ回路の動作説明図、第5,
6図は第1図のメモリ回路による波形観測例であ
る。 1,2:メモリ、3:切換器、4:D/A変換
器、5:クロツク発振器、9:水平位置設定回路
、10:アツプダウンカウンタ、11,12:切
換器、13,14:ANDゲート。

Claims (1)

    【実用新案登録請求の範囲】
  1. デジタルストレージオシロスコープのメモリ回
    路を、クロツク発振器と、水平位置設定回路の設
    定により前記クロツク発振器の出力の伝送タイミ
    ングを制御するアツプダウンカウンタと、一方の
    切換器がこのアツプダウンカウンタの出力を、他
    方の切換器が前記クロツク発振器の出力で動作さ
    せるレベルHを出力する第1、第2の切換器と、
    この切換器の出力と前記クロツク発振器の出力を
    入力とする第1、第2のANDゲートと、このA
    NDゲートの出力をクロツク入力する第1、第2
    のメモリとで構成し、何れか一方のメモリ出力の
    ダイミングを可変できるようにしたことを特徴と
    するデイジタルストレージオシロスコープ。
JP14657385U 1985-09-27 1985-09-27 Pending JPS6255175U (ja)

Priority Applications (1)

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JP14657385U JPS6255175U (ja) 1985-09-27 1985-09-27

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JP14657385U JPS6255175U (ja) 1985-09-27 1985-09-27

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Publication Number Publication Date
JPS6255175U true JPS6255175U (ja) 1987-04-06

Family

ID=31059162

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14657385U Pending JPS6255175U (ja) 1985-09-27 1985-09-27

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JP (1) JPS6255175U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2020122705A (ja) * 2019-01-30 2020-08-13 東芝情報システム株式会社 画像処理装置及び画像処理プログラム

Cited By (1)

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