JPS6249199U - - Google Patents
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- Publication number
- JPS6249199U JPS6249199U JP14059085U JP14059085U JPS6249199U JP S6249199 U JPS6249199 U JP S6249199U JP 14059085 U JP14059085 U JP 14059085U JP 14059085 U JP14059085 U JP 14059085U JP S6249199 U JPS6249199 U JP S6249199U
- Authority
- JP
- Japan
- Prior art keywords
- power supply
- controlled
- port
- frequency
- transistor
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Electromechanical Clocks (AREA)
Description
第１図は本発明の一実施例装置の構成を示す回
路図、第２図は従来装置の構成を示す回路図であ
る。 １，６…マイクロコンピユータ、２〜４…イン
バータ、５，９…電子音ブザー、７…分周回路、
８…トランジスタ、Ｒ１〜Ｒ５…抵抗。
路図、第２図は従来装置の構成を示す回路図であ
る。 １，６…マイクロコンピユータ、２〜４…イン
バータ、５，９…電子音ブザー、７…分周回路、
８…トランジスタ、Ｒ１〜Ｒ５…抵抗。
Claims (1)
- マスタ・クロツクを入力して分周する分周回路
と、分周して得られたクロツクが制御側電極に印
加されるとともに被制御側電極の一方が電源に接
続され被制御側電極の他方がマイクロコンピユー
タのポートに接続されたトランジスタと、前記ポ
ートと前記電源との間に接続されたプルアツプ抵
抗と、前記トランジスタの被制御側電極のいずれ
か一方とグランドとの間に接続された電子音ブザ
ーとを備えてなることを特徴とする発音装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14059085U JPS6249199U (ja) | 1985-09-12 | 1985-09-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14059085U JPS6249199U (ja) | 1985-09-12 | 1985-09-12 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6249199U true JPS6249199U (ja) | 1987-03-26 |
Family
ID=31047577
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14059085U Pending JPS6249199U (ja) | 1985-09-12 | 1985-09-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6249199U (ja) |
-
1985
- 1985-09-12 JP JP14059085U patent/JPS6249199U/ja active Pending