JPS622705Y2 - - Google Patents
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- JPS622705Y2 JPS622705Y2 JP1982136177U JP13617782U JPS622705Y2 JP S622705 Y2 JPS622705 Y2 JP S622705Y2 JP 1982136177 U JP1982136177 U JP 1982136177U JP 13617782 U JP13617782 U JP 13617782U JP S622705 Y2 JPS622705 Y2 JP S622705Y2
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Description
【考案の詳細な説明】 産業上の利用分野 この考案は、ICを内蔵したカードに関する。[Detailed explanation of the idea] Industrial applications This invention relates to a card with a built-in IC.
背景技術とその問題点
クレジツトカードやIDカードなどにおいて、
そのカード内にICを設け、これにより暗証番号
や本人であることのIDコードなど主として個人
に関するデータの提供を可能にしたカードが考え
られている。Background technology and its problems In credit cards, ID cards, etc.
A card is being considered that has an IC installed inside the card, which makes it possible to provide data primarily related to the individual, such as a personal identification number and ID code to identify the individual.
すなわち、第１図及び第２図において、１はそ
のようなICを内蔵したカードを示し、これはポ
リ塩化ビニルなどのプラスチツクにより全体が長
方形のカード状に形成されると共に、例えばその
短辺側に、開口が長方形の凹部２が形成され、こ
の凹部２の開口を塞ぐようにプリント基板３が接
着により設けられている。このプリント基板３
は、両面スルーホール基板とされているもので、
その表側（外側）の面にはカード１の短辺に沿う
ように複数の銅箔パターン３Ａが形成されて接続
端子（接点）T1〜Tnとされ、裏側（内側）の面
には、引き出し線となる銅箔パターン３Ｂがパタ
ーン３Ａに対応して形成されると共に、これらパ
ターン３Ａと３Ｂとは、それぞれ対応するもの同
志が、スルーホールを通じて互いに接続されてい
る。 That is, in FIGS. 1 and 2, 1 indicates a card incorporating such an IC, and this card is made of plastic such as polyvinyl chloride and has a rectangular card shape as a whole. A recess 2 having a rectangular opening is formed in the recess 2, and a printed circuit board 3 is provided by adhesion so as to close the opening of the recess 2. This printed circuit board 3
is a double-sided through-hole board,
A plurality of copper foil patterns 3A are formed along the short sides of the card 1 on its front (outside) surface to serve as connection terminals (contacts) T 1 to Tn, and on its back (inside) surface, there are drawers. A copper foil pattern 3B serving as a line is formed corresponding to the pattern 3A, and corresponding patterns 3A and 3B are connected to each other through through holes.
また、４はＣ−MOSにより構成され、暗証番
号やIDコードなど主として個人に関するデータ
を有するICを示し、これは、例えば、CPUと、
プログラム及び個人に関するデータが書き込まれ
ているROMと、ワークエリア用のRAMとが一体
化された１チツプマイコンである。そして、この
IC４の端子は、パターン３Ｂにそれぞれハンダ
付けされ、従つて、IC４は、パターン３Ｂ及び
スルーホールを通じて端子T1〜Tnに接続されて
いる。 In addition, 4 indicates an IC that is composed of C-MOS and mainly has personal data such as a PIN number and ID code.
It is a one-chip microcomputer that integrates a ROM in which programs and personal data are written, and a RAM for a work area. And this
The terminals of IC4 are each soldered to pattern 3B, and therefore IC4 is connected to terminals T1 to Tn through pattern 3B and through holes.
さらに、５は例えばガラスエポキシ樹脂にセラ
ミツクの粉末を混入した比較的硬い充填材であ
る。また、６Ａは抜ち出しによる形成されたカー
ド番号などの表示部、６Ｂは粗面処理などにより
形成された名前などのメモ部、６Ｃはカード挿入
方向を示す矢印である。 Furthermore, 5 is a relatively hard filler made of, for example, glass epoxy resin mixed with ceramic powder. Further, 6A is a display section such as a card number formed by extraction, 6B is a memo section such as a name formed by surface roughening, etc., and 6C is an arrow indicating the card insertion direction.
従つて、このカード１を使用する場合には、こ
のカード１を矢印６Ｃにしたがつてカード読み取
り装置（図示せず）の挿入孔に挿入すればよい。
すると、装置の接点がカード１の端子T1〜Tnに
接触して装置からカード１のIC４に動作電圧が
供給されると共に、制御信号が供給され、これに
よりIC４からデータが取り出されて装置に供給
される。 Therefore, when using this card 1, it is sufficient to insert this card 1 into the insertion hole of a card reader (not shown) in the direction of arrow 6C.
Then, the contacts of the device come into contact with the terminals T 1 to Tn of card 1, and the device supplies operating voltage to IC4 of card 1, as well as a control signal, which causes data to be taken out from IC4 and sent to the device. Supplied.
こうして、このカード１によれば、暗証番号や
IDコードなどを提供できる。 In this way, according to this card 1, the PIN number and
ID codes etc. can be provided.
ところが、このようなカード１では、端子T1
〜Ｔoがカード１の表面に露出していると共に、
IC４がＣ−MOSにより構成されているので、静
電気によりIC４が破壊されてしまう。因みに、
Ｃ−MOS単体の耐圧は200V程度であるのに対
し、静電気は数千Ｖに達することがある。 However, in such card 1, terminal T 1
~T o is exposed on the surface of card 1, and
Since the IC4 is composed of C-MOS, the IC4 will be destroyed by static electricity. By the way,
While the withstand voltage of a single C-MOS is about 200V, static electricity can reach several thousand volts.
このため、一般には、Ｃ−MOSの入力インピ
ーダンスが大きいことを利用し、端子T1〜Ｔoと
IC４との間の信号ラインに、数十ｋΩの抵抗器
を直列接続して静電気によるIC４の破壊を防止
している。 For this reason, in general, the high input impedance of C-MOS is utilized to connect terminals T 1 to T o .
A resistor of several tens of kilohms is connected in series to the signal line between the IC 4 and the IC 4 to prevent damage to the IC 4 due to static electricity.
しかしながら、IC４の動作時には、IC４の電
源ラインには1mA程度の動作電流が流れるの
で、その電源ラインに数十ｋΩもの抵抗器を直列
接続することはできず、従つて、電源ラインを通
じる静電気によりIC４が破壊されることがあつ
た。 However, when IC4 is in operation, an operating current of about 1mA flows through the power supply line of IC4, so it is not possible to connect a resistor of several tens of kilohms in series to the power supply line. IC4 was sometimes destroyed.
考案の目的
この考案は、上述のような問題点を解決しよう
とするものである。Purpose of the invention This invention attempts to solve the problems mentioned above.
考案の概要
この考案においては、ICを内蔵し、カード本
体の表面に、上記ICの各端子にそれぞれ接続さ
れた接続端子を有すると共に、この接続端子のう
ちの電源端子と、上記ICの電源端子との間に抵
抗器が直列接続され、上記ICの電源端子と共通
端子との間に、上記ICの動作電圧により大きな
ツエナー電圧のツエナーダイオードと、コンデン
サとが並列接続されたカードである。Summary of the invention In this invention, an IC is built in, and the surface of the card body has connection terminals connected to each terminal of the above IC, and a power supply terminal among these connection terminals and a power supply terminal of the above IC. A resistor is connected in series between the IC, and a Zener diode with a Zener voltage higher than the operating voltage of the IC and a capacitor are connected in parallel between the power supply terminal of the IC and a common terminal.
従つて、カードに内蔵されているICを静電気
による破壊から防止することができ、カードの信
頼性を向上することができる。 Therefore, the IC built into the card can be prevented from being destroyed by static electricity, and the reliability of the card can be improved.
実施例
第３図において、端子T1は電源端子、端子T2
は共通端子（接地端子）、端子T3〜Ｔoは信号端
子とする。Example In Fig. 3, terminal T 1 is a power supply terminal, terminal T 2
is a common terminal (ground terminal), and terminals T 3 to T o are signal terminals.
そして、信号端子T3〜Ｔoと、IC４の対応する
端子t3〜ｔoとの間のパターン３Ｂには、上述し
た数十ｋΩの抵抗器R3〜Rnがそれぞれ直列接続
される。また、電源端子T1とIC４の電源端子t1と
の間のパターン３Ｂには、抵抗器R1が直列接続
され、共通端子T2とIC４の共通端子t2とは、パタ
ーン３Ｂによりそのまま接続されると共に、端子
t1と端子t2との間に、ツエナーダイオードD1及び
コンデンサC1が接続される。 The above-mentioned resistors R 3 -Rn of several tens of kilohms are connected in series to the pattern 3B between the signal terminals T 3 -T o and the corresponding terminals t 3 -t o of the IC 4, respectively. In addition, a resistor R 1 is connected in series to the pattern 3B between the power supply terminal T 1 and the power supply terminal t 1 of the IC4, and the common terminal T 2 and the common terminal t 2 of the IC4 are directly connected by the pattern 3B. and the terminal
A Zener diode D 1 and a capacitor C 1 are connected between t 1 and terminal t 2 .
この場合、抵抗器R1は、IC４に動作電流が流
れたとき、あまり大きな電圧降下を生じない程度
の値、例えば100Ωとされ、ダイオードD1は、IC
４の動作電圧よりも大きいツエナー電圧で、か
つ、IC４の耐圧よりも小さなツエナー電圧、特
にIC４の動作電圧に近いツエナー電圧、例えば
IC４の動作電圧が4.5Vとすれば、ツエナー電圧
は6.8Vとされ、さらに、コンデンサC1は高周波
特性に優れ、かつ、IC４に供給される電圧の立
ち上がりをゆるやかにする値、例えば0.01μＦと
される。また、素子R1，R3〜Ｒo，D1，C1は、凹
部２内に位置するように、基板３のパターン３Ｂ
側に設けられる。 In this case, the resistor R1 is set to a value that does not cause a large voltage drop when the operating current flows through the IC4, for example 100Ω, and the diode D1 is set to a value that does not cause a large voltage drop when the operating current flows through the IC4.
A Zener voltage larger than the operating voltage of IC4 and smaller than the withstand voltage of IC4, especially a Zener voltage close to the operating voltage of IC4, e.g.
If the operating voltage of IC4 is 4.5V, the Zener voltage is 6.8V, and the capacitor C1 has excellent high frequency characteristics and has a value that makes the rise of the voltage supplied to IC4 gradual, for example, 0.01μF. be done. Further, the elements R 1 , R 3 to R o , D 1 , C 1 are arranged in the pattern 3B of the substrate 3 so as to be located in the recess 2.
installed on the side.
このような構成によれば、通常の使用時には、
抵抗器R1に動作電流が流れるが、その電圧降下
は小さく、また、ダイオードD1のツエナー電圧
はIC４の動作電圧よりも大きいので、IC４には
正常に動作電圧が供給される。そして、抵抗器
R3〜Ｒoの値に比べてIC４の入力インピーダンス
は十分に大きいと共に、このカード１からデータ
を読み取る回路の入力インピーダンスも十分に大
きくできるので、IC４に対して正常に信号をア
クセスできる。 According to such a configuration, during normal use,
Although the operating current flows through the resistor R1 , the voltage drop is small, and the Zener voltage of the diode D1 is greater than the operating voltage of IC4, so the operating voltage is normally supplied to IC4. And the resistor
The input impedance of the IC4 is sufficiently large compared to the values of R3 to R0 , and the input impedance of the circuit that reads data from the card 1 can also be made sufficiently large, so that signals can be accessed normally to the IC4.
一方、端子T1に静電気が加えられた場合に
は、抵抗器R1及びツエナーダイオードD1によ
り、その静電気の電圧は制限され、IC４にはダ
イオードD1のツエナー電圧に等しい電圧の静電
気しか加わらない。従つて、IC４を静電気から
保護できる。 On the other hand, when static electricity is applied to terminal T1 , the voltage of the static electricity is limited by resistor R1 and Zener diode D1 , and only static electricity of a voltage equal to the Zener voltage of diode D1 is applied to IC4. do not have. Therefore, IC4 can be protected from static electricity.
また、一般に、ツエナーダイオードが電圧を制
限する場合、その電圧が供給されてから実際に電
圧が制限されるまでには動作遅れがあり、この動
作遅れ期間には、制限されない電圧が出力されて
しまう。しかし、この考案によれば、その動作遅
れ期間における静電気は、コンデンサC1（及び
抵抗器R1）により吸収されて端子t1には耐圧以上
の静電気は加えられず、従つて、この動作遅れ期
間もIC４を静電気から保護できる。 Additionally, in general, when a Zener diode limits voltage, there is an operation delay from when that voltage is supplied until the voltage is actually limited, and during this operation delay period, a voltage that is not limited is output. . However, according to this invention, static electricity during the operation delay period is absorbed by the capacitor C 1 (and resistor R 1 ), and no static electricity exceeding the withstand voltage is applied to the terminal t 1 . It can also protect IC4 from static electricity.
実験によれば、上述の数値例のとき、容量が
200pFのコンデンサを10kVの電圧で充電し、こ
の充電されたコンデンサを端子T1，T2間に接続
して静電気の印加をシミユレーシヨンしても、
IC４を十分に保護できた。 According to experiments, in the numerical example above, the capacity is
Even if you charge a 200pF capacitor with a voltage of 10kV and connect this charged capacitor between terminals T 1 and T 2 to simulate the application of static electricity,
IC4 was sufficiently protected.
なお、上述において、端子t3〜ｔoとt2との間
に、ダイオードD1に対応するダイオードをそれ
ぞれ接続してもよい。 In addition, in the above description, diodes corresponding to the diode D 1 may be connected between the terminals t 3 to t 0 and t 2 .
考案の効果
カードに内蔵されているICを静電気による破
壊から防止することができ、カードの信頼性を向
上させることができる。Effects of the invention: The IC built into the card can be prevented from being destroyed by static electricity, and the reliability of the card can be improved.
第１図はこの考案を説明するための斜視図、第
２図は第１図のＡ−Ａ線における拡大断面図、第
３図はこの考案の一例の接続図である。
１はカード、４はICである。
FIG. 1 is a perspective view for explaining this invention, FIG. 2 is an enlarged sectional view taken along line A--A in FIG. 1, and FIG. 3 is a connection diagram of an example of this invention. 1 is a card and 4 is an IC.
Claims (1)
各端子にそれぞれ接続された接続端子を有すると
共に、この接続端子のうちの電源端子と、上記
ICの電源端子との間に抵抗器が直列接続され、
上記ICの電源端子と共通端子との間に、上記IC
の動作電圧より大きなツエナー電圧のツエナーダ
イオードと、コンデンサとが並列接続されたカー
ド。 It has a built-in IC, and has connection terminals connected to each terminal of the above IC on the surface of the card body, and among these connection terminals, the power terminal and the above
A resistor is connected in series with the power supply terminal of the IC,
Connect the above IC between the power supply terminal and common terminal of the above IC.
A card in which a Zener diode with a Zener voltage greater than the operating voltage of the capacitor is connected in parallel.
Priority Applications (1)
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|---|---|---|---|
| JP13617782U JPS5940955U (en) | 1982-09-08 | 1982-09-08 | card |
Applications Claiming Priority (1)
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|---|---|---|---|
| JP13617782U JPS5940955U (en) | 1982-09-08 | 1982-09-08 | card |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5940955U JPS5940955U (en) | 1984-03-16 |
| JPS622705Y2 true JPS622705Y2 (en) | 1987-01-22 |
Family
ID=30306267
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13617782U Granted JPS5940955U (en) | 1982-09-08 | 1982-09-08 | card |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5940955U (en) |
Families Citing this family (1)
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|---|---|---|---|---|
| JP2010160647A (en) * | 2009-01-07 | 2010-07-22 | Toshiba Corp | Semiconductor memory card |
Citations (2)
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|---|---|---|---|---|
| JPS5640675B2 (en) * | 1973-12-27 | 1981-09-22 | ||
| JPS5819639U (en) * | 1981-07-31 | 1983-02-07 | 旭東電商株式会社 | Shopping basket with calculator |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS5640675U (en) * | 1979-09-05 | 1981-04-15 |
-
1982
- 1982-09-08 JP JP13617782U patent/JPS5940955U/en active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5640675B2 (en) * | 1973-12-27 | 1981-09-22 | ||
| JPS5819639U (en) * | 1981-07-31 | 1983-02-07 | 旭東電商株式会社 | Shopping basket with calculator |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5940955U (en) | 1984-03-16 |
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