JPS62235629A - Light pen control circuit - Google Patents

Light pen control circuit

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Publication number
JPS62235629A
JPS62235629A JP61078646A JP7864686A JPS62235629A JP S62235629 A JPS62235629 A JP S62235629A JP 61078646 A JP61078646 A JP 61078646A JP 7864686 A JP7864686 A JP 7864686A JP S62235629 A JPS62235629 A JP S62235629A
Authority
JP
Japan
Prior art keywords
light pen
circuit
display
address information
control circuit
Prior art date
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Pending
Application number
JP61078646A
Other languages
Japanese (ja)
Inventor
Yasuhiro Suzuki
康弘 鈴木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP61078646A priority Critical patent/JPS62235629A/en
Publication of JPS62235629A publication Critical patent/JPS62235629A/en
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Abstract

PURPOSE:To improve operativity by holding the brightness of display information for light pen detection constant on a display picture regardless of the brightness of other video signals. CONSTITUTION:A light pen control circuit consists of a CRT control circuit 1, a multiplexing circuit 2, a memory circuit 3, a video composing circuit 11 including resistances 5-6, a transistor (TR) 7, and diodes 8-9, and a gate circuit 12 corresponding to a light pen and a display 10. When light pen attribute data 106 are inputted through a gate circuit 12, the data are inputted to the display 10 through the TR 7 and diode 8 in this video composing circuit 11. If the data 106 are effective and a video signal 108 is also effective, light pen detection display information can be displayed on the display 10 and its brightness is held high regardless of the video signal 108 so that it is easily detected.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はライトペン制御回路に関する。[Detailed description of the invention] [Industrial application field] The present invention relates to light pen control circuits.

〔従来の技術〕[Conventional technology]

従来、この種のライトペン制御回路にHいでは。 Conventionally, this type of light pen control circuit has no H.

ライトペン検出用のアトリビ島−Fの表示は、ライトペ
ンが押下された時に表示画面全体が明るくされるか、ま
たは常時表示画面が明るくされる状態にSいて行われて
いるのが一般である。
The display of Atribi Island-F for light pen detection is generally performed by brightening the entire display screen when the light pen is pressed, or by keeping the display screen bright all the time. .

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

上述した従来のライトペン制御回路にSいては。 Regarding the conventional light pen control circuit described above.

ライトペン検出用のライトペンアトリビュートデータの
表示が、ライトペンが押下された時に表示画面全体1:
明るくしたり、また常に表示画面ン明るくしているため
に、操作者に対して視覚上の不快感を与え、また、操作
性にどける不具合を生じるという欠点がある。
The display of light pen attribute data for light pen detection is displayed on the entire screen 1 when the light pen is pressed:
Since the display screen is made brighter and the display screen is kept brighter all the time, there are disadvantages in that it gives a visual discomfort to the operator and also causes problems in operability.

〔問題点?解決するための手段〕〔problem? Means to solve]

本発明の2イトベン制#11j回路は、所定のC14T
表示装置に対する水平駆動信号、垂直駆動イに号および
表示アドレス情報音発生するC It ”r制御回路と
、前記表示アドレス情謙と上位より送られてくるライト
アドレス情報と?入力し、上位より送られてくるライト
セレクト信号の有効性に関連して。
The two-event system #11j circuit of the present invention has a predetermined C14T
A control circuit that generates a horizontal drive signal for the display device, a vertical drive signal, and a display address information sound, and the display address information and write address information sent from a higher-level device are inputted and sent from a higher-level device. related to the validity of the light select signal that is generated.

いずれか一方のアドレス情報を出力−f″るマルチプレ
クサ回路と、前記ライトアドレス情報の有効時には所定
のメモリライトデータが書込まれ、且つ前記CRT表示
装置に16ける表示期間中においては前記メモリライト
データが読出されてライトペンアトリビエートデータと
して出力されるメモリ回路と、ライトベンより出力さr
Lbライトベンストローブ信号の有効時に入力される前
記ライトベンアトリビュートデータと所定のビデオ信号
とを第1図は本発明の一実施例を示すブロック図である
。第1図に示されろように1本実施例は、ライトベン4
およびディスプレイ10に対応して。
a multiplexer circuit that outputs one of the address information -f'', and when the write address information is valid, predetermined memory write data is written, and during the display period of 16 on the CRT display device, the memory write data is A memory circuit is read out and output as light pen attribute data, and a
FIG. 1 is a block diagram showing an embodiment of the present invention. One embodiment, as shown in FIG.
and corresponding to display 10.

C几T制御回路1と、マルチプレクス回路2と。A C-T control circuit 1 and a multiplex circuit 2.

メモ+7回路3と、抵抗5zよび6.トランジスタ7、
ダイオード8および9′lt含むビデオ合成回路11と
、ゲート回路12と、を備えている。
Memo +7 circuit 3, resistor 5z and 6. transistor 7,
It includes a video synthesis circuit 11 including diodes 8 and 9'lt, and a gate circuit 12.

第1図に3いて、CRT制御回路1からは、ディスプレ
イ1Oyr−駆動するために必要な水平駆動信号101
jdよび垂直駆動信号102か出方されて、それぞれデ
ィスプレイ10に送られるとともに1表示に必要な表示
アドレス情報103が出方されて、マルチプレクス回路
2に送られる。マルチプレクス回路2に対しては、端子
51jdよび52より、それぞれ上位より与えられるラ
イトアドレス情報104sよび所定のライトセレクト信
号109も入力されてSす、ライトセレクト信号109
により制御されて、表示アドレス情報103gよびライ
トアドレス情報104の、いずれか一方が切替えられて
出方されメモリ回路3に入力される。この場合1表示期
間中においては1表示アドレス情報103がメモリ回路
3に入力され、ライトセレクト信号109が有効である
期間に3いては、ライトアドレス情報104がメモリ回
路3に入力される。
3 in FIG. 1, a horizontal drive signal 101 necessary for driving the display 1Oyr is output from the CRT control circuit 1.
jd and vertical drive signal 102 are output and sent to the display 10, respectively, and display address information 103 necessary for one display is output and sent to the multiplex circuit 2. Write address information 104s and a predetermined write select signal 109 given from the higher order are also input to the multiplex circuit 2 through terminals 51jd and 52, respectively.
Under the control, either the display address information 103g or the write address information 104 is switched and output and inputted to the memory circuit 3. In this case, one display address information 103 is input to the memory circuit 3 during one display period, and write address information 104 is input to the memory circuit 3 during a period in which the write select signal 109 is valid.

一方、端子53からは上位よりのメモリライトデータ1
05がメモリ回路3に送られず来てKす、このメモリラ
イトデータ1osvメモリ回路3に書込む場合には、ラ
イトセレクト信号109’!i有効にし、ライトアドレ
ス情報104ya/与えることにより、ライトアドレス
104に示される回路3の目的の場所に、メモリライト
データ1o5は書込まれる。メモリ回路3に書込まれた
メモリライトデータ105は、表示期間中にSいては、
前記C几T制御回路lより入力される表示アドレス情報
103により周期的に読出され、ライトペンアトリビエ
ートデータ106としてゲート回路12に送られる。
On the other hand, from the terminal 53, memory write data 1 from the higher order
05 is not sent to the memory circuit 3, and when writing this memory write data 1osv to the memory circuit 3, write select signal 109'! By enabling i and providing the write address information 104ya/, the memory write data 1o5 is written to the target location of the circuit 3 indicated by the write address 104. The memory write data 105 written in the memory circuit 3 is stored in S during the display period.
It is read out periodically according to the display address information 103 inputted from the C-T control circuit 1, and sent to the gate circuit 12 as light pen attribute data 106.

ライトベン4より出力され、ゲート回路12に入力され
るライトベンストローブ信号107は。
The light ben strobe signal 107 is output from the light ben 4 and input to the gate circuit 12.

ライトベン4が押下されている期間だけ有効になる信号
で、ゲート回路12に入力it+−^ライEベンアトリ
ビエートデータ106は、ライトベン4が押下されてい
る期間だけゲート回路12’に経由してビデオ合成回路
11に入力される。ビデオ合成回路11に2いては、ゲ
ート回路12’Y経由してライトペンアトリビエートデ
ータ106が入力される時には、トランジスタ7が動作
状態となり。
This is a signal that is valid only while the light ben 4 is pressed down, and the input it+-^rai Eben attribute data 106 is input to the gate circuit 12 via the gate circuit 12' only while the light ben 4 is being pressed down. The signal is input to the video synthesis circuit 11. In the video synthesis circuit 11 2, when the light pen attribute data 106 is inputted via the gate circuit 12'Y, the transistor 7 is activated.

ダイオード8を通してライトベンアトリビュートデータ
はディスプレイ10に入力される。このライトベンアト
リビュートデータ106が有効で。
Light Venn attribute data is input to a display 10 through a diode 8. This light vent attribute data 106 is valid.

且つ端子54よす入力されるビデオ信号108も有効で
ある時には、ダイオード8のアノード側の電位がダイオ
ード9のアノード側の電位よりも高くなるように、抵抗
58よび6の電圧分圧点を選択することによV%ライト
ペンアトリビエートデータ106が有効な時においては
、ディスプレイ10にライトベン検出用表示情報を表示
することが可能となり、端子54より人力されるビデオ
信号lO8に関せず、一定の明るさに固定することが可
能となる。な8.端子55から供給される直流電圧に対
応して、抵抗5sよび6による分圧しペルを適宜選択す
ることにより、ライトベン4による検出のし易い高輝度
が容易に得られる。また。
In addition, when the video signal 108 input to the terminal 54 is also valid, the voltage dividing points of the resistors 58 and 6 are selected so that the potential on the anode side of the diode 8 is higher than the potential on the anode side of the diode 9. By doing this, when the V% light pen attribute data 106 is valid, it becomes possible to display the display information for light pen detection on the display 10, regardless of the video signal lO8 inputted from the terminal 54. It becomes possible to fix the brightness to a constant level. 8. By appropriately selecting the voltage dividing voltage using the resistors 5s and 6 in accordance with the DC voltage supplied from the terminal 55, high brightness that can be easily detected by the light ben 4 can be easily obtained. Also.

ライトペンアトリビエートデータ106は、ライトペン
4が押下された時だけ表示され、且つライトペン検出用
表示清報が表示されていない場所は。
The light pen attribute data 106 is displayed only when the light pen 4 is pressed, and in places where the light pen detection display information is not displayed.

通常の明るさに保持される。Maintains normal brightness.

〔発明の効果〕〔Effect of the invention〕

以上説明したように9本発明は、ライトベン検出用の表
示情報の表示画面上の輝度を、その他のビデオ信号の輝
度にかかわりなく、一定の高輝度に保持することにより
、ライトペンの演出能力を低下させることなく、操作者
に対する不快感を排除させるとともに、操作性を改善す
ることができるという効果がある。
As explained above, the present invention improves the performance ability of a light pen by keeping the brightness on the display screen of display information for light pen detection at a constant high brightness regardless of the brightness of other video signals. This has the effect of eliminating discomfort for the operator and improving operability without degrading the performance.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例の要部を示すブロック図であ
る。 図にgいて、1・・・・・・CルT制御回路、2・・・
・・・マルチプレクス回路、3・・・・・・メモリ回路
、4・・・・・・ライトペン、5,6・・・・・・抵抗
、7・・・・・・トランジスタ。 8.9・・・・・・ダイオード、10・・・・・・ディ
スプレイ。 11・・・・・・ビデオ合成回路、12・・・・・・ゲ
ート回路。 7・−一 代理人 弁理士  内 原   晋゛ノ。 鴫2.,7′
FIG. 1 is a block diagram showing the main parts of an embodiment of the present invention. In the figure, 1...CT control circuit, 2...
...Multiplex circuit, 3...Memory circuit, 4...Light pen, 5, 6...Resistor, 7...Transistor. 8.9...diode, 10...display. 11...Video synthesis circuit, 12...Gate circuit. 7.-One agent, patent attorney, Susumu Uchihara. Shizu 2. ,7'

Claims (1)

【特許請求の範囲】 所定のCRT表示装置に対する水平駆動信号。 垂直駆動信号および表示アドレス情報を発生するCRT
制御回路と、前記表示アドレス情報と上位より送られて
くるライトアドレス情報とを入力し、上位より送られて
くるライトセレクト信号の有効性に関連して、いずれか
一方のアドレス情報を出力するマルチプレクサ回路と、
前記ライトアドレス情報の有効時には所定のメモリライ
トデータが書込まれ、且つ前記CRT表示装置における
表示期間中においては前記メモリライトデータが読出さ
れてライトペンアトリビュートデータとして出力される
メモリ回路と、ライトペンより出力されるライトペンス
トローブ信号の有効時に入力される前記ライトペンアト
リビュートデータと所定のビデオ信号とを合成するビデ
オ合成回路と、を備えることを特徴とするライトペン制
御回路。
Claims: A horizontal drive signal for a given CRT display. CRT that generates vertical drive signals and display address information
a control circuit, and a multiplexer that inputs the display address information and write address information sent from the upper layer, and outputs either one of the address information in relation to the validity of the write select signal sent from the higher layer. circuit and
a memory circuit in which predetermined memory write data is written when the write address information is valid, and in which the memory write data is read out and output as light pen attribute data during a display period on the CRT display device; A light pen control circuit comprising: a video synthesis circuit that synthesizes the light pen attribute data inputted when a light pen strobe signal outputted from the light pen strobe signal is valid and a predetermined video signal.
JP61078646A 1986-04-04 1986-04-04 Light pen control circuit Pending JPS62235629A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7259754B2 (en) 1999-12-28 2007-08-21 Fujitsu Limited Pen sensor coordinate narrowing method and apparatus

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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