JPS62200973A - Picture information processor - Google Patents

Picture information processor

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Publication number
JPS62200973A
JPS62200973A JP61044465A JP4446586A JPS62200973A JP S62200973 A JPS62200973 A JP S62200973A JP 61044465 A JP61044465 A JP 61044465A JP 4446586 A JP4446586 A JP 4446586A JP S62200973 A JPS62200973 A JP S62200973A
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JP
Japan
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image information
picture information
white
output
input
Prior art date
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Granted
Application number
JP61044465A
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Japanese (ja)
Other versions
JPH0481380B2 (en
Inventor
Toshiaki Shinano
利明 信濃
Yoshinori Aoki
好範 青木
Takushi Iga
卓志 伊賀
Takahiro Kikuchi
多可広 菊地
Toshio Narishima
俊夫 成島
Hiroaki Nouchi
広明 野内
Isafumi Wakabayashi
勇文 若林
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Panasonic System Solutions Japan Co Ltd
Original Assignee
Matsushita Graphic Communication Systems Inc
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Publication of JPS62200973A publication Critical patent/JPS62200973A/en
Publication of JPH0481380B2 publication Critical patent/JPH0481380B2/ja
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Abstract

PURPOSE:To output picture information to recording papers of different sizes in a facsimile or the like by adding the white picture information only to a read end of the picture information every one line, connecting it to the set output part of the white picture information and sequentially connecting to the picture information of the preceding line. CONSTITUTION:A shift register of more bits for one line than an input part 1 is provided in an output part, the white picture information is previously filled in this shift register and the picture information having the white picture information added only to the read end is outputted to said shift regisater. Thereby, when adding the white picture information to the picture information inputted in the input part by using the facsimile or the like and outputting the picture information to the recording papers of the different sizes, only by adding the white picture information only to the rear end of the picture information inputted in the input part, the white picture information with the picture information added to both ends can be outputted in the output part.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は入力された画情報の両端に同じ長さの白情報を
付加して出力する画情報処理装置に関する。
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to an image information processing apparatus that adds white information of the same length to both ends of input image information and outputs the resultant image information.

従来の技術 従来から、ファクシミリ等において、送信原稿サイズよ
りも受信側の記録紙サイズが大きな場合、入力画情報の
両端に白画情報を付加し、入力画像が記録紙の中央に記
録されるようにしだ画情報処理装置が提案されている。
Conventional technology Traditionally, in facsimiles, etc., when the recording paper size on the receiving side is larger than the sending original size, white image information is added to both ends of the input image information so that the input image is recorded in the center of the recording paper. A Nishida image information processing device has been proposed.

以下に従来の画情報処理装置について説明する。A conventional image information processing device will be described below.

第4図は従来の画情報処理装置の概略ブロック図であり
、1はA4サイズの画情報aの入力部、2はシフトレジ
スタからなるB4サイズの画情報iが出力される出力部
、3は白情報の付加を制御する画情報制御部、4は入力
された画情報aを一時記憶しておくラインメモリ、5は
ライトアドレスカウンタ、6はリードアドレスカウンタ
、7は画情報aに付加する白情報のカウントを行なう1
60ビツト白付加カウンタ、8は画情報出力用のカウン
タ、9は出力部2内部に設けられたシフトレジスタであ
る。
FIG. 4 is a schematic block diagram of a conventional image information processing device, in which 1 is an input section for A4 size image information a, 2 is an output section consisting of a shift register and outputs B4 size image information i, and 3 is an output section for outputting B4 size image information i. An image information control unit that controls the addition of white information, 4 a line memory that temporarily stores the input image information a, 5 a write address counter, 6 a read address counter, and 7 a white unit that is added to the image information a. Count information 1
A 60-bit white addition counter, 8 a counter for outputting image information, and 9 a shift register provided inside the output section 2.

以上のように構成された画情報処理装置について、第5
図のタイミング図も参照しながら、以下説明する。
Regarding the image information processing device configured as described above, the fifth
The following description will be made with reference to the timing diagram shown in the figure.

入力部1を介して入力した画情報aに白情報を付加して
B4サイズの画情報として出力部2に出力するために、
まず、1ラインがA4サイズの横の長さに相当する画情
報aが、入力部1から画情報制御部3に入力されると、
画情報制御部3はデータの入力開始と同時にライトアド
レスカウンタ制御信号」を発生し、ライトアドレスカウ
ンタ5の計数動作が開始される。そして、ライトアドレ
スカウンタ5は計数値に基づいてラインメモリ4ヘライ
トアドレス信号kを出力するとともに、画情報制御部3
はこのライトアドレス信号kに基づいて画情報aのライ
ン管理を行ないながらラインメモリ4に画情報aを一旦
記憶させる。
In order to add white information to the image information a input through the input section 1 and output it to the output section 2 as B4 size image information,
First, when image information a, in which one line corresponds to the horizontal length of A4 size paper, is input from the input section 1 to the image information control section 3,
The image information control section 3 generates a "write address counter control signal" at the same time as the start of data input, and the counting operation of the write address counter 5 is started. Then, the write address counter 5 outputs a write address signal k to the line memory 4 based on the counted value, and also outputs a write address signal k to the image information control section 3.
temporarily stores the image information a in the line memory 4 while performing line management of the image information a based on the write address signal k.

次に、1ライン分の画情報aを画情報制御部3により出
力部2へB4サイズの横の長さの画情報の出力を行わせ
るだめに、まず、画情報aに付加する白情報をカウント
するカウンタ7を作動させ、と同時に出力データイネー
ブル信号すをHレベルからLレベルにし、シフトレジス
タ9へ出方する。
Next, in order for the image information control section 3 to output image information of B4 size horizontal length to the output section 2 from the image information a for one line, first, white information to be added to the image information a is added to the image information a. The counting counter 7 is operated, and at the same time, the output data enable signal is changed from the H level to the L level, and is output to the shift register 9.

なお、この時シフトレジスタ9ヘシフトクロツクCが常
に画情報制御部3から出力されている。
Incidentally, at this time, the shift clock C to the shift register 9 is always outputted from the image information control section 3.

さらに、カウンタ7がカウントオーバーすると、その情
報がカウント信号eとして画情報制御部3に入力される
。同時にA4サイズデータ出力用のカウンタ8をリード
アドレスカウンタ6に対してはリードアドレスカウント
信号eとして出力し、。
Furthermore, when the counter 7 overcounts, the information is input to the image information control section 3 as a count signal e. At the same time, the counter 8 for outputting A4 size data is outputted to the read address counter 6 as a read address count signal e.

画情報制御部3はリードアドレスカウンタ6のカウント
値に従ってリードアドレス信号!に基づいてラインメモ
リ4から以前に記憶されていた画情報aを取り出して白
情報の後に続いて出力させる。
The image information control section 3 sends a read address signal according to the count value of the read address counter 6! Based on this, the previously stored image information a is retrieved from the line memory 4 and outputted following the white information.

A4サイズの画情報aが出力されると、カウンタ8がカ
ウントオーバーして信号fを発生し、画情報制御部3と
カウンタ7へ入力される。
When the A4 size image information a is output, the counter 8 counts over and generates a signal f, which is input to the image information control section 3 and the counter 7.

そして、画情報aに相当する画情報制御部3から出力さ
れる画情報りの両端に160ビツトの白画情報gが付加
された状態の画情報iが形成され、この画情報1はシフ
トクロックCと共に出力部2内部のシフトレジスタ24
に送出される。この場合、画情報1ライン分の長さは、
合計するとB4サイズの長さとなる。
Then, image information i is formed in which 160-bit white image information g is added to both ends of the image information output from the image information control unit 3 corresponding to image information a, and this image information 1 is Shift register 24 inside output section 2 along with C
sent to. In this case, the length of one line of image information is
The total length is B4 size.

以上のように、従来の画情報処理装置では、例えばA4
サイズの画情報の両端に160ビツトの白画情報を付加
して、B4サイズの画情報を生成するようにしていた。
As mentioned above, in the conventional image information processing device, for example, A4
B4 size image information was generated by adding 160-bit white image information to both ends of the size image information.

発明が解決しようとする問題点 しかしながら上記従来の構成では、画情報の両端に白画
情報を付加して出力するときに使用するカウンタの数が
多く、しかもこれらのカウンタの計数に応じて白画情報
を付加するようにしているため、装置が複雑になる上に
各カウンタの操作が複雑になるという問題点を有してい
た。
Problems to be Solved by the Invention However, in the conventional configuration described above, there are a large number of counters used when outputting the image information with white image information added to both ends of the image information. Since information is added, there are problems in that the device becomes complicated and the operation of each counter becomes complicated.

本発明は上記従来の問題点を解決するもので、簡易な構
成で、白情報を画情報に付加することのできる画情報処
理装置を提供することを目的とする。
SUMMARY OF THE INVENTION The present invention is intended to solve the above-mentioned conventional problems, and an object of the present invention is to provide an image information processing device that has a simple configuration and can add white information to image information.

問題点を解決するだめの手段 この目的を達成するために本発明の画情報処理装置は、
入力部に比べて1ライン当りのビット数の多いシフトレ
ジスタを出力部に備え、このシフトレジスタにあらかじ
め白画情報を満たしておき、後端だけに白画情報の付加
された画情報を前記シフトレジスタへ出力するように構
成されている。
Means for Solving the Problems To achieve this object, the image information processing apparatus of the present invention comprises:
The output section is equipped with a shift register with a larger number of bits per line than the input section, this shift register is filled with white image information in advance, and the image information with the white image information added only to the rear end is shifted. It is configured to output to a register.

作用 この構成によってファクシミリ等を用いて入力部で入力
された画情報に白画情報を付加して異なるサイズの記録
紙等に画情報を出力する場合に、入力部で入力された画
情報の後端のみに白画情報を付加するだけで、出力部で
は画情報の両端に白画情報が付加された状態で出力する
ことができる。
Effect With this configuration, when adding white image information to the image information input at the input section using a facsimile or the like and outputting the image information to recording paper of a different size, the image information input at the input section is By simply adding white image information to only the edges, the output section can output image information with white image information added to both ends.

実施例 以下本発明の一実施例について、図面を参照しながら説
明する。
EXAMPLE An example of the present invention will be described below with reference to the drawings.

第1図は本発明の一実施例における画情報処理装置の概
略ブロック図を示すものである。第1図において1は入
力部、2は出力部、3は画情報制御部、4はラインメモ
リ、5はライトアドレスカウンタ、6はリードアドレス
カウンタ、9はシフトレジスタであり、これらは従来例
の構成と同じものである。10はA4サイズの画情報a
をカウントする1728ビツトのカウンタ、11は16
0ビツトの白画情報をカウントするカウンタである。
FIG. 1 shows a schematic block diagram of an image information processing apparatus in an embodiment of the present invention. In FIG. 1, 1 is an input section, 2 is an output section, 3 is an image information control section, 4 is a line memory, 5 is a write address counter, 6 is a read address counter, and 9 is a shift register. It is the same as the configuration. 10 is A4 size image information a
1728-bit counter that counts 11 is 16
This is a counter that counts 0-bit white image information.

以上のように構成された本実施例の画情報処理装置につ
いて第2図のタイミング図および第3図の説明図を参照
しながら以下その動作を説明する。
The operation of the image information processing apparatus of this embodiment configured as described above will be described below with reference to the timing diagram of FIG. 2 and the explanatory diagram of FIG. 3.

まず、画情報制御部3は、画情報を送出する前にあらか
じめ出力部2内のシフトレジスタ9をクリアする。
First, the image information control section 3 clears the shift register 9 in the output section 2 in advance before transmitting the image information.

次に、入力部1からラインメモリ4にA4サイズの画情
報a′が書き込まれる。すなわち、この画情報a′は1
ライン(1728ビツト)であり、画情報制御部3から
ライトアドレスカウンタ5にカウント開始信号J′が出
されてカウントを開始し、ライトアドレスカウンタ5の
カウント値に従って入力部1から入力されだA4サイズ
の画情報a′をラインメモリ4に一時格納する。
Next, A4 size image information a' is written from the input section 1 to the line memory 4. In other words, this image information a' is 1
A4 size line (1728 bits) is output from the image information control unit 3 to the write address counter 5 to start counting, and according to the count value of the write address counter 5 is input from the input unit 1. The image information a' of is temporarily stored in the line memory 4.

そして、ラインメモリ4に書き込まれた画情報a′を出
力部2内のシフトレジスタ9に出力するために、まず、
出力データイネーブル信号すをHからLにすると同時に
、リードアドレスカウンタ6およびカウンタ10をカウ
ント開始信号dによって起動させる。A4サイズの画情
報の出力が終了した時点でカウンタ10はカウントアツ
プして信号r′を発生し、160ビツトのカウンタ11
および画情報制御部3に入力される。画情報制御部3に
信号fが入力されると出力画情報を白画情報に変えて白
情報を160ビツト付加する。さらに、カウンタ11が
カウントアツプすると出力データイネーブル信号すをL
からHにして1ラインの転送を終了する。
Then, in order to output the image information a' written in the line memory 4 to the shift register 9 in the output section 2, first,
At the same time as the output data enable signal S is changed from H to L, the read address counter 6 and the counter 10 are activated by the count start signal d. When the output of A4 size image information is finished, the counter 10 counts up and generates a signal r', and the 160-bit counter 11
and is input to the image information control section 3. When the signal f is input to the image information control section 3, the output image information is changed to white image information and 160 bits of white information are added. Furthermore, when the counter 11 counts up, the output data enable signal is
to H to complete the transfer of one line.

なお、シフトレジスタ9には常時シフトクロックCが画
情報制御部3から出力されている。
Note that the shift clock C is constantly outputted from the image information control section 3 to the shift register 9.

すなわち、出力部2のシフトレジスタ9は第3図に示す
ように、最初の初期設定の時点でクリアされるので第3
図mに示すように白情報で埋っている。ここに、A4サ
イズの画情報a′をシフトして行くとnのようになる。
That is, as shown in FIG. 3, the shift register 9 of the output section 2 is cleared at the time of the first initial setting, so
As shown in Figure M, it is filled with white information. If the A4 size image information a' is shifted here, it becomes n.

そして、画情報の後端に160ビツトの白画情報を付加
すると0のようにA4サイズの画情報の両端に160ビ
ツトずつの白画情報が付加されてB4サイズの画情報に
なる。
Then, when 160 bits of white image information is added to the rear end of the image information, 160 bits of white image information are added to both ends of the A4 size image information, such as 0, resulting in B4 size image information.

さらに、A4サイズの画情報の次のラインも、その画情
報の後端のみ160ビツトの白画情報を付加してゆけば
第3図のp−+q−+rの順に変化し、B4サイズの画
情報を生成することができる。
Furthermore, if 160-bit white image information is added to the rear end of the A4 size image information, the next line of A4 size image information changes in the order of p-+q-+r as shown in Figure 3, and the B4 size image changes. Information can be generated.

なお、上記実施例ではA4サイズからB4サイズへの画
情報の再生について説明したが本発明はこれに限られる
ものでない。
Although the above embodiment describes reproduction of image information from A4 size to B4 size, the present invention is not limited to this.

発明の効果 本発明は1ライン毎に画情報の後端のみに白画情報を付
加し、これを予め白画情報の設定された出力部に接続し
、順次前ラインの画情報に接続することにより、ファク
シミリ等においてサイズの異なる記録紙に画情報を出力
することができ、特にファクシミリにおいて、送信側の
原稿幅に関係なく受信側では常に一定の原稿幅で受信す
るということを極めて容易に行うことができるという効
果を有するものである。
Effects of the Invention The present invention adds white image information only to the rear end of the image information for each line, connects this to an output section in which white image information is set in advance, and sequentially connects it to the image information of the previous line. This makes it possible to output image information on recording paper of different sizes in facsimiles, etc., and in particular in facsimiles, it is extremely easy to always receive documents with a constant document width on the receiving side, regardless of the document width on the sending side. This has the effect that it is possible to

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例における画情報処理装置の概
略ブロック図、第2図は同実施例のタイミング図、第3
図は同実施例の原理説明図、第4図は従来の画情報処理
装置の概略ブロック図、第5図は従来例のタイミング図
である。 1・・・入力部、2・・・出力部、3・・・画情報制御
部、4・・・ラインメモリ、10.11・・・カウンタ
。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第2
図 0′]!ローr−−−−一−−−m− 第3図 荒 と
FIG. 1 is a schematic block diagram of an image information processing device according to an embodiment of the present invention, FIG. 2 is a timing diagram of the embodiment, and FIG.
4 is a schematic block diagram of a conventional image information processing apparatus, and FIG. 5 is a timing diagram of the conventional example. 1... Input section, 2... Output section, 3... Image information control section, 4... Line memory, 10.11... Counter. Name of agent: Patent attorney Toshio Nakao and 1 other person 2nd
Figure 0′]! Roll r----1---m- Figure 3 Rough and

Claims (1)

【特許請求の範囲】[Claims] 画情報を入力する入力部と、この入力部に入力した画情
報を一旦記憶する記憶手段と、前記入力部に入力された
画情報の1ラインのビット数に比べて多くのビット数を
有する前記記憶手段から取り出された画情報を出力する
出力部と、前記入力部で入力された画情報の出力制御手
段とを備え、前記制御手段により、入力された画情報の
各ラインの一端に白画情報を付加し、出力された前ライ
ンに順次接続して出力することを特徴とする画情報処理
装置。
an input unit for inputting image information; a storage unit for temporarily storing the image information input to the input unit; The output unit outputs the image information retrieved from the storage unit, and the output control unit outputs the image information inputted by the input unit, and the control unit causes a white screen to appear at one end of each line of the inputted image information. An image information processing device characterized by adding information and sequentially connecting and outputting the outputted previous line.
JP61044465A 1986-02-28 1986-02-28 Picture information processor Granted JPS62200973A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP61044465A JPS62200973A (en) 1986-02-28 1986-02-28 Picture information processor

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JP61044465A JPS62200973A (en) 1986-02-28 1986-02-28 Picture information processor

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JPH0481380B2 JPH0481380B2 (en) 1992-12-22

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ID=12692240

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5944172A (en) * 1982-09-06 1984-03-12 Matsushita Graphic Commun Syst Inc Picture width converter

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5944172A (en) * 1982-09-06 1984-03-12 Matsushita Graphic Commun Syst Inc Picture width converter

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