JPS62177703A - Digital signal recorder - Google Patents
Digital signal recorderInfo
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- JPS62177703A JPS62177703A JP1967486A JP1967486A JPS62177703A JP S62177703 A JPS62177703 A JP S62177703A JP 1967486 A JP1967486 A JP 1967486A JP 1967486 A JP1967486 A JP 1967486A JP S62177703 A JPS62177703 A JP S62177703A
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- Digital Magnetic Recording (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、ディジタル信号を磁気テープに記録する場
合に用いられるディジタル信号記録装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a digital signal recording device used for recording digital signals on a magnetic tape.
この発明は、ディジタル信号を磁気テープに記録する場
合に用いられるディジタル信号記録装置において、記録
すべきディジタル信号をこのディジタル信号の高域成分
に比して低域成分のゲインを相対的に下げるように補償
して磁気テープに記録することより、非線形歪を低減さ
せるようにしたものである。The present invention provides a digital signal recording device used for recording digital signals on a magnetic tape, in which the gain of the low-frequency component of the digital signal to be recorded is relatively lowered compared to the high-frequency component of the digital signal. This method is designed to reduce nonlinear distortion by compensating for and recording on magnetic tape.
例えば特開昭55−135316号公報に開示されてい
るように、ディジタルビデオ信号のような高い周波数の
ディジタル信号を記録する場合、従来、第7図に示すよ
うな記録回路が用いられていた。For example, as disclosed in Japanese Unexamined Patent Publication No. 55-135316, when recording a high frequency digital signal such as a digital video signal, a recording circuit as shown in FIG. 7 has conventionally been used.
第7図においてトランジスタ51及び52の互いのエミ
ッタが共通接続され、この接縛点が定電流源として動作
するトランジスタ53のコレクタに接続される。トラン
ジスタ53のベースが定電圧が加えられる端子54に接
続される。トランジスタ53のエミッタが抵抗55を介
して−VEEの電源端子56に接続される。In FIG. 7, the emitters of transistors 51 and 52 are commonly connected, and this junction is connected to the collector of transistor 53, which operates as a constant current source. The base of the transistor 53 is connected to a terminal 54 to which a constant voltage is applied. The emitter of transistor 53 is connected to -VEE power supply terminal 56 via resistor 55.
トランジスタ51及び52の夫々のベースが入力端子5
7及び58に夫々接続される。トランジスタ51及び5
2のコレクタが磁気へソF’ 59の一方の端子60及
び他方の端子61に夫々接続される。磁気ヘッド59の
中点の端子62が士■cCの電源端子63に接続される
。The bases of the transistors 51 and 52 are connected to the input terminal 5.
7 and 58, respectively. Transistors 51 and 5
Two collectors are connected to one terminal 60 and the other terminal 61 of the magnetic navel F' 59, respectively. A terminal 62 at the center of the magnetic head 59 is connected to a power terminal 63 at the center of the magnetic head 59 .
この第7図に示す従来の記録回路は、入力端子57及び
58に供給されるディジタル信号によりトランジスタ5
1及び52をオン/オフさせ、6〃気ヘツド59の巻線
64に夫々互いに逆方向の電流を流し、磁気テープに信
号を記録するようにしたものである。即ち、入力端子5
7に供給されるディジタル信号がハイレベルで、入力端
子58に供給されるディジタル信号がローレベルの時に
は、トランジスタ51がオンし、トランジスタ52がオ
フし、巻線64に矢印aで示す方向にt流が流される。The conventional recording circuit shown in FIG.
1 and 52 are turned on and off, currents in opposite directions are caused to flow through the windings 64 of the 6-air head 59, respectively, and signals are recorded on the magnetic tape. That is, input terminal 5
When the digital signal supplied to input terminal 7 is high level and the digital signal supplied to input terminal 58 is low level, transistor 51 is turned on, transistor 52 is turned off, and winding 64 is driven t in the direction shown by arrow a. The flow is carried away.
入力端子58に供給されるディジタル信号がハイレベル
で、入力端子57に供給されるディジタル信号がローレ
ベルの時には、トランジスタ52がオンし、トランジス
タ51がオフし、巻キ済64に矢印すで示す方向に電流
が流される。When the digital signal supplied to the input terminal 58 is at a high level and the digital signal supplied to the input terminal 57 is at a low level, the transistor 52 is turned on and the transistor 51 is turned off, as already indicated by the arrow 64. A current is passed in the direction.
ところが、ディジタルビデオ信号を磁気テープに記録す
る場合のように、高い記録密度で磁気記録を行うと、磁
気記録固有の非線形歪が多(発生する。このような非線
形歪は、再生時のイコライズでは除去することができな
い。However, when magnetic recording is performed at a high recording density, such as when recording digital video signals on magnetic tape, a large amount of nonlinear distortion inherent to magnetic recording occurs. cannot be removed.
上述の従来の記録回路では、高域成分、低域成分に対し
て常に等しい記録電流が同し位相で流され、非線形歪に
対する補償が何ら行われていない。In the conventional recording circuit described above, equal recording currents are always applied to the high-frequency components and the low-frequency components with the same phase, and no compensation for nonlinear distortion is performed.
このため、記録時に非線形歪が多く発生するという問題
がある。Therefore, there is a problem in that a large amount of nonlinear distortion occurs during recording.
記録過程における非線形歪は、すぐに書き込んだパルス
と次に書き込むパルスとの干渉で発生すると考えられる
。これに対して、記録電流波形を適切に補償すれば、そ
の発生を低減させることが可能である。Nonlinear distortion in the recording process is thought to occur due to interference between the immediately written pulse and the next written pulse. On the other hand, if the recording current waveform is appropriately compensated, the occurrence of this can be reduced.
そこで、記録すべきディジタル信号に対して予め位相歪
を加えておくようにした記録回路が提案されている。即
ち、第8図に示すように、記録すべきディジタル信号を
入力端子71からAイバスフィルタ72に供給し、バイ
パスフィルタ72で記録すべきディジタル信号に予め非
線形歪の発生を補償するように位相歪を与えておく。こ
のバイパスフィルタ72の出力をコンパレータ73で2
値化し、記録アンプ74を介して磁気ヘッド75に供給
する。このように記録すべきディジタル信号に対して予
め位相補償を与えてお(ことにより、非線形歪が低減さ
れる。Therefore, a recording circuit has been proposed in which phase distortion is applied in advance to the digital signal to be recorded. That is, as shown in FIG. 8, a digital signal to be recorded is supplied from an input terminal 71 to an A bus filter 72, and a bypass filter 72 adjusts the phase of the digital signal to be recorded in advance to compensate for the occurrence of nonlinear distortion. Give some distortion. The output of this bypass filter 72 is divided into two by a comparator 73.
It is converted into a value and supplied to the magnetic head 75 via the recording amplifier 74. In this way, phase compensation is applied in advance to the digital signal to be recorded (thereby, nonlinear distortion is reduced).
また、第9図に示すように、記録すべきディジタル信号
を入力端子81からピーキング回路82に供給し、ピー
キング回路82の出力をアッテネータ83、記録アンプ
84を介して磁気へノド85に供給するようにした記録
回路が提案されている。この記録回路については、信学
全大236(1985)に詳細に記載されている。ピー
キング回路82としては、第1O図に示すように、入力
端子86と出力端子87との間に抵抗88及びコンデン
サ89を並列に接続し、出力端子87と抵抗88及びコ
ンデンサ89との接続点と接地間に抵抗90を接続する
ようにしたものが用いられる。また、記録アンプ84は
、リニアな振幅特性のものを用いる必要がある。Further, as shown in FIG. 9, a digital signal to be recorded is supplied from an input terminal 81 to a peaking circuit 82, and the output of the peaking circuit 82 is supplied to a magnetic node 85 via an attenuator 83 and a recording amplifier 84. A recording circuit has been proposed. This recording circuit is described in detail in IEICE 236 (1985). As shown in FIG. 1O, the peaking circuit 82 has a resistor 88 and a capacitor 89 connected in parallel between an input terminal 86 and an output terminal 87, and a connection point between the output terminal 87 and the resistor 88 and capacitor 89. One in which a resistor 90 is connected between ground is used. Furthermore, the recording amplifier 84 must have linear amplitude characteristics.
この第10図に示す記録回路は、ピーキング回路82で
非線形歪に対する振幅及び位相の補償を予め行うように
している。これにより、非線形歪が低減される。In the recording circuit shown in FIG. 10, amplitude and phase compensation for nonlinear distortion is performed in advance by a peaking circuit 82. This reduces nonlinear distortion.
比較的軽度の非線形歪については、上述の第8図及び第
9図に示す記録回路を用いることにより、ある程度軽減
することができる。しかしながら、テープ抗磁力Hc
+残留磁束密度Br共に高い例えばメタルテープを飽和
磁束密度Bsの高い例えばM&F (メタル&フェライ
ト(センダストやアモルファスとフェライトとの組み合
わせ))へ、ノドで記録した場合に発生するような大き
な非線形歪に対しては、上述の従来の記録回路では十分
に除去できない。Relatively mild nonlinear distortion can be reduced to some extent by using the recording circuit shown in FIGS. 8 and 9 described above. However, the tape coercive force Hc
+ Large nonlinear distortion that occurs when recording, for example, a metal tape with a high residual magnetic flux density Br, onto a metal tape with a high saturation magnetic flux density Bs, such as M&F (metal & ferrite (a combination of sendust, amorphous, and ferrite)) with a gutter. However, the above-mentioned conventional recording circuit cannot sufficiently remove the noise.
即ち、第8図に示す記録回路は、非線形歪に対して、位
相特性のみ補償がなされ、振幅についての補償がなされ
ていない。That is, in the recording circuit shown in FIG. 8, only the phase characteristics are compensated for nonlinear distortion, but the amplitude is not compensated.
第9図に示す記録回路では、M &Fへ・ノドでメタル
テープに磁気記録した場合に発生するような大きな非線
形歪に対して、振幅及び位相特性の十分な補償がなし得
ない。つまり、第9図に示す記録回路におけるピーキン
グ回路82 (第10図)の伝達関数H(s)は、抵抗
88及び90の抵抗値を夫々R1,RZ、コンデンサ8
9の静電容量をC8とすると、
となる。The recording circuit shown in FIG. 9 cannot sufficiently compensate amplitude and phase characteristics for large nonlinear distortions that occur when magnetically recording on a metal tape using an M&F. In other words, the transfer function H(s) of the peaking circuit 82 (FIG. 10) in the recording circuit shown in FIG.
Letting the capacitance of 9 be C8, it becomes as follows.
1/C,R,=a。1/C,R,=a.
(R1+R2) / (CI RI R2) =baa
とおくとすると、この伝達関数H(S)は、となる。し
たがって、このピーキング回路の振幅特性1位相特性1
群遅延特性は、第11図A〜第11図Cに夫々示すもの
となる。Assuming that (R1+R2)/(CI RI R2) = baa, this transfer function H(S) becomes. Therefore, the amplitude characteristic 1 phase characteristic 1 of this peaking circuit
The group delay characteristics are shown in FIGS. 11A to 11C, respectively.
第11図A〜第11図Cに示す特性から明らかなように
、このピーキング回路82では急峻な振幅特性が得られ
ず、また、十分な位相補償も行えない。また、このピー
キング回路を用いた場合には、記録アンプ84としてリ
ニアな振幅特性のものを用いなければならないという問
題がある。As is clear from the characteristics shown in FIGS. 11A to 11C, this peaking circuit 82 cannot obtain steep amplitude characteristics and cannot perform sufficient phase compensation. Furthermore, when this peaking circuit is used, there is a problem in that the recording amplifier 84 must have linear amplitude characteristics.
したがって、この発明の目的は、例えばメタルテープを
M&Fへ7 トで記録する場合に発生するような大きな
非線形歪についても、その低域が可能なディジクル信号
記録装置を提供することにある。Therefore, it is an object of the present invention to provide a digital signal recording device that is capable of suppressing large nonlinear distortions such as those that occur when recording metal tapes on M&F at low frequencies.
この発明の他の目的は、記録アンプの消費電力を節減で
きるディジタル信号記録装置を提供することにある。Another object of the present invention is to provide a digital signal recording device that can reduce power consumption of a recording amplifier.
この発明は、記録すべきディジタル信号をこのディジタ
ル信号の高域成分に比して低域成分のゲインを相対的に
下げるイコライズ回路を介して記録ヘッドに供給するよ
うにしたディジクル信号記録装置である。The present invention is a digital signal recording device in which a digital signal to be recorded is supplied to a recording head through an equalization circuit that relatively lowers the gain of low-frequency components of the digital signal compared to high-frequency components. .
ε作用〕
記録過程における非線形歪は、すでに書き込んだパルス
と次に書き込むパルスとの干渉により発生すると考えら
れる。そこで、トランジスタ1゜2、抵抗5.コンデン
サ6、電流源3.4.により構成されるイコライズ回路
が用いられ、記録信号の低域成分のゲインが高域成分に
比べて相対的に下げられ、高域成分の位相が低域成分に
比べて相対的に遅らされ、非線形歪に対する補償が記録
時になされる。これにより、非線形歪が低減できる。ε Effect] Nonlinear distortion in the recording process is thought to occur due to interference between the already written pulse and the next written pulse. Therefore, transistor 1°2, resistor 5. Capacitor 6, current source 3.4. An equalization circuit configured by is used, the gain of the low frequency component of the recording signal is relatively lowered compared to the high frequency component, the phase of the high frequency component is delayed relative to the low frequency component, Compensation for nonlinear distortion is made during recording. Thereby, nonlinear distortion can be reduced.
以下、この発明の一実施例について図面を参照して説明
する。An embodiment of the present invention will be described below with reference to the drawings.
記録過程時における非線形歪は、前述したように、すで
に書き込んだパルスと次に書き込むパルスとの干渉によ
り発生すると考えられる。テープ抗磁力Hc及び残留磁
束密度Br共に高いM &Fヘンドで飽和磁束密度Bs
の高いメタルテープに高密度記録を行う場合においては
、前後のパルスによる干渉ばかりでなく、数タイムスロ
ットに及ぶ干渉が住じると考えられる。然るに、M&F
ヘッドでメタルテープに高密度記録を行う場合、非線形
歪が多く発生すると考えられる。また、幅の広いパルス
、即ち、1又はOが連続した場合、非線形歪が多く発生
するという傾向があり、これは、幅の広いパルスが生じ
ている部分が非線形歪に関与していると考えられる。As described above, nonlinear distortion during the recording process is thought to be caused by interference between the already written pulse and the next written pulse. Saturation magnetic flux density Bs at M&F hand where tape coercive force Hc and residual magnetic flux density Br are both high
When high-density recording is performed on a metal tape with a high density, it is thought that there will be interference not only from the preceding and succeeding pulses but also over several time slots. However, M&F
When performing high-density recording on a metal tape using a head, it is thought that a large amount of nonlinear distortion occurs. In addition, there is a tendency for a large amount of nonlinear distortion to occur when wide pulses, that is, a series of 1's or O's occur, and this is thought to be due to the part where the wide pulses are occurring being involved in nonlinear distortion. It will be done.
以上のことから、低域成分のゲインを高域成分に比べて
相対的に下げ、高域成分の位相を低域成分に比べて相対
的に遅らせ、記録電流波形に振幅及び位相について十分
な補償を行えば、M&Fヘッドでメタルテープに高密度
記録した場合においても、非線形歪を十分低減させるこ
とができる七考えられる。From the above, the gain of the low-frequency component is relatively lowered compared to the high-frequency component, and the phase of the high-frequency component is delayed relative to the low-frequency component, so that the recording current waveform is sufficiently compensated for amplitude and phase. If this is done, it is conceivable that nonlinear distortion can be sufficiently reduced even when high-density recording is performed on a metal tape using an M&F head.
この発明の一実施例では、第4図に示すイコライズ回路
を用いて記録電流波形に非線形歪に対する振幅及び位相
の補償を与え、非線形歪を低)成させるようにしている
。In one embodiment of the present invention, the equalization circuit shown in FIG. 4 is used to provide amplitude and phase compensation for nonlinear distortion to the recording current waveform, thereby reducing nonlinear distortion.
第4図においてトランジスタlのユミノタ及びトランジ
スタ2のエミッタに電流値が■なる電;流源3及び4が
夫々接続されると共に、トランジスタ1及び2の互いの
エミッタの間に抵抗5及びコンデンサ6が接続される。In FIG. 4, current sources 3 and 4 are connected to the emitter of the transistor 1 and the emitter of the transistor 2, respectively, and a resistor 5 and a capacitor 6 are connected between the emitters of the transistors 1 and 2. Connected.
電流源3及び4の他端が−VEEの電源端子7及び8に
夫々接続される。The other ends of current sources 3 and 4 are connected to -VEE power supply terminals 7 and 8, respectively.
トランジスタ1のベースが入力端子9に接続される。ト
ランジスタ2のベースが接地される。トランジスタ1の
コレクタが−vceの電源端子に接続される。トランジ
スタ2のコレクタが出力端子12に接続される。The base of transistor 1 is connected to input terminal 9. The base of transistor 2 is grounded. The collector of transistor 1 is connected to the -vce power supply terminal. The collector of transistor 2 is connected to output terminal 12 .
入力端子9に入力信号電圧V、(1)が供給されると、
トランジスタ1のエミッタとトランジスタ2のエミッタ
との間に生じる電位差に基づいて、抵抗5及びコンデン
サ6を通じて信号電流が流れる。したがって、抵抗5の
抵抗値をR、コンデンサ6の静電容量をC1電流源3及
び4の電流値を1とすると、出力端子12の出力信号電
流1o(t)は、
1o(t)= T = v、 (t)<1 = j (
LICR) /R−・(t)となる。When input signal voltage V, (1) is supplied to input terminal 9,
Based on the potential difference generated between the emitter of transistor 1 and the emitter of transistor 2, a signal current flows through resistor 5 and capacitor 6. Therefore, assuming that the resistance value of the resistor 5 is R, the capacitance of the capacitor 6 is C1, the current value of the current sources 3 and 4 is 1, the output signal current 1o(t) of the output terminal 12 is as follows: 1o(t)=T = v, (t)<1 = j (
LICR) /R-・(t).
ところで、(i+式において第1項は電流源3及び4に
より定まるバイアス電;流であり、第2項が入力電圧に
より変換する信号電流である。(1)式より、出力信号
電流i。(1)は、カットオフ周波数ω。以偉、周波数
が高くなるに従って増大する。しかしながら、(1)式
における第1項の信号電流は、電流源3及び4の電流値
1以上になることはないので、i v、(t)(1十j
ωcR) /R、≦1−(2iであり、(2)式より、
出力信号電流i(υの最大値は電流源3及び4の電流値
■により制限される。By the way, in the formula (i+), the first term is the bias current determined by the current sources 3 and 4, and the second term is the signal current converted by the input voltage. From formula (1), the output signal current i. 1) is the cutoff frequency ω. Therefore, it increases as the frequency becomes higher. However, the signal current in the first term in equation (1) never exceeds the current value of 1 of current sources 3 and 4. Therefore, i v, (t) (10j
ωcR) /R, ≦1−(2i, and from equation (2),
The maximum value of the output signal current i (υ) is limited by the current value ■ of the current sources 3 and 4.
これにより、電流源3及び4の電流値rにより定められ
る周波数以上では、第5図に示すように、出力信号型t
i i o (t)はクリップされ、この周波数よりも
高くなっても、出力信号電流to(t)は増加しな(な
る。この電流源3及び4の電流値Iを適当に定めること
により、不必要に消費電力が増加することが抑えられる
。また、高い周波数では振幅は増加しないが、第5図か
ら明らかなように、電流波形が急峻になり、記録を流の
分解が向上される。As a result, at frequencies above the frequency determined by the current values r of the current sources 3 and 4, the output signal type t
i i o (t) is clipped, and even if it becomes higher than this frequency, the output signal current to(t) does not increase. By appropriately determining the current value I of the current sources 3 and 4, Unnecessary increases in power consumption can be suppressed.Furthermore, although the amplitude does not increase at high frequencies, as is clear from FIG. 5, the current waveform becomes steeper and the resolution of the recorded flow is improved.
上述の(1)式よりこのイコライズ回路の伝達関数H(
s)が
H(s)=C(S+1/CR) =(S−C0)/Rω
G −<3)Qo :カットオフ周波数
として求められる。この伝達関数H(s)からこのイコ
ライズ回路の振幅特性5位相特性1群遅延特性を夫々求
めると、第6図A〜第61NCに示すようになる。なお
、振幅特性は、電流源3及び4の電流値Iにより周波数
ω、で制限されるが、位相特性及びそれを微分して得ら
れる群遅延特性は、電流源3及び4の電流値Iにより制
限されることはない。第6図A〜第6図Cに示す特性か
ら明らかなように、このイコライズ回路は、高域成分に
比して低域のゲインを下げ、高域成分の位相を低域成分
に比して遅らせる特性を有している。From equation (1) above, the transfer function H(
s) is H(s)=C(S+1/CR) =(S-C0)/Rω
G −<3) Qo: Obtained as the cutoff frequency. When the amplitude characteristics, phase characteristics, and first group delay characteristics of this equalizing circuit are obtained from this transfer function H(s), the results are shown in FIGS. 6A to 61NC. Note that the amplitude characteristic is limited by the frequency ω due to the current value I of the current sources 3 and 4, but the phase characteristic and the group delay characteristic obtained by differentiating it are limited by the current value I of the current sources 3 and 4. There are no restrictions. As is clear from the characteristics shown in FIGS. 6A to 6C, this equalization circuit lowers the gain of the low frequency component compared to the high frequency component, and lowers the phase of the high frequency component compared to the low frequency component. It has the property of slowing down.
第1図は、この発明の一実施例を示し、第1図において
トランジスタ21のエミ・ン夕及びトランジスタ22の
エミッタが抵抗23及び抵抗24を夫々介して電流値が
2■なる電流源25に接続されると共に、トランジスタ
21及び22の互いのエミッタ間にコンデンサ26が接
続される。電流源25の他端が一■、の電源端子27に
接続される。トランジスタ21のベースが入力端子28
に接続される。トランジスタ22のベースが接地される
。トランジスタ21のコレクタが抵抗29を介して−V
ccの電源端子31に接続されると共に、ドライブアン
プ32の一方の入力端子に接続される。トランジスタ2
2のコレクタが抵抗30を介して+vCCの電源端子3
1に接続されると共に、ドライブアンプ32の他方の入
力端子−二接続される。FIG. 1 shows an embodiment of the present invention, in which the emitter of a transistor 21 and the emitter of a transistor 22 are connected to a current source 25 with a current value of 2 through a resistor 23 and a resistor 24, respectively. At the same time, a capacitor 26 is connected between the emitters of the transistors 21 and 22. The other end of the current source 25 is connected to a power supply terminal 27. The base of the transistor 21 is the input terminal 28
connected to. The base of transistor 22 is grounded. The collector of the transistor 21 is connected to -V through the resistor 29.
It is connected to the power supply terminal 31 of the cc, and also connected to one input terminal of the drive amplifier 32. transistor 2
2 collector is connected to +vCC power supply terminal 3 via resistor 30.
1 and the other input terminal of the drive amplifier 32 -2.
ドライブアンプ32の出力端子が回転トランス33の一
次側巻線に接続される。回転トランス33の二次側巻線
が記録アンプ34の入力端子に接続される。記録アンプ
34の出力端子力<61気ヘツド35の巻線36に接続
される。An output terminal of the drive amplifier 32 is connected to the primary winding of the rotary transformer 33. A secondary winding of the rotary transformer 33 is connected to an input terminal of the recording amplifier 34. The output terminal of the recording amplifier 34 is connected to the winding 36 of the head 35.
この一実施例は、記録アンプ34が回転ドラムに搭載さ
れている場合に用いて好適なものである。This embodiment is suitable for use when the recording amplifier 34 is mounted on a rotating drum.
トランジスタ21,22.抵抗23,24. コンデン
サ26.電流源25により、前述の第4図に示したイコ
ライズ回路が構成される。なお、抵抗23及び24の抵
抗値は夫々R/2に設定されている。端子28に供給さ
れる入力信号電圧に対して、このイコライズ回路で非線
形歪に対する補償がなされる。一つまり、この入力信号
電圧がイコライズ回路に供給されることにより、第6図
A〜第6図Cに示す特性に従って、低域成分のゲインが
相対的に下げられ、高域成分の位相が相対的に遅らされ
る。このイコライズ回路の出力は、抵抗29及び30で
電圧に変換され、互いに逆相の信号電圧出力がドライブ
アンプ329回転トランス33を介して記録アンプ34
に供給され、記録アンプ34の出力が磁気ヘッド35の
巻線36に供給される。Transistors 21, 22. Resistors 23, 24. Capacitor 26. The current source 25 constitutes the equalization circuit shown in FIG. 4 described above. Note that the resistance values of the resistors 23 and 24 are each set to R/2. With respect to the input signal voltage supplied to the terminal 28, this equalization circuit compensates for nonlinear distortion. In other words, by supplying this input signal voltage to the equalization circuit, the gain of the low frequency component is relatively lowered and the phase of the high frequency component is relatively lowered according to the characteristics shown in FIGS. 6A to 6C. be delayed. The output of this equalization circuit is converted into a voltage by resistors 29 and 30, and signal voltage outputs having mutually opposite phases are passed through a drive amplifier 329 and a rotating transformer 33 to a recording amplifier 34.
The output of the recording amplifier 34 is supplied to the winding 36 of the magnetic head 35.
このように、記録時に非線形歪に対する振幅及び位相の
補償がなされているので、非線形歪が低減される。In this way, since the amplitude and phase are compensated for nonlinear distortion during recording, nonlinear distortion is reduced.
第2図はこの発明の他の実施例である。この実施例は、
このイコライズ回路を記録アンプと兼用させたものであ
る。FIG. 2 shows another embodiment of the invention. This example is
This equalization circuit is also used as a recording amplifier.
第2図においてトランジスタ21,22.抵抗23.2
4. コンデンサ26.電流a25によりイコライズ回
路が構成される。トランジスタ21及び22のコレクタ
がvl気ヘッド35の巻線36に接続される。巻線36
の中点が−VCCの電源・端子31に接続される。トラ
ンジスタ21及び22のベースがバッファアンプ44の
一方及び他方の出力端子に夫々接続される。In FIG. 2, transistors 21, 22 . Resistance 23.2
4. Capacitor 26. An equalization circuit is configured by the current a25. The collectors of transistors 21 and 22 are connected to a winding 36 of a voltage head 35. Winding wire 36
The midpoint of is connected to the -VCC power supply/terminal 31. The bases of transistors 21 and 22 are connected to one and the other output terminals of buffer amplifier 44, respectively.
入力端子41に供給されたディジタル信号は、ドライブ
アンプ422回転トランス43.バッファアンプ44を
介してトランジスタ2工及び220ベースに供給される
。トランジスタ21及び22を流れる電流に応じて巻線
36に記i3電流が流される。このように、トランジス
タ21.22゜抵抗23.24. コンデンサ26.電
流源25により構成されるイコライズ回路は、記録電流
に非線形歪に対する補償を与えると共に、記録アンプと
しても動作する。The digital signal supplied to the input terminal 41 is sent to a drive amplifier 422, a rotary transformer 43. The signal is supplied to the transistor 2 and base 220 via the buffer amplifier 44. The i3 current is caused to flow through the winding 36 in accordance with the current flowing through the transistors 21 and 22. In this way, transistors 21, 22°, resistors 23, 24 . Capacitor 26. The equalization circuit constituted by the current source 25 provides compensation for nonlinear distortion to the recording current, and also operates as a recording amplifier.
なお、第3図に示すように、トランジスタ2工及び22
のコレクタを電流値がIなる電流−tA45及び46を
夫々介して電源端子31に接続し、トランジスタ21の
コレクタと電流845の接続点、及びI・ランジスタ2
2のコレクタと電流源46の接続点を磁気へノド35の
巻線36に接続するようにすれば、巻線36の中点タッ
プは不要になる。In addition, as shown in FIG.
The collector of the transistor 21 is connected to the power supply terminal 31 via the current -tA 45 and 46, respectively, whose current value is I, and the connection point between the collector of the transistor 21 and the current 845, and the I transistor 2.
If the connection point between the collector No. 2 and the current source 46 is connected to the winding 36 of the magnetic node 35, the tap at the center of the winding 36 becomes unnecessary.
即ち、トランジスタ2工のコレクタの電圧がトランジス
タ22のコレクタの電圧より高い時には、巻線36に矢
印Cで示す方向に電流が流され、トランジスタ22のコ
レクタの電圧がトランジスタ21のコレクタの電圧より
高い時には、巻線36に矢印dで示す方向に電流が流さ
れる。That is, when the voltage at the collector of transistor 22 is higher than the voltage at the collector of transistor 22, current flows through the winding 36 in the direction shown by arrow C, and the voltage at the collector of transistor 22 is higher than the voltage at the collector of transistor 21. At times, a current is passed through the winding 36 in the direction indicated by arrow d.
C発明の効果〕
この発明に依れば、記録電流に対して非線形歪に対する
振幅及び位相の補償がなされるので、非線形歪を低減さ
せることができる。C. Effects of the Invention] According to the invention, since amplitude and phase compensation for nonlinear distortion is performed on the recording current, nonlinear distortion can be reduced.
以下、実測した再生波形を比較しながらこの発明の詳細
な説明する。The present invention will be described in detail below while comparing actually measured reproduced waveforms.
第12図Aに示すように、「000・・・」のデータが
連続した後、二l」と「O」が交互に反転するrlol
o・・・2のデータが連続し、更に「111・・・」の
データが連続するような記録信号を、非線形歪に対する
補償がなされていない従来の記録回路(第7図)で記録
すると、再生波形が第12図Bに示すようになるウ一方
、同様の記録信号を、この発明が適用された記録回路で
記録すると、再生波形が第12図Cに示すようになる。As shown in FIG. 12A, after consecutive data of "000...", "2l" and "O" are alternately reversed.
If a recording signal in which the data of o...2 is continuous and the data of "111..." is continuous is recorded by a conventional recording circuit (FIG. 7) that does not compensate for nonlinear distortion, The reproduced waveform becomes as shown in FIG. 12B. On the other hand, when a similar recording signal is recorded by a recording circuit to which the present invention is applied, the reproduced waveform becomes as shown in FIG. 12C.
テープヘッド系は微分特性であるから、非線形歪が発生
していなければ、第12図Aに示す記録信号の微分波形
が再生波形として得′られるはずである。ところが、第
12図Bに示すように、非線形歪に対する補償がなされ
ていない従来の記録回路でこの信号を記録すると、非線
形歪が発生する。Since the tape head system has differential characteristics, if nonlinear distortion does not occur, the differential waveform of the recording signal shown in FIG. 12A should be obtained as the reproduced waveform. However, as shown in FIG. 12B, when this signal is recorded with a conventional recording circuit that does not compensate for nonlinear distortion, nonlinear distortion occurs.
つまり2、rooo・・・」の連続したデータの部分と
rlolo・・・」の繰り返すデータの部分との境界で
出力されるべきビークPが再生されていない。また、「
000・・・2の連続するデータの部分、rlolo・
・・」の繰り返すデータの部分、「111・・・」の連
続するデータ部分の直流レヘルは、夫々、一定となるは
ずであるが、第12図Bに示すように、夫々この部分で
直流レベルの変動が生じている。In other words, the beak P that should be output is not reproduced at the boundary between the continuous data part of "2, rooo..." and the repeated data part of "rlolo...". Also,"
000... 2 consecutive data parts, rlolo.
The DC level of the repeating data part of "..." and the continuous data part of "111..." are supposed to be constant, respectively, but as shown in Figure 12B, the DC level is fluctuations are occurring.
この発明が通用された記録回路を用いると、第12図C
に示すように、ビークPが再生され、「000・・・」
のデータの部分、rioxo・・・」のデータの部分、
「111・・・」のデータの部分で夫々直流レベルの変
動が生じていない。When a recording circuit to which this invention is applied is used, FIG.
As shown in the figure, Beak P is played and "000..."
``rioxo...'' data part,
No fluctuation in the DC level occurs in the data portions "111...".
このことから、非線形歪が低減されたことがわかる。This shows that nonlinear distortion was reduced.
また、第13国人に示すように、「000・・・!のデ
ータの連続した部分と「111・・・」のデータの連続
した部分との間に「10」のデータを挿入し、「111
・・・」のデータの連続した部分と「000・・・」の
データの連続した部分との間に101」のデータを挿入
した記録信号を、非線形歪に対する補償がなされていな
い従来の記録回路で記録した場合、第13図Bに示すよ
うに、[000・・・jの連続データと「ill・・・
」の連続データとの間の「10」のデータ及び「111
・・・:の連続データとVooo・・・」の連続データ
との間の「O12のデータが再生できないウ一方、同様
の記録信号をこの発明が通用された記録回路で記録する
と、第13図Cに示すように、Vooo・・・」の連続
データと1111・・・」の連続データとの間のVIO
Jjのデータ及び「111・・・」の連続データと[0
00・・・jの連続データとの間の「01」のデータが
再生できる。In addition, as shown to the 13th foreigner, the data "10" is inserted between the continuous part of the data "000...!" and the continuous part of the data "111...", and the data "111..." is inserted.
A conventional recording circuit that does not compensate for nonlinear distortion records a recording signal in which data 101'' is inserted between a continuous portion of data of ``000...'' and a continuous portion of data of ``000...''. As shown in FIG. 13B, if the continuous data of [000...j and "ill...
" data of "10" and "111" between consecutive data of
The data of "O12" between the continuous data of "...:" and the continuous data of "Vooo..." cannot be reproduced. On the other hand, when a similar recording signal is recorded by a recording circuit to which the present invention is applied, the data shown in FIG. As shown in C, the VIO between the continuous data of "Vooo..." and the continuous data of "1111..."
Jj data and continuous data of "111..." and [0
Data "01" between continuous data 00...j can be reproduced.
上述の第12図及び第13図に示した再生波形かられか
るように、この発明に依れば非線形歪を十分に低減でき
る。As can be seen from the reproduced waveforms shown in FIGS. 12 and 13 above, according to the present invention, nonlinear distortion can be sufficiently reduced.
また、この発明に敗れば、・イコライズ回路として能動
素子を用いた第6図A〜第6図Cに示す特性のものが用
いられてきる。このイコライズ回路の特性は、従来の第
9図に示す記録回路に用いられていた受動素子だけで構
成されるピーキング回路の特性(第11図A〜第11図
C)に比べて、高域でのゲインが大きく、高域での遅れ
が大きい。Moreover, if this invention is defeated, an equalizer circuit with characteristics shown in FIGS. 6A to 6C using active elements may be used. The characteristics of this equalization circuit are higher than those of the peaking circuit (Figures 11A to 11C) consisting of only passive elements used in the conventional recording circuit shown in Figure 9. The gain is large, and the delay in the high range is large.
このため、非線形歪に対する補償が十分なされ、例えば
メタルテープをM&Fヘッドで記録する場合のような大
きな非線形歪についても十分低減できる。Therefore, compensation for nonlinear distortion is sufficient, and even large nonlinear distortion, such as when recording a metal tape with an M&F head, can be sufficiently reduced.
更に、この発明に依れば、イコライズ回路に流れる電流
を、高い周波数ではクリップさせるようにしているので
、振幅が一定値以上に増大せず、消費電力を低減できる
。また、このようにイコライズ回路を流れる電流が一定
値以下に抑えられているので、特シー、記録アンプを回
転ドラムに搭載させる場合には、発熱による影響が低域
できる。Further, according to the present invention, since the current flowing through the equalization circuit is clipped at high frequencies, the amplitude does not increase beyond a certain value, and power consumption can be reduced. In addition, since the current flowing through the equalization circuit is suppressed to a certain value or less in this way, when a recording amplifier is mounted on a rotating drum, the effects of heat generation can be suppressed in low frequencies.
第1図はこの発明の一実施例の接続図、第2図はこの発
明の他の実施例の接続図、第3図はこの発明の更に他の
実施例の接読図、第4図はこの発明の実施例におけるイ
コライズ回路の一例の接続図、第5図はこの発明の実施
例におけるイコライズ回路の一例の説明に用いる波形図
、第6図はこの発明の実施例におけるイコライズ回路の
説明に用いる周波数特性図、第7図は従来のディジクル
信号記録回路の一例の接続図、第8図は従来のディジク
ル信号記録回路の他の例のブロック図、第9図は従来の
ディジタル信号記録回路の更に他の例のブロック図、第
10図は従来のディジタル信号記録回路の更に他の例に
おけるピーキング回路の一例の接続図、第11図は従来
のディジタル信号記録回路の更に他の例におけるピーキ
ング回路の一例の周波数特性図、第12図及び第13図
はこの発明の効果を示す波形図である。
図面における主要な符号の説明
1.2,21.22=トランジスタ、
5.23,24:抵抗、 6.26:コンデンサ、3.
4,23.25:電流源、 28,41:入力端子、
35:磁気ヘッド。
代理人 弁理士 杉 浦 正 知
第4図 第5図 ゛
$1 イ1114−ノt;l−1
イカ、aq岬t、)i
嫉幅竹・1・先
第11図A
イカ]11」特、l−1
第11図B
JY−3!i翳1・1
第11図CFig. 1 is a connection diagram of one embodiment of this invention, Fig. 2 is a connection diagram of another embodiment of this invention, Fig. 3 is a close-up diagram of still another embodiment of this invention, and Fig. 4 is a connection diagram of another embodiment of this invention. A connection diagram of an example of an equalizer circuit in an embodiment of the invention, FIG. 5 is a waveform diagram used to explain an example of an equalizer circuit in an embodiment of this invention, and FIG. 6 is a diagram used to explain an example of an equalizer circuit in an embodiment of this invention. Frequency characteristics diagram, Figure 7 is a connection diagram of an example of a conventional digital signal recording circuit, Figure 8 is a block diagram of another example of a conventional digital signal recording circuit, and Figure 9 is a further diagram of a conventional digital signal recording circuit. A block diagram of another example, FIG. 10 is a connection diagram of an example of a peaking circuit in still another example of the conventional digital signal recording circuit, and FIG. 11 is a connection diagram of an example of the peaking circuit in still another example of the conventional digital signal recording circuit. An example of frequency characteristic diagrams, FIGS. 12 and 13, are waveform diagrams showing the effects of the present invention. Explanation of main symbols in the drawings 1.2, 21.22 = transistor, 5.23, 24: resistor, 6.26: capacitor, 3.
4, 23.25: Current source, 28, 41: Input terminal,
35: Magnetic head. Agent Patent Attorney Tadashi Sugiura Fig. 4 Fig. 5 ゛$1 I1114-not;l-1 squid, aq,) , l-1 Figure 11B JY-3! i Shadow 1・1 Figure 11C
Claims (1)
成分に比して低域成分のゲインを相対的に下げるイコラ
イズ回路を介して記録ヘッドに供給するようにしたディ
ジタル信号記録装置。A digital signal recording apparatus that supplies a digital signal to be recorded to a recording head via an equalization circuit that relatively lowers the gain of low frequency components of the digital signal compared to high frequency components.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61019674A JPH07118043B2 (en) | 1986-01-31 | 1986-01-31 | Digital signal recorder |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61019674A JPH07118043B2 (en) | 1986-01-31 | 1986-01-31 | Digital signal recorder |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS62177703A true JPS62177703A (en) | 1987-08-04 |
JPH07118043B2 JPH07118043B2 (en) | 1995-12-18 |
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Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53149012A (en) * | 1977-06-01 | 1978-12-26 | Nippon Hoso Kyokai <Nhk> | Digital signal recording and reproducing system |
-
1986
- 1986-01-31 JP JP61019674A patent/JPH07118043B2/en not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS53149012A (en) * | 1977-06-01 | 1978-12-26 | Nippon Hoso Kyokai <Nhk> | Digital signal recording and reproducing system |
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