JPS62147044U - - Google Patents
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- Publication number
- JPS62147044U JPS62147044U JP3309986U JP3309986U JPS62147044U JP S62147044 U JPS62147044 U JP S62147044U JP 3309986 U JP3309986 U JP 3309986U JP 3309986 U JP3309986 U JP 3309986U JP S62147044 U JPS62147044 U JP S62147044U
- Authority
- JP
- Japan
- Prior art keywords
- optional peripheral
- section
- peripheral device
- detects
- connection
- Prior art date
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- Pending
Links
- 230000010365 information processing Effects 0.000 claims description 3
- 230000002093 peripheral effect Effects 0.000 claims 5
- 238000010586 diagram Methods 0.000 description 1
Description
第１図は本考案に係る情報処理装置のブロツク
図である。 １…ＣＰＵ、６…セレクタ回路、６ａ，６ｂ，
６ｄ…ＮＡＮＤ回路、６ｃ…インバータ、７…内
部メモリ、８…オプシヨンＣＧＲＯＭ。
図である。 １…ＣＰＵ、６…セレクタ回路、６ａ，６ｂ，
６ｄ…ＮＡＮＤ回路、６ｃ…インバータ、７…内
部メモリ、８…オプシヨンＣＧＲＯＭ。
Claims (1)
- 接続すべきオプシヨン周辺機器と同一機能を有
する内部機器部と、該内部機器部及び前記オプシ
ヨン周辺機器を制御する中央処理部とを備える情
報処理装置において、前記オプシヨン周辺機器の
接続を検知し、該オプシヨン周辺機器を前記中央
処理部側に優先的に切り換え接続するセレクタ回
路を有することを特徴とする情報処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3309986U JPS62147044U (ja) | 1986-03-06 | 1986-03-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3309986U JPS62147044U (ja) | 1986-03-06 | 1986-03-06 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62147044U true JPS62147044U (ja) | 1987-09-17 |
Family
ID=30840390
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3309986U Pending JPS62147044U (ja) | 1986-03-06 | 1986-03-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62147044U (ja) |
-
1986
- 1986-03-06 JP JP3309986U patent/JPS62147044U/ja active Pending
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