JPS62113387U - - Google Patents

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JPS62113387U
JPS62113387U JP101286U JP101286U JPS62113387U JP S62113387 U JPS62113387 U JP S62113387U JP 101286 U JP101286 U JP 101286U JP 101286 U JP101286 U JP 101286U JP S62113387 U JPS62113387 U JP S62113387U
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registered
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JP101286U
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  • Accessory Devices And Overall Control Thereof (AREA)

Description

【図面の簡単な説明】
第1図は本考案を実施したステイタス保持回路
の例を表わす図、第2図a,bはプリンタの処理
ルーチンを表わす図、第3,4図は本考案を実施
した他のステイタス保持回路の例を表わす図であ
る。 1……メモリ回路、2……フリツプ・フロツプ
回路、3……メモリ領域。

Claims (1)

    【実用新案登録請求の範囲】
  1. ホスト計算機側から外字が登録された際にダウ
    ン・ロード・ステイタスが設定され、プリンタ側
    停電発生時にパワー・フエイル・ステイタスが設
    定されるとともにこのパワー・フエイル・ステイ
    タス及び前記ダウン・ロード・ステイタスを保持
    するメモリ手段を有することを特徴とするステイ
    タス保持回路。
JP101286U 1986-01-08 1986-01-08 Pending JPS62113387U (ja)

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JP101286U JPS62113387U (ja) 1986-01-08 1986-01-08

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JP101286U JPS62113387U (ja) 1986-01-08 1986-01-08

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JPS62113387U true JPS62113387U (ja) 1987-07-18

Family

ID=30778519

Family Applications (1)

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JP101286U Pending JPS62113387U (ja) 1986-01-08 1986-01-08

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