JPS6211102Y2 - - Google Patents
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- JPS6211102Y2 JPS6211102Y2 JP1210181U JP1210181U JPS6211102Y2 JP S6211102 Y2 JPS6211102 Y2 JP S6211102Y2 JP 1210181 U JP1210181 U JP 1210181U JP 1210181 U JP1210181 U JP 1210181U JP S6211102 Y2 JPS6211102 Y2 JP S6211102Y2
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- Japan
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- horizontal
- voltage
- circuit
- negative
- power supply
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- Expired
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- Details Of Television Scanning (AREA)
Description
【考案の詳細な説明】
本案はテレビジヨン受像機の水平発振回路のバ
イアス電源の安定化に係るものである。[Detailed Description of the Invention] The present invention relates to stabilization of the bias power supply of the horizontal oscillation circuit of a television receiver.
従来のテレビジヨン受像機で、特に電池電源を
使用して動作させるものにおいては、水平発振周
波数が電源の変動によりずれることがある。すな
わち、水平発振トランジスタのベースバイアスは
電源回路より得られる+B電圧を抵抗を通して水
平AFC出力と共に加えているものである。した
がつて、電池電源の電圧低下により、電源回路の
安定化動作の制御範囲外になると、+Bが下り、
これによつて水平発振周波数は低い方へずれてし
まう。 In conventional television receivers, especially those operated using battery power, the horizontal oscillation frequency may shift due to fluctuations in the power supply. That is, the base bias of the horizontal oscillation transistor is obtained by applying the +B voltage obtained from the power supply circuit together with the horizontal AFC output through a resistor. Therefore, when the voltage of the battery power source drops and the voltage falls outside the control range of the stabilizing operation of the power supply circuit, +B decreases.
This causes the horizontal oscillation frequency to shift toward the lower side.
本案は、上述の問題を軽減するために提案され
たもので、電源回路が制御範囲外になつても、し
ばらくの間テレビジヨン受像機の動作を維持でき
るようにするものである。そのため、本案は水平
フライバツクパルスを利用して負の直流電圧を
得、この電圧と電源回路から得られる+B電圧と
から、変動の少ない安定したバイアス電圧を合成
するようにしている。本案の実施例を以下図面に
従つて説明する。 The present invention has been proposed in order to alleviate the above-mentioned problems, and allows the television receiver to continue operating for a while even if the power supply circuit goes out of control. Therefore, in the present invention, a negative DC voltage is obtained using a horizontal flyback pulse, and a stable bias voltage with little fluctuation is synthesized from this voltage and the +B voltage obtained from the power supply circuit. Embodiments of the present invention will be described below with reference to the drawings.
第1図は本案の実施例に係るテレビジヨン受像
機の水平偏向回路の部分を示すブロツク回路図で
ある。1は、同期分離回路にて複合映像信号から
分離された水平同期信号が印加される入力端子で
ある。2は水平AFC回路で、その出力は水平発
振回路3の水平発振トランジスタ31に印加され
ている。水平発振回路3の出力パルスは水平ドラ
イブおよび水平出力回路4に加えられる。水平出
力回路4の出力側には、S字補正用のコンデンサ
5と水平偏向コイル6の直列回路に偏向電流が供
給されるように接続されている。7はフライバツ
クトランスで、その1次巻線71には水平フライ
バツクパルスが加えられ、その一端にはダンパー
ダイオード8とコンデンサ9の並列回路が接続さ
れ、他端には水平出力トランジスタに供給する直
流電圧源が設けられている。トランス7の2次巻
線72はフライバツクパルスを昇圧して整流器1
0に与え、その整流出力は陰極線管の陽極に高圧
とし与えられるようになつている。回路4の出力
パルスは、また積分回路11によりのこぎり波に
変形され、水平AFC回路2に位相比較のため与
えられている。これまでの回路構成は、周知の接
続配置である。 FIG. 1 is a block circuit diagram showing a portion of a horizontal deflection circuit of a television receiver according to an embodiment of the present invention. Reference numeral 1 denotes an input terminal to which a horizontal synchronization signal separated from the composite video signal by a synchronization separation circuit is applied. 2 is a horizontal AFC circuit, the output of which is applied to a horizontal oscillation transistor 31 of a horizontal oscillation circuit 3. The output pulses of horizontal oscillation circuit 3 are applied to horizontal drive and horizontal output circuit 4. The output side of the horizontal output circuit 4 is connected to a series circuit of an S-shaped correction capacitor 5 and a horizontal deflection coil 6 so that a deflection current is supplied. 7 is a flyback transformer, to which a horizontal flyback pulse is applied to its primary winding 71, one end of which is connected to a parallel circuit of a damper diode 8 and a capacitor 9, and the other end of which is supplied to a horizontal output transistor. A DC voltage source is provided. The secondary winding 72 of the transformer 7 boosts the flyback pulse to the rectifier 1.
0, and its rectified output is applied as high voltage to the anode of the cathode ray tube. The output pulse of the circuit 4 is also transformed into a sawtooth wave by the integrating circuit 11, and is applied to the horizontal AFC circuit 2 for phase comparison. The circuit configuration so far is a well-known connection arrangement.
第1図の回路配置において、水平発振トランジ
スタ31のベースバイアス電圧としては、抵抗2
0および21を介して+B電圧が電源回路より与
えられているが、この外に次のようにして負の直
流電圧が与えられる。フライバツクトランス7の
2次巻線73より負の水平フライバツクパルスa
が取出される。このパルスaは、ダイオード2
2、コンデンサ23および抵抗24からなる周知
の接続を持つ整流平滑回路により負の直流電圧に
変換される。この負の直流電圧は、抵抗20,2
1の接続点bで正の直流電圧、すなわち+B電圧
と加算され所定の値に選ばれた正の直流電圧とな
る。この合成電圧は水平AFC回路2の出力と共
に水平発振トランジスタ31のベースへ印加され
る。 In the circuit arrangement shown in FIG. 1, the base bias voltage of the horizontal oscillation transistor 31 is set by the resistor 2
A +B voltage is applied from the power supply circuit via pins 0 and 21, and in addition to this, a negative DC voltage is applied as follows. A negative horizontal flyback pulse a from the secondary winding 73 of the flyback transformer 7
is taken out. This pulse a is transmitted through diode 2
2. It is converted into a negative DC voltage by a rectifying and smoothing circuit having a well-known connection consisting of a capacitor 23 and a resistor 24. This negative DC voltage is applied to resistors 20, 2
At connection point b of 1, the positive DC voltage is added to the +B voltage, resulting in a positive DC voltage selected to a predetermined value. This combined voltage is applied to the base of the horizontal oscillation transistor 31 together with the output of the horizontal AFC circuit 2.
ここで、もし電源回路の電圧が低下すると、そ
れに伴つてフライバツクパルスaの波高値も小さ
くなる。したがつて、整流平滑回路の負の直流電
圧の絶対値が小さくなり、合成されたバイアス電
圧は相殺することになるので一定に保たれること
になる。その結果、電源電圧の低下により発振回
路の周波数の低下を防止することが可能となる。 Here, if the voltage of the power supply circuit decreases, the peak value of the flyback pulse a also decreases accordingly. Therefore, the absolute value of the negative DC voltage of the rectifying and smoothing circuit becomes small, and the combined bias voltage is kept constant because it cancels out. As a result, it is possible to prevent the frequency of the oscillation circuit from decreasing due to a decrease in the power supply voltage.
第1図は本案の実施例に係るテレビジヨン受像
機の水平偏向回路の部分を示すブロツク回路図で
ある。
3……水平発振回路、73……フライバツクト
ランスの巻線、22〜24……整流平滑回路、2
0および21……合成回路。
FIG. 1 is a block circuit diagram showing a portion of a horizontal deflection circuit of a television receiver according to an embodiment of the present invention. 3...Horizontal oscillation circuit, 73...Winding of flyback transformer, 22-24...Rectification smoothing circuit, 2
0 and 21...Synthesis circuit.
Claims (1)
圧が水平発振トランジスタのベースバイアスとし
て印加されているテレビジヨン受像機の水平発振
回路において、負の水平フライバツクパルスを取
出すフライバツクトランスに設けられた巻線と、
この負の水平フライバツクパルスから負の直流電
圧を得る整流平滑回路と、前記正の直流電圧と負
の直流電圧とを加算して前記水平発振トランジス
タのベースバイアスとする合成回路とを設けたこ
とを特徴とする水平発振回路のバイアス電源安定
化装置。 In the horizontal oscillation circuit of a television receiver, where a positive DC voltage is applied from the power supply circuit as the base bias of the horizontal oscillation transistor along with the horizontal AFC output, the winding installed in the flyback transformer extracts the negative horizontal flyback pulse. and,
A rectifying and smoothing circuit that obtains a negative DC voltage from this negative horizontal flyback pulse, and a synthesis circuit that adds the positive DC voltage and the negative DC voltage to form a base bias of the horizontal oscillation transistor. A bias power supply stabilizing device for horizontal oscillation circuits featuring:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1210181U JPS6211102Y2 (en) | 1981-01-30 | 1981-01-30 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1210181U JPS6211102Y2 (en) | 1981-01-30 | 1981-01-30 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS57125076U JPS57125076U (en) | 1982-08-04 |
JPS6211102Y2 true JPS6211102Y2 (en) | 1987-03-16 |
Family
ID=29810219
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1210181U Expired JPS6211102Y2 (en) | 1981-01-30 | 1981-01-30 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6211102Y2 (en) |
-
1981
- 1981-01-30 JP JP1210181U patent/JPS6211102Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS57125076U (en) | 1982-08-04 |
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