JPS619930U - 電源投入検出・記憶回路 - Google Patents
電源投入検出・記憶回路Info
- Publication number
- JPS619930U JPS619930U JP9360584U JP9360584U JPS619930U JP S619930 U JPS619930 U JP S619930U JP 9360584 U JP9360584 U JP 9360584U JP 9360584 U JP9360584 U JP 9360584U JP S619930 U JPS619930 U JP S619930U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- power
- detection
- reset
- memory circuit
- Prior art date
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- Pending
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図乃至第３図はそれそれ本考案の実施例を示す回路
図である。 １０・・・・・・双安定回路、２０・・・・・・コンデ
ンサ、３０・・・・・・抵抗素子、４０・・・・・・ゲ
ート、５０・・・・・・コンデンサ、６０・・・・・・
抵抗素子、７０・・・・・・インバータ。
図である。 １０・・・・・・双安定回路、２０・・・・・・コンデ
ンサ、３０・・・・・・抵抗素子、４０・・・・・・ゲ
ート、５０・・・・・・コンデンサ、６０・・・・・・
抵抗素子、７０・・・・・・インバータ。
Claims (1)
- セット及びリセット状態を設定記憶できる双安定回路と
、電源ラインと基準電位ラインとの間に接続され、かつ
電源ライン側にコンデンサの接続された前記コンデンサ
と抵抗素子とを含む直列回路と、該直列回路の中間接続
点を前記双安定回路のセット信号入力端に接続する手段
と、出力が前記双安定回路のリセット信号入力端に接続
され、リセット信号およびリセット禁止信号を入力側に
受けるゲート回路とを含むことを特徴とする電源投入検
出・記憶回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9360584U JPS619930U (ja) | 1984-06-22 | 1984-06-22 | 電源投入検出・記憶回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9360584U JPS619930U (ja) | 1984-06-22 | 1984-06-22 | 電源投入検出・記憶回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS619930U true JPS619930U (ja) | 1986-01-21 |
Family
ID=30651435
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9360584U Pending JPS619930U (ja) | 1984-06-22 | 1984-06-22 | 電源投入検出・記憶回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS619930U (ja) |
-
1984
- 1984-06-22 JP JP9360584U patent/JPS619930U/ja active Pending
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