JPS6165547U - - Google Patents
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- Publication number
- JPS6165547U JPS6165547U JP14689184U JP14689184U JPS6165547U JP S6165547 U JPS6165547 U JP S6165547U JP 14689184 U JP14689184 U JP 14689184U JP 14689184 U JP14689184 U JP 14689184U JP S6165547 U JPS6165547 U JP S6165547U
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- JP
- Japan
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- microprogram
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- Pending
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- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Description
図は本考案にかかる制御装置の一実施例の構成
ブロツク図である。 ５０……制御メモリ、５１……エラー認識用領
域、５２……エラーコードセツト用領域、７０…
…エラーレジスタ、８０……表示手段、９０……
プロセツサ。
ブロツク図である。 ５０……制御メモリ、５１……エラー認識用領
域、５２……エラーコードセツト用領域、７０…
…エラーレジスタ、８０……表示手段、９０……
プロセツサ。
Claims (1)
- 【実用新案登録請求の範囲】 マイクロプログラムによる制御を行なうととも
に、エラー表示機能を有する制御装置において、 エラーの種類を示すエラーコードがセツトされ
るエラーレジスタと、 マイクロプログラムが格納されていて、前記エ
ラーコードが格納されるエラー認識用領域と、エ
ラーコードを前記エラーレジスタにセツトするた
めの情報が格納されているエラーコードセツト用
領域がマイクロプログラムフイールド上に設けら
れている制御メモリと、 前記エラーレジスタに直接接続されていて、エ
ラーレジスタの内容が格納されたマイクロブログ
ラムフイールドをプロセツサの処理が通過したと
きに、エラーレジスタの内容を表示する表示手段
とを具備したことを特徴とする制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14689184U JPS6165547U (ja) | 1984-09-28 | 1984-09-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14689184U JPS6165547U (ja) | 1984-09-28 | 1984-09-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6165547U true JPS6165547U (ja) | 1986-05-06 |
Family
ID=30705128
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14689184U Pending JPS6165547U (ja) | 1984-09-28 | 1984-09-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6165547U (ja) |
-
1984
- 1984-09-28 JP JP14689184U patent/JPS6165547U/ja active Pending