JPS6147532U - 雑音信号抑圧回路 - Google Patents
雑音信号抑圧回路Info
- Publication number
- JPS6147532U JPS6147532U JP13220884U JP13220884U JPS6147532U JP S6147532 U JPS6147532 U JP S6147532U JP 13220884 U JP13220884 U JP 13220884U JP 13220884 U JP13220884 U JP 13220884U JP S6147532 U JPS6147532 U JP S6147532U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- amplifier circuit
- load resistor
- level
- Prior art date
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- Pending
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Landscapes
- Noise Elimination (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の雑音信号抑圧回路の一実施例、第２図
は信号波形図である。 主な図番の説明、２・・・第１増幅回路、３・・・第２
増幅回路、４・・・波形整形回路、６・・・レベル検串
回路、８・・・第１負荷抵抗、９・・・出力信号路、１
０・・・制御トランジスター、１２・・・第２負荷抵抗
。
は信号波形図である。 主な図番の説明、２・・・第１増幅回路、３・・・第２
増幅回路、４・・・波形整形回路、６・・・レベル検串
回路、８・・・第１負荷抵抗、９・・・出力信号路、１
０・・・制御トランジスター、１２・・・第２負荷抵抗
。
Claims (1)
- 第１増幅回路及び第２増幅回路によって増幅された信号
が入力されると共に該信号を方形波に変換する波形整形
回路と、前記第１増幅回路の出力信号路と接地間に接続
されている第１負荷抵抗と、前記第２増幅回路より出力
される信号のレベルを検出するレベル検出回路と、前記
第２増幅回路より出力される信号のレベルが所定レベル
以下にあるとき前記レベル検出回路の出力信号によって
導通状態になる制御トランジズタニと、該制御トランジ
スターが導通状態にあるとき前記第１負荷抵抗に並列に
接続される第２負荷抵抗とより成り、前記第１負荷抵抗
の抵抗値に比較して第２負荷抵抗の抵抗値を充分小にし
たことを特徴とする雑音信号抑圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13220884U JPS6147532U (ja) | 1984-08-30 | 1984-08-30 | 雑音信号抑圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13220884U JPS6147532U (ja) | 1984-08-30 | 1984-08-30 | 雑音信号抑圧回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6147532U true JPS6147532U (ja) | 1986-03-29 |
Family
ID=30690772
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13220884U Pending JPS6147532U (ja) | 1984-08-30 | 1984-08-30 | 雑音信号抑圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6147532U (ja) |
-
1984
- 1984-08-30 JP JP13220884U patent/JPS6147532U/ja active Pending
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